JPS60192023U - マイクロコンピユ−タのリセツト回路 - Google Patents
マイクロコンピユ−タのリセツト回路Info
- Publication number
- JPS60192023U JPS60192023U JP7909884U JP7909884U JPS60192023U JP S60192023 U JPS60192023 U JP S60192023U JP 7909884 U JP7909884 U JP 7909884U JP 7909884 U JP7909884 U JP 7909884U JP S60192023 U JPS60192023 U JP S60192023U
- Authority
- JP
- Japan
- Prior art keywords
- resistor
- microcomputer
- reset circuit
- circuit
- reset
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000003990 capacitor Substances 0.000 claims description 4
- 238000007493 shaping process Methods 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 6
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は従来のリセット回路図、第２図は第１図の回路
のタイムチャート、第３図は本考案のリセット回路を含
むマイクロコンピュータの構成図、第４図は本考案のリ
セット回路図、第５図は第４図の回路のタイムチャート
を示す。 １５はリセット回路、２１．２３は抵抗、２２はダイオ
ード、２４はコンデンサである。 補正 昭５９．１０．９ 考案の名称を次のように補正する。 ■考案の名称 マイクロコンピュータのリセット回
路 実用新案登録請求の範囲、図面の簡単な説明を次のよう
に補正する。 Ｏ実用新案登録請求の範囲 １ 電源の両端子間に、第１の抵抗と上記電源電位に順
方向のダイオードと第２の抵抗とからなる直列回路を接
続し、かつ上記第２の抵抗にコンデンサを並列接続し、
上記ダイオードと第２の抵抗の接続点をマイクロコンピ
ュータのリセット端子に接続してなる巳とを特徴とする
マイクロコンピュータのリセット回路。 ２ 上記接続点と上記リセット端子との間に波形整形回
路を挿入してな−ることを特徴とする第１項記載のマイ
クロコンピュータのリセット回路。 ３ 上記第２の抵抗の抵抗値を第１の抵抗より小さく設
定したことを特徴とする第１項記載のマ、イクロコンピ
ュータのりモット回路。 図面の簡単な説明 第１図は従来のリセット回路図、第２図は第１図の回路
タイムチャート、第３図は本考案のリセット回路を含む
マイクロコンピュータの構成図、第４図は本考案のリセ
ット回路図、第５図は第４ −図の回路のタイムチ
ャートを示す。 １′５はリセット回路、２１．２３は抵抗、２２はダイ
オード、２４はコンデンサである。
のタイムチャート、第３図は本考案のリセット回路を含
むマイクロコンピュータの構成図、第４図は本考案のリ
セット回路図、第５図は第４図の回路のタイムチャート
を示す。 １５はリセット回路、２１．２３は抵抗、２２はダイオ
ード、２４はコンデンサである。 補正 昭５９．１０．９ 考案の名称を次のように補正する。 ■考案の名称 マイクロコンピュータのリセット回
路 実用新案登録請求の範囲、図面の簡単な説明を次のよう
に補正する。 Ｏ実用新案登録請求の範囲 １ 電源の両端子間に、第１の抵抗と上記電源電位に順
方向のダイオードと第２の抵抗とからなる直列回路を接
続し、かつ上記第２の抵抗にコンデンサを並列接続し、
上記ダイオードと第２の抵抗の接続点をマイクロコンピ
ュータのリセット端子に接続してなる巳とを特徴とする
マイクロコンピュータのリセット回路。 ２ 上記接続点と上記リセット端子との間に波形整形回
路を挿入してな−ることを特徴とする第１項記載のマイ
クロコンピュータのリセット回路。 ３ 上記第２の抵抗の抵抗値を第１の抵抗より小さく設
定したことを特徴とする第１項記載のマ、イクロコンピ
ュータのりモット回路。 図面の簡単な説明 第１図は従来のリセット回路図、第２図は第１図の回路
タイムチャート、第３図は本考案のリセット回路を含む
マイクロコンピュータの構成図、第４図は本考案のリセ
ット回路図、第５図は第４ −図の回路のタイムチ
ャートを示す。 １′５はリセット回路、２１．２３は抵抗、２２はダイ
オード、２４はコンデンサである。
Claims (1)
- 【実用新案登録請求の範囲】 １ 電源の両端子間に、第１の抵抗と上記電源電位に順
方向のダイオードと第２の抵抗とからなる直列回路を接
続し、かつ上記第２の抵抗にコンデンサを並列接続し、
上記ダイオードと第２の抵抗の接続点をマイクロコンピ
ュータのリセット端子に接続してなることを特徴とする
マイクロコンピュータのリセット回路。 ２ 上記接続点と上記リセット端子との間に波形整形回
路を挿入してなることを特徴とする第１項記載のマイク
ロコンピュータのリセット回３ 上記第２の抵抗の抵抗
値を第１の抵抗より小さく設定したことを特徴とする第
１項記載のマイクロコンピュータのリセット回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7909884U JPS60192023U (ja) | 1984-05-28 | 1984-05-28 | マイクロコンピユ−タのリセツト回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7909884U JPS60192023U (ja) | 1984-05-28 | 1984-05-28 | マイクロコンピユ−タのリセツト回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60192023U true JPS60192023U (ja) | 1985-12-20 |
Family
ID=30623688
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7909884U Pending JPS60192023U (ja) | 1984-05-28 | 1984-05-28 | マイクロコンピユ−タのリセツト回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60192023U (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5896324A (ja) * | 1981-12-02 | 1983-06-08 | Nakayo Tsushinki:Kk | マイクロプロセツサｃｐｕのリセツト方式 |
-
1984
- 1984-05-28 JP JP7909884U patent/JPS60192023U/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5896324A (ja) * | 1981-12-02 | 1983-06-08 | Nakayo Tsushinki:Kk | マイクロプロセツサｃｐｕのリセツト方式 |
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