JPS60249873A - 整流回路 - Google Patents
整流回路Info
- Publication number
- JPS60249873A JPS60249873A JP10518484A JP10518484A JPS60249873A JP S60249873 A JPS60249873 A JP S60249873A JP 10518484 A JP10518484 A JP 10518484A JP 10518484 A JP10518484 A JP 10518484A JP S60249873 A JPS60249873 A JP S60249873A
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- JP
- Japan
- Prior art keywords
- thyristor
- secondary winding
- voltage
- transistor
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000004804 winding Methods 0.000 claims abstract description 37
- 239000003990 capacitor Substances 0.000 claims description 7
- 238000009499 grossing Methods 0.000 claims description 6
- 238000002955 isolation Methods 0.000 claims description 6
- 238000010304 firing Methods 0.000 abstract description 2
- 238000010586 diagram Methods 0.000 description 9
- 241000272814 Anser sp. Species 0.000 description 1
- 230000006378 damage Effects 0.000 description 1
- 230000004907 flux Effects 0.000 description 1
- 238000010438 heat treatment Methods 0.000 description 1
- 238000009413 insulation Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M7/00—Conversion of AC power input into DC power output; Conversion of DC power input into AC power output
- H02M7/02—Conversion of AC power input into DC power output without possibility of reversal
- H02M7/04—Conversion of AC power input into DC power output without possibility of reversal by static converters
- H02M7/12—Conversion of AC power input into DC power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
- H02M7/145—Conversion of AC power input into DC power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a thyratron or thyristor type requiring extinguishing means
- H02M7/155—Conversion of AC power input into DC power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a thyratron or thyristor type requiring extinguishing means using semiconductor devices only
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は整流回路に関する。
（従来の技術）
従来、通常の電源の整流回路は、ダイオードを使用した
コンデンサ入力型のものが多用されているＯ 第１図は従来のコンデンサ入力型ｙｉ流回路の一例の回
路図である。
コンデンサ入力型のものが多用されているＯ 第１図は従来のコンデンサ入力型ｙｉ流回路の一例の回
路図である。
絶縁変圧器Ｔの二次巻線Ｎｐにパルス発生駆動回路ｌを
接続し、パルスを印加する。二次巻線ｎ鵞。
接続し、パルスを印加する。二次巻線ｎ鵞。
ｎ３にそれぞれダイオードＤ１．Ｄ２．コンデンサＣＩ
ｅ Ｃ鵞＋抵抗Ｒ，、Ｒ，を図のように接続すると、
抵抗Ｒ１，、Ｒ，の両端にそれぞれｅｌｓｅ！の電圧が
現われる。
ｅ Ｃ鵞＋抵抗Ｒ，、Ｒ，を図のように接続すると、
抵抗Ｒ１，、Ｒ，の両端にそれぞれｅｌｓｅ！の電圧が
現われる。
第２図は第１図に示す整流回路の出力の電圧−電流特性
の一例の特性曲線図である。
の一例の特性曲線図である。
二次巻線ｎ２に流れる電流の定格値をｉｌとする。電流
を定格値ｉＩよシ下げて行き、約０．１ｊｌよシ低くし
て行くと、出力電圧は定格出力電圧ｅ１よりかなυ高く
上昇し、極端な場合は、その出力に接続された負荷の耐
圧をオーバーし、破壊に到らしめる危険がある。また特
に、多出力巻線を有する変圧器を使用したスイッチング
電源の場合に、論理回路のために使用される出力回路の
電圧を安定にするような回路方式を採った場合、それ以
外の出力回路の電圧は論理回路用出力回路の負荷′電流
が定格電流の場合は他の出力回路が無負荷になると定格
電圧の２倍以上の電圧が発生する場合がおる。
を定格値ｉＩよシ下げて行き、約０．１ｊｌよシ低くし
て行くと、出力電圧は定格出力電圧ｅ１よりかなυ高く
上昇し、極端な場合は、その出力に接続された負荷の耐
圧をオーバーし、破壊に到らしめる危険がある。また特
に、多出力巻線を有する変圧器を使用したスイッチング
電源の場合に、論理回路のために使用される出力回路の
電圧を安定にするような回路方式を採った場合、それ以
外の出力回路の電圧は論理回路用出力回路の負荷′電流
が定格電流の場合は他の出力回路が無負荷になると定格
電圧の２倍以上の電圧が発生する場合がおる。
通常、高電圧の発生を防止するため、その出力回路に対
して定格の１０１位の電流を常時流すような抵抗を接続
するが、これは電源の効率を低下させるばかりではなく
、発熱処理、実装等に対して多大の費用を費やさなけれ
ばならないという欠点がある。
して定格の１０１位の電流を常時流すような抵抗を接続
するが、これは電源の効率を低下させるばかりではなく
、発熱処理、実装等に対して多大の費用を費やさなけれ
ばならないという欠点がある。
（発明の目的）
本発明の目的は、上記欠点を除去し、整流ダイオードと
してサイリスタを使用し、サイリスタの点弧を制御する
ことによシ、出力回路が無負荷になった時の高電圧の発
生を防止すると共に無駄な熱の発生を無くし、効率の向
上を計れるようにした整流回路を提供することにある。
してサイリスタを使用し、サイリスタの点弧を制御する
ことによシ、出力回路が無負荷になった時の高電圧の発
生を防止すると共に無駄な熱の発生を無くし、効率の向
上を計れるようにした整流回路を提供することにある。
（発明の構成）
本発明の饅流回路は、−次巻線が電源に接続する絶縁変
圧器と、該絶縁変圧器の二次巻線の一方の端にアノード
が接続するサイリスタと、前記二次巻線の他方の端と前
記サイリスタのカソードとの間に接続する平滑用コンデ
ンサと、前記サイリスタのカソードに一端が接続する負
荷と、該負荷の他端と前記二次巻線の他端との間にコレ
クタとエミッタが接続するトランジスタと、該トランジ
スタのベースと前記サイリスタのゲートに接続し該トラ
ンジスタを非導通にして前記二次巻線に電流を館、さな
い状態にするときは前記サイリスタも非導通にする制御
回路とを含んで構成される。
圧器と、該絶縁変圧器の二次巻線の一方の端にアノード
が接続するサイリスタと、前記二次巻線の他方の端と前
記サイリスタのカソードとの間に接続する平滑用コンデ
ンサと、前記サイリスタのカソードに一端が接続する負
荷と、該負荷の他端と前記二次巻線の他端との間にコレ
クタとエミッタが接続するトランジスタと、該トランジ
スタのベースと前記サイリスタのゲートに接続し該トラ
ンジスタを非導通にして前記二次巻線に電流を館、さな
い状態にするときは前記サイリスタも非導通にする制御
回路とを含んで構成される。
（実施例）
次に、本発明の実施例について図面を用いて説明する。
第３図は本発明の第１の実施例の回路図である。
この実施例は、−次巻線Ｎｐが電源としてのパルス発生
駆動回路１に接続する絶縁変圧器Ｔと、この絶縁変圧器
Ｔの二次巻線ｎｆｉの一方の端にアノードが接続するサ
イリスタ３と、二次巻１１３ ｎ ｔの他方の端とサイ
リスタ３０カソードとの間に接続する平滑用コンデンサ
Ｃ１と、サイリスタ３のカソードに一端が接続する負荷
４−１．・・・・・・４−ｎと、この負荷の他端と二次
巻線ｎ２の他端との間にコレクタとエミッタが接続する
トランジスタ５−１．・・・・・・５−ｎと、このトラ
ンジスタのベースとサイリスタ３のゲートに接続し、ト
ランジスタ５−１．・・・・・・５−ｎのすべてを非導
通にして二次巻線ｎｌに電ｍｋＲさない状態にするとき
は前記サイリスタ３も非導通にする制御回路６とを含ん
で構成される。
駆動回路１に接続する絶縁変圧器Ｔと、この絶縁変圧器
Ｔの二次巻線ｎｆｉの一方の端にアノードが接続するサ
イリスタ３と、二次巻１１３ ｎ ｔの他方の端とサイ
リスタ３０カソードとの間に接続する平滑用コンデンサ
Ｃ１と、サイリスタ３のカソードに一端が接続する負荷
４−１．・・・・・・４−ｎと、この負荷の他端と二次
巻線ｎ２の他端との間にコレクタとエミッタが接続する
トランジスタ５−１．・・・・・・５−ｎと、このトラ
ンジスタのベースとサイリスタ３のゲートに接続し、ト
ランジスタ５−１．・・・・・・５−ｎのすべてを非導
通にして二次巻線ｎｌに電ｍｋＲさない状態にするとき
は前記サイリスタ３も非導通にする制御回路６とを含ん
で構成される。
更に詳しく説明すると、絶縁変圧器Ｔの二次巻線”Ｉ＋
”！＋”ｌが巻かれて、二次巻線ｎ、には後述のサイリ
スタ導通の制御に使用されるトランジスタ２が接続され
、二次巻線ｎ３には整流平滑回路７と負荷８とが接続さ
れる。
”！＋”ｌが巻かれて、二次巻線ｎ、には後述のサイリ
スタ導通の制御に使用されるトランジスタ２が接続され
、二次巻線ｎ３には整流平滑回路７と負荷８とが接続さ
れる。
一次巻線ＮｐＫけ常時パルス発生駆動回路１によシ一定
のパルスが印加されており、二次巻線ｎ１〜ｎ３には一
次巻線Ｎｐとの巻数比に応じた電圧が発生している。二
次巻線ｎ３の整流平滑回路７には常時一定の電流が流れ
ている。それに対し二次巻線ｎ２の回路の負荷４−１〜
４−ｎはその各々に接続されたトランジスタ５−１〜５
−ｎに制御されるので大きく変動する。
のパルスが印加されており、二次巻線ｎ１〜ｎ３には一
次巻線Ｎｐとの巻数比に応じた電圧が発生している。二
次巻線ｎ３の整流平滑回路７には常時一定の電流が流れ
ている。それに対し二次巻線ｎ２の回路の負荷４−１〜
４−ｎはその各々に接続されたトランジスタ５−１〜５
−ｎに制御されるので大きく変動する。
今、制御回路６がトランジスタ５−１〜５−ｎの内いく
つかを導通するように動作すると同時にトランジスタ２
に対してもそれを導通させるように制御回路６に接続さ
れたトランジスタ２のベースに電圧を加える。それによ
ｐトランジスタ２が導通するので二次巻線ｎ１に発生し
ている電圧がサイリスタ３のゲートに印加され、サイリ
スタ３が導通し、二次巻Ｈｎ２の電圧が各負荷に供給さ
れる。トランジスタ５−１〜５−ｎが全てオフの場合、
すなわち二次巻線ｎ２の出力が無負荷の場合は、トラン
ジスタ２０ベースに対する電圧の印加も停止されるので
、トランジスタ２は非導通となり、サイリスタ３のゲー
トに対するパルス電圧の供給が断たれ、サイリスタ３も
同時に非導通になシ、二次巻線ｎｔの発生電圧は負荷に
は供給されないので必然的に高電圧は発生しない。
つかを導通するように動作すると同時にトランジスタ２
に対してもそれを導通させるように制御回路６に接続さ
れたトランジスタ２のベースに電圧を加える。それによ
ｐトランジスタ２が導通するので二次巻線ｎ１に発生し
ている電圧がサイリスタ３のゲートに印加され、サイリ
スタ３が導通し、二次巻Ｈｎ２の電圧が各負荷に供給さ
れる。トランジスタ５−１〜５−ｎが全てオフの場合、
すなわち二次巻線ｎ２の出力が無負荷の場合は、トラン
ジスタ２０ベースに対する電圧の印加も停止されるので
、トランジスタ２は非導通となり、サイリスタ３のゲー
トに対するパルス電圧の供給が断たれ、サイリスタ３も
同時に非導通になシ、二次巻線ｎｔの発生電圧は負荷に
は供給されないので必然的に高電圧は発生しない。
第４図は本発明の第２の実施例の回路図である。
この第２の実施例は、第１の実施例における二次巻ｍｎ
ｓ とトランジスタ２の代シにパルス変圧器９を接続し
、サイリスタ３のゲートに対するパルス電圧の供給を制
御回路６より行うようにしたものである。動作は第１の
実施例と同様である。
ｓ とトランジスタ２の代シにパルス変圧器９を接続し
、サイリスタ３のゲートに対するパルス電圧の供給を制
御回路６より行うようにしたものである。動作は第１の
実施例と同様である。
（発明の効果）
本発明は以上説明したように、整流ダイオードにサイリ
スタを使用し、無負荷期間中はサイリスタをオフするこ
とにより、負荷に対する過大な電圧の印加を防止する効
果がおる。
スタを使用し、無負荷期間中はサイリスタをオフするこ
とにより、負荷に対する過大な電圧の印加を防止する効
果がおる。
第１図は従来の整流回路の一例の回路図、第２図は第１
図に示す整流回路の出力の電圧−電流特性の一例の特性
曲線図、第３図は本発明の第１の実施例の回路図、第４
図は本発明の第２の実施例の回路図である。 ｌ・・・・・・パルス発生駆動回路、２・・・・・・ト
ランジスタ、３・・・・・・サイリスタ、４−１〜４−
ｎ・・・・・・負荷、５−１〜５−ｎ・・・・・・トラ
ンジスタ、６・・・・・・制御回路、７・・・・・・整
流平滑回路、８・・・・・・負荷、９・・・・・・パル
ス変圧器、Ｃ１，ＣＩ・・・・・・コンデンサ、Ｄｌ、
Ｄ鵞・・・・・・ダイオード、”Ｉ＋”ｌ＋”ｌ・・・
・・・二次巻線、Ｎｐ・・・・・・−次巻線、” Ｉ
＊ ” 鵞・・・・・・抵抗、Ｔ・・・・・・絶縁変圧
器。 某１図 茅 ２ 図 蓼 ４ 図
図に示す整流回路の出力の電圧−電流特性の一例の特性
曲線図、第３図は本発明の第１の実施例の回路図、第４
図は本発明の第２の実施例の回路図である。 ｌ・・・・・・パルス発生駆動回路、２・・・・・・ト
ランジスタ、３・・・・・・サイリスタ、４−１〜４−
ｎ・・・・・・負荷、５−１〜５−ｎ・・・・・・トラ
ンジスタ、６・・・・・・制御回路、７・・・・・・整
流平滑回路、８・・・・・・負荷、９・・・・・・パル
ス変圧器、Ｃ１，ＣＩ・・・・・・コンデンサ、Ｄｌ、
Ｄ鵞・・・・・・ダイオード、”Ｉ＋”ｌ＋”ｌ・・・
・・・二次巻線、Ｎｐ・・・・・・−次巻線、” Ｉ
＊ ” 鵞・・・・・・抵抗、Ｔ・・・・・・絶縁変圧
器。 某１図 茅 ２ 図 蓼 ４ 図
Claims (1)
- 一次巻線が電源に接続する絶縁変圧器と、該絶縁変圧器
の二次巻線の一方の端にアノードが接続するサイリスタ
と、前記二次巻線の他方の端と前記サイリスタのカソー
ドとの間に接続する平滑用コンデンサと、前記サイリス
タのカソードに一端が接続する負荷の他端と前記二次巻
線の他端との間にコレクタとエミッタが接続するトラン
ジスタと、該トランジスタのペースと前記サイリスタの
ゲートに接続し、該トランジスタを非導通にして前記二
次巻線に電流を流さない状態にするときは前記サイリス
タも非導通にする制御回路とを含むことを特徴とする整
流回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10518484A JPS60249873A (ja) | 1984-05-24 | 1984-05-24 | 整流回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10518484A JPS60249873A (ja) | 1984-05-24 | 1984-05-24 | 整流回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60249873A true JPS60249873A (ja) | 1985-12-10 |
Family
ID=14400588
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10518484A Pending JPS60249873A (ja) | 1984-05-24 | 1984-05-24 | 整流回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60249873A (ja) |
-
1984
- 1984-05-24 JP JP10518484A patent/JPS60249873A/ja active Pending
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