JPS602687B2 - Ｃｒｔ表示装置 - Google Patents
Ｃｒｔ表示装置Info
- Publication number
- JPS602687B2 JPS602687B2 JP55014810A JP1481080A JPS602687B2 JP S602687 B2 JPS602687 B2 JP S602687B2 JP 55014810 A JP55014810 A JP 55014810A JP 1481080 A JP1481080 A JP 1481080A JP S602687 B2 JPS602687 B2 JP S602687B2
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- JP
- Japan
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- light
- correction
- character
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- Expired
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Classifications
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/01—Input arrangements or combined input and output arrangements for interaction between user and computer
- G06F3/03—Arrangements for converting the position or the displacement of a member into a coded form
- G06F3/033—Pointing devices displaced or positioned by the user, e.g. mice, trackballs, pens or joysticks; Accessories therefor
- G06F3/038—Control and interface arrangements therefor, e.g. drivers or device-embedded control circuitry
- G06F3/0383—Signal control means within the pointing device
Landscapes
- Engineering & Computer Science (AREA)
- General Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Human Computer Interaction (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Position Input By Displaying (AREA)
- Digital Computer Display Output (AREA)
Description
【発明の詳細な説明】
本発明は情報処理袋贋に於ける周辺装置或いは端末装置
として使用されるＣＲＴ表示装直に関するものである。
として使用されるＣＲＴ表示装直に関するものである。
従来、この種のＣＲＴ表示装贋は第１図に示すようなブ
ロックで構成されていた。ラインアドレスレジスタ１は
上位装鷹からのラインアドレス指定情報を格納するもの
、キヤラクタアドレスレジスタ２は上位装置からのキヤ
ラクタアドレス指定情報を格納するもの、命令レジスタ
３は上位装置（図示せず）からの命令を格納するもので
ある。
ロックで構成されていた。ラインアドレスレジスタ１は
上位装鷹からのラインアドレス指定情報を格納するもの
、キヤラクタアドレスレジスタ２は上位装置からのキヤ
ラクタアドレス指定情報を格納するもの、命令レジスタ
３は上位装置（図示せず）からの命令を格納するもので
ある。
ラインアドレス選択部４は、再生用バッファメモリ７に
対するラインアドレス情報をラインアドレスレジスタ１
によって与えるか、リフレツシュカウンタ６によって与
えるかを選択制御するものであり、キャラクタアドレス
選択部５は再生用バッファメモリ７に対するキヤラクタ
アドレス情報をキヤラクタアドレスレジスタ２によって
与えるか、リフレツシュカウンタ６によって与えるかを
選択制御するものである。
対するラインアドレス情報をラインアドレスレジスタ１
によって与えるか、リフレツシュカウンタ６によって与
えるかを選択制御するものであり、キャラクタアドレス
選択部５は再生用バッファメモリ７に対するキヤラクタ
アドレス情報をキヤラクタアドレスレジスタ２によって
与えるか、リフレツシュカウンタ６によって与えるかを
選択制御するものである。
再生用バッファメモリ７は上位袋直からの表示情報を格
納するものであり、Ｍ文字／行×Ｎ行の表示性能を有す
る装置の場合には、Ｍ文字／行×Ｎ行の記憶容量が必要
であり、表示情報格納時にはラインアドレスレジスタ１
及びキヤラクタアデレスレジスタ２によってアドレスさ
れ、表示時にはリフレツシュカウンタ６によってアドレ
スされる。
納するものであり、Ｍ文字／行×Ｎ行の表示性能を有す
る装置の場合には、Ｍ文字／行×Ｎ行の記憶容量が必要
であり、表示情報格納時にはラインアドレスレジスタ１
及びキヤラクタアデレスレジスタ２によってアドレスさ
れ、表示時にはリフレツシュカウンタ６によってアドレ
スされる。
即ち、再生用バッファメモリ７に格納された表示情報は
、表示時にはリフレッシュカウンタ６によって順次アド
レスされることによって読み出され、表示信号発生部８
によって我々人間が日常使用している文字／記号表現の
形に変換され、更に並直列変換部９によって、ビット並
列信号がビット直列信号に変換されて、ビデオ増幅部１
１に送られ、表示部１３の表示スクリーン上に表示さ
れる。
、表示時にはリフレッシュカウンタ６によって順次アド
レスされることによって読み出され、表示信号発生部８
によって我々人間が日常使用している文字／記号表現の
形に変換され、更に並直列変換部９によって、ビット並
列信号がビット直列信号に変換されて、ビデオ増幅部１
１に送られ、表示部１３の表示スクリーン上に表示さ
れる。
リフレツシュカウンタ６は表示時に再生用バッファメモ
リ７のアドレス情報を提供すると共に、偏向増幅部１２
に対して同期信号（水平、垂直）を与える為に同期信号
発生部１０を制御するりングカウンタである。
リ７のアドレス情報を提供すると共に、偏向増幅部１２
に対して同期信号（水平、垂直）を与える為に同期信号
発生部１０を制御するりングカウンタである。
ライトベン１４は、表示部１３の表示スクリーン上を走
査する光信号を検出し、電気信号に変換するものであり
、ここで検出されたライトベン入力信号はライトベン入
力受信部１５で増幅される。
査する光信号を検出し、電気信号に変換するものであり
、ここで検出されたライトベン入力信号はライトベン入
力受信部１５で増幅される。
ライトベンレジス夕１６は、ライトベン検出ポジション
を格納するレジスタであり、ライトベン入力信号の立上
りでその時のＩＪフレッシュカウンタ６のライン及びキ
ャラクタアドレス出力がセットされる。
を格納するレジスタであり、ライトベン入力信号の立上
りでその時のＩＪフレッシュカウンタ６のライン及びキ
ャラクタアドレス出力がセットされる。
この時、害８込フリツプフロツプ（以下Ｆ／Ｆと略記す
る）１７が同時に“１”にセットされ、ライトベン入力
があったことを上位装置に知らせる為に割込ラインがア
クティブとなる。従って、上位装置は、ライトベンレジ
スタ１６を読み取ることによって「 ライトベンタッチ
位置を読み取ることができる。このように、従来技術に
於ては、ライトベン入力信号の立上りに於て、その時の
りフレッシュカウンタの値をライトベンタツチ位置情報
として保持する。
る）１７が同時に“１”にセットされ、ライトベン入力
があったことを上位装置に知らせる為に割込ラインがア
クティブとなる。従って、上位装置は、ライトベンレジ
スタ１６を読み取ることによって「 ライトベンタッチ
位置を読み取ることができる。このように、従来技術に
於ては、ライトベン入力信号の立上りに於て、その時の
りフレッシュカウンタの値をライトベンタツチ位置情報
として保持する。
ところが「再生用バッファメモリ７をアドレスしてから
表示部スクリーン上に光信号として表示するに至るまで
、及びその光信号をライトベン１４によりセンスして電
気信号に変換し、その電気信号によってリフレツシュカ
ウンタ６をライトベンタッチ位置情報として保持するま
でには、相当な時間を要し、従って、ライトベンレジス
タ１６にライトベンタッチ位置として格納された位置情
報は、実際のライトベンタッチ位置よりも数キャラクタ
アドレス大きな値となっており、しかも、その値は回路
上の遅延及びライトベンの検出遅延のばらつきのために
「一定とはならないという欠点があった。本発明は従来
の技術に内在する上記欠点を解消する為になされたもの
であり、従って本発明の目的は、ライトベンレジスタ、
ライトベン補正レジスタ、減算部、及び補正値セットＦ
／Ｆを具備することによって「上位装置／ソフトウェア
に於けるライトベン検出情報の補正のわずらわしさを避
けると共に、検出精度を向上できる新規なＣＲＴ表示装
置を提供することにある。
表示部スクリーン上に光信号として表示するに至るまで
、及びその光信号をライトベン１４によりセンスして電
気信号に変換し、その電気信号によってリフレツシュカ
ウンタ６をライトベンタッチ位置情報として保持するま
でには、相当な時間を要し、従って、ライトベンレジス
タ１６にライトベンタッチ位置として格納された位置情
報は、実際のライトベンタッチ位置よりも数キャラクタ
アドレス大きな値となっており、しかも、その値は回路
上の遅延及びライトベンの検出遅延のばらつきのために
「一定とはならないという欠点があった。本発明は従来
の技術に内在する上記欠点を解消する為になされたもの
であり、従って本発明の目的は、ライトベンレジスタ、
ライトベン補正レジスタ、減算部、及び補正値セットＦ
／Ｆを具備することによって「上位装置／ソフトウェア
に於けるライトベン検出情報の補正のわずらわしさを避
けると共に、検出精度を向上できる新規なＣＲＴ表示装
置を提供することにある。
本発明の上記目的は「 ライトベン入力信号によって、
ライトベンのタッチ位置を保持するライトベンレジスタ
と、該レジス外こ保持されたライトベンタッチ位置に対
する補正値を保持するライトベン補正レジスタと、補正
の為の減算部と、補正値セットフリツプフロツプとを有
するＣＲＴ表示装置「によって達成される。
ライトベンのタッチ位置を保持するライトベンレジスタ
と、該レジス外こ保持されたライトベンタッチ位置に対
する補正値を保持するライトベン補正レジスタと、補正
の為の減算部と、補正値セットフリツプフロツプとを有
するＣＲＴ表示装置「によって達成される。
実際のライトベン操作に先立ち、補正値セットフリップ
フロップをセットすることにより、補正値セット可能状
態とし、キャラクタアドレス“０”の位瞳にある文字／
記号を表示し、その文字／記号をライトベンでタッチす
ることにより、その時のりフレッシュカウンタの再生用
バッファアドレス出力を補正値としてライトベン補正レ
ジスタにセットする。
フロップをセットすることにより、補正値セット可能状
態とし、キャラクタアドレス“０”の位瞳にある文字／
記号を表示し、その文字／記号をライトベンでタッチす
ることにより、その時のりフレッシュカウンタの再生用
バッファアドレス出力を補正値としてライトベン補正レ
ジスタにセットする。
一方、実際のライトベン操作時には、補正値セット不可
能状態とし、ライトベンレジスタの格納値よりライトベ
ン補正レジスタの格納値を減算部にて減じた値をライト
ベンタツチ位置として上位装置に与える。
能状態とし、ライトベンレジスタの格納値よりライトベ
ン補正レジスタの格納値を減算部にて減じた値をライト
ベンタツチ位置として上位装置に与える。
次に本発明をその良好な一実施例について図面を参照し
て詳細に説明する。
て詳細に説明する。
第２図は本発明を用いたＣＲＴ表示装置の一実施例のブ
ロック図である。
ロック図である。
第２図に於て、実線はデータ線「破線は制御信号線を夫
々示す。命令レジスタ３は上位装置（図示せず）からの
命令を格納するものである。
々示す。命令レジスタ３は上位装置（図示せず）からの
命令を格納するものである。
ラインアドレスレジスタ１‘ま上位装置からの行指定情
報、キャラクタアドレスレジスタ２はキャラクタ指定情
報、即ちＭ文字ノ行の何番目の文字位置であるかの情報
を格納するものであり、表示情報はこの両アドレスレジ
スタによりアドレスされた再生用バッファメモリ７上の
セルに上位装置より格納される。ラインアドレス選択部
４‘ま、再生用バッファメモリ７に対するラインアドレ
ス情報をラインアドレスレジスタ１によって与えるか、
或いはリフレツシュカウンタ６によって与えるかを選択
制御するものであり、キヤラクタアドレス選択部５は再
生用バッファメモリ７に対するキャラクタアドレス情報
をキヤラクタアドレスレジスタ２によって与えるか、或
いはリフレッシュカウソタ６によって与えるかを選択制
御するものである。リフレツシュカウンタ６は、表示時
に再生用バッファメモリ７を順次読み出す為のアドレス
情報を提供すると共に、同期信号発生部１０を制御する
ことによって水平及び垂直同期信号を発生するりングカ
ウンタである。
報、キャラクタアドレスレジスタ２はキャラクタ指定情
報、即ちＭ文字ノ行の何番目の文字位置であるかの情報
を格納するものであり、表示情報はこの両アドレスレジ
スタによりアドレスされた再生用バッファメモリ７上の
セルに上位装置より格納される。ラインアドレス選択部
４‘ま、再生用バッファメモリ７に対するラインアドレ
ス情報をラインアドレスレジスタ１によって与えるか、
或いはリフレツシュカウンタ６によって与えるかを選択
制御するものであり、キヤラクタアドレス選択部５は再
生用バッファメモリ７に対するキャラクタアドレス情報
をキヤラクタアドレスレジスタ２によって与えるか、或
いはリフレッシュカウソタ６によって与えるかを選択制
御するものである。リフレツシュカウンタ６は、表示時
に再生用バッファメモリ７を順次読み出す為のアドレス
情報を提供すると共に、同期信号発生部１０を制御する
ことによって水平及び垂直同期信号を発生するりングカ
ウンタである。
再生用バッファメモリ７に格納された表示情報は、表示
時に、リフレッシュカウンタ６によって順次読み出され
、表示信号発生部８に於て文字／記号パターンに変換さ
れ、更に並直芥腰鑑換部９に於てビット並列信号がビッ
ト直列信号に変換され、ビデオ増幅部１１に送られて表
示部１３の表示スクリーン上に表示される。
時に、リフレッシュカウンタ６によって順次読み出され
、表示信号発生部８に於て文字／記号パターンに変換さ
れ、更に並直芥腰鑑換部９に於てビット並列信号がビッ
ト直列信号に変換され、ビデオ増幅部１１に送られて表
示部１３の表示スクリーン上に表示される。
ライトベン１４は、表示部１３の表示スクリーン上を走
査する光信号を検出し、電気信号に変換するものであり
、ここで検出されたライトベン入力信号は、微小電圧で
あり、ライトベン信号受信部１５に於て増幅される。
査する光信号を検出し、電気信号に変換するものであり
、ここで検出されたライトベン入力信号は、微小電圧で
あり、ライトベン信号受信部１５に於て増幅される。
Ｚライトベンレジスタ１６は、ラ
イトベン検出位置情報を格納するレジスタであり、ライ
トベン入力信号の立上りでその時のＩＪフレッシュカウ
ンタ６のライン及びキヤラクタアドレス出力が格納され
る。ライトベン補正レジスタ１８は、ライトベンレジス
タ１６のライトベン検出位置情報に対する補正値を格納
するレジスタであり、補正値セットＦ／Ｆ２０が補正値
セット可能状態にセットされている時に、ライトベン入
力信号の立上りでその時のＩＪフレッシュカウンタ６の
ライン及びキャラクタアドレス出力が格納される。
イトベン検出位置情報を格納するレジスタであり、ライ
トベン入力信号の立上りでその時のＩＪフレッシュカウ
ンタ６のライン及びキヤラクタアドレス出力が格納され
る。ライトベン補正レジスタ１８は、ライトベンレジス
タ１６のライトベン検出位置情報に対する補正値を格納
するレジスタであり、補正値セットＦ／Ｆ２０が補正値
セット可能状態にセットされている時に、ライトベン入
力信号の立上りでその時のＩＪフレッシュカウンタ６の
ライン及びキャラクタアドレス出力が格納される。
減算部１９は、ライトベンレジスタ１６の格納値よりラ
イトベン補正レジスタ１８の格納値を減じることによっ
て、ライトベン検出位置情報の補正を実行し、上位装置
の講取り命令時にライトベン検出位置情報を上位装置に
提供する。
イトベン補正レジスタ１８の格納値を減じることによっ
て、ライトベン検出位置情報の補正を実行し、上位装置
の講取り命令時にライトベン検出位置情報を上位装置に
提供する。
割込Ｆ／Ｆ１７は、ライトベン入力信号の立上り時にセ
ットされ、ライトベン入力があったことを上位装置に報
告する。
ットされ、ライトベン入力があったことを上位装置に報
告する。
従って、本Ｆ／Ｆはライトベン検出位置情報が上位装置
により読み取られた時にリセットされる。第３図はライ
トベンレジスタ１６・ライトベン補正レジスタ１８、減
算部１９及び補正値セットＦ／Ｆの詳細なブロック構成
図であり、図示の如く、ライトベンレジスタ１６はライ
ンポジションレジスタ１６ａとキヤラクタポジシヨンレ
ジスタ１６ｂにより、ライトベン補正レジスタ１８はラ
インポジション補正レジスタ１８ａとキャラクタポジシ
ョン補正レジスタ１８ｂにより、減算部１８はライン減
算部１９ａとキャラクタ減算部１９ｂにより夫々構成さ
れる。
により読み取られた時にリセットされる。第３図はライ
トベンレジスタ１６・ライトベン補正レジスタ１８、減
算部１９及び補正値セットＦ／Ｆの詳細なブロック構成
図であり、図示の如く、ライトベンレジスタ１６はライ
ンポジションレジスタ１６ａとキヤラクタポジシヨンレ
ジスタ１６ｂにより、ライトベン補正レジスタ１８はラ
インポジション補正レジスタ１８ａとキャラクタポジシ
ョン補正レジスタ１８ｂにより、減算部１８はライン減
算部１９ａとキャラクタ減算部１９ｂにより夫々構成さ
れる。
このブロック図を参照しながら続いて本実施例の動作の
詳細を説明する。実際のライトベン操作に先立ち、次の
ようにしてライトベン補正レジスタ１８に補正値をセッ
トする。
詳細を説明する。実際のライトベン操作に先立ち、次の
ようにしてライトベン補正レジスタ１８に補正値をセッ
トする。
補正値セットＦ／Ｆ２０をセットして補正値セット可能
状態とし、ラインアドレス０、キャラクタァドレス０の
表示スクリーン上の位置にある文字／記号を表示する。
状態とし、ラインアドレス０、キャラクタァドレス０の
表示スクリーン上の位置にある文字／記号を表示する。
そうしておいて、その表示位直にライトベン１４をタッ
チすれば、ビデオの走査がその表示位贋を通過する時に
、ライトベン入力信号がアクティブとなり、この信号の
立上りに於てその時のりフレッシュカウンタアドレス出
力を、ライトベン補正レジスタ１８にセットする。この
値（ラインポジション補正レジスタ１８ａのセット値Ｑ
、キャラクタポジション補正レジタスタ１８ｂのセット
値８）は、回路上の遅延及びライトベン１４の検出遅延
等の為に、当然“０”よりも大きな値となるであろう（
Ｂは“０”である場合が多い）。一方、実際のライトベ
ン操作に於ては、補正値０セットＦ／Ｆ２０をリセット
し、補正値セット不可能状態とする。
チすれば、ビデオの走査がその表示位贋を通過する時に
、ライトベン入力信号がアクティブとなり、この信号の
立上りに於てその時のりフレッシュカウンタアドレス出
力を、ライトベン補正レジスタ１８にセットする。この
値（ラインポジション補正レジスタ１８ａのセット値Ｑ
、キャラクタポジション補正レジタスタ１８ｂのセット
値８）は、回路上の遅延及びライトベン１４の検出遅延
等の為に、当然“０”よりも大きな値となるであろう（
Ｂは“０”である場合が多い）。一方、実際のライトベ
ン操作に於ては、補正値０セットＦ／Ｆ２０をリセット
し、補正値セット不可能状態とする。
今、ラインアドレスＮ、キヤラクタアドレスＭの表示位
置にライトベン１４をタッチしたとすると、ビデオの走
査がその表示位置を通過する時夕に、ライトベン入力信
号がアクティブとなり、この信号の立上りに於て、その
時のりフレッシュカウンタアドレス出力をライトベンレ
ジスタ１６にセットする。
置にライトベン１４をタッチしたとすると、ビデオの走
査がその表示位置を通過する時夕に、ライトベン入力信
号がアクティブとなり、この信号の立上りに於て、その
時のりフレッシュカウンタアドレス出力をライトベンレ
ジスタ１６にセットする。
この値（ラインポジションレジスタ１６ａのセット値Ｌ
Ｌ、キャラクタポジションし０ジスタ１６ｂのセット値
Ｌｃ）は前記の事情で当然、ＬＬ＝Ｎ＋Ｑ、Ｌｃ＝Ｍ＋
８となっている。従って、減算部１９に於て、減算補正
（ライン減算部１９ａに於て、ライトベン検出情報ライ
ン＝ＬＬ−Ｑ、キャラクタ減算部１９ｂに於て、ラタィ
トベン検出情報キャラクタ＝リー８）を行えば、Ｑ、８
のばらつきに関係なく正確な精度の高いライトベン検出
情報が得られる。本発明は、以上説明したように、ライ
トベンレジスタ、ライトベン補正レジスタ、減算部、補
正処値セットＦ／Ｆとで構成し、ライトベンレジス夕の
格納値をライトベン補正レジスタの格納値で減算補正す
ることにより、上位装置／ソフトウェアに於ける補正の
わずらわしさを避けると共に、検出精度を向上する効果
がある。
Ｌ、キャラクタポジションし０ジスタ１６ｂのセット値
Ｌｃ）は前記の事情で当然、ＬＬ＝Ｎ＋Ｑ、Ｌｃ＝Ｍ＋
８となっている。従って、減算部１９に於て、減算補正
（ライン減算部１９ａに於て、ライトベン検出情報ライ
ン＝ＬＬ−Ｑ、キャラクタ減算部１９ｂに於て、ラタィ
トベン検出情報キャラクタ＝リー８）を行えば、Ｑ、８
のばらつきに関係なく正確な精度の高いライトベン検出
情報が得られる。本発明は、以上説明したように、ライ
トベンレジスタ、ライトベン補正レジスタ、減算部、補
正処値セットＦ／Ｆとで構成し、ライトベンレジス夕の
格納値をライトベン補正レジスタの格納値で減算補正す
ることにより、上位装置／ソフトウェアに於ける補正の
わずらわしさを避けると共に、検出精度を向上する効果
がある。
第１図は従釆技術でのＣＲＴ表示袋贋のブロック図、第
２図は本発明に係るＣＲＴ表示装置の一実施例を示すブ
ロック図、第３図は第２図に於けるライトベンレジスタ
、ライトベン補正レジスタ、減算部、補正値セットＦ／
Ｆの更に詳細なブロック図である。 １……ラインアドレスレジスタ、２……キヤラクタァド
レスレジスタ、３・・・・・・命令レジスタ、４．．．
．．．ラインアドレス選択部、５・・・・・・キヤラク
タアドレス選択部、６・…・・リフレツシュカウンタ、
７・・・・・・再生用バッファメモリ、８…・・・表示
信号発生部、９・・・・・・並直刃腰度換部、１０・・
・・・・同期信号発生部、１１・・・・・・ビデオ増幅
部、１２…・・・偏向増幅部、１３・・・・・・表示部
、１４…・・・ライトベン、１５……ライトベン入力受
信部、１６…・・・ライトベンレジスタ、１６ａ……ラ
インポジションレジスタ、１６ｂ……キヤラクタボジシ
ヨンレジスタ、１１７・・・・・・割込Ｆ／Ｆ、１８・
・・・・・ライトベン補正レジスタ、１８ａ…・・・ラ
インポジション補正レジスタ’、１８ｂ・・…・キャラ
クタポジション補正レジスタ、１９…・・・減算部、１
９ａ・…・・ライン減算部、１９ｂ・・…・キャラクタ
減算部、２０・・・・・・補正値セットＦ／Ｆ、２１・
・・…アンド回路。 第１図 第２図 第３図
２図は本発明に係るＣＲＴ表示装置の一実施例を示すブ
ロック図、第３図は第２図に於けるライトベンレジスタ
、ライトベン補正レジスタ、減算部、補正値セットＦ／
Ｆの更に詳細なブロック図である。 １……ラインアドレスレジスタ、２……キヤラクタァド
レスレジスタ、３・・・・・・命令レジスタ、４．．．
．．．ラインアドレス選択部、５・・・・・・キヤラク
タアドレス選択部、６・…・・リフレツシュカウンタ、
７・・・・・・再生用バッファメモリ、８…・・・表示
信号発生部、９・・・・・・並直刃腰度換部、１０・・
・・・・同期信号発生部、１１・・・・・・ビデオ増幅
部、１２…・・・偏向増幅部、１３・・・・・・表示部
、１４…・・・ライトベン、１５……ライトベン入力受
信部、１６…・・・ライトベンレジスタ、１６ａ……ラ
インポジションレジスタ、１６ｂ……キヤラクタボジシ
ヨンレジスタ、１１７・・・・・・割込Ｆ／Ｆ、１８・
・・・・・ライトベン補正レジスタ、１８ａ…・・・ラ
インポジション補正レジスタ’、１８ｂ・・…・キャラ
クタポジション補正レジスタ、１９…・・・減算部、１
９ａ・…・・ライン減算部、１９ｂ・・…・キャラクタ
減算部、２０・・・・・・補正値セットＦ／Ｆ、２１・
・・…アンド回路。 第１図 第２図 第３図
Claims (1)
- １ ライトペンを有するＣＲＴ表示装置に於て、ライト
ペン入力信号によってライトペンのタツチ位置を保持す
るライトペンレジスタと、該レジスタに保持されたライ
トペンタツチ位置に対する補正値をライトペン入力信号
によってセツトするライトペン補正レジスタと、前記ラ
イトペンレジスタの内容より前記補正レジスタの内容を
減じることによりライトペンタツチ位置を補正する減算
部と、前記ライトペン補正レジスタへの補正値のセツト
を可能／不可能とする補正値セツト手段とを有すること
を特徴としたＣＲＴ表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55014810A JPS602687B2 (ja) | 1980-02-12 | 1980-02-12 | Ｃｒｔ表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55014810A JPS602687B2 (ja) | 1980-02-12 | 1980-02-12 | Ｃｒｔ表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS56111939A JPS56111939A (en) | 1981-09-04 |
| JPS602687B2 true JPS602687B2 (ja) | 1985-01-23 |
Family
ID=11871389
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP55014810A Expired JPS602687B2 (ja) | 1980-02-12 | 1980-02-12 | Ｃｒｔ表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS602687B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5852730A (ja) * | 1981-09-25 | 1983-03-29 | Nec Corp | Ｃｒｔ表示装置 |
| JPS59183428A (ja) * | 1983-04-01 | 1984-10-18 | Hitachi Ltd | 手書き入出力表示装置及び手書き入出力表示装置の表示方法 |
-
1980
- 1980-02-12 JP JP55014810A patent/JPS602687B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS56111939A (en) | 1981-09-04 |
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