JPS6036129B2 - 逓倍回路 - Google Patents
逓倍回路Info
- Publication number
- JPS6036129B2 JPS6036129B2 JP3964276A JP3964276A JPS6036129B2 JP S6036129 B2 JPS6036129 B2 JP S6036129B2 JP 3964276 A JP3964276 A JP 3964276A JP 3964276 A JP3964276 A JP 3964276A JP S6036129 B2 JPS6036129 B2 JP S6036129B2
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- JP
- Japan
- Prior art keywords
- diode
- input signal
- transistor
- resonant circuit
- parallel resonant
- Prior art date
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- Measurement Of Current Or Voltage (AREA)
Description
【発明の詳細な説明】
本発明は入力信号周波数を逓情する逓倍回路に関するも
のである。
のである。
従釆入力信号の周波数を２倍に逓倍する為、第１図に示
すような逓倍回路が採用されていた。
すような逓倍回路が採用されていた。
同図に於いて、Ｑはトランジスタ、Ｒ，〜Ｒ８は抵抗、
Ｃ，〜Ｃ３はコンデンサ、Ｄ，，○２はダイオード、Ｌ
，はィンダクタンス、十Ｅは電源電圧であって、コンデ
ンサＣ３とインダクタンスＬとにより並列共振回路が形
成されている。トランジスタＱのコレクタとェミッタと
は互に位相が反転しているので、入力信号の正負何れの
周期に於いてもダイオードＤ，，Ｄ２の何れかが導適状
態となるので全波整流され、その整流出力は抵抗Ｒ７を
介して並列共振回路に加えられ、入力信号周波数の２倍
の周波数の正弦波が出力される。抵抗Ｒ５，Ｒ６はコン
デンサＣ．，Ｃ２の充電電荷を放電する為のものであり
、、又抵抗Ｒ８は並列共振回路のＱを適当に設定する為
のものである。
Ｃ，〜Ｃ３はコンデンサ、Ｄ，，○２はダイオード、Ｌ
，はィンダクタンス、十Ｅは電源電圧であって、コンデ
ンサＣ３とインダクタンスＬとにより並列共振回路が形
成されている。トランジスタＱのコレクタとェミッタと
は互に位相が反転しているので、入力信号の正負何れの
周期に於いてもダイオードＤ，，Ｄ２の何れかが導適状
態となるので全波整流され、その整流出力は抵抗Ｒ７を
介して並列共振回路に加えられ、入力信号周波数の２倍
の周波数の正弦波が出力される。抵抗Ｒ５，Ｒ６はコン
デンサＣ．，Ｃ２の充電電荷を放電する為のものであり
、、又抵抗Ｒ８は並列共振回路のＱを適当に設定する為
のものである。
又抵抗Ｒ７は、ダイオードＤ，の導適時にトランジスタ
Ｑが定電流源として働き、ダイオードＤ２の導適時にト
ランジスタＱが定電圧源として働くので、何れの場合も
並列共振回路からみたインピーダンスが変化しないよう
に高低抗のものが用いられる。このような従来の逓倍回
路に於いては、入力信号はダイオードＤ，，Ｄ２を導適
状態とし得る振幅が必要であり、若し小振幅入力信号で
あれば、増幅用として更に１個のトランジスタを設けな
ければならない。
Ｑが定電流源として働き、ダイオードＤ２の導適時にト
ランジスタＱが定電圧源として働くので、何れの場合も
並列共振回路からみたインピーダンスが変化しないよう
に高低抗のものが用いられる。このような従来の逓倍回
路に於いては、入力信号はダイオードＤ，，Ｄ２を導適
状態とし得る振幅が必要であり、若し小振幅入力信号で
あれば、増幅用として更に１個のトランジスタを設けな
ければならない。
又充分な振幅の入力信号であっても、ダイオードＤ２が
導通、非導通を繰返す為にトランジスタＱのベースから
みたインピーダンスが変化し、入力信号源に悪影響を与
える場合がある。又全波整流による出力が抵抗Ｒ７と並
列共振回路とによって分圧されることになるので出力効
率が低い欠点がある。更にトランジスタＱの出力による
ダイオードＤ，，Ｄ２の駆動条件が異なる為、ダイオー
ドＤ．，Ｄ２による整流波形が異なり、全波整流波形は
不平礎なものとなる。
導通、非導通を繰返す為にトランジスタＱのベースから
みたインピーダンスが変化し、入力信号源に悪影響を与
える場合がある。又全波整流による出力が抵抗Ｒ７と並
列共振回路とによって分圧されることになるので出力効
率が低い欠点がある。更にトランジスタＱの出力による
ダイオードＤ，，Ｄ２の駆動条件が異なる為、ダイオー
ドＤ．，Ｄ２による整流波形が異なり、全波整流波形は
不平礎なものとなる。
全波整流波形が理想状態であれば、入力信号周波数の２
倍の周波数及びその高調波しか含まないものであるが、
前述の如き不平衡な全波整流波形であると、更に入力信
号周波数成分とその高調波成分とを含むものとなり、共
振回路によって入力信号周波数の２倍の周波数のみ抽出
し、他の周波数成分を除去しようとしても、若干の残留
分が出力に現われることになる。本発明は前述の如き欠
点を改善し、入力信号周波数を逓倍することを目的とす
るものである。以下実施例について詳細に説明する。第
２図は本発明の実施例の回路図であり、Ｑはトランジス
タ、Ｒ，〜Ｒ４は抵抗、Ｃ４，Ｃ５はコンデンサ、Ｄ３
〜Ｄ６は弟仇１〜第４のダイオード、Ｔ，はトランス、
十Ｅは電源電圧である。
倍の周波数及びその高調波しか含まないものであるが、
前述の如き不平衡な全波整流波形であると、更に入力信
号周波数成分とその高調波成分とを含むものとなり、共
振回路によって入力信号周波数の２倍の周波数のみ抽出
し、他の周波数成分を除去しようとしても、若干の残留
分が出力に現われることになる。本発明は前述の如き欠
点を改善し、入力信号周波数を逓倍することを目的とす
るものである。以下実施例について詳細に説明する。第
２図は本発明の実施例の回路図であり、Ｑはトランジス
タ、Ｒ，〜Ｒ４は抵抗、Ｃ４，Ｃ５はコンデンサ、Ｄ３
〜Ｄ６は弟仇１〜第４のダイオード、Ｔ，はトランス、
十Ｅは電源電圧である。
このトランスＴ，の１次側とコンデンサＣ５とにより並
列共振回路を構成し、その端子に接続された第１〜第４
のダイオードＤ３〜ＤＢによりトランジスタＱのコレク
タの出力を全波整流してその出力を並列共振回路に加え
、この並列共振回路の一部を形成しているトランジスタ
Ｔ，の２次側を出力端子に接続して、入力信号周波数の
２倍の周波数の信号を出力するものである。前述の回路
構成に於いて、トランジスタＱはェミッタ接地として動
作し、入力信号の負の半周期によってトランジスタＱの
コレクタからエミツタ方向に交流電流が流れ、そのコレ
ク夕には抵抗Ｒ３を介して流入するものと、ダイオード
Ｄ５、トランスＴ，の１次側とコンデンサＣ５との並列
共振回路及びダイオードＤ４を通り、コンデンサＣ４を
介して流入するものとが加算される。
列共振回路を構成し、その端子に接続された第１〜第４
のダイオードＤ３〜ＤＢによりトランジスタＱのコレク
タの出力を全波整流してその出力を並列共振回路に加え
、この並列共振回路の一部を形成しているトランジスタ
Ｔ，の２次側を出力端子に接続して、入力信号周波数の
２倍の周波数の信号を出力するものである。前述の回路
構成に於いて、トランジスタＱはェミッタ接地として動
作し、入力信号の負の半周期によってトランジスタＱの
コレクタからエミツタ方向に交流電流が流れ、そのコレ
ク夕には抵抗Ｒ３を介して流入するものと、ダイオード
Ｄ５、トランスＴ，の１次側とコンデンサＣ５との並列
共振回路及びダイオードＤ４を通り、コンデンサＣ４を
介して流入するものとが加算される。
このときダイオードＤ３，Ｄ６は非導適状態である。次
に入力信号の正の半周期によって流れる交流電流は、ト
ランジスタＱのェミッタからコレクタ方向に流れ、抵抗
Ｒ３とコンデンサＣ４とに分流し、コンデンサＣ４を介
した電流は、ダイオードＤ３、並列共振回路及びダイオ
ードＤ６に流れる。
に入力信号の正の半周期によって流れる交流電流は、ト
ランジスタＱのェミッタからコレクタ方向に流れ、抵抗
Ｒ３とコンデンサＣ４とに分流し、コンデンサＣ４を介
した電流は、ダイオードＤ３、並列共振回路及びダイオ
ードＤ６に流れる。
このときダイオードＤ４，Ｄ５は非導適状態である。前
述の如く、入力信号の正負の何れかの半周期に於いても
並列共振回路には同方向に電流が流れる。
述の如く、入力信号の正負の何れかの半周期に於いても
並列共振回路には同方向に電流が流れる。
即ち全波整流された出力が並列共振回路に加えられるこ
とになる。そして並列共振回路により入力信号周波数の
２倍の周波数成分のみが取出され、トランスＴ，の２次
側より出力される。コンデンサＣ４には入力信号の正負
に応じて逆向きの電流が流れるので、第１図に示すよう
な抵抗Ｒ５，Ｒ６に相当する放電用の抵抗を必要としな
いものとなる。又抵抗Ｒ４を適当に選定することにより
、コレクタに流れる交流電流を任意に設定することがで
き、従って入力信号の振幅が小さくても、ダイオードＤ
３〜Ｄ６を導適状態とするように増幅することができる
。そして入力信号の正負に対しても、トランジスタＱの
コレクタからの出力を全波整流するものであるから、不
平衡な整流波形になることがなく、全波整流波形には入
力信号周波数の２倍の周波数成分とその高調波成分のみ
が含まれ、入力信号周波数成分とその高調波成分とは含
まれないものとなる。本発明は前述の如き利点以外に、
更にベースからみたインピーダンスが、ｈｆｅ×Ｒ４（
但し、ｈｆｅはェミッタ接地の交流電流増幅率）と抵抗
Ｒ，．Ｒ２の並列値で決定され、ダイオードＤ３〜Ｄ６
の導通、非導通に拘らず一定となる。
とになる。そして並列共振回路により入力信号周波数の
２倍の周波数成分のみが取出され、トランスＴ，の２次
側より出力される。コンデンサＣ４には入力信号の正負
に応じて逆向きの電流が流れるので、第１図に示すよう
な抵抗Ｒ５，Ｒ６に相当する放電用の抵抗を必要としな
いものとなる。又抵抗Ｒ４を適当に選定することにより
、コレクタに流れる交流電流を任意に設定することがで
き、従って入力信号の振幅が小さくても、ダイオードＤ
３〜Ｄ６を導適状態とするように増幅することができる
。そして入力信号の正負に対しても、トランジスタＱの
コレクタからの出力を全波整流するものであるから、不
平衡な整流波形になることがなく、全波整流波形には入
力信号周波数の２倍の周波数成分とその高調波成分のみ
が含まれ、入力信号周波数成分とその高調波成分とは含
まれないものとなる。本発明は前述の如き利点以外に、
更にベースからみたインピーダンスが、ｈｆｅ×Ｒ４（
但し、ｈｆｅはェミッタ接地の交流電流増幅率）と抵抗
Ｒ，．Ｒ２の並列値で決定され、ダイオードＤ３〜Ｄ６
の導通、非導通に拘らず一定となる。
従って入力信号源に複数の逓倍回路を接続したとしても
、動作中に入力インピーダンスが変動しないから、入力
信号源及び他の回路に悪影響を与えることはない。又並
列共振回路及びダイオードＤ３〜Ｄ６はトランジスタＱ
のコレクタにコンデンサＣ４を介して接続されているの
で、抵抗Ｒ３が並列共振回路のＱ設定用となり、第１図
に於ける抵抗Ｒ８は不用となる。又全波整流出力を分圧
するような抵抗（第１図の抵抗Ｒ７）を有しないので、
効率が高いものとなる。従って入力信号の周波数を途倍
する回路として実用上の効果は非常に大きいものである
。
、動作中に入力インピーダンスが変動しないから、入力
信号源及び他の回路に悪影響を与えることはない。又並
列共振回路及びダイオードＤ３〜Ｄ６はトランジスタＱ
のコレクタにコンデンサＣ４を介して接続されているの
で、抵抗Ｒ３が並列共振回路のＱ設定用となり、第１図
に於ける抵抗Ｒ８は不用となる。又全波整流出力を分圧
するような抵抗（第１図の抵抗Ｒ７）を有しないので、
効率が高いものとなる。従って入力信号の周波数を途倍
する回路として実用上の効果は非常に大きいものである
。
第１図は従来の溝倍回路、第２図は本発明の実施例の逓
倍回路を示すものである。 Ｑはトランジスタ、Ｒ，〜Ｒ８は抵抗、Ｃ，〜Ｃ５はコ
ンデンサ、Ｄ，〜Ｄ６はダイオード、Ｔ，はトランスで
ある。 オー図 オ２図
倍回路を示すものである。 Ｑはトランジスタ、Ｒ，〜Ｒ８は抵抗、Ｃ，〜Ｃ５はコ
ンデンサ、Ｄ，〜Ｄ６はダイオード、Ｔ，はトランスで
ある。 オー図 オ２図
Claims (1)
- １ エミツタ接地として動作するトランジスタのコレク
タにコンデンサを介して並列共振回路を構成するコンデ
ンサとトランスの１次側との一方の端子に第１のダイオ
ード、他方の端子に前記第１のダイオードと極性を反対
にした第２のダイオードをそれぞれ接続し、前記一方の
端子とアースとの間に前記第２のダイオードと導通方向
を同じくした第３のダイオードを接続し、前記他方の端
子とアースとの間に前記第１のダイオードと導通方向を
同じくした第４のダイオードを接続し、且つ前記トラン
スの２次側を出力端子に接続したことを特徴とする逓倍
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3964276A JPS6036129B2 (ja) | 1976-04-08 | 1976-04-08 | 逓倍回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3964276A JPS6036129B2 (ja) | 1976-04-08 | 1976-04-08 | 逓倍回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS52123156A JPS52123156A (en) | 1977-10-17 |
| JPS6036129B2 true JPS6036129B2 (ja) | 1985-08-19 |
Family
ID=12558732
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3964276A Expired JPS6036129B2 (ja) | 1976-04-08 | 1976-04-08 | 逓倍回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6036129B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63193623U (ja) * | 1987-05-30 | 1988-12-13 |
-
1976
- 1976-04-08 JP JP3964276A patent/JPS6036129B2/ja not_active Expired
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63193623U (ja) * | 1987-05-30 | 1988-12-13 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS52123156A (en) | 1977-10-17 |
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