JPS6044868B2 - サンプリングパルス発生装置 - Google Patents
サンプリングパルス発生装置Info
- Publication number
- JPS6044868B2 JPS6044868B2 JP11563077A JP11563077A JPS6044868B2 JP S6044868 B2 JPS6044868 B2 JP S6044868B2 JP 11563077 A JP11563077 A JP 11563077A JP 11563077 A JP11563077 A JP 11563077A JP S6044868 B2 JPS6044868 B2 JP S6044868B2
- Authority
- JP
- Japan
- Prior art keywords
- output
- liquid crystal
- shift register
- input
- sampling pulse
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Liquid Crystal Display Device Control (AREA)
- Transforming Electric Information Into Light Information (AREA)
Description
【発明の詳細な説明】
本発明はマトリクスアドレス方式のテレビを駆動する制
御信号を発生する装置に関するものである。
御信号を発生する装置に関するものである。
気体放電素子（プラズマ）、電界発光素子（ＥＬ）、液
晶などを使用したマトリクスアドレス方式のテレビは、
近年盛んに研究されている。
晶などを使用したマトリクスアドレス方式のテレビは、
近年盛んに研究されている。
第１図は液晶テレビのブロック図を示したものである。
チューナ１によつて受信されたテレビの放送波は、映像
中間周波増幅回路２によつて増幅され、音声成分は音声
増幅回路３によつて増幅後、スピーカを駆動する。
中間周波増幅回路２によつて増幅され、音声成分は音声
増幅回路３によつて増幅後、スピーカを駆動する。
２の出力は映像増幅回路４によつて増幅されて、ＡＩＤ
変換器５に印加される。
変換器５に印加される。
４の出力は制御信号発生回路６に印加される。
６では、複合映像信号から垂直同期信号と水平同期信号
を分離して、液晶テレビ全体を制御する各種制御信号お
よび各種クロックパルスを発生する。
を分離して、液晶テレビ全体を制御する各種制御信号お
よび各種クロックパルスを発生する。
ＡＩＤ変換器５の出力はラインメモリ７に書き込まれた
後、ラインメモリ８に転送され、信号電極駆動回路９を
経て液晶マトリクスパネル１０に印加される。１０の走
査線は走査電極駆動回路１１によつて線順次に走査され
る。
後、ラインメモリ８に転送され、信号電極駆動回路９を
経て液晶マトリクスパネル１０に印加される。１０の走
査線は走査電極駆動回路１１によつて線順次に走査され
る。
第２図は第１図に示した液晶テレビの簡略化したタイミ
ングチャートである。
ングチャートである。
ＳＶは垂直同期信号、Ｖｇは映像信号、ＳＨは水平同期
信号、φはサンプリングパルス、ＭＴはメモリ転送パル
スである。ＳＨ■ ０の期間、サンプリングパルスφは
発生し、このサンプリングパルスφによつてＡＩＤ変換
器の出力はラインメモリ７に書き込まれる。ａの期間に
７に書き込まれた信号は１番目のメモリ転送パルスＭＴ
によつてラインメモリ８に転送されて、駆動回路９を経
て液晶マトリクスパネル１０に印加される。この間に７
にはつぎの期間をの信号の書き込みが行なわれる。をの
期間に７に書き込まれた信号は、２番目のメモリ転送パ
ルスＭＴによつて８に転送される。以下、同様の動作を
くり返す。第３図は液晶パネル上の画素に信号が印加さ
れる時間を長くして画質を向上させるために考案された
二重マトリクスパネルとよばれるパネルの原理図である
。
信号、φはサンプリングパルス、ＭＴはメモリ転送パル
スである。ＳＨ■ ０の期間、サンプリングパルスφは
発生し、このサンプリングパルスφによつてＡＩＤ変換
器の出力はラインメモリ７に書き込まれる。ａの期間に
７に書き込まれた信号は１番目のメモリ転送パルスＭＴ
によつてラインメモリ８に転送されて、駆動回路９を経
て液晶マトリクスパネル１０に印加される。この間に７
にはつぎの期間をの信号の書き込みが行なわれる。をの
期間に７に書き込まれた信号は、２番目のメモリ転送パ
ルスＭＴによつて８に転送される。以下、同様の動作を
くり返す。第３図は液晶パネル上の画素に信号が印加さ
れる時間を長くして画質を向上させるために考案された
二重マトリクスパネルとよばれるパネルの原理図である
。
以下第３図を用いて説明する。厚さ数顛の下板ガラス１
２の上には透明電極１３を形成し、上板ガラス１４の上
には細い金属電極１５と透明電極１６を形成し、下板ガ
ラス１２上の透明電極１３と上板ガラス１４上の金属電
極１５が直交するように、厚さ１０μｍ〜数＋μｍのペ
ーサ１７を介して重ね合せて接着する。２枚のガラス板
１２と１４の空隙１８に液晶を満たす。
２の上には透明電極１３を形成し、上板ガラス１４の上
には細い金属電極１５と透明電極１６を形成し、下板ガ
ラス１２上の透明電極１３と上板ガラス１４上の金属電
極１５が直交するように、厚さ１０μｍ〜数＋μｍのペ
ーサ１７を介して重ね合せて接着する。２枚のガラス板
１２と１４の空隙１８に液晶を満たす。
電極１５はＡ系統（Ａ１〜Ａ４）とＢ系統（Ｂ１〜Ｂ４
）の２つに分けられている。１９及び２０はラインメモ
リ７とラインメモリ８と駆動回路を一体化して表現した
電極１５を駆動する信号電極駆動回路である。
）の２つに分けられている。１９及び２０はラインメモ
リ７とラインメモリ８と駆動回路を一体化して表現した
電極１５を駆動する信号電極駆動回路である。
１３は走査電極、１５は信号電極である。
Ｃ１に走査信号を印加してＡ１〜Ａ４及びＢ１〜Ｂ，に
信号を印加するとＣ１電極上の画素（Ｃ１電極と１６の
交点）は印加された信号に応じて輝度を変化する。第３
図は走査電極１３は２本、信号電極１５はＡ系統、Ｂ系
統ともに４本ずつの例を示したものであるが、一般には
１３，１５ともにより多くの電極によつて構成される。
信号を印加するとＣ１電極上の画素（Ｃ１電極と１６の
交点）は印加された信号に応じて輝度を変化する。第３
図は走査電極１３は２本、信号電極１５はＡ系統、Ｂ系
統ともに４本ずつの例を示したものであるが、一般には
１３，１５ともにより多くの電極によつて構成される。
第４図は第３図に示した二重マトリクス液晶パネルを駆
動する場合のタイミングチヤートである。
動する場合のタイミングチヤートである。
ＳＶは垂直同期パルス、ＳＨは水平同期パルス、φ９は
ＡＩＤ変換器５の出力をＡ系統のメモリ７に書き込みを
行なうためのサンプリングパルス、φＢはＡＩＤ変換器
５の出力をＢ系統のメモリ７に書き込みを行なうための
サンプリングパルス、ＭＴはメモリ７の内容をメモリ８
に転送するためのメモリ転送パルスである。以下第４図
を用いて説明を行なう。ＡＩＤ変換器５の出力はＡ系統
のメモリ７にはφぇで書き込み、Ｂ系統のメモリ７には
φ８で書き込む。
ＡＩＤ変換器５の出力をＡ系統のメモリ７に書き込みを
行なうためのサンプリングパルス、φＢはＡＩＤ変換器
５の出力をＢ系統のメモリ７に書き込みを行なうための
サンプリングパルス、ＭＴはメモリ７の内容をメモリ８
に転送するためのメモリ転送パルスである。以下第４図
を用いて説明を行なう。ＡＩＤ変換器５の出力はＡ系統
のメモリ７にはφぇで書き込み、Ｂ系統のメモリ７には
φ８で書き込む。
期間ａでメモリ７に書き込まれて信号はＭＴによつてＡ
系統、Ｂ系統とも同時にメモリ８に転送され、液晶パネ
ルに期間ｂの間印加される。同様に期間ｂにメモリ７に
書き込まれた信号はＭＴによつてメモリ８に転送され、
期間Ｃに液晶パネルに印加される。したがつて二重マト
リクス液晶パネルを駆動するためにはφＡ，φＢなる二
系統のサンプリングパルスを必要とする。本発明の目的
は、液晶マトリクスパネルを使用してテレビ表示を行う
装置の液晶マトリクスパネルを駆動する多種類のサンプ
リングパルスを比較的簡単な回路構成により発生するこ
とのできるサンプリングパルス発生装置を提供すること
にある。
系統、Ｂ系統とも同時にメモリ８に転送され、液晶パネ
ルに期間ｂの間印加される。同様に期間ｂにメモリ７に
書き込まれた信号はＭＴによつてメモリ８に転送され、
期間Ｃに液晶パネルに印加される。したがつて二重マト
リクス液晶パネルを駆動するためにはφＡ，φＢなる二
系統のサンプリングパルスを必要とする。本発明の目的
は、液晶マトリクスパネルを使用してテレビ表示を行う
装置の液晶マトリクスパネルを駆動する多種類のサンプ
リングパルスを比較的簡単な回路構成により発生するこ
とのできるサンプリングパルス発生装置を提供すること
にある。
本発明はＮビツトのシフトレジスタと、Ｎ個のＡＮＤゲ
ートと、基準サンプリングパルスを発生する回路と、一
対のＮＡＮＤゲート、１個のＮＯＴゲート及び１個の０
Ｒゲートよりなる論理回路とで構成され、前記Ｎビツト
のシフトレジスタは水平同期信号をクロツク信号とし、
垂直同期信号をクリア信号とし、更に垂直同期信号とシ
フトレジスタ自身の出力信号を前記論理回路により論理
演算した結果を入力信号とするもので、前記シフトレジ
スタのＮビツト出力信号と前記基準サンプリングパルス
とをそれぞれ前記Ｎ個のＡＮＤゲートで論理積演算を行
つてＮ種類のサンプリングパルスを出力するものである
。
ートと、基準サンプリングパルスを発生する回路と、一
対のＮＡＮＤゲート、１個のＮＯＴゲート及び１個の０
Ｒゲートよりなる論理回路とで構成され、前記Ｎビツト
のシフトレジスタは水平同期信号をクロツク信号とし、
垂直同期信号をクリア信号とし、更に垂直同期信号とシ
フトレジスタ自身の出力信号を前記論理回路により論理
演算した結果を入力信号とするもので、前記シフトレジ
スタのＮビツト出力信号と前記基準サンプリングパルス
とをそれぞれ前記Ｎ個のＡＮＤゲートで論理積演算を行
つてＮ種類のサンプリングパルスを出力するものである
。
第５図は本発明によるサンプリングパルスφＡ，φＢを
発生させる第１の実施例である。
発生させる第１の実施例である。
第６図は第５図に示した装置のタイミングチヤートであ
る。以下第５図の装置の説明を行なう。２１，２２はＮ
ＡＮＤゲート、２３は０Ｒゲート、２４はシフトレジス
タ、２５はＮＯＴゲート、２６は基準サンプリングパル
ス発生器、２７，２８はＮ１ゲートである。
る。以下第５図の装置の説明を行なう。２１，２２はＮ
ＡＮＤゲート、２３は０Ｒゲート、２４はシフトレジス
タ、２５はＮＯＴゲート、２６は基準サンプリングパル
ス発生器、２７，２８はＮ１ゲートである。
ｗ戸０のとき、シフトレジスタ２４はクリアされている
ので第１ビツト出力Ｓ１、第２ビツト出力はともに０に
なつている。
ので第１ビツト出力Ｓ１、第２ビツト出力はともに０に
なつている。
このときＮＡＮＤゲート２１の出力は１になつている。
２１の出力は０Ｒゲート２３を通過して２４の入力ｈに
印加されている。
２１の出力は０Ｒゲート２３を通過して２４の入力ｈに
印加されている。
２６はＳＨ＝０のときだけ出力パルスφを生じる。
したがつて刈＝ｏのとき、ＡＮＤゲート２７，２８の出
力φＡ，φＢは生じない。刈＝１になると、２４に印加
されるクロツクパルスＳＨによつて２４は動作を開始し
、Ｓ１＝１になる。同時に信号Ｓ１はＮＯｒゲート２５
を通過して２２に印加され２１の出力は０にもどる。２
発目のクロツクパルスＳＨによつてＳ２＝１になり、Ｓ
１はＯにもどる。
力φＡ，φＢは生じない。刈＝１になると、２４に印加
されるクロツクパルスＳＨによつて２４は動作を開始し
、Ｓ１＝１になる。同時に信号Ｓ１はＮＯｒゲート２５
を通過して２２に印加され２１の出力は０にもどる。２
発目のクロツクパルスＳＨによつてＳ２＝１になり、Ｓ
１はＯにもどる。
は２４の入力ｈに帰還されているので、３発目のクロツ
クパルスによつてＳ１＝１，Ｓ２＝０となる。以下同様
の動作をくり返し、第６図に示した信号Ｓｌ，Ｓ２を得
ることができる。ここでつぎのような論理積演算をＡＮ
Ｄゲート２７と２８を利用して行なうことによつて二種
類のクロツクパルスφ９とφ８を得ることができる。第
３図に示した二重マトリクス液晶パネルは多重マトリク
ス液晶パネルに拡張することは可能である。
クパルスによつてＳ１＝１，Ｓ２＝０となる。以下同様
の動作をくり返し、第６図に示した信号Ｓｌ，Ｓ２を得
ることができる。ここでつぎのような論理積演算をＡＮ
Ｄゲート２７と２８を利用して行なうことによつて二種
類のクロツクパルスφ９とφ８を得ることができる。第
３図に示した二重マトリクス液晶パネルは多重マトリク
ス液晶パネルに拡張することは可能である。
多重マトリクス液晶パネルにした場合は第４図あるいは
第６図に示したサンプリングパルスは更に多く必要とな
る。本発明によるサンプリングパルス発生装置は多重マ
トリクス液晶パネルを駆動する場合にも容易に拡張する
ことができる。第７図は三重マトリクス液晶パネルを駆
動する場合の第２の実施例である。第８図は第７図に示
した装置のタイミングチヤートである。第７図は第５図
と比較してシフトレジスタ２９を１ビツト増し、ＡＮＤ
ゲート３０を１個増設したものである。第８図に示した
サンプリングパルスφＡ，φＩφ。はつぎの式に示すよ
うな論理積演算を行なうことに＋つて得ることができる
。一般にＮ重マトリクス液晶パネルを駆動する場合は第
５図に示したシフトレジスタ２４はＮビツトのシフトレ
ジスタを使用し、２７，２８で示されるＡＮＤゲートは
Ｎ個使用すればよく、シフトレジスタとＡＮＤゲートを
除いた部分の回路構成は全く同じである。
第６図に示したサンプリングパルスは更に多く必要とな
る。本発明によるサンプリングパルス発生装置は多重マ
トリクス液晶パネルを駆動する場合にも容易に拡張する
ことができる。第７図は三重マトリクス液晶パネルを駆
動する場合の第２の実施例である。第８図は第７図に示
した装置のタイミングチヤートである。第７図は第５図
と比較してシフトレジスタ２９を１ビツト増し、ＡＮＤ
ゲート３０を１個増設したものである。第８図に示した
サンプリングパルスφＡ，φＩφ。はつぎの式に示すよ
うな論理積演算を行なうことに＋つて得ることができる
。一般にＮ重マトリクス液晶パネルを駆動する場合は第
５図に示したシフトレジスタ２４はＮビツトのシフトレ
ジスタを使用し、２７，２８で示されるＡＮＤゲートは
Ｎ個使用すればよく、シフトレジスタとＡＮＤゲートを
除いた部分の回路構成は全く同じである。
ただし０Ｒゲート２３の入力はＮＡＮＤゲート２１の出
力とシフトレジスタのＮビツト目の出力になる。本発明
は二重マトリクス液晶パネルを駆動するサンプリングパ
ルスを発生させる手段を提供するものであり、回路構成
が比較的簡単である。
力とシフトレジスタのＮビツト目の出力になる。本発明
は二重マトリクス液晶パネルを駆動するサンプリングパ
ルスを発生させる手段を提供するものであり、回路構成
が比較的簡単である。
多重マトリクス液晶パネルを駆動する場合に容易に拡張
することができる。
することができる。
第１図は液晶テレビの全体の動作を示すプロツク図、第
２図は液晶テレビの動作を示すタイミングチヤート、第
３図は二重マトリクス液晶パネルの一実施例を示す図、
第４図は二重マトリクス液晶パネルを駆動するタイミン
グチヤートを示す図、第５図は本発明による二重マトリ
クス液晶パネルを駆動するサンプリングパルス発生装置
の第１の実施例を示す図、第６図は第５図に示した装置
の各部の波形を示すタイミングチヤート、第７図は本発
明による三重マトリクス液晶パネルを駆動するサンプリ
ングパルス発生装置の第２の実施例を示す図、第８図は
第７図に示した装置の各部．の波形を示すタイミングチ
ヤートである。 ２１，２２・・・ＮＡＮＤゲート、２３・・・０Ｒゲー
ト、２４・・・シフトレジスタ、２５・・・ＮＯＴゲー
ト、２６・・・基準サンプリングパルス発生器、２７，
２８，３０・・・ＡＮＤゲート。
２図は液晶テレビの動作を示すタイミングチヤート、第
３図は二重マトリクス液晶パネルの一実施例を示す図、
第４図は二重マトリクス液晶パネルを駆動するタイミン
グチヤートを示す図、第５図は本発明による二重マトリ
クス液晶パネルを駆動するサンプリングパルス発生装置
の第１の実施例を示す図、第６図は第５図に示した装置
の各部の波形を示すタイミングチヤート、第７図は本発
明による三重マトリクス液晶パネルを駆動するサンプリ
ングパルス発生装置の第２の実施例を示す図、第８図は
第７図に示した装置の各部．の波形を示すタイミングチ
ヤートである。 ２１，２２・・・ＮＡＮＤゲート、２３・・・０Ｒゲー
ト、２４・・・シフトレジスタ、２５・・・ＮＯＴゲー
ト、２６・・・基準サンプリングパルス発生器、２７，
２８，３０・・・ＡＮＤゲート。
Claims (1)
- １ Ｎ重に多重化された液晶マトリクスパネルを使用し
てテレビ表示を行なう装置の該液晶マトリクスパネルを
駆動するＮ種類のサンプリングパルスを発生する装置に
おいて；垂直同期信号の反転信号でクリヤされ、水平同
期信号をクロックパルスとし、かつ後記２入力ＯＲゲー
トの出力を印加されてリングカウンタとして動作するＮ
ビットのシフトレジスタと；垂直同期信号の反転信号が
印加されると１になり、前記シフトレジスタの１ビット
目の出力が１になると０にもどる機能を有する論理回路
と；該論理回路の出力と前記シフトレジスタのＮビット
目の出力を２入力とし、出力を前記シフトレジスタの入
力として印加する２入力ＯＲゲートと；基準サンプリン
グパルスを発生する回路と；前記シフトレジスタの各ビ
ットの出力を一方の入力とし、前記基準サンプリングパ
ルスを共通入力とし、その出力にＮ種類のサンプリング
パルスを得るＮ個の２入力ＡＮＤゲートとを備えたこと
を特徴とするサンプリングパルス発生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11563077A JPS6044868B2 (ja) | 1977-09-28 | 1977-09-28 | サンプリングパルス発生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11563077A JPS6044868B2 (ja) | 1977-09-28 | 1977-09-28 | サンプリングパルス発生装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5450225A JPS5450225A (en) | 1979-04-20 |
| JPS6044868B2 true JPS6044868B2 (ja) | 1985-10-05 |
Family
ID=14667396
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11563077A Expired JPS6044868B2 (ja) | 1977-09-28 | 1977-09-28 | サンプリングパルス発生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6044868B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60153277A (ja) * | 1984-01-23 | 1985-08-12 | Matsushita Electric Ind Co Ltd | 同期クロツク発生回路 |
| JPH0762789B2 (ja) * | 1984-08-17 | 1995-07-05 | セイコーエプソン株式会社 | ドライバ−内蔵アクテイブマトリクスパネル |
-
1977
- 1977-09-28 JP JP11563077A patent/JPS6044868B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5450225A (en) | 1979-04-20 |
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