JPS6046635U - 水銀接点リレ−の粘着防止装置 - Google Patents

水銀接点リレ−の粘着防止装置

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JPS6046635U
JPS6046635U JP13848683U JP13848683U JPS6046635U JP S6046635 U JPS6046635 U JP S6046635U JP 13848683 U JP13848683 U JP 13848683U JP 13848683 U JP13848683 U JP 13848683U JP S6046635 U JPS6046635 U JP S6046635U
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JP
Japan
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circuit
supplied
mercury contact
clock pulse
pulse signal
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JP13848683U
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和山　幸夫
孝行 小林
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Meidensha Corp
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Meidensha Corp
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は水銀接点リレーを用いた従来の入出力装置の一
例を示す回路図、第２図は本考案の一実施例を示す回路
図、第３図は第２図の回路動作を説明する為の信号波形
図である。 １．１１・・・・・・接点部、２，１２・・・・・・水
銀接点リレー、６，１６・・・・・・トランジスタ、・
４．５，２５・・・・・・マルチエミッタ構造のトラン
ジスタ、１８・・・・・・否定回路、１９ａ、１９ｂ・
・・・・・オフディレー回路、３０　ａ、　３０　ｂ＝
ＮＡＮＤ回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 電気信号の伝送路の入出力端間に第１および第２水銀接
    点リレーの接点を並列接続して成る並列回路と、第１入
    力端に前記リレーのオン、オフ指令信号が供給されると
    ともに第２入力端にクロックパルス信号が供給され且つ
    前記リレーを各別に制御する第１および第２ＮＡＮＤ回
    路と、これらＮＡＮＤ回路のうち一方のＮＡＮＤ回路の
    第２入力端にクロックパルス信号が供給される電路に介
    挿された第１オフディレー回路と、前記第１および第２
    ＮＡＮＤ回路のうち他方のＮＡＮＤ回路の第２入力端に
    クロックパルス信号が供給される電゛　路に介挿され、
    否定回路および第２オフディレー回路から成る直列回路
    とを備えたことを特徴キする水銀接点リレーの粘着防止
    装置。
JP13848683U 1983-09-07 1983-09-07 水銀接点リレ−の粘着防止装置 Granted JPS6046635U (ja)

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JPS6046635U true JPS6046635U (ja) 1985-04-02
JPH0245952Y2 JPH0245952Y2 (ja) 1990-12-05

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02309516A (ja) * 1989-05-25 1990-12-25 Nkk Corp リレー接点の不動作防止方法
JP2015153461A (ja) * 2014-02-10 2015-08-24 株式会社デンソー リレー制御装置
JP2023025461A (ja) * 2021-08-10 2023-02-22 三菱電機株式会社 制御システムおよび端末器

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02309516A (ja) * 1989-05-25 1990-12-25 Nkk Corp リレー接点の不動作防止方法
JP2015153461A (ja) * 2014-02-10 2015-08-24 株式会社デンソー リレー制御装置
JP2023025461A (ja) * 2021-08-10 2023-02-22 三菱電機株式会社 制御システムおよび端末器

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JPH0245952Y2 (ja) 1990-12-05

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