JPS6048538A - デ−タ収集回路 - Google Patents
デ−タ収集回路Info
- Publication number
- JPS6048538A JPS6048538A JP58154881A JP15488183A JPS6048538A JP S6048538 A JPS6048538 A JP S6048538A JP 58154881 A JP58154881 A JP 58154881A JP 15488183 A JP15488183 A JP 15488183A JP S6048538 A JPS6048538 A JP S6048538A
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- JP
- Japan
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- speed
- signal
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- Pending
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- Analysing Materials By The Use Of Radiation (AREA)
- Apparatus For Radiation Diagnosis (AREA)
- Analogue/Digital Conversion (AREA)
- Communication Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は、Ｘ線ＣＴ装置等のように多数の検出器出力デ
ータを収集する必要のある装置に好適なデータ収集回路
に関する。
ータを収集する必要のある装置に好適なデータ収集回路
に関する。
従来、Ｘ線ＣＴ装＋ｉ“、では第１図に示すように人間
Ｈを透過してきたＸ線りを検出器群ＩＫより電気信号に
変換し、増幅器２１〜２ｎで信号増幅したのち、アナロ
グマルチプレクサ３により上記信号を順次選択し、その
信号を次段のサンプルホールド回路４で受け、Ａ、ＴＪ
変換器５でディジタル信号に変換し、ディジタル画像処
理装置６に伝送し、画像処理を行なっている。検出器の
数（ｎ ） Ｕ、普通、５００程度であり、約５１ｎＳ
ｅ（ｉのＪｔＪＪ間内に１６ビツト程度の精度で、上記
５００チヤンネルのＡＤ変換を完了するようになってい
る。従って、ＡＤ変換器として、分解能１６ビツト程度
、変換時間１０μＳＯＣ以下という、偽性能なものが必
要とされ、非常に高価であった。また、アナログマルチ
プレクサ３やサンプルホールド回路４にも高速でかつ高
精度のものが要求きれ、上記Ａ Ｉ）変換器と同様、筒
価であった。
Ｈを透過してきたＸ線りを検出器群ＩＫより電気信号に
変換し、増幅器２１〜２ｎで信号増幅したのち、アナロ
グマルチプレクサ３により上記信号を順次選択し、その
信号を次段のサンプルホールド回路４で受け、Ａ、ＴＪ
変換器５でディジタル信号に変換し、ディジタル画像処
理装置６に伝送し、画像処理を行なっている。検出器の
数（ｎ ） Ｕ、普通、５００程度であり、約５１ｎＳ
ｅ（ｉのＪｔＪＪ間内に１６ビツト程度の精度で、上記
５００チヤンネルのＡＤ変換を完了するようになってい
る。従って、ＡＤ変換器として、分解能１６ビツト程度
、変換時間１０μＳＯＣ以下という、偽性能なものが必
要とされ、非常に高価であった。また、アナログマルチ
プレクサ３やサンプルホールド回路４にも高速でかつ高
精度のものが要求きれ、上記Ａ Ｉ）変換器と同様、筒
価であった。
さらに、高速であるために、サンプルホールド等に広帯
域のものが要求され、Ｓ／Ｎを劣化させる欠点もあった
。
域のものが要求され、Ｓ／Ｎを劣化させる欠点もあった
。
本発明の目的は、上記欠点を１リイ消した安（ｉｆｉで
、Ｓ／Ｈの良いデータ収集回路を１７′ｌｉ供すること
にある。
、Ｓ／Ｈの良いデータ収集回路を１７′ｌｉ供すること
にある。
本発明は、Ｓ／Ｎを向上さぜる目的で、各チャンイ・ル
毎に低速のＡＤ変侯器を設置するデータ収集方式におい
て、上記Ａ、Ｄ変換器に４次比較型ＡＤ亥換方式をｉ吏
用し、高速ＤＡ変換器を全チャンネル共通に使用するこ
とにより、回斃の淘単化を図っている。
毎に低速のＡＤ変侯器を設置するデータ収集方式におい
て、上記Ａ、Ｄ変換器に４次比較型ＡＤ亥換方式をｉ吏
用し、高速ＤＡ変換器を全チャンネル共通に使用するこ
とにより、回斃の淘単化を図っている。
以下、本発明の実施例を第３図により説明する。
第３図は、第２図に示す従来の逐次比較型ＡＤ変換器ヲ
マルチチャン不ル用に変更したものである。
マルチチャン不ル用に変更したものである。
第２図は、Ｄｈ変換器２１ｏ、逐次化中文レジスタ２２
０、比較器２３０から成る。逐次比較型ＡＤ変換器は、
入力にアナログ信号Ａ！を加えて、制御信号Ｓにより逐
次比較レジスタの内容をＭＳＢ（最上位ビット）から順
次ＩＩ Ｉ ＩＩを代入していき、ＤＡ変換器２１０の
出力とアナログ信号Ａ−１との大小間係により逐次比・
咬レジスタの内容が決定され、最終的にＤｏからディジ
クル出力が取出されるものである。第３図において、ア
ナログ人力■Ｉ ｒ Ｖ２＋・・・・・・■ゎが印加さ
れ、ディジタル出力ＤＯがル：出される過程を、第４図
のタイミングチャートに従って説明ゴる。最初の１も１
］徂１１信号Ｓ１を受取ると各チャネルの逐次比較レジ
スタの八４ＳＢを１″にして、ディジタルマルチプ１／
クサをチャイルの順に切替えて高速ＤＡ変換器の出力と
アナログ入力信号ｖＩ ＊ ■２＋・・・・・・ｖｎと
を比較し、アナログ入力イー号の方が大きければ、比較
器３３１゜３３２、・・・・・・３３ｎの出力はｔ ｉ
ｎとなり、そうでなければ ｔｔ Ｏｎとなる。これ
らの出力結果は、適法比較レジスタ３２１，３２２．・
・・・・・３２ｎの順序に従ってｈ３８ Ｈに取込すれ
る。取込まれた直後に、逐次比較レジスタ群に制惧伺言
号Ｓ＋が加えられ、このレジスタ群の内容のうち２ビツ
トｏをパ１ｎにする。逐次比較レジスタの出力につなが
ったデイジタルマルチプレクザ３４０において、チャネ
ルの順序に従って、切替信号Ｓ２によりレジスタ出力の
内容を切替えて切替わるごとにただちに、高速ＤＡ変換
器で１）Ａ変換され、比較器で入力信号と大小比較を行
ない、比較結果が逐次比較レジスタの２ビツト目に取込
まれる。チャネル数（ｎ）だけ、ゲイジタルマルチブレ
クザ３４０を切替えて、ＤＡ変換を行ない、入力信号と
比較して、逐次比較レジスタの該当ビットに取込む。
０、比較器２３０から成る。逐次比較型ＡＤ変換器は、
入力にアナログ信号Ａ！を加えて、制御信号Ｓにより逐
次比較レジスタの内容をＭＳＢ（最上位ビット）から順
次ＩＩ Ｉ ＩＩを代入していき、ＤＡ変換器２１０の
出力とアナログ信号Ａ−１との大小間係により逐次比・
咬レジスタの内容が決定され、最終的にＤｏからディジ
クル出力が取出されるものである。第３図において、ア
ナログ人力■Ｉ ｒ Ｖ２＋・・・・・・■ゎが印加さ
れ、ディジタル出力ＤＯがル：出される過程を、第４図
のタイミングチャートに従って説明ゴる。最初の１も１
］徂１１信号Ｓ１を受取ると各チャネルの逐次比較レジ
スタの八４ＳＢを１″にして、ディジタルマルチプ１／
クサをチャイルの順に切替えて高速ＤＡ変換器の出力と
アナログ入力信号ｖＩ ＊ ■２＋・・・・・・ｖｎと
を比較し、アナログ入力イー号の方が大きければ、比較
器３３１゜３３２、・・・・・・３３ｎの出力はｔ ｉ
ｎとなり、そうでなければ ｔｔ Ｏｎとなる。これ
らの出力結果は、適法比較レジスタ３２１，３２２．・
・・・・・３２ｎの順序に従ってｈ３８ Ｈに取込すれ
る。取込まれた直後に、逐次比較レジスタ群に制惧伺言
号Ｓ＋が加えられ、このレジスタ群の内容のうち２ビツ
トｏをパ１ｎにする。逐次比較レジスタの出力につなが
ったデイジタルマルチプレクザ３４０において、チャネ
ルの順序に従って、切替信号Ｓ２によりレジスタ出力の
内容を切替えて切替わるごとにただちに、高速ＤＡ変換
器で１）Ａ変換され、比較器で入力信号と大小比較を行
ない、比較結果が逐次比較レジスタの２ビツト目に取込
まれる。チャネル数（ｎ）だけ、ゲイジタルマルチブレ
クザ３４０を切替えて、ＤＡ変換を行ない、入力信号と
比較して、逐次比較レジスタの該当ビットに取込む。
この動作をＡＤ変棟器の分解能すなわち逐次比較レジス
タのビット数（ｍ）だけ繰返す。以上の繰返しが終了し
た後、データ転送回路３５０を経由して、取出し１言号
Ｓ３０時ｉｌｌにディジタル出力Ｄｏが取出される。第
４図において、制御信号Ｓ１と切替信号Ｓ２と取出し信
号Ｓ３の時間関係を示す。高速ＤＡ変換器３１０の変換
時間ｔｏは、本データ収集回路の収集時間をＴとすると
、し１’、（ｒは、ディジタル画像処理装置への転送時
間を示す。
タのビット数（ｍ）だけ繰返す。以上の繰返しが終了し
た後、データ転送回路３５０を経由して、取出し１言号
Ｓ３０時ｉｌｌにディジタル出力Ｄｏが取出される。第
４図において、制御信号Ｓ１と切替信号Ｓ２と取出し信
号Ｓ３の時間関係を示す。高速ＤＡ変換器３１０の変換
時間ｔｏは、本データ収集回路の収集時間をＴとすると
、し１’、（ｒは、ディジタル画像処理装置への転送時
間を示す。
高速ＤＡ変換器の一実施例を第５図に示す。電流源４１
１．４１２．−−−−＝４１ｍ’（ｒ高速１” Ｅ Ｔ
スイッチ４２１，４２２．・・・・・４２ｍにより切替
えることにより、ディジタル人力］）１ ｒ Ｄ２ ＋
・・川・Ｄ工に応じて、出力電流Ｉｏが決定てれる。そ
の後、電流電圧変換器４４０により、アナログ出方電圧
Ａｏが取出される。ゲート１回路４３１．４３２゜・・
・・・・４３ｍはディジタル入力信号を同速Ｉ” Ｅ
’Ｉ”スイッチ制御信号へ変換する回路である。
１．４１２．−−−−＝４１ｍ’（ｒ高速１” Ｅ Ｔ
スイッチ４２１，４２２．・・・・・４２ｍにより切替
えることにより、ディジタル人力］）１ ｒ Ｄ２ ＋
・・川・Ｄ工に応じて、出力電流Ｉｏが決定てれる。そ
の後、電流電圧変換器４４０により、アナログ出方電圧
Ａｏが取出される。ゲート１回路４３１．４３２゜・・
・・・・４３ｍはディジタル入力信号を同速Ｉ” Ｅ
’Ｉ”スイッチ制御信号へ変換する回路である。
〔発明の効果〕
以上述べたように、本発明によれば、各チャネルがＡＤ
変換機能を持つため、従来のように高速のマルチプレク
サやサンプルホールド回路が不要であり、また高速化の
ために必要な広帯域特性に基づく雑音の増大を避けられ
る等の効果がある。
変換機能を持つため、従来のように高速のマルチプレク
サやサンプルホールド回路が不要であり、また高速化の
ために必要な広帯域特性に基づく雑音の増大を避けられ
る等の効果がある。
第１図は、従来ＯＣＴ装置のデータ収集回路例、第２図
は、従来の逐次比較型ＡＤ変換器、第３図は、本発明に
よるデータ収集回路の実施例、第４図は、タイミングチ
ャートを示す図、第５図は、第３図の高速ＤＡ変換器の
詳細な回路を示す図である。 ｌ・・・Ｘ線検出器、２１〜２ｎ・・・増幅器、３・・
・アナログマルチプｌ／クザ、４・・・サンプルホール
ド回路、５・・・ＡＤ変換器、６・・・画像処理装置、
２１Ｏ・・・Ｄ Ａ変換器、２２０，３２１．・・・・
・・３２ｎ・・・逐次比較レジスタ、２３０，３３１，
３３２．・・・・・・３３ｎ・・・比較器、３１０・・
・高速ＤＡ変換器、３４０・・・ディジタルマルチプレ
クサ、３５０・・・データ転送回路、４１１，４１２．
・・印・４１ｍ・・・電流源、４２１．４２２．・・・
・・・４２ｍ・・・関連ＦＥＴスイッチ、４３１，４３
２．・・・・・・４３ｍ・・・ゲート回路、築１図 罫 ？ 図 ＹＪ３図 不 ４ 図 一一一几一一−−−〜−−−ローー−−−□ｌ ｍ −圧１１−ｕ工一−−−−一ロー ／Ｚ−−−−７１ｌ ２ − − １）ｊゴーシーーーーーーー−一 ■ 夕 図
は、従来の逐次比較型ＡＤ変換器、第３図は、本発明に
よるデータ収集回路の実施例、第４図は、タイミングチ
ャートを示す図、第５図は、第３図の高速ＤＡ変換器の
詳細な回路を示す図である。 ｌ・・・Ｘ線検出器、２１〜２ｎ・・・増幅器、３・・
・アナログマルチプｌ／クザ、４・・・サンプルホール
ド回路、５・・・ＡＤ変換器、６・・・画像処理装置、
２１Ｏ・・・Ｄ Ａ変換器、２２０，３２１．・・・・
・・３２ｎ・・・逐次比較レジスタ、２３０，３３１，
３３２．・・・・・・３３ｎ・・・比較器、３１０・・
・高速ＤＡ変換器、３４０・・・ディジタルマルチプレ
クサ、３５０・・・データ転送回路、４１１，４１２．
・・印・４１ｍ・・・電流源、４２１．４２２．・・・
・・・４２ｍ・・・関連ＦＥＴスイッチ、４３１，４３
２．・・・・・・４３ｍ・・・ゲート回路、築１図 罫 ？ 図 ＹＪ３図 不 ４ 図 一一一几一一−−−〜−−−ローー−−−□ｌ ｍ −圧１１−ｕ工一−−−−一ロー ／Ｚ−−−−７１ｌ ２ − − １）ｊゴーシーーーーーーー−一 ■ 夕 図
Claims (1)
- ■、各チャネルごとにデータを収集する回路において、
高速ＤＡ変換器と複数のアナログ入力信号と上記ＤＡ変
換器とのレベルを比較するための複数の比Ｉ数冊と、該
各比教器の出力を逐次的に取込む複数の逐次比較レジス
タ群と該各逐次比較レジスタＨ゛１′−の出力をチャネ
ルの順序に従って、上記高速ＤＡＣへ入力妊せるディジ
タルマルチプレクサと、上記逐次比較レジスタ群のシフ
トが終了した時点で、上記逐次比奴レジスタ群の内容を
順次読出すための手段とを具備したことを特徴とするデ
ータ収集回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58154881A JPS6048538A (ja) | 1983-08-26 | 1983-08-26 | デ−タ収集回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58154881A JPS6048538A (ja) | 1983-08-26 | 1983-08-26 | デ−タ収集回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6048538A true JPS6048538A (ja) | 1985-03-16 |
Family
ID=15593988
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58154881A Pending JPS6048538A (ja) | 1983-08-26 | 1983-08-26 | デ−タ収集回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6048538A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5360634A (en) * | 1976-11-12 | 1978-05-31 | Canon Inc | Paper feed device |
| JPH04154221A (ja) * | 1990-10-17 | 1992-05-27 | Nec Corp | 逐次比較型ａ／ｄ変換装置 |
-
1983
- 1983-08-26 JP JP58154881A patent/JPS6048538A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5360634A (en) * | 1976-11-12 | 1978-05-31 | Canon Inc | Paper feed device |
| JPH04154221A (ja) * | 1990-10-17 | 1992-05-27 | Nec Corp | 逐次比較型ａ／ｄ変換装置 |
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