JPS6050598A - 電子鍵盤楽器 - Google Patents
電子鍵盤楽器Info
- Publication number
- JPS6050598A JPS6050598A JP58159883A JP15988383A JPS6050598A JP S6050598 A JPS6050598 A JP S6050598A JP 58159883 A JP58159883 A JP 58159883A JP 15988383 A JP15988383 A JP 15988383A JP S6050598 A JPS6050598 A JP S6050598A
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- JP
- Japan
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- output
- circuit
- pitch
- switch group
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、１オクタ一ブ分の各鍵ピッチ微調スイッチ群
と、１オクタ一ブ分の各鍵音量レベル設定スイッチ群を
有し、こｎらの制御にょシ、美しい和音の響きである純
正調の電子楽器を実現することを目的とする。
と、１オクタ一ブ分の各鍵音量レベル設定スイッチ群を
有し、こｎらの制御にょシ、美しい和音の響きである純
正調の電子楽器を実現することを目的とする。
従来、電子楽器においては、いわゆる平均律と呼ばｎる
、簡易型の楽音発生手段を有してい友。
、簡易型の楽音発生手段を有してい友。
ところが、和音として楽器を演奏しｆｃ場合、その音階
の周波数誤差によシ、うな夛を伴なったにごシのある和
音となっていた。
の周波数誤差によシ、うな夛を伴なったにごシのある和
音となっていた。
本発明は、和音として演奏した場合に、各音階の周波数
を微調することによシ、全くうなシの発生しない美しい
響きを実現できるようにしたものである。かつ、和音の
うちの各音にそｎぞｔ独自の音響レベルを設定できるよ
うに構成し、和音の根音に重みを持たせることが可能と
なる工うにする。
を微調することによシ、全くうなシの発生しない美しい
響きを実現できるようにしたものである。かつ、和音の
うちの各音にそｎぞｔ独自の音響レベルを設定できるよ
うに構成し、和音の根音に重みを持たせることが可能と
なる工うにする。
以下、図面に従って本発明の詳細な説明をする。第１図
は本発明の電子楽器外観図である。
は本発明の電子楽器外観図である。
１は５鍵の鍵盤、２は５個の鍵盤ＬＥＤ、３は楽音ピッ
チ微調用の３２ポジシヨンロータリスイツチであシ、４
は音量レベル設定用の８ポジシヨンスライドスイツチで
ある。ロータリスイッチ３とスライドスイッチ４は１オ
クタ一ブ分（１２個〕用意さｎ１各音名に応じてそｎ（
′：ｎ、独立設定できる次に第２図以降によ）本発明の
具体例を示す。
チ微調用の３２ポジシヨンロータリスイツチであシ、４
は音量レベル設定用の８ポジシヨンスライドスイツチで
ある。ロータリスイッチ３とスライドスイッチ４は１オ
クタ一ブ分（１２個〕用意さｎ１各音名に応じてそｎ（
′：ｎ、独立設定できる次に第２図以降によ）本発明の
具体例を示す。
第２図は、不発明のブロック図でおる。
（至）は鍵盤、２１はロータリースイッチ群、２２はス
ライドスイッチ群、２３はキーアサイナ部、冴はピッチ
ＲＯＭ、２５は鍵盤ＬＥＤ駆動回路、あはオクターブシ
フト回路、２７は波形走立レジスタ、２８は波形メモリ
、２９はピッチシフトレジスタ、初ハ音量レベルレジス
ター３１はエンベロープ回ｍ、３２は乗算回路、３３は
Ｄ−ｉ変換回路である。
ライドスイッチ群、２３はキーアサイナ部、冴はピッチ
ＲＯＭ、２５は鍵盤ＬＥＤ駆動回路、あはオクターブシ
フト回路、２７は波形走立レジスタ、２８は波形メモリ
、２９はピッチシフトレジスタ、初ハ音量レベルレジス
ター３１はエンベロープ回ｍ、３２は乗算回路、３３は
Ｄ−ｉ変換回路である。
鍵盤加はキーアサイナ部おへ、ロータリースイッチ群２
１はピッチシフトレジスタ２９へ、スライドスイッチ群
ηは音量レベルレジスタ加へそｎぞｎ接続さｎ１キ一ア
サイナ部３０出カ（ＢＲＯ〜３で示すンは鍵盤ＬＥＤ駆
動回路５とピッチＲＯＭ２４のそｎぞｎの入力端へ接続
さｎる。ピッチシフトレジスタ２９の出力（Ｐ工。〜４
で示す）はピッチＲＯＭ２４の入力端へピッチＲＯＭ２
４の出力（ＰＸ０〜１１で示す〕はオクターブシフト回
路あの入力端へ、オクターブシフト回路あの出方（ＳＦ
’ｌ’θ〜７で示す）は波形走査レジスタｎの入力端へ
、波形走査レジスタｎの出力ｃｗｏ、−Ｗ７で示す〕は
波形メモリ２８の入力端へそｎぞｒｔｎ接続ｎる。波形
メモＩＪ ２８の出方は乗算回路３２の一方の入力端へ
、音量レベルレジスタ（至）の出力（ＲｉＶＱ〜２で示
す）はエンベロープ回路３１０入カ端へ、エンベロープ
回路３１の出力（ＥＤ□〜７で示す〕は乗算回路３２の
他の一方の入力端へ、乗算回路３２の出力はＩ）−Ａ変
換回路３３の入力端へそｎぞｎ接続さｎる。
１はピッチシフトレジスタ２９へ、スライドスイッチ群
ηは音量レベルレジスタ加へそｎぞｎ接続さｎ１キ一ア
サイナ部３０出カ（ＢＲＯ〜３で示すンは鍵盤ＬＥＤ駆
動回路５とピッチＲＯＭ２４のそｎぞｎの入力端へ接続
さｎる。ピッチシフトレジスタ２９の出力（Ｐ工。〜４
で示す）はピッチＲＯＭ２４の入力端へピッチＲＯＭ２
４の出力（ＰＸ０〜１１で示す〕はオクターブシフト回
路あの入力端へ、オクターブシフト回路あの出方（ＳＦ
’ｌ’θ〜７で示す）は波形走査レジスタｎの入力端へ
、波形走査レジスタｎの出力ｃｗｏ、−Ｗ７で示す〕は
波形メモリ２８の入力端へそｎぞｒｔｎ接続ｎる。波形
メモＩＪ ２８の出方は乗算回路３２の一方の入力端へ
、音量レベルレジスタ（至）の出力（ＲｉＶＱ〜２で示
す）はエンベロープ回路３１０入カ端へ、エンベロープ
回路３１の出力（ＥＤ□〜７で示す〕は乗算回路３２の
他の一方の入力端へ、乗算回路３２の出力はＩ）−Ａ変
換回路３３の入力端へそｎぞｎ接続さｎる。
キーアサイナ部ｚ３で鍵盤加の押鍵状態を検知し、鍵盤
ＬＥＤ駆動回路δへ該当鍵盤コードを転送する。また、
キーアサイナ部るの出力ＢＲＱ〜３は、押鍵さ′ｎた音
名コードを表わし、ピッチＲＯＭ２４に、どのキーが押
さｎｙｃがを伝える。
ＬＥＤ駆動回路δへ該当鍵盤コードを転送する。また、
キーアサイナ部るの出力ＢＲＱ〜３は、押鍵さ′ｎた音
名コードを表わし、ピッチＲＯＭ２４に、どのキーが押
さｎｙｃがを伝える。
ピッチシフトレジスタ四は、ロータリースイッチ群２工
の中がら押鍵に対応した音名のスイッチデータを読み込
み、ピッチＲＯＭ ２４を制御する。ピッチＲＯＭ２４
は押鍵さ′ｎた音名コードと該当する。−ｐリ−スイッ
チデータに応じて所定のデータをオクターブシフト回路
部へ転送する。オクターブシフト回路がでは所定のオク
ターブに応じてピッチＲＯＭ２４（７）出力（ＰＸ ０
−ＰＸＩＩ） ｔ−ヒラ）シフトし、こｌｒＬヲ波形走
査レジスタがへ転送する。波形走査レジスタｎは、８Ｆ
ＴＱ〜７の信号を累積加算し、その出力結果にょ多波形
メモリ２８′ｆｔ：アクセスする。
の中がら押鍵に対応した音名のスイッチデータを読み込
み、ピッチＲＯＭ ２４を制御する。ピッチＲＯＭ２４
は押鍵さ′ｎた音名コードと該当する。−ｐリ−スイッ
チデータに応じて所定のデータをオクターブシフト回路
部へ転送する。オクターブシフト回路がでは所定のオク
ターブに応じてピッチＲＯＭ２４（７）出力（ＰＸ ０
−ＰＸＩＩ） ｔ−ヒラ）シフトし、こｌｒＬヲ波形走
査レジスタがへ転送する。波形走査レジスタｎは、８Ｆ
ＴＱ〜７の信号を累積加算し、その出力結果にょ多波形
メモリ２８′ｆｔ：アクセスする。
音量レベルレジスタ恥は、スライドスイッチ群乙の中か
ら押鍵に対応した音名のスイッチデータを読み込み、エ
ンベロープ回路のエンベロープ立ち上シレペルを制御す
る。
ら押鍵に対応した音名のスイッチデータを読み込み、エ
ンベロープ回路のエンベロープ立ち上シレペルを制御す
る。
次に、第３図と第４図にょ夛楽音周波数の微調方式を説
明する。
明する。
第３図はピッチＲＯＭ２４の出力に応じて波形メモリ器
がどのようにして読み出さｎるがを説明する、波形読み
出しブロック図の詳細図であり、がαはレジスタＡｓ
２ｙ ｂはレジスタＢ、２７ｃはフルアダーＡ、Ｚ７ｄ
はフルアダーＢである。
がどのようにして読み出さｎるがを説明する、波形読み
出しブロック図の詳細図であり、がαはレジスタＡｓ
２ｙ ｂはレジスタＢ、２７ｃはフルアダーＡ、Ｚ７ｄ
はフルアダーＢである。
オクターブシフト回路部の出力（Ｓ Ｔ ＩＦ Ｑ〜７
）ｔｆ、フルアダーＡ２７（ＨのＢ系列入力端へ、レジ
スタＡ ２７ ａのＱ出方群はフルアダーＡ ２７ ｃ
のＡ系列入力端へ、フルアダーＡ２７ｃの加算出力（Ｅ
ｉ’ｌ〜ｓ７）はレジスタＡ２７αのＤ入力系列へ接続
さｎる。
）ｔｆ、フルアダーＡ２７（ＨのＢ系列入力端へ、レジ
スタＡ ２７ ａのＱ出方群はフルアダーＡ ２７ ｃ
のＡ系列入力端へ、フルアダーＡ２７ｃの加算出力（Ｅ
ｉ’ｌ〜ｓ７）はレジスタＡ２７αのＤ入力系列へ接続
さｎる。
フルアダーＡ ２７ ｃのｃｏ出力はフルアダーＢ２７
ｄのａ６入力端へ、フルアダーＢ２７ｄのＢ系列入力端
はすべてＧＮＤ接地へ、レジスタＢ ２７ ｂのＱ出力
群はフルアダーＢ２７ｄのＡ系列入力端と波形メモリあ
の了ドレス入力端へ、フルアダーＢ ２７ ｄの刃口算
出力（８１〜８１３）はレジスタＢ ２７ ｂのＤ入力
端へそｎぞｎ接続さ扛る。
ｄのａ６入力端へ、フルアダーＢ２７ｄのＢ系列入力端
はすべてＧＮＤ接地へ、レジスタＢ ２７ ｂのＱ出力
群はフルアダーＢ２７ｄのＡ系列入力端と波形メモリあ
の了ドレス入力端へ、フルアダーＢ ２７ ｄの刃口算
出力（８１〜８１３）はレジスタＢ ２７ ｂのＤ入力
端へそｎぞｎ接続さ扛る。
レジスタＡ ２７αとレジスタＢ２７ｂ１１：ｒ、、フ
ルアダー Ａ ２７ ＧとフルアダーＢ ２７ ｄの働
きにより、オクターブシフト回路２６の出力を累積加算
する。この刀口算要素は、楽音周波数の微調に応じて、
そのデータ骨が制御さｎている。
ルアダー Ａ ２７ ＧとフルアダーＢ ２７ ｄの働
きにより、オクターブシフト回路２６の出力を累積加算
する。この刀口算要素は、楽音周波数の微調に応じて、
そのデータ骨が制御さｎている。
第４図に、波形メモリ四の読み出しタイミングを示す。
第４＠）図は、たとえば力ｎ算要素（ＥＩＦ’ＴＯ〜７
）がデータ２の場合の例で、第４の）図は、刀口算要素
がデータ３の場合の例である。
）がデータ２の場合の例で、第４の）図は、刀口算要素
がデータ３の場合の例である。
ｆｉｔ）ち、ピッチＲＯＭ２４の出力（ＰｘＯ〜１１〕
あるいはオクターブシフト回路あの出力（ｓＦＴＯ〜７
〕のデータがわずかに異なると、その差が累積加算さし
、第４（→と第４（ｂ）■に示すような楽音波形のピッ
チ差となって表わｎる。この時、第３図に示す全回路は
、同一のシステムクロック信号によシ同期して動作して
いることが必要である。そして、楽音周波数の微調のた
め、７１ＩＩ算要素はレジスタＡ２７αへ加えら扛、波
形メモリあのアドレス走査はレジスタＢ２７ｂの出方に
よっている。このように、波形メモリあのアドレス走査
が、非常にわずかずつ微調さｔているため、楽音の最小
セント分解能は１セントというような微調も可能である
。
あるいはオクターブシフト回路あの出力（ｓＦＴＯ〜７
〕のデータがわずかに異なると、その差が累積加算さし
、第４（→と第４（ｂ）■に示すような楽音波形のピッ
チ差となって表わｎる。この時、第３図に示す全回路は
、同一のシステムクロック信号によシ同期して動作して
いることが必要である。そして、楽音周波数の微調のた
め、７１ＩＩ算要素はレジスタＡ２７αへ加えら扛、波
形メモリあのアドレス走査はレジスタＢ２７ｂの出方に
よっている。このように、波形メモリあのアドレス走査
が、非常にわずかずつ微調さｔているため、楽音の最小
セント分解能は１セントというような微調も可能である
。
次に、第５図と第６因によシ、デジタル的に音量レベル
を調整する方式について述べる。デジタル的に、かつ各
鍵独立に音量を調整する方法としては、エンベロープ回
路３１のエンベロープデータを制限すｎば、乗算回路３
２の出力はそ扛に比例して制限さする。
を調整する方式について述べる。デジタル的に、かつ各
鍵独立に音量を調整する方法としては、エンベロープ回
路３１のエンベロープデータを制限すｎば、乗算回路３
２の出力はそ扛に比例して制限さする。
第５図はエンベロープ回路まわシの詳細図である。５１
は一致回路でめシ、５２はエンベロープレジスタでおシ
、５３はハーフアダーであシ、５４はアンド回路で必る
。
は一致回路でめシ、５２はエンベロープレジスタでおシ
、５３はハーフアダーであシ、５４はアンド回路で必る
。
ｉｆ＆レベルレジスタ関の出力（ｕｖＯ〜７〕は一致回
路５１の一方の入力端へ、エンベロ−プデータ５２の出
力群（Ｑ、 Ｏ−Ｑ ７）は、ハーフアダー５３のＡ系
列入力端と一致回路５１の他の一方の入力端へそ扛ぞｎ
接続さｎｌこ扛はＢＤθ〜７で示さ扛るエンベロープデ
ータである。ハーフアダー５３の出力（８０〜７〕はエ
ンベロープレジスタ５２のＤ入力端子群へ接続さｎる。
路５１の一方の入力端へ、エンベロ−プデータ５２の出
力群（Ｑ、 Ｏ−Ｑ ７）は、ハーフアダー５３のＡ系
列入力端と一致回路５１の他の一方の入力端へそ扛ぞｎ
接続さｎｌこ扛はＢＤθ〜７で示さ扛るエンベロープデ
ータである。ハーフアダー５３の出力（８０〜７〕はエ
ンベロープレジスタ５２のＤ入力端子群へ接続さｎる。
−数回路５１の出力はアンド回路５４の一方の入力端へ
、アンド回路５４の他の一方の入力端へは、ＥＯＫで示
すエンベロープレジスタ加算信号がそｎぞｎ接続さし、
アンド回路５４の出力はハーフアダー５３のａ６入力端
へ接続さｎる。
、アンド回路５４の他の一方の入力端へは、ＥＯＫで示
すエンベロープレジスタ加算信号がそｎぞｎ接続さし、
アンド回路５４の出力はハーフアダー５３のａ６入力端
へ接続さｎる。
通常、−数回路５１の出力はレベル「Ｈ」でらシ、エン
ベロープレジスタ５２はＷＯＫ信号によシ加算さｎる。
ベロープレジスタ５２はＷＯＫ信号によシ加算さｎる。
そして、エンベロープレジスタ５２の出力が音七゛レベ
ルレジスタＩの内容と一致した時、−数回路５１の出力
がレベル「０」とな力、エンベロープレジスタ５２の加
算を停止する。
ルレジスタＩの内容と一致した時、−数回路５１の出力
がレベル「０」とな力、エンベロープレジスタ５２の加
算を停止する。
このタイミングを第６図に示す。鍵盤が押さｒＬｆｃ時
、エンベロープレジスタは序々にカウントアツプをする
。そして、たとえば、第６図のｃＬ３で示すポイントで
一致回路５１が一致検出したとすｒば、そのポイントで
カウントを停止する。この停止するポイントは音量レベ
ルレジスタ園の内容によって決定さｎる。結果的に、ス
ライドスイッチ（音量レベル設定用〕のデータはエンベ
ロープレジスタのカウントを制限し、音量レベルを制限
する０ 以上説明したように、本発明を実現すｔば、自由自在な
和音を発生することができ、和音の学習あるいは正確な
音合わせに使用できる。また、楽音周波数の微調に、Ｌ
Ｏ発振を使わず水晶発振素子を応用すｎば、調整のいら
ない生産性の高い電子鍵盤楽器を提供することができる
。
、エンベロープレジスタは序々にカウントアツプをする
。そして、たとえば、第６図のｃＬ３で示すポイントで
一致回路５１が一致検出したとすｒば、そのポイントで
カウントを停止する。この停止するポイントは音量レベ
ルレジスタ園の内容によって決定さｎる。結果的に、ス
ライドスイッチ（音量レベル設定用〕のデータはエンベ
ロープレジスタのカウントを制限し、音量レベルを制限
する０ 以上説明したように、本発明を実現すｔば、自由自在な
和音を発生することができ、和音の学習あるいは正確な
音合わせに使用できる。また、楽音周波数の微調に、Ｌ
Ｏ発振を使わず水晶発振素子を応用すｎば、調整のいら
ない生産性の高い電子鍵盤楽器を提供することができる
。
第１図は本発明の外観図、８２図は本発明のブロック図
−１第３図は波形走査レジスタの詳細図、第４図は第３
図におけるタイミング説明図、第５図はエンベロープ回
路の詳細図、第６図は第５図におけるタイミング説明図
である。 １゜。鍵盤 ２゜。鍵盤ＬＥＤ ３゜。ロータリスイッチ ４６゜スライドスイッチ 加。。鍵盤２１．、。ロータリスイッチ群２２゜。スラ
イドスイッチ群 田。。キーアサイナ部 ス。。ピッチＲＯＭ５゜。鍵盤
Ｔ−ＩＥＤ駆動回路 ２６、。オクターブシフト回路 ２７゜。波形走査レジスタ 詔。。波形メモリ ２９゜。ピッチシフトレジスタ （２）。。音量レベルレジスタ ３１、。エンベロープ回路 ３２１０乗算回路 ３３ 、 、 Ｄ −Ａ変換回路２
７α、’ｚｚｂ、、レジスタ ２７ｃ、９７ｄ、。フルアダー ５１゜。一致回路 ５２６．エンベロープレジスタ ５３、。ハーフアダー ５４゜。アンド回路 以上 出願人 株式会社第二精工舎 代理人 弁理士最上 務
−１第３図は波形走査レジスタの詳細図、第４図は第３
図におけるタイミング説明図、第５図はエンベロープ回
路の詳細図、第６図は第５図におけるタイミング説明図
である。 １゜。鍵盤 ２゜。鍵盤ＬＥＤ ３゜。ロータリスイッチ ４６゜スライドスイッチ 加。。鍵盤２１．、。ロータリスイッチ群２２゜。スラ
イドスイッチ群 田。。キーアサイナ部 ス。。ピッチＲＯＭ５゜。鍵盤
Ｔ−ＩＥＤ駆動回路 ２６、。オクターブシフト回路 ２７゜。波形走査レジスタ 詔。。波形メモリ ２９゜。ピッチシフトレジスタ （２）。。音量レベルレジスタ ３１、。エンベロープ回路 ３２１０乗算回路 ３３ 、 、 Ｄ −Ａ変換回路２
７α、’ｚｚｂ、、レジスタ ２７ｃ、９７ｄ、。フルアダー ５１゜。一致回路 ５２６．エンベロープレジスタ ５３、。ハーフアダー ５４゜。アンド回路 以上 出願人 株式会社第二精工舎 代理人 弁理士最上 務
Claims (1)
- Ｉａ盤と、該鍵盤の状態を検出するキーアサイナ部と、
楽音周波数ピッチを６鍵に対して独立に微調する第１の
スイッチ群と、楽音出力の音量レベルを６鍵に対して独
立に、かつデジタル的に設定する第２のスイッチ群と、
前記第１のスイッチ群および鍵盤の出力が入力さ肛るピ
ッチＲＯＭと、前記ピッチＲＯＭに接続さｎ７ｃオクタ
一ブシフト回路と、前記オクターブシフト回路に接続さ
ｎｆｃ波形走査レジスタと、前記波形走査レジスタに接
続され該波形走査レジスタの計数内容に従ってデータが
読み出さｎる波形メモリと、前記第２のスイッチ群に接
続さｎた音量レベルレジスタに接続さｎたエンベロープ
回路と、前記波形メモリの出力と前記エンベロープ回路
の出力をデジタル乗算回路と、該乗算回路の出力をＤ−
Ａ変換回路と、前記キーアサイナの出力に応じて所定の
鍵盤１．ｌ１ｆＤを駆動する鍵盤ＬＥＤ駆動回路とがら
なハ前記ピッチＲＯＭは前記キーアサイナと前記第１の
スイッチ群の出力によって所定のデータを発生し、前記
ピッチＲＯＭの出方は前記波形走査レジスタへ累積加算
さハ前記波形走査レジスタの出力は前記波形メモリのア
ドレスをアクセスし、前記エンベロープ回路は前記第２
のスイッチ群にょシ制御さ扛ることにょシ、前記第１の
スイッチ群の制御に応じて楽音周波数を各鍵独立に微胆
ｉ整し、かつ前記第２のスイッチ・群の制御に応じて楽
音信号の音量レベルを各鍵独立に設定することｆ、特徴
とする電子鍵盤楽器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58159883A JPS6050598A (ja) | 1983-08-30 | 1983-08-30 | 電子鍵盤楽器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58159883A JPS6050598A (ja) | 1983-08-30 | 1983-08-30 | 電子鍵盤楽器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6050598A true JPS6050598A (ja) | 1985-03-20 |
Family
ID=15703269
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58159883A Pending JPS6050598A (ja) | 1983-08-30 | 1983-08-30 | 電子鍵盤楽器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6050598A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60178493A (ja) * | 1984-02-27 | 1985-09-12 | ヤマハ株式会社 | 電子楽器 |
| JPS63137296A (ja) * | 1987-01-17 | 1988-06-09 | ヤマハ株式会社 | 電子楽器 |
-
1983
- 1983-08-30 JP JP58159883A patent/JPS6050598A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60178493A (ja) * | 1984-02-27 | 1985-09-12 | ヤマハ株式会社 | 電子楽器 |
| JPS63137296A (ja) * | 1987-01-17 | 1988-06-09 | ヤマハ株式会社 | 電子楽器 |
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