JPS6057767B2 - amplifier circuit - Google Patents

amplifier circuit

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JPS6057767B2
JPS6057767B2 JP54077342A JP7734279A JPS6057767B2 JP S6057767 B2 JPS6057767 B2 JP S6057767B2 JP 54077342 A JP54077342 A JP 54077342A JP 7734279 A JP7734279 A JP 7734279A JP S6057767 B2 JPS6057767 B2 JP S6057767B2
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JP
Japan
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transistor
voltage
resistor
emitter
reference voltage
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JP54077342A
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Japanese (ja)
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JPS561603A (en
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雅晴 森田
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Panasonic Holdings Corp
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Matsushita Electric Industrial Co Ltd
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    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03FAMPLIFIERS
    • H03F3/00Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements
    • H03F3/04Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements with semiconductor devices only

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  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Amplifiers (AREA)

Description

【発明の詳細な説明】 本発明は増幅回路に係り、特に惑磁素子であるホール
素子の出力を増幅する増幅回路に関するものてあり、優
れた減電圧特性を持つ増幅回路を提供せんとすることに
ある。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to an amplifier circuit, and more particularly to an amplifier circuit for amplifying the output of a Hall element, which is a magnetizing element, and an object of the present invention is to provide an amplifier circuit with excellent voltage reduction characteristics. It is in.

従来より、テープレコーダにおけるリール台の回転検
出やレコードプレヤーにおけるターンテーブル駆動モー
タの回転検出等、各種の回転検出にホール効果を利用し
た感磁素子いわゆるホール素子が用いられている。
2. Description of the Related Art Conventionally, a magnetic sensing element, a so-called Hall element, which utilizes the Hall effect, has been used to detect various rotations, such as detecting the rotation of a reel stand in a tape recorder and detecting the rotation of a turntable drive motor in a record player.

このホール素子の出力交流信号を増幅する増幅回路とし
ては種々のものが提供されているが、これらのものはい
ずれも動作電”源電圧として高電圧が必要であつたり、
減電圧時にオフセット電圧によりホール素子の出力信号
が影響され易い等の不都合な点を有していた。ホール素
子のオフセット電圧とは増幅回路の出力直流電圧の不平
衝電圧であり、増幅回路の出力直流電、圧は上記オフセ
ット電圧に増幅回路の増幅度をかけた値となる。従つて
、オフセット電圧に対してホール素子の出力交流信号電
圧が充分大きくないと、増幅回路の出力端はオフセット
により影響をうけ、上記交流信号を伝達しえなくなる。
よつて直流カットをコンデンサで行ない、その後、増幅
することが、電圧の低いホール素子用増幅回路では一般
的に行なわれている。かかる従来の増幅回路を第1図を
用いて説明すると、1〜3はPNPトランジスタ、4〜
9はNPNトランジスタ、10,11はダイオード、1
2〜16は抵抗、17はホール素子(トランジスタ4,
5のベースが接続されているのが出力端子)、18はコ
ンデンサ、19は電源、20は増幅回路の出力端子、2
1は電源端子、22は接地端子である。トランジスタ4
,5は差動増幅器を構成しており、トランジスタ3は増
幅用のもの、トランジスタ6はエミッタフォロア回路を
構成している。抵抗12,13は等しい抵抗値のもので
あり、抵抗14でトランジスタ6のエミッタからトラン
ジスタ5のエミッタに帰還をかけ、端子20の出力直流
電圧をトランジスタ5のエミッタ電圧と等しい電圧にな
るよう設定している。ダイオード10,11トランジス
タ7〜9は電流源を構成している。トランジスタ4,5
のエミッタ電圧は112Vcc−■BE(■。。電源電
圧、VBE;トランジスタのベース●エミッタ間電圧)
となり、出力直流電圧も同り値となる。従つて、電源電
圧■ェが2VBEになつたとき、出力直流電圧はν×2
VI3。−■BOからゼロとなり、減電圧特性がわるく
てホール素子17のオフセット電圧■。9が出力端20
に現われることを考慮すると、この増幅回路の正常動作
を可能とする下限の電源電圧は2VBE+VOff以上
少くとも必要となる。
Various types of amplifier circuits are available for amplifying the output AC signal of the Hall element, but all of these require a high voltage as the operating power supply voltage.
This has disadvantages such as the fact that the output signal of the Hall element is easily affected by the offset voltage when the voltage is reduced. The offset voltage of the Hall element is an unbalanced voltage of the output DC voltage of the amplifier circuit, and the output DC voltage and voltage of the amplifier circuit are the values obtained by multiplying the offset voltage by the amplification degree of the amplifier circuit. Therefore, if the output AC signal voltage of the Hall element is not sufficiently large with respect to the offset voltage, the output end of the amplifier circuit will be affected by the offset and will not be able to transmit the AC signal.
Therefore, it is common practice in low voltage Hall element amplifier circuits to cut off the direct current using a capacitor and then amplify it. To explain such a conventional amplifier circuit using FIG. 1, 1 to 3 are PNP transistors, and 4 to 3 are PNP transistors.
9 is an NPN transistor, 10 and 11 are diodes, 1
2 to 16 are resistors, 17 is a Hall element (transistor 4,
The base of 5 is connected to the output terminal), 18 is the capacitor, 19 is the power supply, 20 is the output terminal of the amplifier circuit, 2
1 is a power supply terminal, and 22 is a ground terminal. transistor 4
, 5 constitute a differential amplifier, transistor 3 is for amplification, and transistor 6 constitutes an emitter follower circuit. Resistors 12 and 13 have the same resistance value, and resistor 14 applies feedback from the emitter of transistor 6 to the emitter of transistor 5, and the output DC voltage of terminal 20 is set to be equal to the emitter voltage of transistor 5. ing. Diodes 10, 11 and transistors 7-9 constitute a current source. Transistors 4, 5
The emitter voltage of is 112Vcc-■BE (■.Power supply voltage, VBE; transistor base-emitter voltage)
Therefore, the output DC voltage also has the same value. Therefore, when the power supply voltage A becomes 2VBE, the output DC voltage is ν×2
VI3. -■ The offset voltage of the Hall element 17 becomes zero due to BO and poor voltage reduction characteristics. 9 is the output end 20
Taking into consideration that this occurs, the lower limit power supply voltage that enables normal operation of this amplifier circuit needs to be at least 2VBE+Voff or more.

本発明は上記欠点を改善したものであり、その一実施例
をその具体回路を示す第2図とこの回路の等価回路を示
す第3図と共に説明する。
The present invention has improved the above-mentioned drawbacks, and one embodiment thereof will be described with reference to FIG. 2 showing a specific circuit thereof and FIG. 3 showing an equivalent circuit of this circuit.

なお第2図、第3図中、第1図と同一構成部分には同一
番号を発明の詳細な説明を省略する。第2図にお.いて
23〜27はPNPトランジスタ、28,33はダイオ
ード、29〜32はNPNトランジスタ、34〜43は
抵抗である。次にこの第2図の回路を等価的に示した第
3図で、44,45は抵抗34を含めたホール素子17
の等価抵抗、46はトランジスタ23〜25,30,3
1とダイオード33、抵抗39,40で構成される電流
源 ■Bεで、これは(2+n)TCn
;任意数、■BE;トランジスタ31のベース●エミッ
タ間電圧、R:抵抗値〕なる電流を供給する。
Note that in FIGS. 2 and 3, the same components as those in FIG. In Figure 2. 23 to 27 are PNP transistors, 28 and 33 are diodes, 29 to 32 are NPN transistors, and 34 to 43 are resistors. Next, in FIG. 3 which equivalently shows the circuit of FIG. 2, 44 and 45 are Hall elements 17 including the resistor 34.
equivalent resistance, 46 is the transistors 23 to 25, 30, 3
1, diode 33, and resistors 39 and 40 ■Bε, which is (2+n)TCn
; Arbitrary number, ■BE: voltage between the base and emitter of the transistor 31, R: resistance value] is supplied.

47はトランジスタ29と抵抗37で構成される電流源
、48はダイオード28と抵抗36で構成される電流吸
VBEい込み源でいずれも]「なる一定
の電流を流す。
47 is a current source composed of a transistor 29 and a resistor 37, and 48 is a current absorber composed of a diode 28 and a resistor 36.
In any case, a constant current flows through the VBE intrusion source.

なお抵抗35,43の係は抵抗43の値をrとすると抵
抗35は(1+n)rなる値に設定し、抵抗38は?に
設定される。またトランジスタ26,27は差動増幅器
を構成し、トランジスタ32は増幅用のもの、ダイオー
ド28、トランジスタ29、抵抗36,37はコモンモ
ードリジエクシヨンを良くするためのカレントミラー負
荷であ・る。上記実施例においてトランジスタ30のコ
レクタ電流1は簀=〔R39;抵抗39の値〕となり、
トランジスタ26,27よりなる差動増幅器に供゛給す
る電流源46からの電流は31となる。
Regarding the resistors 35 and 43, if the value of the resistor 43 is r, the resistor 35 is set to a value of (1+n)r, and the resistor 38 is set to a value of (1+n)r. is set to Further, transistors 26 and 27 constitute a differential amplifier, transistor 32 is for amplification, and diode 28, transistor 29, and resistors 36 and 37 are current mirror loads for improving common mode resilience. In the above embodiment, the collector current 1 of the transistor 30 is equal to [R39; the value of the resistor 39],
The current from the current source 46 supplied to the differential amplifier composed of transistors 26 and 27 is 31.

抵抗35の値を抵抗43の2倍に設定すると、抵抗43
に流れる電流は抵抗35に流れる電流の2倍となる。し
かるにトランジスタ26,27が差動増幅器を構成して
いるのでこれら両トランジスタ26,27は同一電流を
流そうと作用し、このため帰還抵抗38にはIなる電流
が流れる。この時、抵抗38を抵抗39と等しい値にす
れば抵抗38の電圧降下は■B5となる。よつてトラン
ジスタ26,27のベース電圧弓■。〔■。。;電源電
圧〕とするとトランジスタ27のエミッタ電圧はνVc
O+■BO〔■圭;トランジスタ27のベース●エミッ
タ間電圧〕となり、これが抵抗38の電圧降下VBEを
うけて出力端20に現われるため、出力直流電圧はム■
。となる。同様にトランジスタ26,27のベース電圧
を侍■。CN;任意数〕とすれば出力直流電圧は青Vc
Oとなる。そして電源電圧Vccが2VBEの時には端
子20からの直流出力電圧はVBEとなり、ホール素子
17のオフセット電圧■。Ffが■。Ffく■BEであ
れば確実にホール素子17の交流出力を増幅して取出し
得る。ホール素子17に直列に抵抗34を接続すること
により、たとえばRvccとすれば電源電圧■。が2V
BBのときトランジスタ27のエミッタ電圧は(VBB
となり六VBOだけ減電圧特性が改善される。上記実施
例では差動増幅器をPNPトランジスタで構成したが、
これはNPNトランジスタで構成しても同様であること
は言うまでもない。以上説明したように本発明の増幅回
路によれば簡単な回路構成で減電圧特性を改善でき、こ
れをホール素子の出力交流信号増幅に用いれば上記出力
信号を確実に増幅することができる。
If the value of resistor 35 is set to twice that of resistor 43,
The current flowing through the resistor 35 is twice the current flowing through the resistor 35. However, since the transistors 26 and 27 constitute a differential amplifier, both transistors 26 and 27 act to cause the same current to flow, so that a current I flows through the feedback resistor 38. At this time, if the resistor 38 is set to the same value as the resistor 39, the voltage drop across the resistor 38 will be B5. Therefore, the base voltage of transistors 26 and 27 is . [■. . ; power supply voltage], the emitter voltage of the transistor 27 is νVc
O+■BO [■Kei; base-emitter voltage of transistor 27], which appears at the output terminal 20 after receiving the voltage drop VBE of the resistor 38, the output DC voltage becomes M■
. becomes. Similarly, set the base voltage of transistors 26 and 27. CN; any number], the output DC voltage is blue Vc
It becomes O. When the power supply voltage Vcc is 2VBE, the DC output voltage from the terminal 20 is VBE, and the offset voltage of the Hall element 17 is . Ff is ■. If Ff×BE, the AC output of the Hall element 17 can be reliably amplified and taken out. By connecting the resistor 34 in series with the Hall element 17, for example, if Rvcc, the power supply voltage ■. is 2V
When BB, the emitter voltage of transistor 27 is (VBB
Therefore, the voltage reduction characteristics are improved by 6 VBO. In the above embodiment, the differential amplifier was composed of PNP transistors, but
Needless to say, this is the same even if it is configured with NPN transistors. As explained above, according to the amplifier circuit of the present invention, the reduced voltage characteristics can be improved with a simple circuit configuration, and if this is used to amplify the output AC signal of the Hall element, the output signal can be reliably amplified.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来の増幅回路を示す回路図、第2図は本発明
の一実施例における増幅回路を示す回路図、第3図はそ
の等価回路図である。 20・・・・・・出力端、26・・・・・・(第2の)
トランジスタ、27・・・・・・(第1の)トランジス
タ、32・・・・・・(第3の)トランジスタ、35・
・・・・(第2の)抵抗、38・・・・・・(第3の)
抵抗、43・・・・・・(第1の)抵抗。
FIG. 1 is a circuit diagram showing a conventional amplifier circuit, FIG. 2 is a circuit diagram showing an amplifier circuit according to an embodiment of the present invention, and FIG. 3 is an equivalent circuit diagram thereof. 20... Output end, 26... (second)
Transistor, 27... (first) transistor, 32... (third) transistor, 35...
...(second) resistance, 38...(third)
Resistor, 43... (first) resistor.

Claims (1)

【特許請求の範囲】 1 (1/N)V_c_c〔N:任意数、V_c_c:
電源電圧〕の電圧を差動増幅器を構成する第1、第2の
トランジスタの各ベースに印加するとともに入力信号を
前記各ベース間に印加し、上記第1のトランジスタのエ
ミッタにになる値の第1の抵抗の一端を接続し、上記第
2のトランジスタのエミッタに(1+n)r〔n;任意
数〕なる第2の抵抗の一端を接続し、上記第1、第2の
抵抗の他端を共通接続すると共にI=(2+n)・V_
B_E/R〔V_B_E:電流源を構成するトランジス
タのベース・エミッタ間電圧〕なる電流源を接続し、上
記第2のトランジスタのコレクタを第1の負荷を通して
第1の基準電圧点に接続し、第1のトランジスタのコレ
クタを第2の負荷を通して上記第1の基準電圧点に接続
しさらにこのコレクタを第3のトランジスタのベースに
接続し、この第3のトランジスタのエミッタを第1の基
準電圧点に接続し、この第3のトランジスタのコレクタ
を第3の負荷を通じてV_c_cが印加された第2の基
準電圧点に接続し、上記第1のトランジスタのエミッタ
と上記第3のトランジスタのコレクタをR/nなる値の
第3の抵抗を介して接続するとともに、この第3のトラ
ンジスタのコレクタを出力端としたことを特徴とする増
幅回路。 2 差動増幅器を構成する第1、第2のトランジスタの
ベースをホール素子の第1、第2の出力端子に接続し、
このホール素子の第3の端子を第2の基準電圧点に、第
4の端子を第1の基準電圧点に接続したことを特徴とす
る特許請求の範囲第1項記載の増幅回路。 3 ホール素子の第3の端子と第2の基準電圧点との間
、もしくは第4の端子と第1の基準電圧点との間に抵抗
を挿入してなる特許請求の範囲第2項記載の増幅回路。
[Claims] 1 (1/N)V_c_c [N: arbitrary number, V_c_c:
A voltage of [power supply voltage] is applied to each base of the first and second transistors constituting the differential amplifier, and an input signal is applied between each of the bases, and a voltage of the value that becomes the emitter of the first transistor is applied. One end of a second resistor of (1+n)r [n; arbitrary number] is connected to the emitter of the second transistor, and the other ends of the first and second resistors are connected to the emitter of the second transistor. Common connection and I=(2+n)・V_
A current source of B_E/R [V_B_E: voltage between the base and emitter of the transistor constituting the current source] is connected, the collector of the second transistor is connected to the first reference voltage point through the first load, and the collector of the second transistor is connected to the first reference voltage point through the first load. The collector of one transistor is connected to the first reference voltage point through a second load, the collector is further connected to the base of a third transistor, and the emitter of the third transistor is connected to the first reference voltage point. The collector of this third transistor is connected to a second reference voltage point to which V_c_c is applied through a third load, and the emitter of the first transistor and the collector of the third transistor are connected to R/n. An amplifier circuit characterized in that the amplifier circuit is connected through a third resistor having a value of , and the collector of the third transistor is used as an output terminal. 2 Connecting the bases of the first and second transistors constituting the differential amplifier to the first and second output terminals of the Hall element,
2. The amplifier circuit according to claim 1, wherein the third terminal of the Hall element is connected to the second reference voltage point, and the fourth terminal is connected to the first reference voltage point. 3. According to claim 2, a resistor is inserted between the third terminal of the Hall element and the second reference voltage point, or between the fourth terminal and the first reference voltage point. Amplification circuit.
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