JPS6064271A - カ−ドテスタ - Google Patents

カ−ドテスタ

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Publication number
JPS6064271A
JPS6064271A JP58172648A JP17264883A JPS6064271A JP S6064271 A JPS6064271 A JP S6064271A JP 58172648 A JP58172648 A JP 58172648A JP 17264883 A JP17264883 A JP 17264883A JP S6064271 A JPS6064271 A JP S6064271A
Authority
JP
Japan
Prior art keywords
board
grid
lifter
pin
holes
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP58172648A
Other languages
English (en)
Inventor
Hiroshi Nozaki
博 野崎
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Usac Electronic Ind Co Ltd
Original Assignee
Usac Electronic Ind Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Usac Electronic Ind Co Ltd filed Critical Usac Electronic Ind Co Ltd
Priority to JP58172648A priority Critical patent/JPS6064271A/ja
Publication of JPS6064271A publication Critical patent/JPS6064271A/ja
Pending legal-status Critical Current

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  • Measuring Leads Or Probes (AREA)
  • Tests Of Electronic Circuits (AREA)
  • Testing Or Measuring Of Semiconductors Or The Like (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔発明の技術分野〕 本発明は、各種ディジタル機器のICボードあるいはカ
ードのテスタに関し、特にカード内の任意のIC回路を
実装されたままの状態で試験するインサーキットテスタ
において、カードとテスタとの間の電気的結合を行うペ
ソドオブネイルと呼ばれるプローブ部の新規な構造に関
する。
〔技術の背景〕
従来、任意のICカードに適合できるユニバーサル型イ
ンサーキットテスタのベッドオブネイルの一種に、マト
リックス状に配置した多数のスプリングプローブビンを
設けたボードと、必要なスプリングプローブビンのみを
突出させてICカードの導電部に接触させるためのりフ
タ−ビンを植えつけたボードとを組み合わせた結合用ビ
ンボード構造をもつものがある。A11図にその1例を
示す。
第1図1よインサーキットテスタのベッドオブネイルの
断面図であり、1はICカード、2はダイヤフラムラバ
ー、3はダイヤフラムボード、4/よマトリックスポー
ド、5?よプローブピンホール、。
6はスプリングプローブビン、7はエアシールラバー、
8はリフタボード、9はGND(接地)ブレーン、10
はリフタピン、11はピン隔離孔。
12は接地線、13はリンク線、14はピン接点。
15はインタフェースボード、16はプローブピン、1
7はリング線、18はテスタ本体を示している。
マトリックスボード4およびリフタボード8は絶縁材料
でつくられ1またGNL)プレーン9は金属板であり、
リフタピンと接触しないように、リフタピンに対応させ
てピン隔離孔11が設けられている。マトリックスポー
ド4のポール5には。
スプリングプローブピン6が滑動可能に挿入され。
リフタボード8には、リフタピン10が固着されている
リフタピン10は、ICカード1におけるテスタとの電
気的結合を必要とする各導電部分の直下に配置される。
第2図にリフタボードのりフタピン配置例を示す。
リフタボード8をマトリックスポード4の下面に装着す
ることにより、各リフタピン10が対応するスプリング
プローブピン6を押し上げる。そのため、スプリングプ
ローブビン6は、ダイヤフラムボード3およびダイヤフ
ラムラバー2を通って上方へ突出し、ピン先端はICカ
ード1の裏側の導電面に接触し、かつスプリングの力に
よりしっかりと圧着される。第3図に、スプリングプロ
ーブビン6が押し上げられた状態を示す。なお。
ベッドオブネイル内、すなわちICカードl、マトリッ
クスポード4.リフタボード8間は真空吸引され、各ボ
ードの全面が互いに均等に圧着されるようになっている
これにより、ICカード1の任意の導電面、すなわちI
C回路のテストポイント等は、スプリングプローブピン
6を介して、リフタピン10に電気的に接続される。
各リフタピン10のうち、接地対象のピンは接地線12
によりGNDプレーン9に接続され、また信号伝送用の
ピンはリンク線13.ビン接点14゜プローブピン16
.リンク線17を介しで、テスタ本体18に接続される
マトリックスポード4は汎用的に使用され、そのプロー
ブピンホール5は、任意のテスト対象ICカードについ
て任意の部分のテストが可能なように数十個乃至数万個
設けられでいる。しかし。
リフタボード8およびGNDブレーン9は、テスト対象
のICカードごとに作成されることがらパーソナルボー
ドと呼ばれるが、従来は、その設計。
孔あけ、リフタピン固着、接地線接続などのために多く
の工数を必要とし、コストも高いものとなっていた。
〔発明の目的および構成〕
本発明の目的は、カードテスタのベッドオブネイルに使
用されるパーソナルボードの作成を容易ニジ、ソのコス
トの低減を図ることにある。
そのため本発明は、リフタボードとGNDプレーンとを
一体化したパーソナルボードを作成し。
かつマトリックスポードと同様に予め全面に挿入する孔
を開けておき、リフタピンを任意の位置に容易に装着で
きるようにするものである。
それにより本発明の構成は、スプリングプローブピンを
内蔵するマトリックスポードと、このマトリックスボー
ド内の所定の位置のスプリングプローブビンを押上げる
リフタピンを装着したパーソナルボードとを有し、上記
パーソナルボードは絶縁基板上に格子状に形成された接
地用導電パターンと、この接地用導電パターンの各格子
内に設けられたスルーホールと、接地用導電パターンの
格子点を除く部分を被覆するレジスト層と、所定の位置
のスルーホールに固着されたりフタピンとにより構成さ
れでいることを特徴としでいる。
〔発明の実施例〕
以下に1本発明の詳細を実施例にしたがって説明する。
第4図(cLl + (6) + (clは1本発明に
よるパーソナルボードの1実施例を示し1図(α)は上
面図2図(b)。
(、Jはそれぞれ図(α〕のX−X、Y−Yに沿った断
面図である。図中、19はパーソナルボード、20は絶
縁基板、21はスルーホール、22はGND用導電パタ
ーン、23はレジスト層を表わしている。
絶縁基板20はガラス・エポキシ樹脂等でつくられてお
り、GND用導主導電パターン22絶縁基板20の両面
あるいは片面に格子状に既知のエツチング技術を用いて
形成される。スルーホール21は、リフタピンを装着す
るための孔であり。
各格子ごとにその中央部に形成される。レジスト層23
は、GND用導主導電パターン22子点にリフタピンか
らの接地線が半田付けされたとき。
半田が格子点から流れないようにする働きをもつ。
N−5図(αl 、 (b)は、第4図に示したパーソ
ナルボード19の一部に、リフタピンを装着した状態を
示している。図(α)はパーソナルボード19の上面を
示し9図(blは同じパーソナルボードの下面を示して
いる。図中、10.10’はりフタビン、21はスルー
ホール、22はGND用導電パターン。
24は接地線、25α、25bは半田付は部、26はリ
ンク線を表わしている。
リフタピン10′からの接地線24は、2つのスルーホ
ールをくぐらせてから、GND用導電パターンの1つの
格子点に25a、256に示すように半田付けされてい
る。このようにして任意のりフタビン10をしっかりと
接地へ接続することができる。
リフタピンが装着されない空きのスルーホールは、Af
1図で説明したベッドオブネイル内の真空吸引の際に、
空気洩れの原因となるため、適当な絶縁塗料などを用い
で充填されるか又はリフタービンを装着後リフタービン
の固定及び空きのスルーホールをハンダディプで一括固
定、充填される。
〔発明の効果〕
以上のように1本発明によれば、ベッドオブネイル内の
パーソナルボードは、汎用化された部品を用いて容易に
組み立てることができ、また変更。
再利用等も容易であるため、テスト作業の能率を向上さ
せコストの低減を図ることができる。
【図面の簡単な説明】
第1図は従来のカードテスタにおけるベッドオブネイル
の断面図、第2図はりフタボードの構成例を示す図、′
:A13図はスプリングプローブピンがリフタピンによ
り作動された状態を示す図、第4図(LL) 、 (b
) 、 (a)は本発明によるパーソナルボードの1実
施例の構造図で1図(a)は上面図1図(6)、 (c
)はそれぞれ図(arのX−X、Y−Yの位置における
断面図、第5図(d) 、 (blはパーソナルボード
にリフタピンを装着した状態を示す図である。 図中、lはICカード、4はマトリックスボード、6は
スプリングプローブピン、10.10’はりフタビン、
19はパーソナルボード、20は絶縁基板、21はスル
ーホール、22はGND用導電パターン、23はレジス
ト層を表わす。 特許出願人 ユーザツク電子工業株式会社代理人弁理士
 長谷用 文 廣(外2名)Y−1冒〒◎;×=シー−

Claims (1)

    【特許請求の範囲】
  1. スプリングプローブビンを内蔵するマトリックスボード
    と、このマトリックスポード内の所定の位置のスプリン
    グプローブビンを押上げるリフタビンを装着したパーソ
    ナルボードとを有し、上記パーソナルボードは絶縁基板
    上に格子状に形成された接地用導電パターンと、この接
    地用導電パターンの各格子内に設けられたスルーホール
    と、接地用導電パターンの格子点を除く部分を被覆する
    レジスト層と、所定の位置のスルーホールに固着された
    りフタビンとにより構成されていることを特徴とするカ
    ードテスタ。
JP58172648A 1983-09-19 1983-09-19 カ−ドテスタ Pending JPS6064271A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP58172648A JPS6064271A (ja) 1983-09-19 1983-09-19 カ−ドテスタ

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP58172648A JPS6064271A (ja) 1983-09-19 1983-09-19 カ−ドテスタ

Publications (1)

Publication Number Publication Date
JPS6064271A true JPS6064271A (ja) 1985-04-12

Family

ID=15945779

Family Applications (1)

Application Number Title Priority Date Filing Date
JP58172648A Pending JPS6064271A (ja) 1983-09-19 1983-09-19 カ−ドテスタ

Country Status (1)

Country Link
JP (1) JPS6064271A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61178482U (ja) * 1985-04-25 1986-11-07

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61178482U (ja) * 1985-04-25 1986-11-07

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