JPS6068617A - 半導体装置のイオンミリング方法 - Google Patents
半導体装置のイオンミリング方法Info
- Publication number
- JPS6068617A JPS6068617A JP58177433A JP17743383A JPS6068617A JP S6068617 A JPS6068617 A JP S6068617A JP 58177433 A JP58177433 A JP 58177433A JP 17743383 A JP17743383 A JP 17743383A JP S6068617 A JPS6068617 A JP S6068617A
- Authority
- JP
- Japan
- Prior art keywords
- substrate
- ion milling
- junction
- filament
- milling device
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
- H10P50/00—Etching of wafers, substrates or parts of devices
- H10P50/20—Dry etching; Plasma etching; Reactive-ion etching
Landscapes
- Drying Of Semiconductors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は加速されたイオンにより半導体装置をエツチン
グするいわゆる。半導体装置のイオンミリング方法に−
するものである。
グするいわゆる。半導体装置のイオンミリング方法に−
するものである。
加速されたアルゴンイオメトク種々の物質全エツチング
する際物質表面上でイオンによる電荷蓄積が生じクーロ
ン反発力によりエツチング割カ合いが低下する。これを
防止するため、イオンミリング装置では熱フィラメント
がら熱電子全放出して、基板上で電気的に中和するよう
に考慮しである。
する際物質表面上でイオンによる電荷蓄積が生じクーロ
ン反発力によりエツチング割カ合いが低下する。これを
防止するため、イオンミリング装置では熱フィラメント
がら熱電子全放出して、基板上で電気的に中和するよう
に考慮しである。
しかし被エツチング物質の表面がP−型を示すP/N接
合を有する時、プラスイオンのアルゴンはP/N接合に
おいて順方向゛電流が流れる。このように電流はP/N
接合の電気的に流れやすい部分に集中的に流れる為接合
破壊が生じる0通常の半導体装置はスクライプ線がP/
N接合で形成されておタイオンミリング全行うと前述の
接合破壊がスクライプ線において発生し製造上大きな問
題となる。
合を有する時、プラスイオンのアルゴンはP/N接合に
おいて順方向゛電流が流れる。このように電流はP/N
接合の電気的に流れやすい部分に集中的に流れる為接合
破壊が生じる0通常の半導体装置はスクライプ線がP/
N接合で形成されておタイオンミリング全行うと前述の
接合破壊がスクライプ線において発生し製造上大きな問
題となる。
不発明の目的は、これらの接合破壊を改善するものであ
V安定にイオンミリングが実行する方法を提供すること
にある・ 接合破壊の原因は前述のようにP/N接合のある極部に
集中的にイオン電流が流れる為でめハこの電流の流れを
防ぐことに、l:り接合破壊を防止出来る。
V安定にイオンミリングが実行する方法を提供すること
にある・ 接合破壊の原因は前述のようにP/N接合のある極部に
集中的にイオン電流が流れる為でめハこの電流の流れを
防ぐことに、l:り接合破壊を防止出来る。
そこで本発明によれば#!−導体装置のスクライプ線の
P/N接合を有する基板t1イオンミリング装置の基板
ホルダーから電気的に絶縁すること全特徴とする半導体
装置のイオンミリング方法を得る・ 次に、図面?参照して不発明をより詳細に説明する・ 本発明の一実施例によれば、第1図に示すよう、イオン
ミリング装置はコイルlで囲まれたアノード2内にフィ
ラメント3上層しており、フィラメント3からのイオン
はカソード4お工び中性化フィラメント5全通して千尋
体基板7の載置された基板6に照射される。半導体基板
7は基板6に与えられている接地電位から電気的に絶縁
させるために、第2図に示すように、2層17. 19
,20およびN7輪18の形成されたN型基板16の裏
面にシリコン酸化膜24vf−形成しておく、尚21は
表面酸化膜、22.23は金属配線層である。このよう
IcN型基板16の裏面を酸化膜24でおおっておくこ
とにより、イオンミリング装置ン板ホルダー6に電流が
流れず、従って接合破壊は発生せず歩留が非常に安定す
る。イオノミリング終了後、牛導体基板表面全レジスト
膜で保1ウェトエッチ法でシリコン酸イト膜24′I!
−エツチング除去することで半導体装置の選択エツチン
グが完成する。
P/N接合を有する基板t1イオンミリング装置の基板
ホルダーから電気的に絶縁すること全特徴とする半導体
装置のイオンミリング方法を得る・ 次に、図面?参照して不発明をより詳細に説明する・ 本発明の一実施例によれば、第1図に示すよう、イオン
ミリング装置はコイルlで囲まれたアノード2内にフィ
ラメント3上層しており、フィラメント3からのイオン
はカソード4お工び中性化フィラメント5全通して千尋
体基板7の載置された基板6に照射される。半導体基板
7は基板6に与えられている接地電位から電気的に絶縁
させるために、第2図に示すように、2層17. 19
,20およびN7輪18の形成されたN型基板16の裏
面にシリコン酸化膜24vf−形成しておく、尚21は
表面酸化膜、22.23は金属配線層である。このよう
IcN型基板16の裏面を酸化膜24でおおっておくこ
とにより、イオンミリング装置ン板ホルダー6に電流が
流れず、従って接合破壊は発生せず歩留が非常に安定す
る。イオノミリング終了後、牛導体基板表面全レジスト
膜で保1ウェトエッチ法でシリコン酸イト膜24′I!
−エツチング除去することで半導体装置の選択エツチン
グが完成する。
このように不発明によるイオンミリングによれば、接合
破壊が起きないでイオンミリングによるエツチング?す
ることが出来る。
破壊が起きないでイオンミリングによるエツチング?す
ることが出来る。
第1図はイオンミリング装置を闇単に示した図である。
第2凶は不発明の一実施例に用いられる半導体装置の断
面図である。 1・・・・・・コイル、2・・・・・・アノード、3・
・・・・・フイラメ/ト、4・・・・・・カソード、5
・・・・・・中1生化フィラメント、6・・・・・・基
板ホルダー、7・・・・・・半導体装置。 16・・・・・・へ型基板、17・・・・・・P層、1
8・・・・・N鳩、19.20・・・・・・P/N接合
スクライプ線、21゜24・・・・・・シリコン酸化膜
、22.23・・・・・・メタル層。
面図である。 1・・・・・・コイル、2・・・・・・アノード、3・
・・・・・フイラメ/ト、4・・・・・・カソード、5
・・・・・・中1生化フィラメント、6・・・・・・基
板ホルダー、7・・・・・・半導体装置。 16・・・・・・へ型基板、17・・・・・・P層、1
8・・・・・N鳩、19.20・・・・・・P/N接合
スクライプ線、21゜24・・・・・・シリコン酸化膜
、22.23・・・・・・メタル層。
Claims (1)
- 加速されたイオンにより半導体装置金工、チングする方
法においてP/N接合’11する半導体装置を絶縁膜を
フ「シて接地を位に保持された基板上におき、加速され
たイオンでエツチングすることを特徴とするイオンミリ
ング方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58177433A JPS6068617A (ja) | 1983-09-26 | 1983-09-26 | 半導体装置のイオンミリング方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58177433A JPS6068617A (ja) | 1983-09-26 | 1983-09-26 | 半導体装置のイオンミリング方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6068617A true JPS6068617A (ja) | 1985-04-19 |
Family
ID=16030853
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58177433A Pending JPS6068617A (ja) | 1983-09-26 | 1983-09-26 | 半導体装置のイオンミリング方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6068617A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63104334A (ja) * | 1986-10-21 | 1988-05-09 | Nec Corp | 半導体装置の製造方法 |
| KR100706799B1 (ko) | 2005-10-07 | 2007-04-12 | 삼성전자주식회사 | 필라멘트 부재 및 이를 가지는 이온 주입 장치의 이온 소스 |
| KR100706788B1 (ko) | 2005-11-17 | 2007-04-12 | 삼성전자주식회사 | 필라멘트 부재 및 이를 가지는 이온 주입 장치의 이온 소스 |
| CN119486221A (zh) * | 2024-10-30 | 2025-02-18 | 湖北九峰山实验室 | 一种半导体器件终端结构及其制备方法 |
-
1983
- 1983-09-26 JP JP58177433A patent/JPS6068617A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63104334A (ja) * | 1986-10-21 | 1988-05-09 | Nec Corp | 半導体装置の製造方法 |
| KR100706799B1 (ko) | 2005-10-07 | 2007-04-12 | 삼성전자주식회사 | 필라멘트 부재 및 이를 가지는 이온 주입 장치의 이온 소스 |
| KR100706788B1 (ko) | 2005-11-17 | 2007-04-12 | 삼성전자주식회사 | 필라멘트 부재 및 이를 가지는 이온 주입 장치의 이온 소스 |
| CN119486221A (zh) * | 2024-10-30 | 2025-02-18 | 湖北九峰山实验室 | 一种半导体器件终端结构及其制备方法 |
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