JPS606875A - タイムチヤ−トの図示装置 - Google Patents
タイムチヤ−トの図示装置Info
- Publication number
- JPS606875A JPS606875A JP58114607A JP11460783A JPS606875A JP S606875 A JPS606875 A JP S606875A JP 58114607 A JP58114607 A JP 58114607A JP 11460783 A JP11460783 A JP 11460783A JP S606875 A JPS606875 A JP S606875A
- Authority
- JP
- Japan
- Prior art keywords
- data
- time chart
- memory
- rlj
- displayed
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Digital Computer Display Output (AREA)
- Controls And Circuits For Display Device (AREA)
- Programmable Controllers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明はブラウン管表示装置（ラスタヌキャン方式に
よシ文字、図形、画像を表示する装置で、文字を表示す
る場合はキャラクタディスプレイとも称せられ、以下Ｃ
ＲＴと略記する）にタイムチャートを表示するタイムチ
ャートの図示装置に関するものである。
よシ文字、図形、画像を表示する装置で、文字を表示す
る場合はキャラクタディスプレイとも称せられ、以下Ｃ
ＲＴと略記する）にタイムチャートを表示するタイムチ
ャートの図示装置に関するものである。
プラントのシーケンス制御を行うような場合、そのプロ
セスデータは１ビツトの信号（２値付号）であることが
多い。したがって、このようなシーケンス制御のプログ
ラムを作成すると、そのプログラム中にプロセスデータ
として１ビツトの信号が多数入って来る。このプログラ
ムのデバッグならびにメンテナンスにおいては、プログ
ラミングパネルを用いて、当該シーケンス制御プログラ
ムによって制御ｌ１１される各入出力及び中間メモリの
内容が論理「１」であるか「０」であるかを１点ずつ確
かめながら調整を進めていた。然し、従来のプログラミ
ングパネルでは、多数の１ピッｌ−（Ｓ号の論理の瞬間
値が表示されるにすぎず、１つの信号の時間的経過を他
の信号の時間的経過と対応させることができなかった。
セスデータは１ビツトの信号（２値付号）であることが
多い。したがって、このようなシーケンス制御のプログ
ラムを作成すると、そのプログラム中にプロセスデータ
として１ビツトの信号が多数入って来る。このプログラ
ムのデバッグならびにメンテナンスにおいては、プログ
ラミングパネルを用いて、当該シーケンス制御プログラ
ムによって制御ｌ１１される各入出力及び中間メモリの
内容が論理「１」であるか「０」であるかを１点ずつ確
かめながら調整を進めていた。然し、従来のプログラミ
ングパネルでは、多数の１ピッｌ−（Ｓ号の論理の瞬間
値が表示されるにすぎず、１つの信号の時間的経過を他
の信号の時間的経過と対応させることができなかった。
すなわち、従来の装置では観察しようとする信号を表す
符号又は記号をキーボードから入力すると、当該信号の
ビット論理が表示部に表示される。
符号又は記号をキーボードから入力すると、当該信号の
ビット論理が表示部に表示される。
この表示されたビット論理はキーボードから当該信号を
表す符号又は記号が入力された時点の論理であって、し
たがってその表示は変化しない。その後の時点でのビッ
ト論理を表示しだいときは、表示すべき時点でキーボー
ドから再入力することが必要である。
表す符号又は記号が入力された時点の論理であって、し
たがってその表示は変化しない。その後の時点でのビッ
ト論理を表示しだいときは、表示すべき時点でキーボー
ドから再入力することが必要である。
従来のプログラミングパネルでは、以上のように、各信
号のビットの論理を瞬時値でかつ断片的にしか表示する
ことができなかった為、信号の時間的変化を１察したい
場合には、キーボードからの入力操作を何回も繰返して
行うことが必要で、長時間の間開−輪理を保つ信号に対
しては、多くの無駄な操作を必要とし、また各種の信号
の時間的変化の相互関連を観察することが困離であるな
どの欠点があった。
号のビットの論理を瞬時値でかつ断片的にしか表示する
ことができなかった為、信号の時間的変化を１察したい
場合には、キーボードからの入力操作を何回も繰返して
行うことが必要で、長時間の間開−輪理を保つ信号に対
しては、多くの無駄な操作を必要とし、また各種の信号
の時間的変化の相互関連を観察することが困離であるな
どの欠点があった。
この発明は上記のような従来のものの欠点を除去するだ
めになされたもので、各種の信号の時間的変化をｃｉｊ
Ｔ上にタイムチャートとして図示することによシ、各種
の信号の相互関係及びタイミングを容易に観察できる装
置を提供することを目的としている。
めになされたもので、各種の信号の時間的変化をｃｉｊ
Ｔ上にタイムチャートとして図示することによシ、各種
の信号の相互関係及びタイミングを容易に観察できる装
置を提供することを目的としている。
以下この発明の実施例を図面について説明する。
第１図はこの発明の一実施例を示すブロック図で、（１
）は入力回路、（２）はＣＰＵ％（３１ｔｊ：出力回路
、（５）はＣＲＴである。入力回路（１１はデバッグす
べきプログラムから読出されＣＲＴ （５）に表示すべ
き各オニｈのプロセスデータを入力する。この各梅のプ
ロセスデータはそれぞれが１ビツトの信号であると仮定
する。すなわち複数ピットの４ｐ号の場合も１ビツトの
信号の複数個として取扱うことにする。入力回路で７Ｊ
ｉ定のサンプル周期（たとえば、５００ｍ５ ）でサン
プルされて読出された各種の信号はＣＰＵ （２）に入
って処理されるが、ＣＰＵ（２）では１サンプル周３”
Ｊ］前のデータを記憶しており、各データについて１サ
ンプル周期前の論理と比較し、データの変化パターンを
検出してこれをメモリ（４）に格納する。
）は入力回路、（２）はＣＰＵ％（３１ｔｊ：出力回路
、（５）はＣＲＴである。入力回路（１１はデバッグす
べきプログラムから読出されＣＲＴ （５）に表示すべ
き各オニｈのプロセスデータを入力する。この各梅のプ
ロセスデータはそれぞれが１ビツトの信号であると仮定
する。すなわち複数ピットの４ｐ号の場合も１ビツトの
信号の複数個として取扱うことにする。入力回路で７Ｊ
ｉ定のサンプル周期（たとえば、５００ｍ５ ）でサン
プルされて読出された各種の信号はＣＰＵ （２）に入
って処理されるが、ＣＰＵ（２）では１サンプル周３”
Ｊ］前のデータを記憶しており、各データについて１サ
ンプル周期前の論理と比較し、データの変化パターンを
検出してこれをメモリ（４）に格納する。
第２図はＣＲＴ （２）にタイムチャートを表示する場
合のタイムチャートを構成する各単位図形のドツトパタ
ーンを示し、回−画面に文字と一緒に表汗する場合、第
２図は点線で示す６個の文字に相当する枠内に１個の単
位図形が、太い実線で示すドツトパターンのように表示
されることを表していると考えてもよく、あるいは、第
２図の点線は１個の文字枠内の位置目盛を示す仮想線で
あシ、タイムチャートの単位図形は１個の文字枠内に表
７Ｊ声されると考えてもよい。ＣＲＴに文字を表示する
場合のキャラクタジェネレータ（ｃｈａｒａｃｔｅｒ
ｇｅｎｅｒにおいて、文字のドツトパターンを記憶して
いて当該文字の文字コードをアドレスとして読出される
フォントメモリ（ｆｏｎｔ ｍｅｍｏｒｙ ）を備えて
いるが、第２図の各図形はタイムチャートの図示の為に
迫加されるフォントメモリであると考えることができる
。
合のタイムチャートを構成する各単位図形のドツトパタ
ーンを示し、回−画面に文字と一緒に表汗する場合、第
２図は点線で示す６個の文字に相当する枠内に１個の単
位図形が、太い実線で示すドツトパターンのように表示
されることを表していると考えてもよく、あるいは、第
２図の点線は１個の文字枠内の位置目盛を示す仮想線で
あシ、タイムチャートの単位図形は１個の文字枠内に表
７Ｊ声されると考えてもよい。ＣＲＴに文字を表示する
場合のキャラクタジェネレータ（ｃｈａｒａｃｔｅｒ
ｇｅｎｅｒにおいて、文字のドツトパターンを記憶して
いて当該文字の文字コードをアドレスとして読出される
フォントメモリ（ｆｏｎｔ ｍｅｍｏｒｙ ）を備えて
いるが、第２図の各図形はタイムチャートの図示の為に
迫加されるフォントメモリであると考えることができる
。
しだがって、ＣＰＵ （２）が各データの変ずヒバター
ンをメモリ（４）に書込む場合 「０」→「０」のときは第２図（ａｔのフォントメモリ
にアトｌメスする図形コード（仮に図形コードａという
）を、 「０」→「１」のときは第２１Ａ（ｂ）のフォントメ１
モリにアドレスする図形コード（仮に図形コードｂと
いう）を、 「１」→ｒｌＪのときは第２図（ｃｌのフォントメモリ
にアドレスする図形コード（仮に図形コードＣという）
を、 「１」→「０」のときは第２図（ｄ）のフォントメモリ
にアドレスする図形コード（仮に図形コードａｔｏｒ）
ｄという）を、 それぞれメモリ（４）に書込む。
ンをメモリ（４）に書込む場合 「０」→「０」のときは第２図（ａｔのフォントメモリ
にアトｌメスする図形コード（仮に図形コードａという
）を、 「０」→「１」のときは第２１Ａ（ｂ）のフォントメ１
モリにアドレスする図形コード（仮に図形コードｂと
いう）を、 「１」→ｒｌＪのときは第２図（ｃｌのフォントメモリ
にアドレスする図形コード（仮に図形コードＣという）
を、 「１」→「０」のときは第２図（ｄ）のフォントメモリ
にアドレスする図形コード（仮に図形コードａｔｏｒ）
ｄという）を、 それぞれメモリ（４）に書込む。
第３図はＣＰＩＪ （２）からメモリ（４）へ書込みを
行う動作を示す流れ図で、１ｌＧ−（２Ｉ）は各ステッ
プを示し、ステップαＤは１サンプル周期（前述の数値
例では５００ｍ５ ）に相当する時間間隔をおいて次の
データが入力されることを意味し、ステップ０３では各
データについて９４〜（イ）のステップを実行し図形コ
ードａ ＝ ｄ ’５メモリ（４）内の当該データのｄ
（シ憶領域に書込む。メモリ（４）からのデータ読出し
の便宜を考えると、メモ１月４）は、たとえはシフトレ
ジスタの初数個を並列にして１つのデータのメモリを構
成し、新しい図形コードが入力される度に、従来記１、
ｕされていた図形コードは１ピツトずつシフＩ・され、
最も古く人力された図形コードはシフトレジスタからシ
フトアウトされるように構成すれは、ＣＲＴ （５）に
表示できる限度の過去までさかのｅまってｉｒｅ ’Ａ
ｒのデータ変化を常にメモリ（４）内に保持することが
できる。
行う動作を示す流れ図で、１ｌＧ−（２Ｉ）は各ステッ
プを示し、ステップαＤは１サンプル周期（前述の数値
例では５００ｍ５ ）に相当する時間間隔をおいて次の
データが入力されることを意味し、ステップ０３では各
データについて９４〜（イ）のステップを実行し図形コ
ードａ ＝ ｄ ’５メモリ（４）内の当該データのｄ
（シ憶領域に書込む。メモリ（４）からのデータ読出し
の便宜を考えると、メモ１月４）は、たとえはシフトレ
ジスタの初数個を並列にして１つのデータのメモリを構
成し、新しい図形コードが入力される度に、従来記１、
ｕされていた図形コードは１ピツトずつシフＩ・され、
最も古く人力された図形コードはシフトレジスタからシ
フトアウトされるように構成すれは、ＣＲＴ （５）に
表示できる限度の過去までさかのｅまってｉｒｅ ’Ａ
ｒのデータ変化を常にメモリ（４）内に保持することが
できる。
第４図はＣＩζＴ（５）に表示されるタイムチャートの
一例を示す図で、Ｑ］）はデータ名、（ハ）はサンプル
周期を示し、（ハ）はサンプル点を示すパルスで５００
ｍ５間隔パルスであシ、（ハ）がタイムチャートである
。
一例を示す図で、Ｑ］）はデータ名、（ハ）はサンプル
周期を示し、（ハ）はサンプル点を示すパルスで５００
ｍ５間隔パルスであシ、（ハ）がタイムチャートである
。
データ８ 、Ｍ２Ｏ３に対するタイムチャートを表示す
る／こめには、当Ｎｉデータの図形コードをメモリ（４
）から読出す前に文字コード［８：） 、 Ｃ・］ 、
［ｆＶＤ 、 ［１）。
る／こめには、当Ｎｉデータの図形コードをメモリ（４
）から読出す前に文字コード［８：） 、 Ｃ・］ 、
［ｆＶＤ 、 ［１）。
ＣＯ’３ 、 ［７］を胱出しくこれらのコードはキー
ボードからＣＰＩＪ （２） ’ｉ：介してメモリ（４
）に入力して１６＜ことができる）、次に図形コードを
読出してラスクスキャン方式でＣＲＴ ｔ５）に表示す
る。第４図に示すデータ８．Ｍｌ（＋７ の例では図形
コードはｃａ〕、 （ａ） 。
ボードからＣＰＩＪ （２） ’ｉ：介してメモリ（４
）に入力して１６＜ことができる）、次に図形コードを
読出してラスクスキャン方式でＣＲＴ ｔ５）に表示す
る。第４図に示すデータ８．Ｍｌ（＋７ の例では図形
コードはｃａ〕、 （ａ） 。
ｒｂＪ 、ｒ’ｃＪ ＋ ｒｃＪ 、ｒｃＪ ＋ ｒｃ
Ｊ 、ｒｄＪ 、ｒａＪ 、ｒａＪ 。
Ｊ 、ｒｄＪ 、ｒａＪ 、ｒａＪ 。
ｒｂＪ ｌ ｒｃＪ 、ｒｄＪのように記憶されていた
筈である。まだ第４図に示す例では、フォントメモリと
して第２図（ａ）、 ｆｂｌ 、 ｔｅｌ 、 （ｄ）
に示す４種類の外にＯ〜９の数字、〔・〕記号とローマ
字大文字だけ備えれば足る。
筈である。まだ第４図に示す例では、フォントメモリと
して第２図（ａ）、 ｆｂｌ 、 ｔｅｌ 、 （ｄ）
に示す４種類の外にＯ〜９の数字、〔・〕記号とローマ
字大文字だけ備えれば足る。
以上の説明では、入力回路（１）に入力するデータはデ
バッグすべきプログラムのオペランドから読出されるデ
ータであるとしたが、この発明の装置作はどのような２
値付号に対しても適用することができる。
バッグすべきプログラムのオペランドから読出されるデ
ータであるとしたが、この発明の装置作はどのような２
値付号に対しても適用することができる。
以上のようにこの発明によれば、オペランドの２値付号
をタイムチャートにして表示することができるので信号
の時間的変化や他の信号との関連がよくわかりプログラ
ムのデバッグやメンテナンスが容易になるという効果が
ある。
をタイムチャートにして表示することができるので信号
の時間的変化や他の信号との関連がよくわかりプログラ
ムのデバッグやメンテナンスが容易になるという効果が
ある。
第１図はこの発明の一実施例を示すブロック図、第２図
はタイムチャートを構成する各ＪＩＬ位図形のドツトパ
ターンを示す図、第３図は第１図のＣＰＵからメモリへ
井込みを行う動作を示す流れ図、第４図は第１図のＣＲ
Ｔ上に表示されるタイムチャートの一例を示す図である
。 （１）・・・入力回路、（２）・・・ＣＰＵ、（３１・
・・出力回路、（４）・・・メモリ、（５）・・・Ｃｔ
ζＴ。 代理人 大 岩 増 雄
はタイムチャートを構成する各ＪＩＬ位図形のドツトパ
ターンを示す図、第３図は第１図のＣＰＵからメモリへ
井込みを行う動作を示す流れ図、第４図は第１図のＣＲ
Ｔ上に表示されるタイムチャートの一例を示す図である
。 （１）・・・入力回路、（２）・・・ＣＰＵ、（３１・
・・出力回路、（４）・・・メモリ、（５）・・・Ｃｔ
ζＴ。 代理人 大 岩 増 雄
Claims (1)
- 【特許請求の範囲】 それぞれが論理ｒｌＪ、ｒＯＪの２値付号で表される複
数のデータを、所定のサンプル周期で入力する入力回路
と、この入力回路から入力する上記複数のデータを１サ
ンプル周期前のデータと比較し、各データの時間的変化
を「０」→「０」。 「０」→ｒｌＪ 、ｒｌＪ→ｒＬＪ、ｒｌＪ→「０」の
４ ｆｉＩｉの変化パターンに分類し、それぞれの変化
パターンを表す図形コードを各データについてメモリに
書込む手段と、上記メモリの図形コードを順次読出して
各図形コードに対応してあらかじめ定められた図形を当
該データについて編集してブラウン管表示装置上に表示
する手段とを備えたタイムチャートの図示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58114607A JPS606875A (ja) | 1983-06-24 | 1983-06-24 | タイムチヤ−トの図示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58114607A JPS606875A (ja) | 1983-06-24 | 1983-06-24 | タイムチヤ−トの図示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS606875A true JPS606875A (ja) | 1985-01-14 |
Family
ID=14642087
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58114607A Pending JPS606875A (ja) | 1983-06-24 | 1983-06-24 | タイムチヤ−トの図示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS606875A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6421406U (ja) * | 1987-07-28 | 1989-02-02 | ||
| JPH01100603A (ja) * | 1987-10-13 | 1989-04-18 | Honda Motor Co Ltd | シーケンス制御装置におけるシーケンスプログラム作成支援システム |
| JPH0367305A (ja) * | 1989-08-04 | 1991-03-22 | Toshiba Corp | タイムチャートの設定方法 |
| WO1999036842A1 (en) * | 1998-01-20 | 1999-07-22 | Takashi Nishikawa | Sequence control method |
-
1983
- 1983-06-24 JP JP58114607A patent/JPS606875A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6421406U (ja) * | 1987-07-28 | 1989-02-02 | ||
| JPH01100603A (ja) * | 1987-10-13 | 1989-04-18 | Honda Motor Co Ltd | シーケンス制御装置におけるシーケンスプログラム作成支援システム |
| JPH0367305A (ja) * | 1989-08-04 | 1991-03-22 | Toshiba Corp | タイムチャートの設定方法 |
| WO1999036842A1 (en) * | 1998-01-20 | 1999-07-22 | Takashi Nishikawa | Sequence control method |
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