JPS6070969A - スイツチングレギユレ−タ - Google Patents
スイツチングレギユレ−タInfo
- Publication number
- JPS6070969A JPS6070969A JP17805183A JP17805183A JPS6070969A JP S6070969 A JPS6070969 A JP S6070969A JP 17805183 A JP17805183 A JP 17805183A JP 17805183 A JP17805183 A JP 17805183A JP S6070969 A JPS6070969 A JP S6070969A
- Authority
- JP
- Japan
- Prior art keywords
- voltage
- current
- transformer
- transistor
- reset time
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M3/00—Conversion of DC power input into DC power output
- H02M3/22—Conversion of DC power input into DC power output with intermediate conversion into AC
- H02M3/24—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters
- H02M3/28—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate AC
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Dc-Dc Converters (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は、パルス幅制御によシ出力電圧を制御するスイ
ッチングレギュレータに関する。
ッチングレギュレータに関する。
従来、スイッチングレギュレータの変圧器のリセット方
法として、第１図に示す回路が知られている。その動作
の概要は次の通りである。
法として、第１図に示す回路が知られている。その動作
の概要は次の通りである。
入力コンデンサＣに直流電圧＋Ｅを供給し、トランジス
タＱ１がＯＮ期間に変圧器Ｔの一次巻線に蓄えられる励
磁エネルギはＱｌがＯＦＦするとＤｌが導通し、コンデ
ンサＣ１の電圧でリセットされ蓄えられたエネルギは抵
抗Ｒ１で消費される。
タＱ１がＯＮ期間に変圧器Ｔの一次巻線に蓄えられる励
磁エネルギはＱｌがＯＦＦするとＤｌが導通し、コンデ
ンサＣ１の電圧でリセットされ蓄えられたエネルギは抵
抗Ｒ１で消費される。
磁束のリセットで重要なことは、ＱｌがＯＮ期間に増加
した変圧器の磁束をＱｌが０ＰＩｉ’の期間で完全にリ
セットする必要がアリ、完全にリセットしないと変圧器
の磁束はスイッチングをするたびに増加し、変圧器の磁
心が飽和してしまう。もう一つ重要なことは、リセット
時のフライバック電圧がトランジスタＱ１のコレクター
エンツタ電圧絶対定格Ｖｃｚｏを越えてはならないこと
である。
した変圧器の磁束をＱｌが０ＰＩｉ’の期間で完全にリ
セットする必要がアリ、完全にリセットしないと変圧器
の磁束はスイッチングをするたびに増加し、変圧器の磁
心が飽和してしまう。もう一つ重要なことは、リセット
時のフライバック電圧がトランジスタＱ１のコレクター
エンツタ電圧絶対定格Ｖｃｚｏを越えてはならないこと
である。
両者を満足するために従来方式は、トランジスタＱ１の
ＴＯＮ −−−／Ｔに制限を加え、ＴＯＮ期間が周期Ｔ
の１／２程度までしか使用できない。つま夛、定電圧制
御保証範囲がせまい欠点がある。
ＴＯＮ −−−／Ｔに制限を加え、ＴＯＮ期間が周期Ｔ
の１／２程度までしか使用できない。つま夛、定電圧制
御保証範囲がせまい欠点がある。
第２図に第１図の入力電圧が高く、負荷電流の小さい時
（ωと、入力電圧が低く負荷電流の大きい時（ｂ）のＱ
ｌのＶ ｃ ｍ電圧波形をそれぞれ示す。
（ωと、入力電圧が低く負荷電流の大きい時（ｂ）のＱ
ｌのＶ ｃ ｍ電圧波形をそれぞれ示す。
本発明の目的は、トランジスタのコレクター工くツタ電
圧絶対定格を越えないよう、リセット時間を制御し、大
きな入力電圧の変動に対して広い定電圧制御範囲を得ら
れるスイッチングレギュレータを提供するにある。
圧絶対定格を越えないよう、リセット時間を制御し、大
きな入力電圧の変動に対して広い定電圧制御範囲を得ら
れるスイッチングレギュレータを提供するにある。
本発明の要点は、変圧器磁心の磁束リセット時の励磁エ
ネルギを半導体素子で制御しながら、コンデンサと抵抗
から構成される回路でリセットするにある。
ネルギを半導体素子で制御しながら、コンデンサと抵抗
から構成される回路でリセットするにある。
第３図によシ本発明を説明する。第１図との相異点は、
抵抗Ｒ１と並列に抵抗Ｒ２とトランジスタＱ３とダイオ
ードＤ２及び（ｈのペース抵抗Ｒ３から構成される回路
を追加した事である。入力コンデンサＣに直流電圧＋Ｅ
を供給し、トランジスタＱ１がＯＮ期間に変圧器の一次
巻線に蓄えられる励磁エネルギはＱｌがＯＦＦすると、
ダイオードＤｌを通してコンデンサＣＩに吸収され、か
つトランジスタＱ２のベース電流に応じたコレクタ電流
によりＲ２に電流を流し、励磁エネルギを吸収させ、励
磁エネルギの大きい時、コレクタ電流を多く流し、フラ
イバック電圧を低く、リセット時間を長くとシ、励磁エ
ネルギの小さい時コレクタ電流を少なく（見かけ上Ｒ２
の抵抗値大きくしたのと同等と）シ、フライバック電圧
を高く、リセット時間を短くさせることができる。
抵抗Ｒ１と並列に抵抗Ｒ２とトランジスタＱ３とダイオ
ードＤ２及び（ｈのペース抵抗Ｒ３から構成される回路
を追加した事である。入力コンデンサＣに直流電圧＋Ｅ
を供給し、トランジスタＱ１がＯＮ期間に変圧器の一次
巻線に蓄えられる励磁エネルギはＱｌがＯＦＦすると、
ダイオードＤｌを通してコンデンサＣＩに吸収され、か
つトランジスタＱ２のベース電流に応じたコレクタ電流
によりＲ２に電流を流し、励磁エネルギを吸収させ、励
磁エネルギの大きい時、コレクタ電流を多く流し、フラ
イバック電圧を低く、リセット時間を長くとシ、励磁エ
ネルギの小さい時コレクタ電流を少なく（見かけ上Ｒ２
の抵抗値大きくしたのと同等と）シ、フライバック電圧
を高く、リセット時間を短くさせることができる。
第４図に第３図の回路に於ける入力電圧が高く負荷電流
の小さい時（ａ）のＶａｎ電圧波形と入力電圧が低く負
荷電流の大きい時（ｂ）のＶｃｍ電圧波形を示す。
の小さい時（ａ）のＶａｎ電圧波形と入力電圧が低く負
荷電流の大きい時（ｂ）のＶｃｍ電圧波形を示す。
又、ダイオードＤＩはＱｌのＯＮ期間に電流の流れるの
を阻止し、リセット回路の損失を低減する目的から挿入
してあシ、ダイオードＤ３はＱｌのＯＮ期間にＱ霊のペ
ース−エミッタ間に逆電圧が加わるのを阻止するために
挿入しである。
を阻止し、リセット回路の損失を低減する目的から挿入
してあシ、ダイオードＤ３はＱｌのＯＮ期間にＱ霊のペ
ース−エミッタ間に逆電圧が加わるのを阻止するために
挿入しである。
本発明はスイッチングレギュレータで説明したが、スイ
ッチングトランス、パルストランスを応用した回路すべ
てに適用でき、リセット時間を制御することができる。
ッチングトランス、パルストランスを応用した回路すべ
てに適用でき、リセット時間を制御することができる。
第５図に示すようにパワーＭＯ８ＦＥＴＱｓと抵抗Ｒ２
とを直列とした構成からなる回路で組むことも可能で、
要するに、変圧器の励磁エネルギ吸収回路において、フ
ライバック電圧及びリセット時間を変えることができれ
ばよい。
とを直列とした構成からなる回路で組むことも可能で、
要するに、変圧器の励磁エネルギ吸収回路において、フ
ライバック電圧及びリセット時間を変えることができれ
ばよい。
本発明によれは、スイッチングレギュレータに於いて、
入力電圧が低い時、リセット時間を短くでき、ＴｏＮ期
間を長く取ることができ、定電圧制御範囲を広くするこ
とができる。又、入力電圧が高時、・フライバック電圧
を低くできるので、高い入力電圧までトランジスタのコ
レクターエミッタ電圧にかかる電圧が小さくてすむ。
入力電圧が低い時、リセット時間を短くでき、ＴｏＮ期
間を長く取ることができ、定電圧制御範囲を広くするこ
とができる。又、入力電圧が高時、・フライバック電圧
を低くできるので、高い入力電圧までトランジスタのコ
レクターエミッタ電圧にかかる電圧が小さくてすむ。
第１図は従来の変圧器磁心の磁束リセット時の励磁エネ
ルギ吸収回路図、第２図は第１図のトランジスタＱ１の
ｉ品邊Ｊ僧よ−のコレクターエミッタ電圧波形図、第３
図は本発明の一実施例の回路図、第４図は第３図のトラ
ンジスタＱＩのコレクターエミッタ電圧波形図、第５図
は本発明の他の実施例の回路図である。 １・・・整流平滑回路、Ｅ・・・直流電圧、Ｃ，Ｃ１・
・・コンデンサ、Ｒｔ、Ｒ言ｅＲ１・・・抵抗、ＤＩ
、 Ｉｈ・・・ダイオード、Ｑｓ ｓ Ｑｓ・・・トラ
ンジスタ、Ｑｓ・・・パワーＭＯ８ＦＥＴ、Ｔ・・・変
圧器。 代理人 弁理士 高橋明夫 第１０ 桔２図 （α） （１） 竿３０ 糖４図 （α） （句
ルギ吸収回路図、第２図は第１図のトランジスタＱ１の
ｉ品邊Ｊ僧よ−のコレクターエミッタ電圧波形図、第３
図は本発明の一実施例の回路図、第４図は第３図のトラ
ンジスタＱＩのコレクターエミッタ電圧波形図、第５図
は本発明の他の実施例の回路図である。 １・・・整流平滑回路、Ｅ・・・直流電圧、Ｃ，Ｃ１・
・・コンデンサ、Ｒｔ、Ｒ言ｅＲ１・・・抵抗、ＤＩ
、 Ｉｈ・・・ダイオード、Ｑｓ ｓ Ｑｓ・・・トラ
ンジスタ、Ｑｓ・・・パワーＭＯ８ＦＥＴ、Ｔ・・・変
圧器。 代理人 弁理士 高橋明夫 第１０ 桔２図 （α） （１） 竿３０ 糖４図 （α） （句
Claims (1)
- 【特許請求の範囲】 １、直流電圧が一次側に供給される変圧器と、この変圧
器の一次側電流路に接続され、−次電流を所定周波数を
もって駆動するトランジスタと、前記変圧器の二次巻線
に得られる出力を整流し平滑化する整流平滑回路とから
なるスイッチングレギュレータに於いて、 前記変圧器の磁束のリセット回路内に設は喪中導体素子
と、励磁エネルギに応じて前記半導体素子の電流を制御
して、リセット時間を調整する手段とからなることを特
徴とするスイッチングレギュレータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17805183A JPS6070969A (ja) | 1983-09-28 | 1983-09-28 | スイツチングレギユレ−タ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17805183A JPS6070969A (ja) | 1983-09-28 | 1983-09-28 | スイツチングレギユレ−タ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6070969A true JPS6070969A (ja) | 1985-04-22 |
Family
ID=16041739
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17805183A Pending JPS6070969A (ja) | 1983-09-28 | 1983-09-28 | スイツチングレギユレ−タ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6070969A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1104084A3 (en) * | 1999-11-25 | 2003-05-21 | Drenkrum Limited | Efficient parallel connection of improved power-supplies |
-
1983
- 1983-09-28 JP JP17805183A patent/JPS6070969A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1104084A3 (en) * | 1999-11-25 | 2003-05-21 | Drenkrum Limited | Efficient parallel connection of improved power-supplies |
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