JPS6087589A - 多重放送受信装置 - Google Patents
多重放送受信装置Info
- Publication number
- JPS6087589A JPS6087589A JP58196370A JP19637083A JPS6087589A JP S6087589 A JPS6087589 A JP S6087589A JP 58196370 A JP58196370 A JP 58196370A JP 19637083 A JP19637083 A JP 19637083A JP S6087589 A JPS6087589 A JP S6087589A
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- Japan
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- circuit
- digital memory
- power
- power supply
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N7/00—Television systems
- H04N7/08—Systems for the simultaneous or sequential transmission of more than one television signal, e.g. additional information signals, the signals occupying wholly or partially the same frequency band, e.g. by time division
- H04N7/087—Systems for the simultaneous or sequential transmission of more than one television signal, e.g. additional information signals, the signals occupying wholly or partially the same frequency band, e.g. by time division with signal insertion during the vertical blanking interval only
- H04N7/088—Systems for the simultaneous or sequential transmission of more than one television signal, e.g. additional information signals, the signals occupying wholly or partially the same frequency band, e.g. by time division with signal insertion during the vertical blanking interval only the inserted signal being digital
- H04N7/0882—Systems for the simultaneous or sequential transmission of more than one television signal, e.g. additional information signals, the signals occupying wholly or partially the same frequency band, e.g. by time division with signal insertion during the vertical blanking interval only the inserted signal being digital for the transmission of character code signals, e.g. for teletext
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Television Systems (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、テレビジョン信号に重畳して伝送される２値
情報信号を受信するディジタルメモリを備えた受信装置
に関する。
情報信号を受信するディジタルメモリを備えた受信装置
に関する。
従来例の構成とその問題点
従来のテレビジョン多重信号受信装置の一例のブロック
図を第１図に示す。第１図中、一点鎖線より上方に記載
された１〜２１と２２Ａの部分は従来より文字放送受信
機（パターン伝送方式）として公知の構成である。一点
鎖線より下方に記載された漢字ＲＯＭ２３．音楽発生回
路２４．主メモリ１７′、ワークＲＯＭ１９’、ＤＣ電
源回路２２Ｂは、文字がコード化して伝送された場合に
これを受信し文字に変換する機能と、更に音譜が符号化
して伝送された場合にこれを復号して音楽音を発生させ
る機能と有する付加ユニットである。この付加ユニット
部分はパスラインを介して本体部分に装着されて結合さ
れ、コード伝送方式の文字多重放送を受信することがで
きるよう処するためのものである、しかるに、このよう
な付加ユニットはＤＣ電源を別に持っているのが一般的
であシ、本体部とは別に余分な容量の電源を必要とする
不便がある。
図を第１図に示す。第１図中、一点鎖線より上方に記載
された１〜２１と２２Ａの部分は従来より文字放送受信
機（パターン伝送方式）として公知の構成である。一点
鎖線より下方に記載された漢字ＲＯＭ２３．音楽発生回
路２４．主メモリ１７′、ワークＲＯＭ１９’、ＤＣ電
源回路２２Ｂは、文字がコード化して伝送された場合に
これを受信し文字に変換する機能と、更に音譜が符号化
して伝送された場合にこれを復号して音楽音を発生させ
る機能と有する付加ユニットである。この付加ユニット
部分はパスラインを介して本体部分に装着されて結合さ
れ、コード伝送方式の文字多重放送を受信することがで
きるよう処するためのものである、しかるに、このよう
な付加ユニットはＤＣ電源を別に持っているのが一般的
であシ、本体部とは別に余分な容量の電源を必要とする
不便がある。
発明の目的
本発明は、付加ユニットを装着したときにその電源を本
体部から供給でき、かつ、その本体部の電源の容量をも
小さいものとすることのできる受信装置を提供すること
を目的とするものである。
体部から供給でき、かつ、その本体部の電源の容量をも
小さいものとすることのできる受信装置を提供すること
を目的とするものである。
発明の構成
木発、におい、は、７−Ｌ’ Ｅ”； ＝ｙ’ ７信、
。工、帰線期間に重畳して伝送されて来る２値情報信号
を受信し、ディジタルメモリに記１．姦し、読み出して
表示する受信回路を備えるとともに、このディジタルメ
モリの全部又は一部の電源を受信回路の他の部分とは別
の経路でスイッチ回路を介して供給するようにし、この
別経路で電源が供給されているディジタルメモリの全部
の機能を代行することができかつ更に剰余の機能を有す
る集積回路群を具備した付加ユニットを受信回路に装着
する端子を設け、この付加ユニットが装着されたときに
ディジタルメモリ及びこのディジタルメモリとデータア
ドレスバスラインとの間に挿入されているバッファ回路
の一部又は全部の電源を切離し、かつ゛付加ユニットへ
電源を供給するように切換える電源切換回路を設けたこ
とを特徴とするものである。
。工、帰線期間に重畳して伝送されて来る２値情報信号
を受信し、ディジタルメモリに記１．姦し、読み出して
表示する受信回路を備えるとともに、このディジタルメ
モリの全部又は一部の電源を受信回路の他の部分とは別
の経路でスイッチ回路を介して供給するようにし、この
別経路で電源が供給されているディジタルメモリの全部
の機能を代行することができかつ更に剰余の機能を有す
る集積回路群を具備した付加ユニットを受信回路に装着
する端子を設け、この付加ユニットが装着されたときに
ディジタルメモリ及びこのディジタルメモリとデータア
ドレスバスラインとの間に挿入されているバッファ回路
の一部又は全部の電源を切離し、かつ゛付加ユニットへ
電源を供給するように切換える電源切換回路を設けたこ
とを特徴とするものである。
実施例の説明
以下、第２図に本発明の一実施例におけるテレビジョン
多重放送受信装置のプロッーク図を示して説明する。
多重放送受信装置のプロッーク図を示して説明する。
図中、１はチューナー、２はＶＩＰ回路、３は映像検波
回路、４はクロマ・ビデオ信号の処理回路、５は同期分
離回路、６は水平・垂直の発振回路、７は偏向出力回路
、８は映像出力回路、９はカラー陰極線管である。また
、１０はクロマ・ビデオ処理回路４の出力信号と文字表
示用のＲ，Ｇ・Ｂ信号形成回路２１の出力信号との切替
・混合回路、１１は受信信号から文字信号のみを抜取る
だめのクロックの発生回路、１２は受信信号を２値化号
に成形するスライス回路、１３は文字信号多重区間を抜
取るためのゲートパルスの発生回路、１４は文字信号を
クロックにょシサンプリングする回路、１６はバッファ
メモリ１６の書込・読出しを制御する回路、１６はバッ
ファメモリ、１７は少くとも１画面分の文字信号を記憶
するディジタル主メモリ、１８は制御用のセンタープロ
セシングユニット（ＣＰＵ）、１９ｉＣＰＵ１８の７−
クＲＯＭ、２０は（’ＰＵ１８（１）’／−りＲＡＭで
ある。２１は主ディジタルメモリ１７から読み出した出
力から文字表示−用のＲ−Ｇ−Ｂ信−号を形成する回路
、２２は電源回路である。こｈらの部分で本体部を構成
している。
回路、４はクロマ・ビデオ信号の処理回路、５は同期分
離回路、６は水平・垂直の発振回路、７は偏向出力回路
、８は映像出力回路、９はカラー陰極線管である。また
、１０はクロマ・ビデオ処理回路４の出力信号と文字表
示用のＲ，Ｇ・Ｂ信号形成回路２１の出力信号との切替
・混合回路、１１は受信信号から文字信号のみを抜取る
だめのクロックの発生回路、１２は受信信号を２値化号
に成形するスライス回路、１３は文字信号多重区間を抜
取るためのゲートパルスの発生回路、１４は文字信号を
クロックにょシサンプリングする回路、１６はバッファ
メモリ１６の書込・読出しを制御する回路、１６はバッ
ファメモリ、１７は少くとも１画面分の文字信号を記憶
するディジタル主メモリ、１８は制御用のセンタープロ
セシングユニット（ＣＰＵ）、１９ｉＣＰＵ１８の７−
クＲＯＭ、２０は（’ＰＵ１８（１）’／−りＲＡＭで
ある。２１は主ディジタルメモリ１７から読み出した出
力から文字表示−用のＲ−Ｇ−Ｂ信−号を形成する回路
、２２は電源回路である。こｈらの部分で本体部を構成
している。
一点鎖線から下方の部分は（ｑ加ユニットを構成し、２
３はコード化されて伝送された文字信号を表示用映像信
号に変換するための漢字発生用ＲＯＭ、１７’は付加ユ
ニットの生ディジタルメモリで、主ディジタルメモリ１
７の代行をする。また、１９′は付加ユニットのワーク
ＲＡＭで、ワークＲＡＭ１９の代行をする。２４は伝送
されてきた音譜の符号化信号に従って音楽を発生する回
路である。
３はコード化されて伝送された文字信号を表示用映像信
号に変換するための漢字発生用ＲＯＭ、１７’は付加ユ
ニットの生ディジタルメモリで、主ディジタルメモリ１
７の代行をする。また、１９′は付加ユニットのワーク
ＲＡＭで、ワークＲＡＭ１９の代行をする。２４は伝送
されてきた音譜の符号化信号に従って音楽を発生する回
路である。
１〜２２の部分の動作については公知であるので省略す
る。
る。
さて、我国では、文字多重放送の規格はパターン方式に
ついては電波技術審議会から昭和６６年３月に答申され
ている。一方、コード方式については、その規格は検討
中である。パターン方式による放送が始まった後、コー
ド方式の規格が決まるような場合、或は、全く別の２値
情報放送を受信するような場合には、その信号形式がパ
ターン方式の基本方式と同一であれば、かなシの部分が
共通に使用できることになる。
ついては電波技術審議会から昭和６６年３月に答申され
ている。一方、コード方式については、その規格は検討
中である。パターン方式による放送が始まった後、コー
ド方式の規格が決まるような場合、或は、全く別の２値
情報放送を受信するような場合には、その信号形式がパ
ターン方式の基本方式と同一であれば、かなシの部分が
共通に使用できることになる。
第２図中の１７’、 １９’、 ２３ 、２４の部分は
このような場合に後から付加して受信機能を拡充付加す
るユニットで、このような場合に電源回路２２に余裕を
持たせておくことは経済的ではない。そこで、付加ユニ
ットを装着したときには、電源回路２２から主メモリ１
７への電源供給を中止し、かわシに付加アダプターの各
回路に電源回路２２から電源を供給するように切換える
ようにする。
このような場合に後から付加して受信機能を拡充付加す
るユニットで、このような場合に電源回路２２に余裕を
持たせておくことは経済的ではない。そこで、付加ユニ
ットを装着したときには、電源回路２２から主メモリ１
７への電源供給を中止し、かわシに付加アダプターの各
回路に電源回路２２から電源を供給するように切換える
ようにする。
ここでは、仮に、文字コード方式の信号を受信する付加
ユニットとする場合について考える。漢字発生用ＲＯＭ
２３は１Ｍビットとし、主ディジタルメモリ１７′はド
ツト着色可能なだけの容量を有するＲＡＭ、ワークＲＯ
Ｍ１９’はコード方式を受信するプログラムの書込擾れ
たＲＯＭである。
ユニットとする場合について考える。漢字発生用ＲＯＭ
２３は１Ｍビットとし、主ディジタルメモリ１７′はド
ツト着色可能なだけの容量を有するＲＡＭ、ワークＲＯ
Ｍ１９’はコード方式を受信するプログラムの書込擾れ
たＲＯＭである。
また、音楽発生回路２４１よコード化して送られて来る
音楽情報信号を後シラし、音楽に変換する回路である。
音楽情報信号を後シラし、音楽に変換する回路である。
さて、本装置を実施する為ｅ（は、主ディジタルメモリ
１．７ 、１９の電源を切離した時、主ディジタルメモ
リ１７．１９の入出カニ端子、アドレス端子がパスライ
ンに対して悪影響を与えないようバッファ回路を間に入
れて、主ディジタルメモリ１７゜１９と、パスラインを
結合する必要がある。
１．７ 、１９の電源を切離した時、主ディジタルメモ
リ１７．１９の入出カニ端子、アドレス端子がパスライ
ンに対して悪影響を与えないようバッファ回路を間に入
れて、主ディジタルメモリ１７゜１９と、パスラインを
結合する必要がある。
そのようなバッファ回路２５の一例を第３図に示す。第
３図は、パスライン１木について必要な回路の内容を示
しており、データバスを８本、アドレスバスを１６本と
すると、２６〜４ｏからなるバッファ回路２５が全部で
２４組必要である。
３図は、パスライン１木について必要な回路の内容を示
しており、データバスを８本、アドレスバスを１６本と
すると、２６〜４ｏからなるバッファ回路２５が全部で
２４組必要である。
第３図中、Ｖｃｌは後述の如く付加ユニットを装着した
ときに切断される電源ラインを示し、Ｖｃｌ−Ｖｃ２で
あシ、ＴＴＬ回路であれば６ｖである。−ＲＡＭ１９１
は、ワークＲＯＭ１９の一部を示してお勺、その一つの
入出力或はアドレス端子をｂｌ とし、対応するパスラ
インをａｌ とする。ｃｌはバッファ回路２６全体で１
個でよく、ｃｌが高レベルの時にＡＮＤゲート２７が導
通して抵抗１２９の両端に電圧が発生し、トランジスタ
３３が導通してそのエミッタは低下する。即ち、トラン
ジスタ３２は導通可となる。一方、ＡＮＤゲート２８は
遮断され、抵抗３００両端には電圧が発生しなくなり、
トランジスタ３７が遮断される。
ときに切断される電源ラインを示し、Ｖｃｌ−Ｖｃ２で
あシ、ＴＴＬ回路であれば６ｖである。−ＲＡＭ１９１
は、ワークＲＯＭ１９の一部を示してお勺、その一つの
入出力或はアドレス端子をｂｌ とし、対応するパスラ
インをａｌ とする。ｃｌはバッファ回路２６全体で１
個でよく、ｃｌが高レベルの時にＡＮＤゲート２７が導
通して抵抗１２９の両端に電圧が発生し、トランジスタ
３３が導通してそのエミッタは低下する。即ち、トラン
ジスタ３２は導通可となる。一方、ＡＮＤゲート２８は
遮断され、抵抗３００両端には電圧が発生しなくなり、
トランジスタ３７が遮断される。
これにより、トランジスタ３６も遮断されるので、トラ
ンジスタ４１も遮断され、矢印Ｂの方向を見るとハイイ
ンピーダンスになっている。この時、ａｌが高レベルに
なると、トランジスタ３２が導通し、抵抗３１に電流が
流れてトランジスタ４゜のベースが低下し、トランジス
タ４Ｑが導通してｂｌへ高レベルの信号が伝わる。ａｌ
が低レベルとなると、トランジスタ３２が遮断されてト
ランジスタ４０が遮断し、ｂ！が低レベルになる。ｂｌ
が変化しても、トランジスタ３６が遮断されているので
トランジスタ４１のベースはｂ１’の変化の影響を受け
ない。
ンジスタ４１も遮断され、矢印Ｂの方向を見るとハイイ
ンピーダンスになっている。この時、ａｌが高レベルに
なると、トランジスタ３２が導通し、抵抗３１に電流が
流れてトランジスタ４゜のベースが低下し、トランジス
タ４Ｑが導通してｂｌへ高レベルの信号が伝わる。ａｌ
が低レベルとなると、トランジスタ３２が遮断されてト
ランジスタ４０が遮断し、ｂ！が低レベルになる。ｂｌ
が変化しても、トランジスタ３６が遮断されているので
トランジスタ４１のベースはｂ１’の変化の影響を受け
ない。
次１ｆｉ：、ｃ１ を低レベルにすると、トランジスタ
３３．３２．４０が遮断さＪＬ１矢印矢印方向のインピ
ーダンスはハイインピーダンスとなる一方、反転器２６
の出力が高レベルとなり、ＡＮＤゲート２８が導通する
。トランジスタ３７は導通し、３６は導通可となる。Ｒ
ＡＭ１９１からの読み出し信号が高レベル、１．！１）
ぢｂｌが高レベルになると、トランジスタ３６が導通し
、抵抗３６をトランジスタ３６のコレクタ電流が流れて
トランジスタ４１０ベース電流か低下し、トランジスタ
４１が導通してそのコレクタ電流に」ニジａ１ は高レ
ベルとなる。ｆｆ１Ｊち、ｂｌの変化が８１へ伝わる。
３３．３２．４０が遮断さＪＬ１矢印矢印方向のインピ
ーダンスはハイインピーダンスとなる一方、反転器２６
の出力が高レベルとなり、ＡＮＤゲート２８が導通する
。トランジスタ３７は導通し、３６は導通可となる。Ｒ
ＡＭ１９１からの読み出し信号が高レベル、１．！１）
ぢｂｌが高レベルになると、トランジスタ３６が導通し
、抵抗３６をトランジスタ３６のコレクタ電流が流れて
トランジスタ４１０ベース電流か低下し、トランジスタ
４１が導通してそのコレクタ電流に」ニジａ１ は高レ
ベルとなる。ｆｆ１Ｊち、ｂｌの変化が８１へ伝わる。
ｂｌがアドレス端子であれば、ＡＮＤゲート２８１．ト
ランジスタ３７．３６．４１は不要であるが、ＩＣ化し
た場合は汎用性の面から、そのままにしておいても動作
上支障はない。
ランジスタ３７．３６．４１は不要であるが、ＩＣ化し
た場合は汎用性の面から、そのままにしておいても動作
上支障はない。
次にｖＣｌを遮断し、零ボルトにすると、ＡＮＤゲー）
２７．２８が共に遮断され、ａｌから矢印Ａ、Ｈの方向
を見ると、どちらもノ・インピーダンスになっており、
バスライ／には影響を与えない。
２７．２８が共に遮断され、ａｌから矢印Ａ、Ｈの方向
を見ると、どちらもノ・インピーダンスになっており、
バスライ／には影響を与えない。
なお、２６〜４２０回路は原理を示しておシ、ＩＣ化回
路では、抵抗をトランジスタに置換えた□ シするのは云う迄もない。
路では、抵抗をトランジスタに置換えた□ シするのは云う迄もない。
第４図に、電源とコネクタ及びマイクロスイッチの構成
を示す。４６は第２図の付加ユニットのコネクタで、雄
ビンを内蔵している。例えば３２ピンのコネクタとする
。４５は３２ピンの雌コネクタである。
を示す。４６は第２図の付加ユニットのコネクタで、雄
ビンを内蔵している。例えば３２ピンのコネクタとする
。４５は３２ピンの雌コネクタである。
コネクタ４６の片側を伸ばしておき、コネクタ４６と４
５を嵌合結合ぎせた時にコネクタ４６の斜線部でマイク
ロスイッチ４３の突起部を押さえて切換えるように構成
する。マイクロスイッチ４３は数Ａ迄の電流を扱えるマ
イクロスイッチで、コモン端子ＣＯはＤＣ電源に、常閉
端子ＮＯ端子はＶｃｌに接続され、常開端子Ｎｏはコネ
クタ４５に接続されている。コネクタ４６と４６が結合
されると突起４４が押さえられ、ＮＣ−Ｃｏ端子間は遮
断され、Ｃｏ−Ｎｏ端子間が接続されて、コネクタ４５
．４６を介して第２図中の１７’、 １９’。
５を嵌合結合ぎせた時にコネクタ４６の斜線部でマイク
ロスイッチ４３の突起部を押さえて切換えるように構成
する。マイクロスイッチ４３は数Ａ迄の電流を扱えるマ
イクロスイッチで、コモン端子ＣＯはＤＣ電源に、常閉
端子ＮＯ端子はＶｃｌに接続され、常開端子Ｎｏはコネ
クタ４５に接続されている。コネクタ４６と４６が結合
されると突起４４が押さえられ、ＮＣ−Ｃｏ端子間は遮
断され、Ｃｏ−Ｎｏ端子間が接続されて、コネクタ４５
．４６を介して第２図中の１７’、 １９’。
２３．２４の部分へ電源（Ｖｃｌ ）が供給される。
発明の効果
一般に、受信装置の本体１ｒＡＳ分が膜用生産された時
点と、付加ユニットがＩＩＱ伺けられる時点との間には
２〜３年又は数年の１１、冒ｊｉＪ差があシ、その間の
技術進歩により４＝Ｊ加ユニットの部分の必要電力は本
体部分の中のディジタルメモリ等の部分の必要電力よシ
大幅に減少しているのが通常であるので、本体部分中の
電のの容量を余り大きくしなくても、本体部分中のディ
ジタルメモリおよびパスライン用バッファ回路の電力を
カットすれば付加ユニットの各回路への電力が供給でき
、その電源の容量を少し大きくする必要がある場合でも
その余裕の持たせ方はディジクルメモリやバッファ回路
の電力をカットしない場合よりも少なくできる。
点と、付加ユニットがＩＩＱ伺けられる時点との間には
２〜３年又は数年の１１、冒ｊｉＪ差があシ、その間の
技術進歩により４＝Ｊ加ユニットの部分の必要電力は本
体部分の中のディジタルメモリ等の部分の必要電力よシ
大幅に減少しているのが通常であるので、本体部分中の
電のの容量を余り大きくしなくても、本体部分中のディ
ジタルメモリおよびパスライン用バッファ回路の電力を
カットすれば付加ユニットの各回路への電力が供給でき
、その電源の容量を少し大きくする必要がある場合でも
その余裕の持たせ方はディジクルメモリやバッファ回路
の電力をカットしない場合よりも少なくできる。
第１図は従来例の多重放送受信装置のブロック図、電２
図は本発明の一実施例における多重放送受信装置のブロ
ック図、第３図は同装置に用いられるバッファ回路の回
路図、第４図は同装置に用いられる電源切替回路の回路
図である。 １７・・・・・・主ディジタルメモリ、１７′・・・・
・・主ディジタルメモリ、１９・・・・・・ワークＲＯ
−Ｍ、 １９’・・・・・・ワークＲＯＭ、２０・・・
・・・ワークＲＡＭ、２２・・・・・・電源回路、２３
・・・・・・漢字発生用ＲＯＭ、２４・・・・・・音楽
発生回路、２５・・・・・・バッファ回路。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名第３
図 第４図 １７二ｌｑ、ど：ｉ２う１１
図は本発明の一実施例における多重放送受信装置のブロ
ック図、第３図は同装置に用いられるバッファ回路の回
路図、第４図は同装置に用いられる電源切替回路の回路
図である。 １７・・・・・・主ディジタルメモリ、１７′・・・・
・・主ディジタルメモリ、１９・・・・・・ワークＲＯ
−Ｍ、 １９’・・・・・・ワークＲＯＭ、２０・・・
・・・ワークＲＡＭ、２２・・・・・・電源回路、２３
・・・・・・漢字発生用ＲＯＭ、２４・・・・・・音楽
発生回路、２５・・・・・・バッファ回路。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名第３
図 第４図 １７二ｌｑ、ど：ｉ２う１１
Claims (1)
- テレビジョン信号の垂直帰線期間に１「畳して伝送され
て来る２値情報信号を受信し、ディジタルメモリに記憶
し、読み出して表示する受信回路を備えるとともに、前
記ディジタルメモリの全部又は一部の電源を１１ｉＩ記
受信回路の他の部分とは別の経路でスイッチ回路を介し
て（Ｉｎするようにし、前記別経路で電源が供給さ７′
ｉ、でいる前記ディジタルメモリの全部の機能を代行゛
Ｊることかできかつ更に剰余の機能を有する隼・Ｊｉ’
ｉｌｉ’ｌ路群を具備したイ；Ｊ加ユニットを前記受信
回路に装着する端子を設け、前記付加ユニットが装＞７
２さｉｔだときに前記ディジタルメモリ及びこのディジ
タルメモリとデータアドレスバスラインとの間に挿入さ
れているバッファ回路の一部又は全ｌＸ１５の電源を切
離し、かつ前記付加ユニットへ電ユ；（を供給する。１
つに切換える電源切換回路を設けたことを特徴とする多
ＪＲ放送受信装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58196370A JPS6087589A (ja) | 1983-10-20 | 1983-10-20 | 多重放送受信装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58196370A JPS6087589A (ja) | 1983-10-20 | 1983-10-20 | 多重放送受信装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6087589A true JPS6087589A (ja) | 1985-05-17 |
| JPS6244475B2 JPS6244475B2 (ja) | 1987-09-21 |
Family
ID=16356726
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58196370A Granted JPS6087589A (ja) | 1983-10-20 | 1983-10-20 | 多重放送受信装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6087589A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62159073U (ja) * | 1986-03-31 | 1987-10-08 | ||
| JPS63215179A (ja) * | 1987-03-03 | 1988-09-07 | Fujitsu General Ltd | 受信装置 |
-
1983
- 1983-10-20 JP JP58196370A patent/JPS6087589A/ja active Granted
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62159073U (ja) * | 1986-03-31 | 1987-10-08 | ||
| JPS63215179A (ja) * | 1987-03-03 | 1988-09-07 | Fujitsu General Ltd | 受信装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6244475B2 (ja) | 1987-09-21 |
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