JPS6090433A - 無線通信機 - Google Patents
無線通信機Info
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- JPS6090433A JPS6090433A JP19849383A JP19849383A JPS6090433A JP S6090433 A JPS6090433 A JP S6090433A JP 19849383 A JP19849383 A JP 19849383A JP 19849383 A JP19849383 A JP 19849383A JP S6090433 A JPS6090433 A JP S6090433A
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- 230000005540 biological transmission Effects 0.000 claims description 12
- 230000004044 response Effects 0.000 claims description 4
- 101100296075 Arabidopsis thaliana PLL4 gene Proteins 0.000 abstract 1
- 230000006870 function Effects 0.000 description 10
- 238000010586 diagram Methods 0.000 description 5
- 210000000078 claw Anatomy 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
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- 238000000034 method Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03J—TUNING RESONANT CIRCUITS; SELECTING RESONANT CIRCUITS
- H03J5/00—Discontinuous tuning; Selecting predetermined frequencies; Selecting frequency bands with or without continuous tuning in one or more of the bands, e.g. push-button tuning, turret tuner
- H03J5/02—Discontinuous tuning; Selecting predetermined frequencies; Selecting frequency bands with or without continuous tuning in one or more of the bands, e.g. push-button tuning, turret tuner with variable tuning element having a number of predetermined settings and adjustable to a desired one of these settings
- H03J5/0245—Discontinuous tuning using an electrical variable impedance element, e.g. a voltage variable reactive diode, in which no corresponding analogue value either exists or is preset, i.e. the tuning information is only available in a digital form
- H03J5/0272—Discontinuous tuning using an electrical variable impedance element, e.g. a voltage variable reactive diode, in which no corresponding analogue value either exists or is preset, i.e. the tuning information is only available in a digital form the digital values being used to preset a counter or a frequency divider in a phase locked loop, e.g. frequency synthesizer
- H03J5/0281—Discontinuous tuning using an electrical variable impedance element, e.g. a voltage variable reactive diode, in which no corresponding analogue value either exists or is preset, i.e. the tuning information is only available in a digital form the digital values being used to preset a counter or a frequency divider in a phase locked loop, e.g. frequency synthesizer the digital values being held in an auxiliary non erasable memory
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Transceivers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は無線通信機に係わり、特に送信周波数並びに受
信周波数を記憶するメモリを有する無線通信機に関する
。
信周波数を記憶するメモリを有する無線通信機に関する
。
従来、無線通信機には腎５１図に示す如く、メモリ１８
を有し、メモリに周波数データ並びにＳＳＢ・Ｌ側、
ＳＳＢ弔側、 ＣＷ−広、、ＣＷ−狭、 ＡＭ 、 Ｆ
Ｍ等の゛運用データを記憶して置く無線ノＩＤ信機があ
る。引き込まれる周波数データは操作ノ４ネル１３に設
けられた周波数調整ダイヤル１５、アップ釦１５ａ１ダ
ウン釦１５ｂ１分周比設定回路１１等からなる周波数調
整手段で調整され、メモリ選択ダイヤル１７により指定
されたアドレスのデータエリヤへ書き込まれる。メモリ
１８に記憶された周波数データ（以下、メそり周波数デ
ータという）並びに分周比設定回路１１で生成された周
波数データ（以下調整周波数データという）はメモリ呼
び出し電鍵１４等の操作に応じてデータバス切換器１０
を介してＰＬＬＮ路４のプログラマブルカウンタ９へ送
出される。メ渣り周波数データを変更したいときけプリ
セット釦１６およびメモリ選択ダイヤル１７を操作し所
望のメモリ周波数データをデータバス１８′ａを介して
予かじめ分周比設定回路１１ヘプリセツトする。メモリ
周波数データと調整周波数データは送受４８回路側に対
しては周波数調整機能に対応できるか否かの点が異層る
だけで本質的な差は見当らない。送受信回路側では送信
用周波数データ、受信用周波数データが常時選択的に用
意され、かつ両者共微調整可能、送受信周波数のレバー
スおよび同一送受信周波数可能となることが望捷しい。
を有し、メモリに周波数データ並びにＳＳＢ・Ｌ側、
ＳＳＢ弔側、 ＣＷ−広、、ＣＷ−狭、 ＡＭ 、 Ｆ
Ｍ等の゛運用データを記憶して置く無線ノＩＤ信機があ
る。引き込まれる周波数データは操作ノ４ネル１３に設
けられた周波数調整ダイヤル１５、アップ釦１５ａ１ダ
ウン釦１５ｂ１分周比設定回路１１等からなる周波数調
整手段で調整され、メモリ選択ダイヤル１７により指定
されたアドレスのデータエリヤへ書き込まれる。メモリ
１８に記憶された周波数データ（以下、メそり周波数デ
ータという）並びに分周比設定回路１１で生成された周
波数データ（以下調整周波数データという）はメモリ呼
び出し電鍵１４等の操作に応じてデータバス切換器１０
を介してＰＬＬＮ路４のプログラマブルカウンタ９へ送
出される。メ渣り周波数データを変更したいときけプリ
セット釦１６およびメモリ選択ダイヤル１７を操作し所
望のメモリ周波数データをデータバス１８′ａを介して
予かじめ分周比設定回路１１ヘプリセツトする。メモリ
周波数データと調整周波数データは送受４８回路側に対
しては周波数調整機能に対応できるか否かの点が異層る
だけで本質的な差は見当らない。送受信回路側では送信
用周波数データ、受信用周波数データが常時選択的に用
意され、かつ両者共微調整可能、送受信周波数のレバー
スおよび同一送受信周波数可能となることが望捷しい。
しかし、実際の回路では周波数調整ダイヤル１５０１回
転当シ変化域の指定釦、上位ＭＨｚ部分の数値のみを指
定するバンド選択ダイヤル等が設けられる。また分周比
設定回路１１の数値を直接設定できるよう０から９に相
当する数字釦をキーピード２１に設けたものがある。
転当シ変化域の指定釦、上位ＭＨｚ部分の数値のみを指
定するバンド選択ダイヤル等が設けられる。また分周比
設定回路１１の数値を直接設定できるよう０から９に相
当する数字釦をキーピード２１に設けたものがある。
また、メモリ周波数データをレジスタ等の蓄積手段で形
成しこの蓄積手段をロータリースイッチで選択する送受
信周波数選択回路がある。この場合はロータリースイッ
チを２個設けてそれぞれのロータリースイッチで選択さ
れた周波数データを送信用とするか受信用とするかを決
める切換スイッチを設けである。切換スイッチの観測端
子を送信または受信用スイッチを介して周波数調整ダイ
ヤル１５等の周波数調整手段へ接続すれば送信せたは受
信動作時に周波数調整機能が得られる。
成しこの蓄積手段をロータリースイッチで選択する送受
信周波数選択回路がある。この場合はロータリースイッ
チを２個設けてそれぞれのロータリースイッチで選択さ
れた周波数データを送信用とするか受信用とするかを決
める切換スイッチを設けである。切換スイッチの観測端
子を送信または受信用スイッチを介して周波数調整ダイ
ヤル１５等の周波数調整手段へ接続すれば送信せたは受
信動作時に周波数調整機能が得られる。
上述した従来の無縁通信機は周波数データ生成手段とし
て若干の不便さく補正用にバンド選択手段を併用）があ
る周波数調整ダイヤルを用い、更に微調整用としても若
干の不便さがある（補正用に一回転当り可変量変化手段
を併用）周波数調整ダイヤルを送信または受信用の周波
数データ調整用に使用している。このため、周波数デー
タ生成手段に数字釦等で直接周波数データを生成し、ま
たはメモリ等から既に形成された周波数データを得たと
しても単に上位桁に相当するバンド情報生成を省略でき
る程度の利便しかない等データ相互における論理構造が
明確化されない欠点を有している。このため、操作パネ
ルには各種操作部材が設けられ ｌ、、＋、作性が悪く
、かつ回路構成が複雑で、部品点数が多い等の欠点があ
る。
て若干の不便さく補正用にバンド選択手段を併用）があ
る周波数調整ダイヤルを用い、更に微調整用としても若
干の不便さがある（補正用に一回転当り可変量変化手段
を併用）周波数調整ダイヤルを送信または受信用の周波
数データ調整用に使用している。このため、周波数デー
タ生成手段に数字釦等で直接周波数データを生成し、ま
たはメモリ等から既に形成された周波数データを得たと
しても単に上位桁に相当するバンド情報生成を省略でき
る程度の利便しかない等データ相互における論理構造が
明確化されない欠点を有している。このため、操作パネ
ルには各種操作部材が設けられ ｌ、、＋、作性が悪く
、かつ回路構成が複雑で、部品点数が多い等の欠点があ
る。
本発明は上述した点にかんがみなされたもので周波数デ
ータを記憶するメモリと周波数調整手段で生成される周
波数データとの間の論理構造を明確にし、操作性を向上
した無線通信機を提供することを目的とする。
ータを記憶するメモリと周波数調整手段で生成される周
波数データとの間の論理構造を明確にし、操作性を向上
した無線通信機を提供することを目的とする。
本発明にはメモリを指定する第１．第２・・・第ｎのア
ドレス指定釦等のアドレス指定手段が設けである。アド
レス指定手段を操作すると指定でれたアドレスデータは
アドンスレジスタヘ一旦蓄積される。周波数調整手段は
２組設けられ、アドレスデータへ蓄積されたアドレスデ
ータはつぎに周波数調整操作が行こなわれた周波数調整
機能の読み出し書きこみ用として準備される。アドレス
指定後の周波数調整操作を検出しｉ抗み出し動作を行こ
ない、以降は省き込み動作シーケンスとなるよう構成さ
れている。
ドレス指定釦等のアドレス指定手段が設けである。アド
レス指定手段を操作すると指定でれたアドレスデータは
アドンスレジスタヘ一旦蓄積される。周波数調整手段は
２組設けられ、アドレスデータへ蓄積されたアドレスデ
ータはつぎに周波数調整操作が行こなわれた周波数調整
機能の読み出し書きこみ用として準備される。アドレス
指定後の周波数調整操作を検出しｉ抗み出し動作を行こ
ない、以降は省き込み動作シーケンスとなるよう構成さ
れている。
以下、本発明による無線通信機の一実施例を第３図、第
４図にもとづき説明する。
４図にもとづき説明する。
第３図、第４図と第１図、第２図で同一のものには同一
符号を付しであるから説明を省略する。
符号を付しであるから説明を省略する。
第３図において、Ａ側の周波数調整手段は桁指定釦Ｄ１
〜Ｄｎ（Ｈａ明のためｎは９とする）、周波数選択用減
算釦１９ａ１周波数選択用加算釦２０ａおよびＡ側周波
数データ用桁レジスタ２４ａで構成されている。周波数
データ用桁レジスタ２４ａは第２図に示す第１位用桁レ
ジスタＱ１％第２位用桁レジスタＱ２・・・第１位用桁
レジスタＱｓ （説明のためｎは９とする）で形成され
桁指定釦Ｄ１〜Ｄ９で指定された桁レジスタＱ１〜Ｑ９
が周波数選択用加算釦２０または周波数選択用減算釦１
９の操作に応じて出力される加減算パルスを４数し、９
から０へ復帰するときは上位の市川レノスタＱ２〜Ｑ９
へ桁上げパルスを、１から０へ復帰するときはＱ１〜Ｑ
８へ桁下げ・ｅルスを出力する。桁用レジスタＱｓ−Ｑ
ｏがＡ側周波数データ用桁レジスタ２４１Ｌである。桁
レジスタＱ１〜Ｑ９で編成された言１数値がＡ側の周波
数データとなシデータパス１０ａを介してデータバス切
換器１０ヘパラレル出力される。Ｂ側の周波数調整手段
は桁指定釦ｖ１〜ｖ９、周波数選択用減算釦１９ｂ。
〜Ｄｎ（Ｈａ明のためｎは９とする）、周波数選択用減
算釦１９ａ１周波数選択用加算釦２０ａおよびＡ側周波
数データ用桁レジスタ２４ａで構成されている。周波数
データ用桁レジスタ２４ａは第２図に示す第１位用桁レ
ジスタＱ１％第２位用桁レジスタＱ２・・・第１位用桁
レジスタＱｓ （説明のためｎは９とする）で形成され
桁指定釦Ｄ１〜Ｄ９で指定された桁レジスタＱ１〜Ｑ９
が周波数選択用加算釦２０または周波数選択用減算釦１
９の操作に応じて出力される加減算パルスを４数し、９
から０へ復帰するときは上位の市川レノスタＱ２〜Ｑ９
へ桁上げパルスを、１から０へ復帰するときはＱ１〜Ｑ
８へ桁下げ・ｅルスを出力する。桁用レジスタＱｓ−Ｑ
ｏがＡ側周波数データ用桁レジスタ２４１Ｌである。桁
レジスタＱ１〜Ｑ９で編成された言１数値がＡ側の周波
数データとなシデータパス１０ａを介してデータバス切
換器１０ヘパラレル出力される。Ｂ側の周波数調整手段
は桁指定釦ｖ１〜ｖ９、周波数選択用減算釦１９ｂ。
周波数選択用加算釦２０ｂおよびＹ −Ｙ／結線を介し
て操作されるＢ側周波数データ用桁レジスタ２４ｂで構
成されている。Ｂ ＄１１１周波数データ用桁レジスタ
２４ｂの計数値はＢ側の周波数データとなシデータパス
１０ｂを介してデータバス切換器１０ヘパラレル出力さ
れる。
て操作されるＢ側周波数データ用桁レジスタ２４ｂで構
成されている。Ｂ ＄１１１周波数データ用桁レジスタ
２４ｂの計数値はＢ側の周波数データとなシデータパス
１０ｂを介してデータバス切換器１０ヘパラレル出力さ
れる。
Ｍ１〜Ｍｎはアドレス指定釦である。アドレス指定釦Ｍ
ｌ ＝Ｍ ｎを操作するとアドレスレジスタ４１は指定
されたアドレスデータを蓄積する。
ｌ ＝Ｍ ｎを操作するとアドレスレジスタ４１は指定
されたアドレスデータを蓄積する。
Ａ側の周波数データ読み出し書き込み手段はＡ側桁指定
用オア回路２５ａ１Ａ側読み出し制御回路２６ａ１Ａ側
■き込みＭ＋り御回路２７ａＸＡアドレススイッチ２８
ａおよびＡアドレスレジスタ２９ａで構成される。アド
レス指定釦Ｍ１〜Ｍｎが操作されるとアドレスレジスタ
４１ヘアドレスデータが蓄積されると同時にアドレス指
定用オア回路４２が動作しフリップフロップ回路４３を
セットする。フリップフロップ回路４３がセットされて
いるとき桁指定釦Ｄｌ−Ｄ、を操作するとＡ側Ｎｆｌ出
し制御回路２６ａが動作しアドレスレジスタ４１に蓄積
されたアドレスデータをＡアドレススイッチ２８ａの閉
成された常開接点群を経由してＡアドレスレジスタへ移
送する。また、移送されたＡアドレスレジスタのアドレ
スデータに係わる周波数データはメモリ１８のＲＤ端子
に送出される読み出し制御信号でｒ−タパス１８ａから
イネイブルとなっている入側周波数データ用桁レジスタ
２４ａへ読み出される。読み出し動作終了後はフリップ
フロップ回路４３がリセットされる。フリップフロップ
回路４３がリセットされるとＸ−Ｘ′結線を介してＡ側
番き込み制御回路２７ａへ動作シーケンスが進み、周波
数選択用減算釦１９ａ１周波数選択用加算釦２０ＪＬの
動作で変化するＡ側周波数データ用桁レジスタ２４ｍの
計数値はＡアドレスレジスタ２９ａに蓄積されたアドレ
スデータのデータエリヤへ書き込まれる。アドレス指定
釦ＭＩ＝Ｍ ｎが操作されない限シ、メモリ１８は書き
込み制ａとなシム側周波数データ用桁レジスタ２４ａ並
びにＢ側周波数データ用桁レジスタ２４ｂの計数値はそ
の都度Ａアドレスレジスタ２９ａ並びにアドレスレジス
タ２９ｂのそれぞれのアドレスデータで指定されるデー
タエリヤへ書き込まれる。
用オア回路２５ａ１Ａ側読み出し制御回路２６ａ１Ａ側
■き込みＭ＋り御回路２７ａＸＡアドレススイッチ２８
ａおよびＡアドレスレジスタ２９ａで構成される。アド
レス指定釦Ｍ１〜Ｍｎが操作されるとアドレスレジスタ
４１ヘアドレスデータが蓄積されると同時にアドレス指
定用オア回路４２が動作しフリップフロップ回路４３を
セットする。フリップフロップ回路４３がセットされて
いるとき桁指定釦Ｄｌ−Ｄ、を操作するとＡ側Ｎｆｌ出
し制御回路２６ａが動作しアドレスレジスタ４１に蓄積
されたアドレスデータをＡアドレススイッチ２８ａの閉
成された常開接点群を経由してＡアドレスレジスタへ移
送する。また、移送されたＡアドレスレジスタのアドレ
スデータに係わる周波数データはメモリ１８のＲＤ端子
に送出される読み出し制御信号でｒ−タパス１８ａから
イネイブルとなっている入側周波数データ用桁レジスタ
２４ａへ読み出される。読み出し動作終了後はフリップ
フロップ回路４３がリセットされる。フリップフロップ
回路４３がリセットされるとＸ−Ｘ′結線を介してＡ側
番き込み制御回路２７ａへ動作シーケンスが進み、周波
数選択用減算釦１９ａ１周波数選択用加算釦２０ＪＬの
動作で変化するＡ側周波数データ用桁レジスタ２４ｍの
計数値はＡアドレスレジスタ２９ａに蓄積されたアドレ
スデータのデータエリヤへ書き込まれる。アドレス指定
釦ＭＩ＝Ｍ ｎが操作されない限シ、メモリ１８は書き
込み制ａとなシム側周波数データ用桁レジスタ２４ａ並
びにＢ側周波数データ用桁レジスタ２４ｂの計数値はそ
の都度Ａアドレスレジスタ２９ａ並びにアドレスレジス
タ２９ｂのそれぞれのアドレスデータで指定されるデー
タエリヤへ書き込まれる。
Ｂ側の周波数データ読み出し淋き込み手段はＢ側桁指定
用オア回路２５ｂ、Ｂ（ｉｌｌＩ読み出し制御回路２６
ｂ、Ｂ（１１１１”ＪＪき込み制御回路２７ｂ、Ｂアド
レススイッチ２８ｂ１およびＢアドレスレジスタ２９ｂ
でイイｑ成される。図中符号３９は送受信切換スイッチ
、２２はディスプレイである。
用オア回路２５ｂ、Ｂ（ｉｌｌＩ読み出し制御回路２６
ｂ、Ｂ（１１１１”ＪＪき込み制御回路２７ｂ、Ｂアド
レススイッチ２８ｂ１およびＢアドレスレジスタ２９ｂ
でイイｑ成される。図中符号３９は送受信切換スイッチ
、２２はディスプレイである。
ディスプレイ２２は液晶またはＣＲＴで形成され第４図
に示すようにディスプレイエリヤＭ’１ ％ Ｍ’ ｎ
を有し、アドレス化だ釦Ｍ１〜Ｍｎに対応した周波数デ
ータ並びに運用データをディスプレイする。
に示すようにディスプレイエリヤＭ’１ ％ Ｍ’ ｎ
を有し、アドレス化だ釦Ｍ１〜Ｍｎに対応した周波数デ
ータ並びに運用データをディスプレイする。
周波数データがディスプレイされる直下に桁指定釦Ｄ１
〜Ｄ９およびＤ／ｌ、、 ｐ′９が配置される。周波数
選択用減算釦１９ａ、１９ｂと周波数選択用加算釦２０
ａと２０ｂは桁指定釦Ｄｌ−Ｄ、、Ｄ’。
〜Ｄ９およびＤ／ｌ、、 ｐ′９が配置される。周波数
選択用減算釦１９ａ、１９ｂと周波数選択用加算釦２０
ａと２０ｂは桁指定釦Ｄｌ−Ｄ、、Ｄ’。
〜Ｄ’９が配置された近傍に設置される。ディスプレイ
エリヤＭ’ｌ ＝ Ｍ’ｎの上位２ビツトけｒｏｏＪｒ
ｌＯＪｒｏｌＪまたは「１１」がディスプレイされる。
エリヤＭ’ｌ ＝ Ｍ’ｎの上位２ビツトけｒｏｏＪｒ
ｌＯＪｒｏｌＪまたは「１１」がディスプレイされる。
「ＯＯ」が表示されている場合は該当するデータエリヤ
の周波数データは未使用中であることを示している。上
位ビットが「１０」の場合はＡ側の周波数調整手段に対
応して有き込み動作が行こなわれるデータエリヤ、上位
ビットが「ｏｌ」の場合はＢ側の周波数調整手段に対応
して鳴き込み動作が行こなわれるデータエリヤ、「１１
」はアドレス指定釦Ｍ１〜Ｍｎが操作され、読み出し先
未定のｆ−タエリャを示す。図中符号３３〜４０はオン
オフスイッチで電源接・ｈ丁、送信時メータ切換、ＲＦ
アンプスイッチ、ＲＦアッテネータオンオフ、スピーチ
ゾロセッサオンオフ、ノイズブランカオンオフ、ＡＧＣ
時定数速緩切換、送受信切換、ｖＯＸオペレーションが
割付けられている。運用モード選択、ＡＦ利得＋Ｉそリ
ーーム、ＲＦ利得ボリューム、マイクゲインコントロー
ル、ドライブコントロール、スケルチボリューム、ノイ
ズブランカスレッショールドボリューム、工Ｆシフトゴ
リューム、工Ｆワイズボリューム等の選択または量的制
御を要するものは上記それぞれのファンクションを選択
する。リングカウンタをファンクション選択釦３０の押
下により出力される／４’ルスで駆動し、リングカウン
タの数値によシ定められたノ母ルス積算カウンタヘファ
ンクション用アップ釦３１およびファンクション用ダウ
ン釦３２によシ所望の数値を設定することで所定の制御
を行こなえるようになっている。制御爪はディスプレイ
エリヤ２２ｆで表示する。また、祠号４１はメータであ
る。
の周波数データは未使用中であることを示している。上
位ビットが「１０」の場合はＡ側の周波数調整手段に対
応して有き込み動作が行こなわれるデータエリヤ、上位
ビットが「ｏｌ」の場合はＢ側の周波数調整手段に対応
して鳴き込み動作が行こなわれるデータエリヤ、「１１
」はアドレス指定釦Ｍ１〜Ｍｎが操作され、読み出し先
未定のｆ−タエリャを示す。図中符号３３〜４０はオン
オフスイッチで電源接・ｈ丁、送信時メータ切換、ＲＦ
アンプスイッチ、ＲＦアッテネータオンオフ、スピーチ
ゾロセッサオンオフ、ノイズブランカオンオフ、ＡＧＣ
時定数速緩切換、送受信切換、ｖＯＸオペレーションが
割付けられている。運用モード選択、ＡＦ利得＋Ｉそリ
ーーム、ＲＦ利得ボリューム、マイクゲインコントロー
ル、ドライブコントロール、スケルチボリューム、ノイ
ズブランカスレッショールドボリューム、工Ｆシフトゴ
リューム、工Ｆワイズボリューム等の選択または量的制
御を要するものは上記それぞれのファンクションを選択
する。リングカウンタをファンクション選択釦３０の押
下により出力される／４’ルスで駆動し、リングカウン
タの数値によシ定められたノ母ルス積算カウンタヘファ
ンクション用アップ釦３１およびファンクション用ダウ
ン釦３２によシ所望の数値を設定することで所定の制御
を行こなえるようになっている。制御爪はディスプレイ
エリヤ２２ｆで表示する。また、祠号４１はメータであ
る。
上記実施例で、ディスプレイエリヤＭ’ １ ＋ Ｍ’
２ ＋Ｍ′３がｒｉｏ Ｊｒ５０，４２０．ＯＭＨｚＪ
、ｒ０１Ｊｒ５０．５４０．０ＭＨｚＪ、ｒ００Ｊｒ１
４５．５４θ、０■ＩｚＪとするとＡ側周波数データ用
桁レジスタ２４［Ｌはアドレス１番の周波数データ５０
，４２０．０ Ｍｌ（ｚと一致し、調１１！：＠作に応
じてアドレス１番に書き込１れている周波数データは礪
き変えられる。アドレス指定釦Ｍ３を押下するとディス
プレイエリヤＭ′３の表示は「１１」ｒ １４５．５４
０．ＯＭＨｚＪとなる。アドレスデータ４１のアドレス
データは３となるがＡアドレスレジスタ２９１１および
Ｂアドレスレジスタ２９ｂのアドレスデータはそれぞれ
１と２で変化しない。
２ ＋Ｍ′３がｒｉｏ Ｊｒ５０，４２０．ＯＭＨｚＪ
、ｒ０１Ｊｒ５０．５４０．０ＭＨｚＪ、ｒ００Ｊｒ１
４５．５４θ、０■ＩｚＪとするとＡ側周波数データ用
桁レジスタ２４［Ｌはアドレス１番の周波数データ５０
，４２０．０ Ｍｌ（ｚと一致し、調１１！：＠作に応
じてアドレス１番に書き込１れている周波数データは礪
き変えられる。アドレス指定釦Ｍ３を押下するとディス
プレイエリヤＭ′３の表示は「１１」ｒ １４５．５４
０．ＯＭＨｚＪとなる。アドレスデータ４１のアドレス
データは３となるがＡアドレスレジスタ２９１１および
Ｂアドレスレジスタ２９ｂのアドレスデータはそれぞれ
１と２で変化しない。
桁指定釦Ｄ’ｌ ｙ Ｄ’、を押下するとディスプレイ
エリヤＭ’２の上位ビットは「００」、Ｍｌ３は「０１
」に掌化しＢ側周波数データ用桁レジスタ２４ｂには周
波数データ１４５．５４０ 、０ ＭＨｚが読み出され
る。
エリヤＭ’２の上位ビットは「００」、Ｍｌ３は「０１
」に掌化しＢ側周波数データ用桁レジスタ２４ｂには周
波数データ１４５．５４０ 、０ ＭＨｚが読み出され
る。
Ｂアドレスレジスタ２９ｂのアドレスデータは２から３
へ変化する。
へ変化する。
Ａ側周波数データ用桁レジスタ２４ａとＢ側周波数デー
タ用桁レジスタ２４ｂの周波数データをレバースしたい
ときはアドレス指定釦Ｍ１とＭ２および桁指定釦Ｄ１〜
Ｄ ｇ ｒ Ｄ’ｔ 〜ｐ／９を操作する。操作により
Ａアドレスレジスタ２９ａと８７ドレスレジスタ２９ｂ
のアドレスデータは取替えられ１と２が２と１となる。
タ用桁レジスタ２４ｂの周波数データをレバースしたい
ときはアドレス指定釦Ｍ１とＭ２および桁指定釦Ｄ１〜
Ｄ ｇ ｒ Ｄ’ｔ 〜ｐ／９を操作する。操作により
Ａアドレスレジスタ２９ａと８７ドレスレジスタ２９ｂ
のアドレスデータは取替えられ１と２が２と１となる。
読み出した周波数データを変化させたくない場合はＡ側
桁指定用オア回路２５ａ、Ｂ側桁指定用オア回路２５ｂ
とＡ側１き込み制御回路２７ａ、Ｂ （１１１１書き込
み制御回路２７ｂとの間に常閉接点を有する書き込み禁
止スイッチ４４を設ける。書き込み禁止スイッチ４４を
動作させると書き込みが禁止され彷旧すると、復旧後初
めて操作されたＡ側周波数データ桁レジスタ２４ａまた
はＢ側周波数データ桁レジスタ２４ｂへＡアドレスレジ
スタ２９ａまたはＢアドレスレジスタ２９ｂのアドレス
か−ら周波数データを読み出す。書き込み禁止スイッチ
４４を用いるとクラリファイヤ動作が容易となる。
桁指定用オア回路２５ａ、Ｂ側桁指定用オア回路２５ｂ
とＡ側１き込み制御回路２７ａ、Ｂ （１１１１書き込
み制御回路２７ｂとの間に常閉接点を有する書き込み禁
止スイッチ４４を設ける。書き込み禁止スイッチ４４を
動作させると書き込みが禁止され彷旧すると、復旧後初
めて操作されたＡ側周波数データ桁レジスタ２４ａまた
はＢ側周波数データ桁レジスタ２４ｂへＡアドレスレジ
スタ２９ａまたはＢアドレスレジスタ２９ｂのアドレス
か−ら周波数データを読み出す。書き込み禁止スイッチ
４４を用いるとクラリファイヤ動作が容易となる。
上記実施例ではアドレス指定釦Ｍｌ〜Ｍｎに対応してデ
ィスプレイエリヤＭ′１〜Ｍ’ｎを設けたが書き込み動
作中の周波数データとアドレスデータのみ表示するよう
にしてもよい。桁指定釦Ｄ′１〜Ｄ′、。
ィスプレイエリヤＭ′１〜Ｍ’ｎを設けたが書き込み動
作中の周波数データとアドレスデータのみ表示するよう
にしてもよい。桁指定釦Ｄ′１〜Ｄ′、。
周波数選択用減算釦１９’ａ、周波数選択用加算釦１９
′ｂ等の操作部月を省略しＡ側、Ｂ側切換スイッチで切
換えるようにしてもよい。この場合は操作性が若干低下
する。
′ｂ等の操作部月を省略しＡ側、Ｂ側切換スイッチで切
換えるようにしてもよい。この場合は操作性が若干低下
する。
第１．第２・・・第ｎのアドレス指定釦を数字釦とし、
数字の組合せでアドレスを指定してもよい。
数字の組合せでアドレスを指定してもよい。
アドレス指定手段にロータリスイッチを用いると操作の
履歴が保存されるので誤操作の原因となる。
履歴が保存されるので誤操作の原因となる。
周波数データ読み出し書き込み手段は布線論理によらず
プログラム論理で形成してもよい。この場合書き込み、
読み出しの動作シーケンスを特に定める必要がない。
プログラム論理で形成してもよい。この場合書き込み、
読み出しの動作シーケンスを特に定める必要がない。
本発明になる無線通信機は第１．＠２０周波数調整手段
と、メモリのアドレスを指定するアドレス指定手段と、
周波数調整操作に応動して第１または第２の周波数調整
手段とアドレス指定手段でアドレス指定されたデータエ
リヤとの間で周波数データの読み出し書き込みを行仁な
う周波数データ読み出し書き込み手段とを具備した構成
としであるため複数の周波数データから２つの周波数デ
ータを選出し、かつ、選出された周波数データを変更し
て保存できる特長を有している。このため、メモリと送
受信周波数に係わる論理構造が明確になシ操作部材が削
減でき、操作性が向上する効果がある。また、回路はレ
ジスタ、オア回路等で形成されているので既存の集積回
路を用いることが可能である等の利便がある。
と、メモリのアドレスを指定するアドレス指定手段と、
周波数調整操作に応動して第１または第２の周波数調整
手段とアドレス指定手段でアドレス指定されたデータエ
リヤとの間で周波数データの読み出し書き込みを行仁な
う周波数データ読み出し書き込み手段とを具備した構成
としであるため複数の周波数データから２つの周波数デ
ータを選出し、かつ、選出された周波数データを変更し
て保存できる特長を有している。このため、メモリと送
受信周波数に係わる論理構造が明確になシ操作部材が削
減でき、操作性が向上する効果がある。また、回路はレ
ジスタ、オア回路等で形成されているので既存の集積回
路を用いることが可能である等の利便がある。
第１図は従来の無線通信機のブロック図、第２図は周波
数調整回路のブロック図、第３図は本発明による無線通
信機の一実施例を示すブロック図、第４図は第３図の操
作パネルの正面図である。 図中符号１はアンテナ、２はＲＦユニット、３は混合器
、３ａは中間周波回路、４はＰＬＬ回路、５は基準信号
発生器、６は位相比較器、７はローフ４スフイルタ、８
は電圧制セＩｌ１発振器、９はプログラマブルカウンタ
、１０はデータバス切換器、１１は分周比設定回路、１
３は操作ツヤネル、１４はメモリ呼び出し電鍵、１５は
周波数調整ダイヤル、１５ａはアップ釦、１５ｂはダユ
ン釦、１６ｉ−１ニブリセツト釦、１７はメモリ選択ダ
イヤル、１７ａは書き込み釦、１８はメモリ、１９．１
９ａ、１９ｂは周波数選択用減算釦、２０．２０ａ 、
２０ｂは周波数選択用加算釦、２１はキーが一ド、２２
はディスプレイ、２４＆は入側周波数データ用桁レジス
タ、２４ｂｉ”１．Ｂ側周波数データ用桁レジスタ、２
５ａはＡ側桁指定用オア回路、２５ｂはＢ側桁指定用オ
ア回路、２６ａはＡ側読み出し制御回路、２６ｂはＢ側
読み出し制御回路、２７ａはＡ（Ｉｌｌｌ書き込み制御
回路、２７ｂはＢ伺書き込み制御回路、２８ａはＡアド
レススイッチ、２８ｂはＢアドレススイッチ、２９１１
はＡアドレスレジスタ、２９ｂはＢアドレスレジスタ、
３０はファンクション選択釦、３１はファンクション用
アップ釦、３２はファンクション用ダウン釦、３３〜４
０はオンオフスイッチ、４１はアドレスレジスタ、４２
はアドレス指定用オア回路、４３はフリップフロップ回
路、４４は書き込み禁止釦、Ｄｌ−Ｄ９．Ｄ′１〜Ｄ′
９は桁指定釦、Ｍ１〜Ｍｎはアドレス指定釦、ＳＩ〜Ｓ
９ ＊ Ｓ’ｌ〜Ｓ／、は桁指定スイ、ッチ、Ｑｌ−Ｑ
ｌｌは桁用レジスタである。 特許出願人 八重洲無線株式会社
数調整回路のブロック図、第３図は本発明による無線通
信機の一実施例を示すブロック図、第４図は第３図の操
作パネルの正面図である。 図中符号１はアンテナ、２はＲＦユニット、３は混合器
、３ａは中間周波回路、４はＰＬＬ回路、５は基準信号
発生器、６は位相比較器、７はローフ４スフイルタ、８
は電圧制セＩｌ１発振器、９はプログラマブルカウンタ
、１０はデータバス切換器、１１は分周比設定回路、１
３は操作ツヤネル、１４はメモリ呼び出し電鍵、１５は
周波数調整ダイヤル、１５ａはアップ釦、１５ｂはダユ
ン釦、１６ｉ−１ニブリセツト釦、１７はメモリ選択ダ
イヤル、１７ａは書き込み釦、１８はメモリ、１９．１
９ａ、１９ｂは周波数選択用減算釦、２０．２０ａ 、
２０ｂは周波数選択用加算釦、２１はキーが一ド、２２
はディスプレイ、２４＆は入側周波数データ用桁レジス
タ、２４ｂｉ”１．Ｂ側周波数データ用桁レジスタ、２
５ａはＡ側桁指定用オア回路、２５ｂはＢ側桁指定用オ
ア回路、２６ａはＡ側読み出し制御回路、２６ｂはＢ側
読み出し制御回路、２７ａはＡ（Ｉｌｌｌ書き込み制御
回路、２７ｂはＢ伺書き込み制御回路、２８ａはＡアド
レススイッチ、２８ｂはＢアドレススイッチ、２９１１
はＡアドレスレジスタ、２９ｂはＢアドレスレジスタ、
３０はファンクション選択釦、３１はファンクション用
アップ釦、３２はファンクション用ダウン釦、３３〜４
０はオンオフスイッチ、４１はアドレスレジスタ、４２
はアドレス指定用オア回路、４３はフリップフロップ回
路、４４は書き込み禁止釦、Ｄｌ−Ｄ９．Ｄ′１〜Ｄ′
９は桁指定釦、Ｍ１〜Ｍｎはアドレス指定釦、ＳＩ〜Ｓ
９ ＊ Ｓ’ｌ〜Ｓ／、は桁指定スイ、ッチ、Ｑｌ−Ｑ
ｌｌは桁用レジスタである。 特許出願人 八重洲無線株式会社
Claims (1)
- １、加算減算に応じて桁上げ桁下げされる第１位、第２
位・・・第ｎ位の桁用レジスタ、第１位、第２位・・・
第ｎ位の桁用レジスタへ加減算パルスを出力する加減算
パルス送出手段、および加減算ｉｊルス送出手段から出
力される加減ｎｉｅルスにょシ計数を行こなう桁を指定
する桁指定手段からなる周波数調整手段と、上記周波数
調整手段がら出力される分周情報に応じた運用周波数を
定めるプログラマブルカウンタを有するＰＬＬ１路と、
上記運用周波数に係わる周波数プ′−夕を記憶するメモ
リと、を具備した無線通信機において、上記第１．第２
の周波数調整手段と、上記メモリのアドレスを指定する
第１．第２・・・第ｎのアドレス指定釦と、周波数θＮ
整操作に応動じて第１または第２の周波数調整手段と第
１．第２・・・第ｎのアドレス指定釦でアドレス指定さ
れたデータエリヤとの間で周波数データの読み出し書き
込みを行こなう周波数データ読み出し書き込み手段と、
を具備し、第１．第２の周波数調整手段に係わる周波数
データにより送受信周波数を生成するよう構成したこと
を特徴とする無線通信機。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19849383A JPS6090433A (ja) | 1983-10-24 | 1983-10-24 | 無線通信機 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19849383A JPS6090433A (ja) | 1983-10-24 | 1983-10-24 | 無線通信機 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6090433A true JPS6090433A (ja) | 1985-05-21 |
| JPH0220181B2 JPH0220181B2 (ja) | 1990-05-08 |
Family
ID=16392034
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19849383A Granted JPS6090433A (ja) | 1983-10-24 | 1983-10-24 | 無線通信機 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6090433A (ja) |
-
1983
- 1983-10-24 JP JP19849383A patent/JPS6090433A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0220181B2 (ja) | 1990-05-08 |
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