JPS6093200U - ダイナミツクメモリアクセス回路 - Google Patents

ダイナミツクメモリアクセス回路

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Publication number
JPS6093200U
JPS6093200U JP18391683U JP18391683U JPS6093200U JP S6093200 U JPS6093200 U JP S6093200U JP 18391683 U JP18391683 U JP 18391683U JP 18391683 U JP18391683 U JP 18391683U JP S6093200 U JPS6093200 U JP S6093200U
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JP
Japan
Prior art keywords
dynamic memory
memory access
access circuit
selection signal
address selection
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP18391683U
Other languages
English (en)
Inventor
大槻　光弘
Original Assignee
日本電気ホームエレクトロニクス株式会社
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Publication date
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Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図はダイナミックメモリアクセス回路の従来例によ
る回路図、第２図は第１図の回路における信号のタイミ
ングチャート、第３図は本考案によるダイナミックメモ
リアクセス回路の一実施例の回路図、第４図は第３図の
回路における信号のタイミングチャートである。 １・・・・・・ダイナミックメモリ、２・・・・・・ア
ドレス切換回路、６・・・・・・ＣＰＵ、　１７・・・
・・・クロック信号、ＲＡＳ・・・・・・行アドレス選
択信号（又はその端子）、ＣＡＳ・・・・・・列アドレ
ス選択信号（又はその端子）、Ｓ・・・・・・アドレス
選択信号（又はその端子）。

Claims (1)

    【実用新案登録請求の範囲】
  1. ダイナミックメモリに供給される行アドレス選択信号及
    び列アドレス選択信号ならびにアドレス切替回路に供給
    されるアドレス選択信号の各々のレベル転換時期を、Ｃ
    ＰＵのクロック信号を用いて制御するように構成したこ
    とを特徴とするダイナミックメモリアクセス回路。
JP18391683U 1983-11-28 1983-11-28 ダイナミツクメモリアクセス回路 Pending JPS6093200U (ja)

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JP18391683U JPS6093200U (ja) 1983-11-28 1983-11-28 ダイナミツクメモリアクセス回路

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JP18391683U JPS6093200U (ja) 1983-11-28 1983-11-28 ダイナミツクメモリアクセス回路

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JPS6093200U true JPS6093200U (ja) 1985-06-25

Family

ID=30397922

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JP18391683U Pending JPS6093200U (ja) 1983-11-28 1983-11-28 ダイナミツクメモリアクセス回路

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