JPS593385U - 信号処理回路 - Google Patents

信号処理回路

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JPS593385U
JPS593385U JP9719182U JP9719182U JPS593385U JP S593385 U JPS593385 U JP S593385U JP 9719182 U JP9719182 U JP 9719182U JP 9719182 U JP9719182 U JP 9719182U JP S593385 U JPS593385 U JP S593385U
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JP
Japan
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circuit
memories
calculates
controls
signal processing
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JP9719182U
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武司 阿部
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Japan Radio Co Ltd
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Japan Radio Co Ltd
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  • Measurement Of Velocity Or Position Using Acoustic Or Ultrasonic Waves (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は、従来の信号処理回路を示すブロック図、第２
図は、本考案実施例を示すブロック回路図、および第３
図は、該実施例回路の動作を説明するための信号波形図
である。 １・・・アナログディジクル変換回路、２・・・書込制
御回路、３・・・第１メモリ、４・・・第２メモリ、５
・・・タイミング回路、６・・・アドレスカウンタ、７
．８・・・ＡＮＤ回路、９・・・ＯＲ回路、１０・・・
入力信号端子、１１・・・タイミングパルス端子、１２
・・・出力信号端子、１３・・・出力タイミングパルス
。

Claims (1)

    【実用新案登録請求の範囲】
  1. 入力信号をディジタル信号に変換するアナログディジタ
    ル変換回路と、該アナログディジタル変換回路にそれぞ
    れ接続された第１〜第３メモリと、前記第１および第２
    メモリの記憶データの論理積を求める第１ＡＮＤ回路と
    、前記第２および第３メモリの記憶データの論理積を求
    める第２ＡＮＤ回路と、前記第１および第２ＡＮＤ回路
    の出力の論理和を求めるＯＲ回路と、前記第１〜第３メ
    モリへのデータ書込順序を制御する書込制御回路と、前
    記第１〜第３メモリのアドレスを制御するアドレスカウ
    ンタと、前記書込制御回路と前記アドレスカウンタのタ
    イミングを制御し、出力タイミングパルスを発生するタ
    イミング回路とを備え、入力使信号から相関性のないノ
    イズおよび干渉波信号を除去する一方、変動のある信号
    を除去しないようにしたことを特徴とする信号処理回路
    。
JP9719182U 1982-06-28 1982-06-28 信号処理回路 Granted JPS593385U (ja)

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JP9719182U JPS593385U (ja) 1982-06-28 1982-06-28 信号処理回路

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JP9719182U JPS593385U (ja) 1982-06-28 1982-06-28 信号処理回路

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Publication Number Publication Date
JPS593385U true JPS593385U (ja) 1984-01-10
JPH0112218Y2 JPH0112218Y2 (ja) 1989-04-10

Family

ID=30231294

Family Applications (1)

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JP9719182U Granted JPS593385U (ja) 1982-06-28 1982-06-28 信号処理回路

Country Status (1)

Country Link
JP (1) JPS593385U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6245729U (ja) * 1985-09-06 1987-03-19

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6245729U (ja) * 1985-09-06 1987-03-19

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JPH0112218Y2 (ja) 1989-04-10

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