JPS61100008A - 周波数逓倍器 - Google Patents
周波数逓倍器Info
- Publication number
- JPS61100008A JPS61100008A JP59221608A JP22160884A JPS61100008A JP S61100008 A JPS61100008 A JP S61100008A JP 59221608 A JP59221608 A JP 59221608A JP 22160884 A JP22160884 A JP 22160884A JP S61100008 A JPS61100008 A JP S61100008A
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- Japan
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- output
- wavelength
- input signal
- input
- diode
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、超高周波帯（ｆＰ、ミリ波帯〜ミＩＪ波帯）
における無線通信機等で利用される周波数逓倍器に関す
るものである。
における無線通信機等で利用される周波数逓倍器に関す
るものである。
従来例の構成とその問題点
従来、準ミリ波帯およびミリ波帯における周波数逓倍器
は、バラクタダイオード等を使用しだものが一般的であ
った。バラクタダイオードを使用した逓倍器の場合、高
い入力信号レベルを印加しないと逓倍効率が、良くなら
ないという欠点があった。
は、バラクタダイオード等を使用しだものが一般的であ
った。バラクタダイオードを使用した逓倍器の場合、高
い入力信号レベルを印加しないと逓倍効率が、良くなら
ないという欠点があった。
そこで第１図に示すような導波管を使用したバラクタダ
イオード逓倍器の構成が考えられる。
イオード逓倍器の構成が考えられる。
以下、第１図を参照しながら導波管を用いた従来のバラ
クタダイオード逓倍器について説明する。
クタダイオード逓倍器について説明する。
第１図において、入力導波管１から信号を入力し、バラ
クタダイオード８に、バイアスポスト９を介して入力し
、２逓倍出力を出力樽波管７から得るもので、入出力信
号の整合をスタブチューナー２により調整し、さらに入
出力導波管に設けた整合用可動短絡板４により調整可能
である。また出力の２逓倍出力が入力導波管に出力され
るのを抑制するため、高周波阻止フィルタ５を設けであ
る。また出力の整合用に、出力整合用導波管１０を設は
整合用可動短絡板４により整合をとることができる。ま
−たバラクタダイオードのバイアスは、バイアス端子６
から加え、バイア丈スボスト９を介して加え、２庸倍出
力が最も多くなるように調整している。
クタダイオード８に、バイアスポスト９を介して入力し
、２逓倍出力を出力樽波管７から得るもので、入出力信
号の整合をスタブチューナー２により調整し、さらに入
出力導波管に設けた整合用可動短絡板４により調整可能
である。また出力の２逓倍出力が入力導波管に出力され
るのを抑制するため、高周波阻止フィルタ５を設けであ
る。また出力の整合用に、出力整合用導波管１０を設は
整合用可動短絡板４により整合をとることができる。ま
−たバラクタダイオードのバイアスは、バイアス端子６
から加え、バイア丈スボスト９を介して加え、２庸倍出
力が最も多くなるように調整している。
しかし、第１図に示す様な導波管を使用したバラクタダ
イオード逓倍器の場合は、構造が複雑になり、製作が非
常に困難であると同時に、コストも非常に高いという欠
点があった。
イオード逓倍器の場合は、構造が複雑になり、製作が非
常に困難であると同時に、コストも非常に高いという欠
点があった。
発明の目的
本発明は、従来のバラクタダイオード等を使用した周波
数逓倍器の欠点であった高い入力信号レベルを印加しな
いと逓倍効率が良くならないという欠点、および導波管
を使用したバラクタダイオード雁＠器の場合構造が複雑
となり製作が困難であると同時にコスト高という欠点を
除去し、入力レベルの強弱による効率の変化が少なく、
安価で製作の容易な周波数逓倍器を提供するものである
。
数逓倍器の欠点であった高い入力信号レベルを印加しな
いと逓倍効率が良くならないという欠点、および導波管
を使用したバラクタダイオード雁＠器の場合構造が複雑
となり製作が困難であると同時にコスト高という欠点を
除去し、入力レベルの強弱による効率の変化が少なく、
安価で製作の容易な周波数逓倍器を提供するものである
。
発明の構成
本発明による周波数逓倍器は、入力信号に対し２分１波
長の位相差出力を得ることができる方向性結合器（一般
的には、う〜ノドレース形方向性結合器がある。）によ
り、入力信号を２分の１波長の位相差を持った２つのイ
ｄ号に分配し、その分配出力端に、先端オープンの、入
力信号の８分１波長のマイクロストリップ線路と、ダイ
オード（たとえば、ンヨソ降・バリヤ・ダイオード：５
ＢＤ）を付加し、それぞれのダイオードの出力端を結合
し、入力信号に対して２冊倍された周波数出力を得るも
のである。
長の位相差出力を得ることができる方向性結合器（一般
的には、う〜ノドレース形方向性結合器がある。）によ
り、入力信号を２分の１波長の位相差を持った２つのイ
ｄ号に分配し、その分配出力端に、先端オープンの、入
力信号の８分１波長のマイクロストリップ線路と、ダイ
オード（たとえば、ンヨソ降・バリヤ・ダイオード：５
ＢＤ）を付加し、それぞれのダイオードの出力端を結合
し、入力信号に対して２冊倍された周波数出力を得るも
のである。
ここで使用しているショットキ・バリヤ・ダイオードは
、逓倍用バラクタダイオードに比較して十分低価格であ
り、２個使用しても、１゛曲格的にはまったく問題とな
らない。また、マイクロ波集積回路化できるため、小形
でしかもパターン形成もエツチング加工も可能であり、
量産性も良好な周波数逓倍器を提供することができる。
、逓倍用バラクタダイオードに比較して十分低価格であ
り、２個使用しても、１゛曲格的にはまったく問題とな
らない。また、マイクロ波集積回路化できるため、小形
でしかもパターン形成もエツチング加工も可能であり、
量産性も良好な周波数逓倍器を提供することができる。
実施例の説明
以下、図面を参照し々から本発明の一実施例について説
明する。
明する。
第２図は本発明の一実施例における周波数逓倍器の平面
図、第３図は第２図のＡ部の部分拡大図である。
図、第３図は第２図のＡ部の部分拡大図である。
第２図、第３図において、２０は誘電体基板、２１信号
を入力する入力端子、２２は４分の１波長線路を使用し
たＤＣ力、ト、２３はラットレース形方向性結合器、２
４は８分の１波長のマイクロストリップ線路、２５は一
対のショットキ・バリヤ・ダイオード、２６は４分の１
波長線路を使用したＤＣカット、２７は出力端子である
。２７はロー・パス・フィルタ（ＬＰＦ）２８を介して
ラットレース形方向性結合器２３に接続されていルハイ
アス端子、２９はロー・パス・フィルタ（ＬＰＦ）３０
１ストリツプ線路３１を介してショットキ・バリヤ・ダ
イオード２５に接続されているアース端子である。
を入力する入力端子、２２は４分の１波長線路を使用し
たＤＣ力、ト、２３はラットレース形方向性結合器、２
４は８分の１波長のマイクロストリップ線路、２５は一
対のショットキ・バリヤ・ダイオード、２６は４分の１
波長線路を使用したＤＣカット、２７は出力端子である
。２７はロー・パス・フィルタ（ＬＰＦ）２８を介して
ラットレース形方向性結合器２３に接続されていルハイ
アス端子、２９はロー・パス・フィルタ（ＬＰＦ）３０
１ストリツプ線路３１を介してショットキ・バリヤ・ダ
イオード２５に接続されているアース端子である。
以上のようなｆｆ４ｍにおいて、まず入力端子２１かも
信号を入力し、４分の１波長線路を使用したＤＣカット
２２を介してラットレース形方向性結合器２３に加えら
れる。２分の１波長の位相差を持−出力に先端オープン
の入力信づに対して、８分の１波長のマイクロストリッ
プ線路２４とンヨノトキ・バリヤ・ダイオード２６とが
接続されているため、その出力が結合される。そして入
力信号の整流出力の２子倍出力が４分の１波長線路を使
用したＤＣカット２６を介して、出力端子２７から得ら
れる。
信号を入力し、４分の１波長線路を使用したＤＣカット
２２を介してラットレース形方向性結合器２３に加えら
れる。２分の１波長の位相差を持−出力に先端オープン
の入力信づに対して、８分の１波長のマイクロストリッ
プ線路２４とンヨノトキ・バリヤ・ダイオード２６とが
接続されているため、その出力が結合される。そして入
力信号の整流出力の２子倍出力が４分の１波長線路を使
用したＤＣカット２６を介して、出力端子２７から得ら
れる。
尚、ショットキ・バリヤ・ダイオード２５にバイアスを
印加する場合は、ＤＣバイアス端子２７からバイフ゛ス
電圧を印加してＬＰＦ２８を介してラットレース形方向
性結合器２３に、そしてショットキ・バリヤ・ダイオー
ド２５からＬＰＦ３０を介してアース端子２９へとルー
プが形成さ、れ、逓倍効率の最も良い点を見い出すこと
かでさる。
印加する場合は、ＤＣバイアス端子２７からバイフ゛ス
電圧を印加してＬＰＦ２８を介してラットレース形方向
性結合器２３に、そしてショットキ・バリヤ・ダイオー
ド２５からＬＰＦ３０を介してアース端子２９へとルー
プが形成さ、れ、逓倍効率の最も良い点を見い出すこと
かでさる。
また、ショットキ・バリヤ・ダイオード２５と共に設け
た先端オープンの８分の１波長のマイクロストリップ線
路２４は、２逓倍出力に対しては７ヨートとなり、２逓
倍出力が入力側に回り込むことなく出力される。
た先端オープンの８分の１波長のマイクロストリップ線
路２４は、２逓倍出力に対しては７ヨートとなり、２逓
倍出力が入力側に回り込むことなく出力される。
なお、ここではＤＣカプト２２．２６に、４分の１波長
線路を用いたが、個定容量でも分布定数形の容量でも良
い。
線路を用いたが、個定容量でも分布定数形の容量でも良
い。
発明の効果
」１記のように本発明は、入力レベルの強弱による効率
の変化が少なく、マイクロ波集積化が可能で、小形化が
できると同時に、量産性も良好となり、低コスト化が実
現でき、非常に有効なものである。
の変化が少なく、マイクロ波集積化が可能で、小形化が
できると同時に、量産性も良好となり、低コスト化が実
現でき、非常に有効なものである。
第１図は従来のバラクタダイオードを用いた周波数牙倍
器の断面図、第２図は本発明の一実施例における周波数
逓倍器の平面図、第３図は第２図のＡ部分の拡大図であ
る。 ２０・・・・・・誘電体基板、２１・・・・・・入力端
子、２１゜２６・・・・・・ＤＣカット、２３・・・・
・・ラットレース形方向性結合器、２４・・・・・・マ
イクロストリ、ブ線路、２６・・・・・・ンヨノトキ・
バリヤ・ダイオード、２７・・・・・・バイアス端子、
２８ 、３０・・印・ロー・パス・フィルタ、２９・・
・・・・アース端子。 代理人の氏名 弁理士 中 尾 軟 男 ほか１名手続
補正書 昭和６０年６月１４日
器の断面図、第２図は本発明の一実施例における周波数
逓倍器の平面図、第３図は第２図のＡ部分の拡大図であ
る。 ２０・・・・・・誘電体基板、２１・・・・・・入力端
子、２１゜２６・・・・・・ＤＣカット、２３・・・・
・・ラットレース形方向性結合器、２４・・・・・・マ
イクロストリ、ブ線路、２６・・・・・・ンヨノトキ・
バリヤ・ダイオード、２７・・・・・・バイアス端子、
２８ 、３０・・印・ロー・パス・フィルタ、２９・・
・・・・アース端子。 代理人の氏名 弁理士 中 尾 軟 男 ほか１名手続
補正書 昭和６０年６月１４日
Claims (1)
- 入力信号に対して２分の１波長の位相差出力を与える方
向性結合器と、前記方向性結合器の出力を入力するとと
もに、入力信号の８分の１波長で先端オープンのマイク
ロストリップ線路と、前記マイクロストリップ線路の先
端にそれぞれ接続された一対のダイオードとを具備し、
前記ダイオードの他端の接続点から前記入力信号の２逓
倍出力を得る周波数逓倍器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59221608A JPS61100008A (ja) | 1984-10-22 | 1984-10-22 | 周波数逓倍器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59221608A JPS61100008A (ja) | 1984-10-22 | 1984-10-22 | 周波数逓倍器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61100008A true JPS61100008A (ja) | 1986-05-19 |
Family
ID=16769414
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59221608A Pending JPS61100008A (ja) | 1984-10-22 | 1984-10-22 | 周波数逓倍器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61100008A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02134722U (ja) * | 1989-04-13 | 1990-11-08 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56122512A (en) * | 1980-03-03 | 1981-09-26 | Fujitsu Ltd | Frequency multiplying equipment |
-
1984
- 1984-10-22 JP JP59221608A patent/JPS61100008A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56122512A (en) * | 1980-03-03 | 1981-09-26 | Fujitsu Ltd | Frequency multiplying equipment |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02134722U (ja) * | 1989-04-13 | 1990-11-08 |
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