JPS61104495U - - Google Patents

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JPS61104495U
JPS61104495U JP18965684U JP18965684U JPS61104495U JP S61104495 U JPS61104495 U JP S61104495U JP 18965684 U JP18965684 U JP 18965684U JP 18965684 U JP18965684 U JP 18965684U JP S61104495 U JPS61104495 U JP S61104495U
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JP
Japan
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clock signal
display
circuit
sequential scan
scan timing
Prior art date
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Application number
JP18965684U
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  • Control Of Indicators Other Than Cathode Ray Tubes (AREA)

Description

【図面の簡単な説明】
図面は本考案の１実施例を示す回路図である。 １はデイスプレイ インターフエース、２と５
はドライブ用トランジスタアレイ、３は７セグメ
ントＬＥＤ、４はデコーダ、８は再トリガー可能
形ワンシヨツト回路である。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 複数ないし多数桁表示器を少数のデコーダ
    ／ドライバにより時分割で一定周期ごとにくり返
    し点灯させ、全表示器が同時に点灯しているよう
    にみせかけるようにしたダイナミツク デイスプ
    レイ回路において、表示器の順次走査タイミング
    用クロツク信号の動作を常時監視する手段と、こ
    れによりクロツク信号の停止を検出した場合には
    表示器に前置されたこれらのドライブ素子の全て
    の入力端をリセツトするようにした手段とを具有
    していることを特徴とする、ダイナミツク デイ
    スプレイ回路。 (2) クロツク信号をトリガー入力として再トリ
    ガー可能形ワンシヨツト回路を使用した監視手段
    と、これによりクロツク信号の停止を検出した場
    合にデコーダを介して表示器のドライブ素子入力
    端の全てがリセツトされるようにしたゲート回路
    とを具有していることを特徴とする、実用新案登
    録請求の範囲第１項に記載のダイナミツク デイ
    スプレイ回路。
JP18965684U 1984-12-14 1984-12-14 Pending JPS61104495U (ja)

Priority Applications (1)

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JP18965684U JPS61104495U (ja) 1984-12-14 1984-12-14

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Application Number Priority Date Filing Date Title
JP18965684U JPS61104495U (ja) 1984-12-14 1984-12-14

Publications (1)

Publication Number Publication Date
JPS61104495U true JPS61104495U (ja) 1986-07-03

Family

ID=30747106

Family Applications (1)

Application Number Title Priority Date Filing Date
JP18965684U Pending JPS61104495U (ja) 1984-12-14 1984-12-14

Country Status (1)

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JP (1) JPS61104495U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH021784U (ja) * 1988-06-14 1990-01-08

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH021784U (ja) * 1988-06-14 1990-01-08

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