JPS61111233U - - Google Patents
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- Publication number
- JPS61111233U JPS61111233U JP20101384U JP20101384U JPS61111233U JP S61111233 U JPS61111233 U JP S61111233U JP 20101384 U JP20101384 U JP 20101384U JP 20101384 U JP20101384 U JP 20101384U JP S61111233 U JPS61111233 U JP S61111233U
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- ecl
- level
- output
- pair
- Prior art date
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- Pending
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- 238000006243 chemical reaction Methods 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Logic Circuits (AREA)
Description
第１図は、本考案によるレベル変換回路の一実
施例を示す回路図である。第２図は、従来技術に
よるレベル変換回路の一例を示す回路図である。 １……ＥＣＬゲート、２，３……トランジスタ
、４〜９……抵抗器。
施例を示す回路図である。第２図は、従来技術に
よるレベル変換回路の一例を示す回路図である。 １……ＥＣＬゲート、２，３……トランジスタ
、４〜９……抵抗器。
Claims (1)
- ＥＣＬレベルの信号を入力することができ、出
力用の第１のトランジスタを差動増幅器の一つの
トランジスタとして使用することができるＥＣＬ
ゲートと、前記ＥＣＬゲートの中の前記第１のト
ランジスタと共に差動トランジスタ対を形成する
第２のトランジスタと、前記第２のトランジスタ
のエミツタならびにコレクタに接続された一対の
プルアツプ抵抗器とを具備し、ＥＣＬレベルの入
力信号が加えられたときにＴＴＬレベルあるいは
ＣＭＯＳレベルの信号を出力できるように構成し
たことを特徴とするレベル変換回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20101384U JPS61111233U (ja) | 1984-12-25 | 1984-12-25 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20101384U JPS61111233U (ja) | 1984-12-25 | 1984-12-25 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61111233U true JPS61111233U (ja) | 1986-07-14 |
Family
ID=30762405
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20101384U Pending JPS61111233U (ja) | 1984-12-25 | 1984-12-25 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61111233U (ja) |
-
1984
- 1984-12-25 JP JP20101384U patent/JPS61111233U/ja active Pending
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