JPS6123595B2 - - Google Patents
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- JPS6123595B2 JPS6123595B2 JP949879A JP949879A JPS6123595B2 JP S6123595 B2 JPS6123595 B2 JP S6123595B2 JP 949879 A JP949879 A JP 949879A JP 949879 A JP949879 A JP 949879A JP S6123595 B2 JPS6123595 B2 JP S6123595B2
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- JP
- Japan
- Prior art keywords
- pcm signal
- signal
- pcm
- recorded
- code
- Prior art date
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- Management Or Editing Of Information On Record Carriers (AREA)
Description
【発明の詳細な説明】
本発明は、例えばオーデイオ信号をPCM変調
して得られるPCM信号が記録された磁気テープ
に対して他の新たなPCM信号を挿入記録した
り、もとのPCM信号につなげて記録することが
できる電子的なPCM信号の編集装置に関する。
して得られるPCM信号が記録された磁気テープ
に対して他の新たなPCM信号を挿入記録した
り、もとのPCM信号につなげて記録することが
できる電子的なPCM信号の編集装置に関する。
以下、本発明の一実施例について説明すると、
第１図において、１は、矢印方向に一定速度で走
行する磁気テープを示す。磁気テープ１に摺接す
るように先行再生ヘツド２と記録ヘツド３とモニ
ター再生ヘツド４とが設けられ、図示せずも消去
ヘツドが設けられている。先行再生ヘツド２は、
記録ヘツド３の記録位置より先行して磁気テープ
２からPCM信号を再生するものである。この例
では、説明の簡単なために１チヤンネルのPCM
信号が磁気テープ１の長手方向と平行する１本の
トラツクとして記録されているものとする。先行
再生ヘツド２からの再生出力が再生アンプ５を介
してデコーダ６に供給される。デコーダ６は、
NRZI、MFM、3PM等の所定の記録方式の再生出
力をバイナリーコードに復調する復調回路、時間
軸変動分を除去する時間軸補正回路、誤り訂正回
路等を備えており、デコーダ６からもとのPCM
信号S1が現れる。このもとのPCM信号S1が遅延
回路７に供給され、遅延回路７の出力が編集点処
理回路８に供給される。編集点処理回路８には、
端子９から記録すべき新たなPCM信号S2が供給
され、この編集点処理回路８から発生するPCM
信号S3がエンコーダ１０に供給される。エンコー
ダ１０は、デコーダ６とは逆に誤り検出及び訂正
が可能なコード構成にPCM信号S3を変換すると
共に、所定の記録方式に変調するもので、このエ
ンコーダ１０の出力信号が記録ゲート回路１１及
び記録アンプ１２を介して記録ヘツド３に供給さ
れる。上述の編集点処理回路８と記録ゲート回路
１１とが制御回路１３から発生する制御信号P1及
びP2によつて制御される。
第１図において、１は、矢印方向に一定速度で走
行する磁気テープを示す。磁気テープ１に摺接す
るように先行再生ヘツド２と記録ヘツド３とモニ
ター再生ヘツド４とが設けられ、図示せずも消去
ヘツドが設けられている。先行再生ヘツド２は、
記録ヘツド３の記録位置より先行して磁気テープ
２からPCM信号を再生するものである。この例
では、説明の簡単なために１チヤンネルのPCM
信号が磁気テープ１の長手方向と平行する１本の
トラツクとして記録されているものとする。先行
再生ヘツド２からの再生出力が再生アンプ５を介
してデコーダ６に供給される。デコーダ６は、
NRZI、MFM、3PM等の所定の記録方式の再生出
力をバイナリーコードに復調する復調回路、時間
軸変動分を除去する時間軸補正回路、誤り訂正回
路等を備えており、デコーダ６からもとのPCM
信号S1が現れる。このもとのPCM信号S1が遅延
回路７に供給され、遅延回路７の出力が編集点処
理回路８に供給される。編集点処理回路８には、
端子９から記録すべき新たなPCM信号S2が供給
され、この編集点処理回路８から発生するPCM
信号S3がエンコーダ１０に供給される。エンコー
ダ１０は、デコーダ６とは逆に誤り検出及び訂正
が可能なコード構成にPCM信号S3を変換すると
共に、所定の記録方式に変調するもので、このエ
ンコーダ１０の出力信号が記録ゲート回路１１及
び記録アンプ１２を介して記録ヘツド３に供給さ
れる。上述の編集点処理回路８と記録ゲート回路
１１とが制御回路１３から発生する制御信号P1及
びP2によつて制御される。
なお、モニター再生ヘツド４の再生出力が再生
アンプ１４に供給され、図示せずも再生アンプ１
４の出力がデコーダを介してＤ／Ａ変換器等の
PCM復調回路に供給され、オーデイオ信号が取
り出される。また、記録すべき新たなPCM信号
S2としては、他のPCM信号記録再生装置の再生
出力、又は磁気テープ１に複数トラツクが形成さ
れ別チヤンネルのPCM信号が記録されている場
合における別チヤンネルの再生出力を用いること
ができる。
アンプ１４に供給され、図示せずも再生アンプ１
４の出力がデコーダを介してＤ／Ａ変換器等の
PCM復調回路に供給され、オーデイオ信号が取
り出される。また、記録すべき新たなPCM信号
S2としては、他のPCM信号記録再生装置の再生
出力、又は磁気テープ１に複数トラツクが形成さ
れ別チヤンネルのPCM信号が記録されている場
合における別チヤンネルの再生出力を用いること
ができる。
第２図は、編集点処理回路８の一例の構成を示
す。第２図において１５ａ，１５ｂで示される入
力端子の夫々に遅延回路７を介されたもとの
PCM信号S1と端子９からの新たなPCM信号S2と
が供給され、デジタル的な乗算器１６ａ，１６ｂ
の夫々に加えられる。１７は、乗算器１６ａ，１
６ｂに対する乗算定数α及び（１−α）を発生す
る定数発生器を示す。定数発生器１７は、カウン
タ等で構成されており、端子１８に制御信号P2が
供給される時から動作を開始し、（１→０）及び
（０→１）に相対的なレベルがステツプ的に変化
する定数α及び（１−α）を発生する。乗算器１
６ａ，１６ｂの出力が加算器１９に供給され、こ
の加算器１９の出力端子２０にPCM信号S3が発
生する。
す。第２図において１５ａ，１５ｂで示される入
力端子の夫々に遅延回路７を介されたもとの
PCM信号S1と端子９からの新たなPCM信号S2と
が供給され、デジタル的な乗算器１６ａ，１６ｂ
の夫々に加えられる。１７は、乗算器１６ａ，１
６ｂに対する乗算定数α及び（１−α）を発生す
る定数発生器を示す。定数発生器１７は、カウン
タ等で構成されており、端子１８に制御信号P2が
供給される時から動作を開始し、（１→０）及び
（０→１）に相対的なレベルがステツプ的に変化
する定数α及び（１−α）を発生する。乗算器１
６ａ，１６ｂの出力が加算器１９に供給され、こ
の加算器１９の出力端子２０にPCM信号S3が発
生する。
第３図Ａにおいて、t0のタイミングでは、（α
＝１）したがつて（（１−α）＝０）となつてお
り、編集点処理回路８の出力端子２０に現れる
PCM信号S3は、もとのPCM信号S1に他ならな
い。次に、t1のタイミングで制御信号P2が発生す
ると、定数発生器１７が動作を開始し、αが１か
ら０にステツプ的に減少し、（１−α）が逆に０
から１にステツプ的に増入する。この変化のステ
ツプ数によつてフエードイン、フエードアウトの
なされる時間が定まる。かかる定数α及び（１−
α）の変化によつてそのレベルが徐々に減少（フ
エードアウト）するもとのPCM信号S1とそのレ
ベルが徐々に増大（フエードイン）する新たな
PCM信号S2とが混合されたPCM信号S3が発生す
る。そしてt2で示すタイミング以後では、（α＝
０）（（１−α）＝１）となるので編集点処理回路
８の出力に現れるPCM信号S3は、新たなPCM信
号S2そのものとなる。
＝１）したがつて（（１−α）＝０）となつてお
り、編集点処理回路８の出力端子２０に現れる
PCM信号S3は、もとのPCM信号S1に他ならな
い。次に、t1のタイミングで制御信号P2が発生す
ると、定数発生器１７が動作を開始し、αが１か
ら０にステツプ的に減少し、（１−α）が逆に０
から１にステツプ的に増入する。この変化のステ
ツプ数によつてフエードイン、フエードアウトの
なされる時間が定まる。かかる定数α及び（１−
α）の変化によつてそのレベルが徐々に減少（フ
エードアウト）するもとのPCM信号S1とそのレ
ベルが徐々に増大（フエードイン）する新たな
PCM信号S2とが混合されたPCM信号S3が発生す
る。そしてt2で示すタイミング以後では、（α＝
０）（（１−α）＝１）となるので編集点処理回路
８の出力に現れるPCM信号S3は、新たなPCM信
号S2そのものとなる。
この状態で第３図Ｂにおいてt3で示すタイミン
グで制御信号P2が発生すると、再び定数発生器１
７が動作を開始し、αが０から１にステツプ的に
増大し、（１−α）が１から０にステツプ的に減
少する。第３図Ａの場合とは逆に、もとのPCM
信号S1のレベルが増大（フエードイン）し、新た
なPCM信号S2のレベルが減少（フエードアウ
ト）する。（α＝１）（（１−α）＝０）となるタイ
ミングt4以後では、PCM信号S3はもとのPCM信
号S1そのものとなる。
グで制御信号P2が発生すると、再び定数発生器１
７が動作を開始し、αが０から１にステツプ的に
増大し、（１−α）が１から０にステツプ的に減
少する。第３図Ａの場合とは逆に、もとのPCM
信号S1のレベルが増大（フエードイン）し、新た
なPCM信号S2のレベルが減少（フエードアウ
ト）する。（α＝１）（（１−α）＝０）となるタイ
ミングt4以後では、PCM信号S3はもとのPCM信
号S1そのものとなる。
上述の本発明の一実施例により第４図に示すよ
うなインサートモードの電子編集動作を行なうこ
とができる。つまり、磁気テープ１のトラツク１
ａに実線のハツチング領域で示すようにもとの信
号が記録されている場合に、t0で示すタイミング
でもつて制御信号P1が例えば高レベルに立上るこ
とにより記録ゲート回路１１がオンするカツトイ
ン（パンチイン）動作がなされ、このタイミング
t0でもつて再生動作から記録動作への切替がなさ
れる。これよりやや遅れたタイミングt1で制御信
号P2が発生して上述のようなクロスフエード動作
が開始する。t0及びt1と夫々対応するトラツク１
ａの位置T0及びT1の間には、もとの信号（PCM
信号S1がエンコーダ１０を介されたもの）が再記
録される。もとの信号は、既に記録されていた信
号と同一であり、またそのような記録が行なわれ
るように遅延回路７の遅延量が選ばれている。ク
ロスフエード動作が終了するタイミングt2と対応
するトラツク１ａの位置をT2とすると、T1から
T2までの区間には、徐々に減少するもとのPCM
信号S1と徐々に増大する新たなPCM信号S2とが
混合されたPCM信号S3がエンコーダ１０、記録
ゲート回路１１及び記録アンプ１２を介して記録
される。T2以降には、新たなPCM信号S2がエン
コーダ１０を介された信号が記録される。トラツ
ク１ａの区間T0〜T2を破線のハツチング領域と
して示す。
うなインサートモードの電子編集動作を行なうこ
とができる。つまり、磁気テープ１のトラツク１
ａに実線のハツチング領域で示すようにもとの信
号が記録されている場合に、t0で示すタイミング
でもつて制御信号P1が例えば高レベルに立上るこ
とにより記録ゲート回路１１がオンするカツトイ
ン（パンチイン）動作がなされ、このタイミング
t0でもつて再生動作から記録動作への切替がなさ
れる。これよりやや遅れたタイミングt1で制御信
号P2が発生して上述のようなクロスフエード動作
が開始する。t0及びt1と夫々対応するトラツク１
ａの位置T0及びT1の間には、もとの信号（PCM
信号S1がエンコーダ１０を介されたもの）が再記
録される。もとの信号は、既に記録されていた信
号と同一であり、またそのような記録が行なわれ
るように遅延回路７の遅延量が選ばれている。ク
ロスフエード動作が終了するタイミングt2と対応
するトラツク１ａの位置をT2とすると、T1から
T2までの区間には、徐々に減少するもとのPCM
信号S1と徐々に増大する新たなPCM信号S2とが
混合されたPCM信号S3がエンコーダ１０、記録
ゲート回路１１及び記録アンプ１２を介して記録
される。T2以降には、新たなPCM信号S2がエン
コーダ１０を介された信号が記録される。トラツ
ク１ａの区間T0〜T2を破線のハツチング領域と
して示す。
次に、カツトアウト（パンチアウト）動作時に
は、第３図Ｂにおいてt3で示すタイミングで制御
信号P2が発生し、t3〜t4の期間でクロスフエード
動作がなされる。この期間に対応するトラツク１
ａのT3〜T4の区間に、徐々に減少する新たな
PCM信号S2と徐々に増大するもとのPCM信号S1
とが混合されたPCM信号S3がエンコーダ１０、
記録ゲート回路１１及び記録アンプ１２を介して
記録される。制御信号P1がt5で示すタイミングか
ら低レベルとなり、これによつて記録ゲート回路
１１がオフし、記録動作から再生動作への切替が
なされる。このタイミングt5り相当するトラツク
１ａの位置T5以後は、もとのPCM信号が既に記
録されている領域である。トラツク１ａのT3〜
T5の区間を破線のハツチング領域を付して示
す。
は、第３図Ｂにおいてt3で示すタイミングで制御
信号P2が発生し、t3〜t4の期間でクロスフエード
動作がなされる。この期間に対応するトラツク１
ａのT3〜T4の区間に、徐々に減少する新たな
PCM信号S2と徐々に増大するもとのPCM信号S1
とが混合されたPCM信号S3がエンコーダ１０、
記録ゲート回路１１及び記録アンプ１２を介して
記録される。制御信号P1がt5で示すタイミングか
ら低レベルとなり、これによつて記録ゲート回路
１１がオフし、記録動作から再生動作への切替が
なされる。このタイミングt5り相当するトラツク
１ａの位置T5以後は、もとのPCM信号が既に記
録されている領域である。トラツク１ａのT3〜
T5の区間を破線のハツチング領域を付して示
す。
なお、上述の説明は、既に磁気テープ１のトラ
ツク１ａに記録されているPCM信号の途中に新
たなPCM信号を挿入するインサートモードにつ
いてであるが、既に記録されているPCM信号の
前又は後に新たなPCM信号をつなげるアツセン
ブルモードに対しても同様に本発明を適用するこ
とができる。また、クロスフエード以外に、なだ
らかにミユーテイングをかける方式や、もとの
PCM信号と新たなPCM信号との間でなるべくレ
ベル差をもたないように両信号を接続する方式等
の編集点処理を行なうようにしても良い。更に、
先行再生ヘツド２及びモニター再生ヘツド４の２
つの再生ヘツドを設ける構成に限らず、１個の再
生ヘツドと２個の記録ヘツドとを設けるようにし
たり、メモリー装置を用いるようにしても良い。
ツク１ａに記録されているPCM信号の途中に新
たなPCM信号を挿入するインサートモードにつ
いてであるが、既に記録されているPCM信号の
前又は後に新たなPCM信号をつなげるアツセン
ブルモードに対しても同様に本発明を適用するこ
とができる。また、クロスフエード以外に、なだ
らかにミユーテイングをかける方式や、もとの
PCM信号と新たなPCM信号との間でなるべくレ
ベル差をもたないように両信号を接続する方式等
の編集点処理を行なうようにしても良い。更に、
先行再生ヘツド２及びモニター再生ヘツド４の２
つの再生ヘツドを設ける構成に限らず、１個の再
生ヘツドと２個の記録ヘツドとを設けるようにし
たり、メモリー装置を用いるようにしても良い。
上述の一実施例の説明から理解されるように、
本発明に依れば、もとのPCM信号が既に記録さ
れている磁気テープ１に新たなPCM信号を記録
するときに、このもとのPCM信号と新たなPCM
信号との間のレベル飛びのような不連続性が緩和
された信号を両者の間に記録するので、本発明に
より編集された磁気テープを再生するときに、も
とのPCM信号と新たなPCM信号とのつなぎめで
クリツク音が発生するような問題点を回避するこ
とができる。また、もとのPCM信号と新たな
PCM信号とからデジタル的な処理によつて両者
の間の不連続性が緩和されたPCM信号を形成す
るので、アナログ信号に戻して処理する場合のよ
うに歪を発生することを防止できる。
本発明に依れば、もとのPCM信号が既に記録さ
れている磁気テープ１に新たなPCM信号を記録
するときに、このもとのPCM信号と新たなPCM
信号との間のレベル飛びのような不連続性が緩和
された信号を両者の間に記録するので、本発明に
より編集された磁気テープを再生するときに、も
とのPCM信号と新たなPCM信号とのつなぎめで
クリツク音が発生するような問題点を回避するこ
とができる。また、もとのPCM信号と新たな
PCM信号とからデジタル的な処理によつて両者
の間の不連続性が緩和されたPCM信号を形成す
るので、アナログ信号に戻して処理する場合のよ
うに歪を発生することを防止できる。
第５図は、本発明を適用できるコード構成の他
の例を示す。第５図Ａに示すように、W-1，
W0，W1，W2………と連続するPCM信号（情報
コード）の２ワード毎に対してこの２ワードの全
加算コードP-1，P1，P3………が付加されてお
り、２ワードのPCM信号例えばW1及びW2とこれ
に対する誤り訂正用の全加算コードP1（＝W1＋
W2）でもつて１ブロツクが構成されている。この
第５図Ａに示すもとのコード構成のうちで第５図
Ｂに示すように全加算コードをｄブロツクだけ遅
延し、更に図示せずも複数ブロツク毎に対して
CRCコード、パリテイコード等の誤り検出用コ
ード（ポインタ）を付加して磁気テープ１に記録
するようになされる。このような配列順序の並び
かえ（インターリーブ）は、ドロツプアウト等に
よるバースト誤りが発生するときに、同一ブロツ
クのPCM信号と全加算コードとの両者がともに
誤ることを回避できるので、バースト誤りに対し
て強くなる効果をもたらす。例えばPCM信号の
W1及びW2がともに誤つたことがポインタによつ
て検出されるときには、全加算コードP1の1/2の
レベルのコードをW1及びW2の代わりとするよう
な訂正を行なえば良い。更に、図示せずも１ブロ
ツクを構成するPCM信号の２ワードの間でもイ
ンターリーブを行なうようにすれば、一層誤り訂
正能力が高まる。
の例を示す。第５図Ａに示すように、W-1，
W0，W1，W2………と連続するPCM信号（情報
コード）の２ワード毎に対してこの２ワードの全
加算コードP-1，P1，P3………が付加されてお
り、２ワードのPCM信号例えばW1及びW2とこれ
に対する誤り訂正用の全加算コードP1（＝W1＋
W2）でもつて１ブロツクが構成されている。この
第５図Ａに示すもとのコード構成のうちで第５図
Ｂに示すように全加算コードをｄブロツクだけ遅
延し、更に図示せずも複数ブロツク毎に対して
CRCコード、パリテイコード等の誤り検出用コ
ード（ポインタ）を付加して磁気テープ１に記録
するようになされる。このような配列順序の並び
かえ（インターリーブ）は、ドロツプアウト等に
よるバースト誤りが発生するときに、同一ブロツ
クのPCM信号と全加算コードとの両者がともに
誤ることを回避できるので、バースト誤りに対し
て強くなる効果をもたらす。例えばPCM信号の
W1及びW2がともに誤つたことがポインタによつ
て検出されるときには、全加算コードP1の1/2の
レベルのコードをW1及びW2の代わりとするよう
な訂正を行なえば良い。更に、図示せずも１ブロ
ツクを構成するPCM信号の２ワードの間でもイ
ンターリーブを行なうようにすれば、一層誤り訂
正能力が高まる。
上述の第５図Ｂに示すコード構成でもつて磁気
テープ１にPCM信号が記録されている場合に対
しても同様に本発明を適用することができる。つ
まり、先行再生ヘツド２の再生出力が再生アンプ
５を介して第６図に示すデコーダの入力端子２１
に供給される。２２は、復調回路を示し、この復
調回路２２からの第５図Ｂに示す配列の信号が時
間軸補正回路２３を介して分配回路２４に供給さ
れてPCM信号系列と全加算コード系列とに分け
られ、PCM信号系列が遅延回路２５によつてｄ
ブロツク遅延され、第５図Ａに示す配列と同様の
時間関係とされたPCM信号系列及び全加算コー
ド系列が誤り訂正回路２６に供給される。この誤
り訂正回路２６の出力端子２７には、誤りが訂正
又は補正されたPCM信号S1が得られる。
テープ１にPCM信号が記録されている場合に対
しても同様に本発明を適用することができる。つ
まり、先行再生ヘツド２の再生出力が再生アンプ
５を介して第６図に示すデコーダの入力端子２１
に供給される。２２は、復調回路を示し、この復
調回路２２からの第５図Ｂに示す配列の信号が時
間軸補正回路２３を介して分配回路２４に供給さ
れてPCM信号系列と全加算コード系列とに分け
られ、PCM信号系列が遅延回路２５によつてｄ
ブロツク遅延され、第５図Ａに示す配列と同様の
時間関係とされたPCM信号系列及び全加算コー
ド系列が誤り訂正回路２６に供給される。この誤
り訂正回路２６の出力端子２７には、誤りが訂正
又は補正されたPCM信号S1が得られる。
この第６図に示すデコーダからのPCM信号S1
が前述と同様に遅延回路７を介して編集点処理回
路８に供給され、新たなPCM信号S2と混合され
る。編集点処理回路８からのPCM信号S3が第７
図に示すエンコーダの入力端子２８に加えられ
る。全加算コード発生回路２９によりPCM信号
S3の２ワード毎に対する全加算コードが形成さ
れ、この全加算コードが遅延回路３０によつてｄ
ブロツクだけ遅延され、PCM信号S3と遅延され
た全加算コードとが合成回路３１に供給される。
この合成回路３１によつてPCM信号S3とこれに
対して付加され且つ遅延された全加算コードとが
１チヤンネルとされ、変調回路３２に供給される
ことにより所定の記録方式とされて出力端子３３
に取り出される。
が前述と同様に遅延回路７を介して編集点処理回
路８に供給され、新たなPCM信号S2と混合され
る。編集点処理回路８からのPCM信号S3が第７
図に示すエンコーダの入力端子２８に加えられ
る。全加算コード発生回路２９によりPCM信号
S3の２ワード毎に対する全加算コードが形成さ
れ、この全加算コードが遅延回路３０によつてｄ
ブロツクだけ遅延され、PCM信号S3と遅延され
た全加算コードとが合成回路３１に供給される。
この合成回路３１によつてPCM信号S3とこれに
対して付加され且つ遅延された全加算コードとが
１チヤンネルとされ、変調回路３２に供給される
ことにより所定の記録方式とされて出力端子３３
に取り出される。
上述のデコーダ及びエンコーダを用いることに
より、インサートモードの電子編集を行なつた場
合、PCM信号S3は、第８図Ａに示すように第４
図と同様にトラツク１ａに記録される。しかし、
全加算コードは遅延されているので、トラツク１
ａに記録される場合、第８図Ｂ（理解の容易のた
めに第８図Ａと別の図としている）に示すよう
に、再生から記録状態に変わつた位置T0から
T0′迄の長さＤの区間には、T0より前のPCM信号
S1に対する全加算コードが再記録される。この長
さＤは、前述の遅延量（ｄブロツク）と対応して
いる。そしてT0′〜T1′の区間には、T0〜T1に記
録されるPCM信号S3（もとのPCM信号S1）に対す
る全加算コードが記録され、T1′〜T2′の区間に
は、T1〜T2に記録されるPCM信号S3（もとの
PCM信号S1及び新たなPCM信号S2が混合された
信号）に対する全加算コードが記録される。ま
た、T3の位置から始まるパンチアウト動作のと
きも同様に、PCM信号S3に対する全加算コード
を欠落なく記録することができる。つまりT3〜
T3′のＤの長さの区間には、それ以前に記録され
たPCM信号S3（新たなPCM信号S2）に対する全加
算コードが記録され、T3′〜T4′の区間には、
PCM信号S3（もとのPCM信号S1と新たなPCM信
号S2とが混合されたもの）に対する全加算コード
が記録され、T4′〜T5の区間には、PCM信号S3
（T4より後の一部の区間に記録されるもとのPCM
信号S1）に対する全加算コードが記録される。
より、インサートモードの電子編集を行なつた場
合、PCM信号S3は、第８図Ａに示すように第４
図と同様にトラツク１ａに記録される。しかし、
全加算コードは遅延されているので、トラツク１
ａに記録される場合、第８図Ｂ（理解の容易のた
めに第８図Ａと別の図としている）に示すよう
に、再生から記録状態に変わつた位置T0から
T0′迄の長さＤの区間には、T0より前のPCM信号
S1に対する全加算コードが再記録される。この長
さＤは、前述の遅延量（ｄブロツク）と対応して
いる。そしてT0′〜T1′の区間には、T0〜T1に記
録されるPCM信号S3（もとのPCM信号S1）に対す
る全加算コードが記録され、T1′〜T2′の区間に
は、T1〜T2に記録されるPCM信号S3（もとの
PCM信号S1及び新たなPCM信号S2が混合された
信号）に対する全加算コードが記録される。ま
た、T3の位置から始まるパンチアウト動作のと
きも同様に、PCM信号S3に対する全加算コード
を欠落なく記録することができる。つまりT3〜
T3′のＤの長さの区間には、それ以前に記録され
たPCM信号S3（新たなPCM信号S2）に対する全加
算コードが記録され、T3′〜T4′の区間には、
PCM信号S3（もとのPCM信号S1と新たなPCM信
号S2とが混合されたもの）に対する全加算コード
が記録され、T4′〜T5の区間には、PCM信号S3
（T4より後の一部の区間に記録されるもとのPCM
信号S1）に対する全加算コードが記録される。
以上の説明から理解されるように、PCM信号
の情報コードとチエツクコードとが所定長離され
るコード構成の場合でも、T0又はT3で示す編集
点の前の情報コードに対するチエツクコードをそ
の後においても記録することができる。したがつ
て、本発明により電子編集された磁気テープを再
生したときに、編集点の前後の部分でも誤り検出
又は訂正を正常に行なうことができる利点があ
る。
の情報コードとチエツクコードとが所定長離され
るコード構成の場合でも、T0又はT3で示す編集
点の前の情報コードに対するチエツクコードをそ
の後においても記録することができる。したがつ
て、本発明により電子編集された磁気テープを再
生したときに、編集点の前後の部分でも誤り検出
又は訂正を正常に行なうことができる利点があ
る。
なお、以上の説明では、固定ヘツドにより
PCM信号を記録再生する構成について説明した
が、これに限らず、回転ヘツドによりPCM信号
を記録再生する場合に対して本発明を適用するこ
とができる。
PCM信号を記録再生する構成について説明した
が、これに限らず、回転ヘツドによりPCM信号
を記録再生する場合に対して本発明を適用するこ
とができる。
第１図は本発明の一実施例のブロツク図、第２
図及び第３図は編集点処理回路の一例のブロツク
図及びその説明に用いる略線図、第４図は本発明
による電子編集の説明に用いる略線図、第５図は
本発明の他の実施例におけるコード構成の説明に
用いる略線図、第６図及び第７図は本発明の他の
実施例におけるエンコーダ及びデコーダの構成を
示すブロツク図、第８図は本発明の他の実施例に
おける電子編集の説明に用いる略線図である。 １は磁気テープ、１ａはトラツク、２は先行再
生ヘツド、３は記録ヘツド、６はデコーダ、８は
編集点処理回路、１０はエンコーダ、１１は記録
ゲート回路である。
図及び第３図は編集点処理回路の一例のブロツク
図及びその説明に用いる略線図、第４図は本発明
による電子編集の説明に用いる略線図、第５図は
本発明の他の実施例におけるコード構成の説明に
用いる略線図、第６図及び第７図は本発明の他の
実施例におけるエンコーダ及びデコーダの構成を
示すブロツク図、第８図は本発明の他の実施例に
おける電子編集の説明に用いる略線図である。 １は磁気テープ、１ａはトラツク、２は先行再
生ヘツド、３は記録ヘツド、６はデコーダ、８は
編集点処理回路、１０はエンコーダ、１１は記録
ゲート回路である。
Claims (1)
- 【特許請求の範囲】 １ 記録媒体から第１のPCM信号を得る手段
と、この第１のPCM信号を所定時間遅延させる
手段と、上記遅延された第１のPCM信号と混合
されるべき第２のPCM信号を得る手段と、上記
遅延された第１のPCM信号と上記第２のPCM信
号とを所定時間内で一方を他方に徐々に変換する
ようにして第３のPCM信号を得る手段とからな
り、上記記録媒体に既に記録されているPCM信
号と新たなPCM信号との間に挿入されるように
上記第３のPCM信号を記録するようにしたPCM
信号の編集装置。 ２ 第１のPCM信号は、情報コードとこれに対
するチエツクコードとよりなり、少なくともこの
情報コードとチエツクコードとが所定長離されて
記録媒体に記録されることを特徴とする特許請求
の範囲第１項記載のPCM信号の編集装置。
Priority Applications (9)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP949879A JPS55105871A (en) | 1979-01-30 | 1979-01-30 | Editing device for pcm signal |
| CA344,532A CA1133639A (en) | 1979-01-30 | 1980-01-28 | Method and apparatus for editing digital signals recorded on a record medium |
| DE19803003134 DE3003134A1 (de) | 1979-01-30 | 1980-01-29 | Verfahren und vorrichtung zum edieren von auf einem aufzeichnungstraeger aufgezeichneten digitalsignalen |
| GB8002966A GB2043984B (en) | 1979-01-30 | 1980-01-29 | Method and apparatus for editing digital signals recorded on a record medium |
| US06/116,401 US4327382A (en) | 1979-01-30 | 1980-01-29 | Method and apparatus for editing digital signals recorded on a record medium |
| AU55038/80A AU535800B2 (en) | 1979-01-30 | 1980-01-30 | Editing recorded digital signals |
| NL8000595A NL8000595A (nl) | 1979-01-30 | 1980-01-30 | Inrichting voor het bewerken van op een registratie- medium opgetekende digitale signalen. |
| AT0048580A AT371263B (de) | 1979-01-30 | 1980-01-30 | Vorrichtung zum edieren von auf einem aufzeichnungstraeger aufgezeichneten digitalsignalen mit ediersignalen |
| FR8002010A FR2448209A1 (fr) | 1979-01-30 | 1980-01-30 | Appareil de mise en forme de signaux numeriques notamment de signaux modules par impulsions codees enregistres sur bande magnetique |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP949879A JPS55105871A (en) | 1979-01-30 | 1979-01-30 | Editing device for pcm signal |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS55105871A JPS55105871A (en) | 1980-08-13 |
| JPS6123595B2 true JPS6123595B2 (ja) | 1986-06-06 |
Family
ID=11721892
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP949879A Granted JPS55105871A (en) | 1979-01-30 | 1979-01-30 | Editing device for pcm signal |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS55105871A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0592452U (ja) * | 1992-05-18 | 1993-12-17 | 内山工業株式会社 | シリンダヘッドカバー構造 |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS55139676A (en) * | 1979-03-05 | 1980-10-31 | Decca Ltd | Edit of program and other signal in digitally coded format |
| JPS57141081A (en) * | 1981-01-21 | 1982-09-01 | Minnesota Mining & Mfg | Editting method of and apparatus for combining audio signal digitally recorded |
| GB2167889B (en) * | 1984-11-28 | 1988-05-11 | Sony Corp | Video tape recorders |
-
1979
- 1979-01-30 JP JP949879A patent/JPS55105871A/ja active Granted
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0592452U (ja) * | 1992-05-18 | 1993-12-17 | 内山工業株式会社 | シリンダヘッドカバー構造 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS55105871A (en) | 1980-08-13 |
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