JPS61278212A - 比較回路 - Google Patents
比較回路Info
- Publication number
- JPS61278212A JPS61278212A JP12017085A JP12017085A JPS61278212A JP S61278212 A JPS61278212 A JP S61278212A JP 12017085 A JP12017085 A JP 12017085A JP 12017085 A JP12017085 A JP 12017085A JP S61278212 A JPS61278212 A JP S61278212A
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- Japan
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- voltage
- circuit
- output
- amplifier circuit
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、入力信号電圧と段階的に電圧値を設定した
複数の比較電圧とを個別に比較する比較回路に係り、た
とえば、信号電圧レベルに応じてLED (発光ダイオ
ード)などの表示素子を点灯させ、その表示素子の点灯
個数や点灯位置によりレベル表示を行う場合などにおい
て、連続して変化する信号電圧レベルを複数の段階的な
レベル信号に変換する場合に適する・比較回路に関する
ものである。
複数の比較電圧とを個別に比較する比較回路に係り、た
とえば、信号電圧レベルに応じてLED (発光ダイオ
ード)などの表示素子を点灯させ、その表示素子の点灯
個数や点灯位置によりレベル表示を行う場合などにおい
て、連続して変化する信号電圧レベルを複数の段階的な
レベル信号に変換する場合に適する・比較回路に関する
ものである。
たとえば、信号電圧レベルに応じてLEDを点灯させて
そのレベルを視覚的に表示するレベルメータにおいては
、信号電圧レベルに応じた点灯出力を得るために、第4
図に示すような比較回路が用いられている。
そのレベルを視覚的に表示するレベルメータにおいては
、信号電圧レベルに応じた点灯出力を得るために、第4
図に示すような比較回路が用いられている。
この比較回路では、入力端子2に加えられる入力電圧V
INを対数増幅器4で増幅し、対数増幅器4の出力電流
は、その出力側に設けられた固定抵抗6によって電圧に
変換される。
INを対数増幅器4で増幅し、対数増幅器4の出力電流
は、その出力側に設けられた固定抵抗6によって電圧に
変換される。
この対数増幅器4で得られた出力電圧は、レベル表示の
段階数に応じて設けられた複数の比較器、この場合、5
段階表示のために設けられた比較器81.8□、8:l
、84.8Sのそれぞれの非反転入力端子(+)に加え
られ、その反転入力端子(−)に抵抗LO,,10□、
103.104.10s、]、Obから電圧■。、の分
圧によって加えられた比較電圧V C1、V cz、V
C3、VC4、VCSと比較される。
段階数に応じて設けられた複数の比較器、この場合、5
段階表示のために設けられた比較器81.8□、8:l
、84.8Sのそれぞれの非反転入力端子(+)に加え
られ、その反転入力端子(−)に抵抗LO,,10□、
103.104.10s、]、Obから電圧■。、の分
圧によって加えられた比較電圧V C1、V cz、V
C3、VC4、VCSと比較される。
したがって、この比較回路では、第5図のAに示すよう
に、入力電圧VINに対応して対数増幅器4および抵抗
6を経て得られた出力電圧■。と、比較電圧VC1〜V
C5とが比較器81〜8.で比較され、各出力端子12
.〜12.から第5図のB〜Fに示すような比較出力が
出力電圧■。に応じて取り出される。
に、入力電圧VINに対応して対数増幅器4および抵抗
6を経て得られた出力電圧■。と、比較電圧VC1〜V
C5とが比較器81〜8.で比較され、各出力端子12
.〜12.から第5図のB〜Fに示すような比較出力が
出力電圧■。に応じて取り出される。
このような比較回路では、比較電圧VC1〜VCSが抵
抗lO0〜10.の分圧によって形成されているため、
比較電圧の最大値が電源電圧VCCによって制限される
。この場合、対数増幅器4の出力電圧の最大電圧は、比
較電圧によって制限を受けるので、入力電圧レベルの比
較電圧段階数が多くなると、上限電圧が一定である場合
、分圧回路における分圧比が小さくなるとともに、その
分圧比率を設定する分圧抵抗値が小さい値となり、比較
回路の精度が低下する。
抗lO0〜10.の分圧によって形成されているため、
比較電圧の最大値が電源電圧VCCによって制限される
。この場合、対数増幅器4の出力電圧の最大電圧は、比
較電圧によって制限を受けるので、入力電圧レベルの比
較電圧段階数が多くなると、上限電圧が一定である場合
、分圧回路における分圧比が小さくなるとともに、その
分圧比率を設定する分圧抵抗値が小さい値となり、比較
回路の精度が低下する。
そこで、この発明は、簡単な構成によって比較精度を高
めた比較回路の提供を目的とする。
めた比較回路の提供を目的とする。
C問題点を解決するための手段〕
この発明の比較回路は、たとえば、第1図に示すように
、増幅利得が切換え可能にされた増幅回路(20)と、
この増幅回路の増幅利得の切換えに対応して比較電圧が
切換え可能にされた比較電圧設定回路(36)と、この
比較電圧設定回路で設定された比較電圧と増幅回路の出
力電圧とを比較する比較器(341〜346.34a、
34b)とから構成したものである。
、増幅利得が切換え可能にされた増幅回路(20)と、
この増幅回路の増幅利得の切換えに対応して比較電圧が
切換え可能にされた比較電圧設定回路(36)と、この
比較電圧設定回路で設定された比較電圧と増幅回路の出
力電圧とを比較する比較器(341〜346.34a、
34b)とから構成したものである。
たとえば、第2図に示すように、増幅利得を切り換える
ことによって、増幅回路の出力電圧の値が変更され、こ
れに対応して比較電圧設定回路の比較電圧も変更される
。したがって、比較器には、比較すべき増幅回路の出力
電圧と、比較電圧とが相対的に変更されて加えられるの
で、分圧抵抗値を大きく取ることができ、比較精度が高
められる。
ことによって、増幅回路の出力電圧の値が変更され、こ
れに対応して比較電圧設定回路の比較電圧も変更される
。したがって、比較器には、比較すべき増幅回路の出力
電圧と、比較電圧とが相対的に変更されて加えられるの
で、分圧抵抗値を大きく取ることができ、比較精度が高
められる。
以下、この発明の実施例を図面を参照して詳細に説明す
る。
る。
第1図はこの発明の比較回路の実施例を示す。
第1図において、入力端子2に加えられた入力電圧v1
Nは、増幅利得が切換え可能に構成された増幅回路20
に加えられて増幅される。この増幅回路20には、第4
図に示す比較回路と同様の対数増幅器4が設置され、こ
の対数増幅器4の出力部に抵抗22.24を個別に介し
て増幅利得を切り換えるためのトランジスタ26.28
を接続したものである。
Nは、増幅利得が切換え可能に構成された増幅回路20
に加えられて増幅される。この増幅回路20には、第4
図に示す比較回路と同様の対数増幅器4が設置され、こ
の対数増幅器4の出力部に抵抗22.24を個別に介し
て増幅利得を切り換えるためのトランジスタ26.28
を接続したものである。
各トランジスタ26.280ベースには、スイッチ回路
30を介して特定のバイアス電圧vllが加えられてい
る。したがって、切換信号32に応じてスイッチ回路3
0の接点a、bが切り換えられ、トランジスタ26.2
8が選択的に動作状態に制御され、増幅回路20の増幅
利得が切り換えられることになる。
30を介して特定のバイアス電圧vllが加えられてい
る。したがって、切換信号32に応じてスイッチ回路3
0の接点a、bが切り換えられ、トランジスタ26.2
8が選択的に動作状態に制御され、増幅回路20の増幅
利得が切り換えられることになる。
このような増幅利得の切換えによって、増幅回路20で
得られたその出力電圧VB6. Vb6は、比較器34
..34□、343.34..34s、34、に加えら
れ、比較電圧設定回路36で設定された第1の比較電圧
■1、V 112、v13、■、4、VCS、V−6ま
たは第2 のkl[を圧vb、、■b2、Vl、3、V
b4s V 65、Vb6と比較される。この実施例
の各比較器34.〜346は、増幅回路2oの出力電圧
■3o、VbOと、第1の比較電圧■3.〜V@6また
は第2の比較電圧Vbl〜Vいとを比較する3人力とな
っている。
得られたその出力電圧VB6. Vb6は、比較器34
..34□、343.34..34s、34、に加えら
れ、比較電圧設定回路36で設定された第1の比較電圧
■1、V 112、v13、■、4、VCS、V−6ま
たは第2 のkl[を圧vb、、■b2、Vl、3、V
b4s V 65、Vb6と比較される。この実施例
の各比較器34.〜346は、増幅回路2oの出力電圧
■3o、VbOと、第1の比較電圧■3.〜V@6また
は第2の比較電圧Vbl〜Vいとを比較する3人力とな
っている。
比較電圧設定回路36には抵抗38..38□、38、
.38..38s 、38..38.の直列回路と、抵
抗40r 、40z 、40z 、404.405.4
06.10tの直列回路とを併設した分圧回路とともに
、切換信号 32によってこれらの分圧回路を選択する
スイッチ回路42が設けられ、抵抗38.〜38)によ
って電圧VCCを分圧して第Iの比較電圧V□〜 V3
い抵抗40+〜40.によって同様に電圧 VCCを分
圧して第2の比較電圧Vbl〜Vbl、が得られている
。
.38..38s 、38..38.の直列回路と、抵
抗40r 、40z 、40z 、404.405.4
06.10tの直列回路とを併設した分圧回路とともに
、切換信号 32によってこれらの分圧回路を選択する
スイッチ回路42が設けられ、抵抗38.〜38)によ
って電圧VCCを分圧して第Iの比較電圧V□〜 V3
い抵抗40+〜40.によって同様に電圧 VCCを分
圧して第2の比較電圧Vbl〜Vbl、が得られている
。
したがって、この比較回路では、入力電圧VINに応じ
てスイッチ回路30.42を切り換え、たとえば、入力
電圧■、が低い範囲では、スイッチ回路30,42を接
点a側に閉じ、トランジスタ26のベースにバイアス電
圧■、を加えてトランジスタ26を動作状態にするとと
もに、抵抗381〜38.による分圧回路を動作させて
第1の比較電圧■□〜Va&を比較器34.〜34.に
加える。この場合、トランジスタ26の動作によって増
幅回路20の増幅利得は、トランジスタ28を動作させ
た場合より高く設定されているので、増幅回路20の出
力電圧V、。とこれに対応した比較電圧Vml〜Vm&
が設定される。このため、第2図のAに示すように、出
力電圧V、。と比較電圧v0〜v1のように最大比較電
圧■いを3段階にしたものとなり、この結果、偏差値の
幅が拡大されて比較される。したがって、第2図のBX
ClDに示すように、各比較器34.〜34.の出力端
子44..44□、443には、比較器34+〜343
の動作反転によってH(高電位)出力が発生する。
てスイッチ回路30.42を切り換え、たとえば、入力
電圧■、が低い範囲では、スイッチ回路30,42を接
点a側に閉じ、トランジスタ26のベースにバイアス電
圧■、を加えてトランジスタ26を動作状態にするとと
もに、抵抗381〜38.による分圧回路を動作させて
第1の比較電圧■□〜Va&を比較器34.〜34.に
加える。この場合、トランジスタ26の動作によって増
幅回路20の増幅利得は、トランジスタ28を動作させ
た場合より高く設定されているので、増幅回路20の出
力電圧V、。とこれに対応した比較電圧Vml〜Vm&
が設定される。このため、第2図のAに示すように、出
力電圧V、。と比較電圧v0〜v1のように最大比較電
圧■いを3段階にしたものとなり、この結果、偏差値の
幅が拡大されて比較される。したがって、第2図のBX
ClDに示すように、各比較器34.〜34.の出力端
子44..44□、443には、比較器34+〜343
の動作反転によってH(高電位)出力が発生する。
そして、出力電圧■1゜が比較電圧v、3を超える値を
呈するとき、スイッチ回路30.42を接点す側に切り
換えると、増幅回路20にはトランジスタ26の動作停
止およびトランジスタ28の動作によって、低い増幅利
得が設定されて出力電圧■、。が出力されるとともに、
比較電圧設定回路36には、第2の比較電圧Vbl〜■
、6が設定される。このため、第2図のAに示すように
、出力電圧VbOと第2の比較電圧vb3〜VI+6と
が比較され、第2図のDSE、FSGに示すように、各
比較器34、〜34.の出力端子443.444.44
s、44&には、比較器34.〜34.の動作反転によ
ってH(高電位)出力が発生する。
呈するとき、スイッチ回路30.42を接点す側に切り
換えると、増幅回路20にはトランジスタ26の動作停
止およびトランジスタ28の動作によって、低い増幅利
得が設定されて出力電圧■、。が出力されるとともに、
比較電圧設定回路36には、第2の比較電圧Vbl〜■
、6が設定される。このため、第2図のAに示すように
、出力電圧VbOと第2の比較電圧vb3〜VI+6と
が比較され、第2図のDSE、FSGに示すように、各
比較器34、〜34.の出力端子443.444.44
s、44&には、比較器34.〜34.の動作反転によ
ってH(高電位)出力が発生する。
このように増幅回路20の増幅利得をたとえば2段階に
設定して切り換えるとともに、各比較器34+ 〜34
bに加える比較電圧も比較電圧設定回路36でたとえば
、第1および第2の比較電圧v0〜V、い■ゎ、〜Vb
6のように2段階に設定して切り換えることにより、出
力電圧と比較電圧とを相対的にレベル変更するので一入
力電圧VIHのレベルに関係なく比較精度を高めること
ができる。
設定して切り換えるとともに、各比較器34+ 〜34
bに加える比較電圧も比較電圧設定回路36でたとえば
、第1および第2の比較電圧v0〜V、い■ゎ、〜Vb
6のように2段階に設定して切り換えることにより、出
力電圧と比較電圧とを相対的にレベル変更するので一入
力電圧VIHのレベルに関係なく比較精度を高めること
ができる。
なお、実施例の各比較器34.〜346は、2段階に設
定された比較電圧のそれぞれと増幅回路20の出力電圧
とを個別に比較するため、3端子構成のものを用いたが
、第3図に示すように、各比較電圧V、〜■1い■b1
〜vbaごとに一対の比較器34a、34bからなる比
較器ユニットとし、切換信号32でスイッチ回路46を
切り換えて比較器34a、34bの比較出力を選択して
取り出すようにしてもよい。
定された比較電圧のそれぞれと増幅回路20の出力電圧
とを個別に比較するため、3端子構成のものを用いたが
、第3図に示すように、各比較電圧V、〜■1い■b1
〜vbaごとに一対の比較器34a、34bからなる比
較器ユニットとし、切換信号32でスイッチ回路46を
切り換えて比較器34a、34bの比較出力を選択して
取り出すようにしてもよい。
また、実施例では、6組の比較器34.〜346で6段
階の比較出力を得ているが、たとえば、16組の比較器
を設置して16段階の比較出力を発生させ、この比較出
力によって16個の表示素子としてのLEDを入力電圧
V工に応じて点灯させるようにしてもよい。
階の比較出力を得ているが、たとえば、16組の比較器
を設置して16段階の比較出力を発生させ、この比較出
力によって16個の表示素子としてのLEDを入力電圧
V工に応じて点灯させるようにしてもよい。
また、増幅回路の増幅利得は3以上の複数段階の異なる
値に設定するとともに、比較回路の比較電圧も複数組の
段階値に設定し、入力電圧や表示出力の用途などに応じ
て切り換えるようにしてもよい。
値に設定するとともに、比較回路の比較電圧も複数組の
段階値に設定し、入力電圧や表示出力の用途などに応じ
て切り換えるようにしてもよい。
以上説明したように、この発明によれば、比較すべき電
圧レベルと、比較電圧レベルを相対的に変更するので、
入力電圧の低い値から高い値まで精度の高い比較出力を
得ることができ、たとえば、信号レベルに応じてLED
を点灯させるレベルメータなどにおいて、精度の高いレ
ベル表示を実現できる。
圧レベルと、比較電圧レベルを相対的に変更するので、
入力電圧の低い値から高い値まで精度の高い比較出力を
得ることができ、たとえば、信号レベルに応じてLED
を点灯させるレベルメータなどにおいて、精度の高いレ
ベル表示を実現できる。
第1図はこの発明の比較回路の実施例を示す回路図、第
2図はこの発明の比較回路の動作を示す図、第3図はこ
の発明の比較回路における比較器の変形例を示す回路図
、第4図は従来の比較回路を示す回路図、第5図は従来
の比較回路の動作を示す図である。 20・・・増幅回路、34I〜346.34a134、
b ・・比較器、36・・・比較電圧設定回路。 第2図 第3図 第4図 第5図
2図はこの発明の比較回路の動作を示す図、第3図はこ
の発明の比較回路における比較器の変形例を示す回路図
、第4図は従来の比較回路を示す回路図、第5図は従来
の比較回路の動作を示す図である。 20・・・増幅回路、34I〜346.34a134、
b ・・比較器、36・・・比較電圧設定回路。 第2図 第3図 第4図 第5図
Claims (2)
- (1)増幅利得が切換え可能にされた増幅回路と、この
増幅回路の増幅利得の切換えに応じた比較電圧が切換え
可能にされた比較電圧設定回路と、この比較電圧設定回
路で設定された比較電圧と前記増幅回路の出力電圧とを
比較する比較器とから構成したことを特徴とする比較回
路。 - (2)前記増幅回路の増幅利得および前記比較電圧設定
回路の比較電圧は、入力信号レベルに応じて切り換える
ようにしたことを特徴とする特許請求の範囲第1項に記
載の比較回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12017085A JPS61278212A (ja) | 1985-06-03 | 1985-06-03 | 比較回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12017085A JPS61278212A (ja) | 1985-06-03 | 1985-06-03 | 比較回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61278212A true JPS61278212A (ja) | 1986-12-09 |
Family
ID=14779661
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12017085A Pending JPS61278212A (ja) | 1985-06-03 | 1985-06-03 | 比較回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61278212A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5384786A (en) * | 1976-12-29 | 1978-07-26 | Victor Co Of Japan Ltd | Level display device |
-
1985
- 1985-06-03 JP JP12017085A patent/JPS61278212A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5384786A (en) * | 1976-12-29 | 1978-07-26 | Victor Co Of Japan Ltd | Level display device |
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