JPS61296330A - 液晶表示素子の製造方法 - Google Patents
液晶表示素子の製造方法Info
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- JPS61296330A JPS61296330A JP13877885A JP13877885A JPS61296330A JP S61296330 A JPS61296330 A JP S61296330A JP 13877885 A JP13877885 A JP 13877885A JP 13877885 A JP13877885 A JP 13877885A JP S61296330 A JPS61296330 A JP S61296330A
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- Japan
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- short
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- circuited
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- Pending
Links
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Landscapes
- Liquid Crystal (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はラビング法に−よって配向処理を行う液晶表示
素子の製造方法に関するもので、上記ラビング処理中に
静電気によって生じる配向不良を解消する製造方法に関
する。
素子の製造方法に関するもので、上記ラビング処理中に
静電気によって生じる配向不良を解消する製造方法に関
する。
従来、特にＴＮ型液晶表示素子ではへ液晶分子を一定方
向に配列させるため、液晶表示素子の基板に配向処理が
行われていた。上記配向処理の１つの方法としてラビン
グ法がある。この方法の例としては、表示電極である透
明導電膜上にポリイミド樹脂やポリアミド樹脂等の誘電
体膜を塗布し、その表面を綿布やポリエステル等の化学
繊維布等で特定の方向にラビングする。このような処理
をする事で液晶分子の長袖をラビング方向に平行に配向
させる事ができるλしかし、上記のラビング処理ではガ
ラス基板と綿布や化学繊維布との摩擦により静電気が生
じる。そして、この静電気により表示電極の間隔が接近
している部分で放電が生じ、ポリイミド樹脂等の配向膜
の一部が熱的に破壊され配向状態が乱され配向不良が生
じていた。
向に配列させるため、液晶表示素子の基板に配向処理が
行われていた。上記配向処理の１つの方法としてラビン
グ法がある。この方法の例としては、表示電極である透
明導電膜上にポリイミド樹脂やポリアミド樹脂等の誘電
体膜を塗布し、その表面を綿布やポリエステル等の化学
繊維布等で特定の方向にラビングする。このような処理
をする事で液晶分子の長袖をラビング方向に平行に配向
させる事ができるλしかし、上記のラビング処理ではガ
ラス基板と綿布や化学繊維布との摩擦により静電気が生
じる。そして、この静電気により表示電極の間隔が接近
している部分で放電が生じ、ポリイミド樹脂等の配向膜
の一部が熱的に破壊され配向状態が乱され配向不良が生
じていた。
また、上記欠点を解消する方法として特公昭５７−５６
０４４号は、配向処理前に表示電極パターンを基板表面
上で共通パターンによって短絡させておき、ラビング時
に静電気によって生じる放電を防ぎ、ラビング後に短絡
部分を除去するという方法である。
０４４号は、配向処理前に表示電極パターンを基板表面
上で共通パターンによって短絡させておき、ラビング時
に静電気によって生じる放電を防ぎ、ラビング後に短絡
部分を除去するという方法である。
しかし前述のごとく基板表面上で表示電極パターンを短
絡させる場合、短絡した部分を除去するために基板の一
部を切断する必要があり、この場合、基板表示面の有効
表示部が狭くなるという欠点があった。
絡させる場合、短絡した部分を除去するために基板の一
部を切断する必要があり、この場合、基板表示面の有効
表示部が狭くなるという欠点があった。
本発明は上記欠点を解消するものであり、基板の外形に
対し有効表示部を小さくする事なく、ラビング時の静電
気による配向不良を防ぐ事を目的とする。
対し有効表示部を小さくする事なく、ラビング時の静電
気による配向不良を防ぐ事を目的とする。
上記の目的を達成させるために、本発明は次のような構
成としている。すなわち、本発明ではラビング処理前に
表示電極パターンを基板側面に設けた共通パターンにて
短絡させている。
成としている。すなわち、本発明ではラビング処理前に
表示電極パターンを基板側面に設けた共通パターンにて
短絡させている。
以上の構成によって゛ラビング法による配向処理を行う
前に、表示電極パターンを基板側面で短絡させ、ラビン
グ中に生じる静電気を防止し、ラビング後に基板側面の
短絡部分を除去させることにより配向不良が防げる。
前に、表示電極パターンを基板側面で短絡させ、ラビン
グ中に生じる静電気を防止し、ラビング後に基板側面の
短絡部分を除去させることにより配向不良が防げる。
以下、本発明の実施例を図面に基づいて詳述する。第１
図は本発明に係わる液晶表示素子の一実施例で、第１図
（ａｌは平面図、第１図（ｂ）は側面図、第２図は第１
図の短絡部分を示す斜視図、第３図は短絡部分を除去し
た状態を示す斜視図である。
図は本発明に係わる液晶表示素子の一実施例で、第１図
（ａｌは平面図、第１図（ｂ）は側面図、第２図は第１
図の短絡部分を示す斜視図、第３図は短絡部分を除去し
た状態を示す斜視図である。
第１図〜第３図において１．２はガラス基板であ分を構
成する共通電極、５は共通電極４．４を接続するための
電極パターンである。あらかじめ表示電極パターン６．
６を基板側面に形成した共通電極パターン５で短絡させ
る事により、ラビング処理により静電気が生じても、電
極間が全て同電位となっているため表示電極間での放電
は生じない。すなわち、従来では特に電極間隔の最も狭
い部分６等で放電が生じ配向を乱していたが本実施例の
ようにあらかじめ電極を短絡しておけば配向不良を生じ
ない。また、本実施例のように液晶表示素子の完成後に
、第３図（ａｌのように基板側面の共通電極を透明導電
膜の膜厚分だけ研摩して除去するか、あるいは第３図（
ｂｌのように基板の周辺部を電極パターン３．３′と共
通電極４．４の導通が無（なる程度に面取りをする事で
外形寸法を変える事な（共通電極４．４を除去でき、各
電極は独立し各々を単独に駆動する事ができる。
成する共通電極、５は共通電極４．４を接続するための
電極パターンである。あらかじめ表示電極パターン６．
６を基板側面に形成した共通電極パターン５で短絡させ
る事により、ラビング処理により静電気が生じても、電
極間が全て同電位となっているため表示電極間での放電
は生じない。すなわち、従来では特に電極間隔の最も狭
い部分６等で放電が生じ配向を乱していたが本実施例の
ようにあらかじめ電極を短絡しておけば配向不良を生じ
ない。また、本実施例のように液晶表示素子の完成後に
、第３図（ａｌのように基板側面の共通電極を透明導電
膜の膜厚分だけ研摩して除去するか、あるいは第３図（
ｂｌのように基板の周辺部を電極パターン３．３′と共
通電極４．４の導通が無（なる程度に面取りをする事で
外形寸法を変える事な（共通電極４．４を除去でき、各
電極は独立し各々を単独に駆動する事ができる。
以上の説明で明らかなように、ラビング処理前に基板側
面で表示電極パターンを共通電極によって短絡させてお
きラビング処理後に上記短絡部分を研摩等で除去すると
いう手段によりラビング法で生じる静電気による放電を
防止でき、さらには短絡部の除去の際に、基板寸法が大
きく減少する事もないので、同じ基板サイズに対し、有
効表示面積を大きく設計できるという効果がある。
面で表示電極パターンを共通電極によって短絡させてお
きラビング処理後に上記短絡部分を研摩等で除去すると
いう手段によりラビング法で生じる静電気による放電を
防止でき、さらには短絡部の除去の際に、基板寸法が大
きく減少する事もないので、同じ基板サイズに対し、有
効表示面積を大きく設計できるという効果がある。
第１図は本発明の液晶表示素子の一実施例を示し、第１
図（ａ）は平面図、第１図（ｂｌは側面図、第２図は第
１図の短絡部分を示す斜視図、第３図は短絡部分を除去
した状態を示す斜視図で、第３図（ａｌは基板側面の短
絡部を全て除去した場合、第３図（ｂｌは基板側面の短
絡部分の一部を除去した場合を示す。 １．２・・・・・・ガラス基板、 ６．３・・・・・・表示電極パターン、４．４・・・・
・・共通電極、 ５・・・・・・電極パターン。
図（ａ）は平面図、第１図（ｂｌは側面図、第２図は第
１図の短絡部分を示す斜視図、第３図は短絡部分を除去
した状態を示す斜視図で、第３図（ａｌは基板側面の短
絡部を全て除去した場合、第３図（ｂｌは基板側面の短
絡部分の一部を除去した場合を示す。 １．２・・・・・・ガラス基板、 ６．３・・・・・・表示電極パターン、４．４・・・・
・・共通電極、 ５・・・・・・電極パターン。
Claims (1)
- ラビング法によって配向処理を行う液晶表示素子の製造
方法において、表示電極パターンを短絡させるための共
通電極を基板側面に設け、ラビング処理後、前記共通電
極を除去させる事を特徴とする液晶表示素子の製造方法
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13877885A JPS61296330A (ja) | 1985-06-25 | 1985-06-25 | 液晶表示素子の製造方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13877885A JPS61296330A (ja) | 1985-06-25 | 1985-06-25 | 液晶表示素子の製造方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61296330A true JPS61296330A (ja) | 1986-12-27 |
Family
ID=15229975
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13877885A Pending JPS61296330A (ja) | 1985-06-25 | 1985-06-25 | 液晶表示素子の製造方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61296330A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0653664A3 (en) * | 1993-11-17 | 1996-02-07 | Matsushita Electric Industrial Co Ltd | Liquid crystal display panel and process for its manufacture. |
-
1985
- 1985-06-25 JP JP13877885A patent/JPS61296330A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0653664A3 (en) * | 1993-11-17 | 1996-02-07 | Matsushita Electric Industrial Co Ltd | Liquid crystal display panel and process for its manufacture. |
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