JPS6133100A - タイムスロツト割当て方式 - Google Patents
タイムスロツト割当て方式Info
- Publication number
- JPS6133100A JPS6133100A JP15500684A JP15500684A JPS6133100A JP S6133100 A JPS6133100 A JP S6133100A JP 15500684 A JP15500684 A JP 15500684A JP 15500684 A JP15500684 A JP 15500684A JP S6133100 A JPS6133100 A JP S6133100A
- Authority
- JP
- Japan
- Prior art keywords
- time slot
- control
- channel
- devices
- channels
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04Q—SELECTING
- H04Q11/00—Selecting arrangements for multiplex systems
- H04Q11/04—Selecting arrangements for multiplex systems for time-division multiplexing
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
技術分野
本発明はタイムスロット割当て方式に関し、特にディジ
タル交換器において多重チャンネルをタイムスロツＩ・
に割当てる方式に関する。
タル交換器において多重チャンネルをタイムスロツＩ・
に割当てる方式に関する。
従来技術
従来のタイムスロット割当て方式について第１図に示す
システムを例に説明するに、同−規模及び同一機能を有
する゛ｎ回線収容装置１〜ｍがあり、これ等装置１〜ｍ
の各ｎチャンネルがタイムスロット割当て及び多重制御
回路１００によってタイムスロット毎に割当てられる。
システムを例に説明するに、同−規模及び同一機能を有
する゛ｎ回線収容装置１〜ｍがあり、これ等装置１〜ｍ
の各ｎチャンネルがタイムスロット割当て及び多重制御
回路１００によってタイムスロット毎に割当てられる。
各装置１〜ｍに収容される各チャンネルは第２図に示す
様にｍタイムスロットの周期毎に順次割当てられる。第
２図において＊は１〜ｍを示す。そして、第３図に示す
様に各装冒毎に第２図で示したタイムスロット割当てを
１タイムスロツトずつずらして多重化している。
様にｍタイムスロットの周期毎に順次割当てられる。第
２図において＊は１〜ｍを示す。そして、第３図に示す
様に各装冒毎に第２図で示したタイムスロット割当てを
１タイムスロツトずつずらして多重化している。
従って、各装置ごとの割当てのタイムスロットは互いに
不連続となっているので、第４図に示す様に多重化時に
１タイムスロツト毎に装置内で制御が切替わることにな
り、この切替え制御が複雑化する欠点がある。
不連続となっているので、第４図に示す様に多重化時に
１タイムスロツト毎に装置内で制御が切替わることにな
り、この切替え制御が複雑化する欠点がある。
発明の目的
本発明はかかる従来の欠点を排除すべくなされたもので
あって、その目的とするところは、各装置の各チャンネ
ルにタイムスロットを割当てるに際してその方法を工夫
することによって切替え制御を簡単化したタイムスロッ
ト割当て方式を提供することにある。
あって、その目的とするところは、各装置の各チャンネ
ルにタイムスロットを割当てるに際してその方法を工夫
することによって切替え制御を簡単化したタイムスロッ
ト割当て方式を提供することにある。
各々がｎチャンネル（ｎは正の整数）を収容可能なｍ個
（ｍは正の整数）の回線収容装置の各チャンネルをタイ
ムスロットに割当てるディジタル交換器におけるタイム
スロット割当て方式であって、連続する第１〜第ｎのタ
イムスロットに第ｉ（ｉは１〜ｍまでの整数）の回線収
容装置のｎ個のチャンネルを夫々割当てるようにしたこ
とを特徴とする。
（ｍは正の整数）の回線収容装置の各チャンネルをタイ
ムスロットに割当てるディジタル交換器におけるタイム
スロット割当て方式であって、連続する第１〜第ｎのタ
イムスロットに第ｉ（ｉは１〜ｍまでの整数）の回線収
容装置のｎ個のチャンネルを夫々割当てるようにしたこ
とを特徴とする。
火■１
以下、図面を用いて本発明の詳細な説明する。
第５図〜第７図は本発明の詳細な説明する図であり、第
５図に示す様に連続するｎ個のタイムスロツ１−に各装
置の各チャンネルを順次割当てるようにしたものであり
、例えば、第１の装置１（第１図参照）の第１チヤンネ
ル〜第ｎチヤンネルを互いに連続する第１〜第ｎのタイ
ムスロットに順次割当てる・、す？′ある。そして、第
６図に示す様に各装置単位に第５図で示したととぎタイ
ムスロワ１〜割当てを多重化するものである。
５図に示す様に連続するｎ個のタイムスロツ１−に各装
置の各チャンネルを順次割当てるようにしたものであり
、例えば、第１の装置１（第１図参照）の第１チヤンネ
ル〜第ｎチヤンネルを互いに連続する第１〜第ｎのタイ
ムスロットに順次割当てる・、す？′ある。そして、第
６図に示す様に各装置単位に第５図で示したととぎタイ
ムスロワ１〜割当てを多重化するものである。
その結果、各装置に対する制御の切替えタイミングは第
７図に示す様に行われる。すなわら、装置１に対しては
ｎタイムスロットの長さだけ制御が続行しこの期間が経
過すると続いて装置２に対して同様にｎタイムスロット
期間制御が続行して、順次かかる制御状態が装置３〜ｍ
へと移行していくことになる。よって、全回線にタイム
スロットを割当てるためには、ｍ回の切替え制御がなさ
れるだけで充分となる。
７図に示す様に行われる。すなわら、装置１に対しては
ｎタイムスロットの長さだけ制御が続行しこの期間が経
過すると続いて装置２に対して同様にｎタイムスロット
期間制御が続行して、順次かかる制御状態が装置３〜ｍ
へと移行していくことになる。よって、全回線にタイム
スロットを割当てるためには、ｍ回の切替え制御がなさ
れるだけで充分となる。
発明の効宋
本発明によれば、各装置の各チャンネルに連続的にタイ
ムスロットを割当でるものであるから、多重化のための
装置間の制御切替え回数が従来のｍｎ回から第７図に示
したにうにｍ回に減少するので、結果的に多重制御が簡
単化される利点がある。
ムスロットを割当でるものであるから、多重化のための
装置間の制御切替え回数が従来のｍｎ回から第７図に示
したにうにｍ回に減少するので、結果的に多重制御が簡
単化される利点がある。
第１図はディジタル交換器の概略構成図、第２図〜第４
図は従来のタイムスロット割当て方式を説明するタイム
ヂャート、第５図〜第７図は本発明の詳細な説明するタ
イムヂャードである。 主要部分の符号の説明 １〜ｍ・・・・・・ｎ回線収容装置 １００・・・・・・タイムスロット割当て及び多重制御
回路
図は従来のタイムスロット割当て方式を説明するタイム
ヂャート、第５図〜第７図は本発明の詳細な説明するタ
イムヂャードである。 主要部分の符号の説明 １〜ｍ・・・・・・ｎ回線収容装置 １００・・・・・・タイムスロット割当て及び多重制御
回路
Claims (1)
- 各々がｎチャンネル（ｎは正の整数）を収容可能なｍ個
（ｍは正の整数）の回線収容装置の各チャンネルをタイ
ムスロットに割当てるディジタル交換器におけるタイム
スロット割当て方式であって、連続する第１〜第ｎのタ
イムスロットに第ｉ（ｉは１〜ｍまでの整数）の回線収
容装置のｎ個のチャンネルを夫々割当てるようにしたこ
とを特徴とするタイムスロット割当て方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15500684A JPS6133100A (ja) | 1984-07-25 | 1984-07-25 | タイムスロツト割当て方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15500684A JPS6133100A (ja) | 1984-07-25 | 1984-07-25 | タイムスロツト割当て方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6133100A true JPS6133100A (ja) | 1986-02-15 |
Family
ID=15596631
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15500684A Pending JPS6133100A (ja) | 1984-07-25 | 1984-07-25 | タイムスロツト割当て方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6133100A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6398903U (ja) * | 1986-12-18 | 1988-06-27 | ||
| JPH01166685A (ja) * | 1987-11-20 | 1989-06-30 | General Instr Corp | 遠隔地で生成されたデータの自動報告装置 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54146517A (en) * | 1978-05-09 | 1979-11-15 | Fujitsu Ltd | Digital multiplication transmission system |
-
1984
- 1984-07-25 JP JP15500684A patent/JPS6133100A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54146517A (en) * | 1978-05-09 | 1979-11-15 | Fujitsu Ltd | Digital multiplication transmission system |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6398903U (ja) * | 1986-12-18 | 1988-06-27 | ||
| JPH01166685A (ja) * | 1987-11-20 | 1989-06-30 | General Instr Corp | 遠隔地で生成されたデータの自動報告装置 |
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