JPS6133653Y2 - - Google Patents
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- Publication number
- JPS6133653Y2 JPS6133653Y2 JP133580U JP133580U JPS6133653Y2 JP S6133653 Y2 JPS6133653 Y2 JP S6133653Y2 JP 133580 U JP133580 U JP 133580U JP 133580 U JP133580 U JP 133580U JP S6133653 Y2 JPS6133653 Y2 JP S6133653Y2
- Authority
- JP
- Japan
- Prior art keywords
- phototransistor
- power supply
- bias power
- collector
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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Description
【考案の詳細な説明】
この考案はフオトトランジスタのバイアス回路
に関するものである。
に関するものである。
第１図は従来の光検知を行うフオトトランジス
タのバイアス回路を示し、１は第１のバイアス電
源、２は電源スイツチ、３は光源となるランプ、
４はしや光体５はフオトトランジスタ、６は電流
制限抵抗７はトランジスタ、８は光検知のしきい
値を定める抵抗、９はトランジスタ７のコレクタ
負荷抵抗、Vcは制御信号であつて負荷１０に加
えられる。その様な従来回路に於て、しや光体４
でしや光中スイツチ２に閉路した時、抵抗８トラ
ンジスタ７のベースエミツタと抵抗６を通してフ
オトトランジスタ５のコレクタに電源が印加され
る。この時フオトトランジスタのコレクタとベー
ス間の容量を通してベースに電流が流れる。この
電流は電流増幅されてコレクタに流れる。すなわ
ちフオトトランジスタのコレクタエミツタ間は等
価的にコレクタベース間容量の電流増幅率倍の容
量を持つ。フオトトランジスタがダーリントン接
続になつている時は電流増幅率は10万倍位有りコ
レクタベース間容量は10PFとするとコレクタエ
ミツタ間等価容量は１μＦにもなる。従つて抵抗
６が100KΩとすれば時定数は0.1秒になりスイツ
チ２を閉路してから0.1秒位の間フオトトランジ
スタ５のコレクタ電流が流れる。これはしや光し
ていないのと同じであつてトランジスタ７がオン
となり制御信号Vcが電源電位に達して負荷１０
が駆動される。すなわち従来回路では電源を投入
した時に一時的にしや光をしない状態と同じにな
る欠点があつた。
タのバイアス回路を示し、１は第１のバイアス電
源、２は電源スイツチ、３は光源となるランプ、
４はしや光体５はフオトトランジスタ、６は電流
制限抵抗７はトランジスタ、８は光検知のしきい
値を定める抵抗、９はトランジスタ７のコレクタ
負荷抵抗、Vcは制御信号であつて負荷１０に加
えられる。その様な従来回路に於て、しや光体４
でしや光中スイツチ２に閉路した時、抵抗８トラ
ンジスタ７のベースエミツタと抵抗６を通してフ
オトトランジスタ５のコレクタに電源が印加され
る。この時フオトトランジスタのコレクタとベー
ス間の容量を通してベースに電流が流れる。この
電流は電流増幅されてコレクタに流れる。すなわ
ちフオトトランジスタのコレクタエミツタ間は等
価的にコレクタベース間容量の電流増幅率倍の容
量を持つ。フオトトランジスタがダーリントン接
続になつている時は電流増幅率は10万倍位有りコ
レクタベース間容量は10PFとするとコレクタエ
ミツタ間等価容量は１μＦにもなる。従つて抵抗
６が100KΩとすれば時定数は0.1秒になりスイツ
チ２を閉路してから0.1秒位の間フオトトランジ
スタ５のコレクタ電流が流れる。これはしや光し
ていないのと同じであつてトランジスタ７がオン
となり制御信号Vcが電源電位に達して負荷１０
が駆動される。すなわち従来回路では電源を投入
した時に一時的にしや光をしない状態と同じにな
る欠点があつた。
この考案は上記欠点に鑑みなされたもので、電
源投入時にフオトトランジスタの誤動作を防止す
るため電源のスイツチ動作とは無関係なバイアス
電源を備えたフオトトランジスタのバイアス回路
を提供するものである。
源投入時にフオトトランジスタの誤動作を防止す
るため電源のスイツチ動作とは無関係なバイアス
電源を備えたフオトトランジスタのバイアス回路
を提供するものである。
以下、この考案について、第２図に示す一実施
例を用いて説明する。
例を用いて説明する。
第２図において、１１は第２のバイアス電源で
あり、１２は第２のバイアス電源１１をフオトト
ランジスタ５のコレクタに印加するための抵抗で
ある。
あり、１２は第２のバイアス電源１１をフオトト
ランジスタ５のコレクタに印加するための抵抗で
ある。
本考案によると第２のバイアス電源１１によつ
てフオトトランジスタ５のコレクタエミツタ間は
常時バイアスされている。従つてスイツチ２を閉
路した時にテープ４によりしや光されていれば、
フオトトランジスタのコレクタ電圧は、第２のバ
イアス電源の電圧に達しているのでトランジスタ
７の通電を防ぐことができる。これは下記の条件
の時である。
てフオトトランジスタ５のコレクタエミツタ間は
常時バイアスされている。従つてスイツチ２を閉
路した時にテープ４によりしや光されていれば、
フオトトランジスタのコレクタ電圧は、第２のバ
イアス電源の電圧に達しているのでトランジスタ
７の通電を防ぐことができる。これは下記の条件
の時である。
V1−ＶBE×Ｒ８＋Ｒ６／Ｒ８＜
V11×Ｒ８＋Ｒ６／Ｒ１２＋Ｒ６＋Ｒ８…(1)
この(1)式の左辺はトランジスタ７がオンになる
時のフオトトランジスタ５のコレクタ電圧を示
し、右辺はスイツチ２が開路中のフオトトランジ
スタ５のコレクタ電圧を示す。但しランプ３はＯ
オームとしＶBEはトランジスタ７のベースエミツ
タ順方向電圧である。
時のフオトトランジスタ５のコレクタ電圧を示
し、右辺はスイツチ２が開路中のフオトトランジ
スタ５のコレクタ電圧を示す。但しランプ３はＯ
オームとしＶBEはトランジスタ７のベースエミツ
タ順方向電圧である。
この様な条件を満足し得ぬ時は第３図のごとく
抵抗６と直列にダイオード１３を挿入することに
より次の(2)式に示す条件でもよい。
抵抗６と直列にダイオード１３を挿入することに
より次の(2)式に示す条件でもよい。
V1−ＶBE×Ｒ８＋Ｒ６／Ｒ８＜V11 …(2)
以上のようにこの実施例によるとスイツチ２を
閉じてもトランジスタ７がオンにならず、従来の
欠点をなくしたフオトトランジスタのバイアス回
路を構成することができ、しや光体としてテープ
を用いた場合、テープの始め又は終りを検知する
回路に応用できるものである。
閉じてもトランジスタ７がオンにならず、従来の
欠点をなくしたフオトトランジスタのバイアス回
路を構成することができ、しや光体としてテープ
を用いた場合、テープの始め又は終りを検知する
回路に応用できるものである。
以上説明したようにこの考案は、第２のバイア
ス電源を用いたので、電源投入時においても正常
は回路を構成することができ実用的効果の大なも
のである。
ス電源を用いたので、電源投入時においても正常
は回路を構成することができ実用的効果の大なも
のである。
第１図は従来のフオトトランジスタのバイアス
回路の一例を示す回路図、第２図はこの考案の一
実施例を示す回路図。第３図はこの考案の他の実
施例を示す回路図である。 図において、１は第１のバイアス電源、２はス
イツチ、４はフオトトランジスタ、１１は第２の
バイアス電源である。なお、図中同一符号は同一
又は相当部分を示す。
回路の一例を示す回路図、第２図はこの考案の一
実施例を示す回路図。第３図はこの考案の他の実
施例を示す回路図である。 図において、１は第１のバイアス電源、２はス
イツチ、４はフオトトランジスタ、１１は第２の
バイアス電源である。なお、図中同一符号は同一
又は相当部分を示す。
Claims (1)
- フオトトランジスタと、第１のバイアス電源
と、第１のバイアス電源をスイツチを介して前記
フオトトランジスタのエミツタコレクタ間に加え
る回路と、第２のバイアス電源と、この第２のバ
イアス電源を前記フオトトランジスタのエミツタ
コレクタ間に加える回路とを備え、第１のバイア
ス電源の前記スイツチの開閉とは無関係に第２の
バイアス電源がフオトトランジスタに加えられる
ことを特徴としたフオトトランジスタのバイアス
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP133580U JPS6133653Y2 (ja) | 1980-01-09 | 1980-01-09 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP133580U JPS6133653Y2 (ja) | 1980-01-09 | 1980-01-09 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS56104156U JPS56104156U (ja) | 1981-08-14 |
| JPS6133653Y2 true JPS6133653Y2 (ja) | 1986-10-01 |
Family
ID=29598219
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP133580U Expired JPS6133653Y2 (ja) | 1980-01-09 | 1980-01-09 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6133653Y2 (ja) |
-
1980
- 1980-01-09 JP JP133580U patent/JPS6133653Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS56104156U (ja) | 1981-08-14 |
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