JPS6141206A - 位相同期型周波数シンセサイザ - Google Patents
位相同期型周波数シンセサイザInfo
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- JPS6141206A JPS6141206A JP16182984A JP16182984A JPS6141206A JP S6141206 A JPS6141206 A JP S6141206A JP 16182984 A JP16182984 A JP 16182984A JP 16182984 A JP16182984 A JP 16182984A JP S6141206 A JPS6141206 A JP S6141206A
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03B—GENERATION OF OSCILLATIONS, DIRECTLY OR BY FREQUENCY-CHANGING, BY CIRCUITS EMPLOYING ACTIVE ELEMENTS WHICH OPERATE IN A NON-SWITCHING MANNER; GENERATION OF NOISE BY SUCH CIRCUITS
- H03B5/00—Generation of oscillations using amplifier with regenerative feedback from output to input
- H03B5/08—Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element comprising lumped inductance and capacitance
- H03B5/12—Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element comprising lumped inductance and capacitance active element in amplifier being semiconductor device
- H03B5/1231—Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element comprising lumped inductance and capacitance active element in amplifier being semiconductor device the amplifier comprising one or more bipolar transistors
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
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- H03B5/12—Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element comprising lumped inductance and capacitance active element in amplifier being semiconductor device
- H03B5/1203—Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element comprising lumped inductance and capacitance active element in amplifier being semiconductor device the amplifier being a single transistor
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- H03B5/12—Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element comprising lumped inductance and capacitance active element in amplifier being semiconductor device
- H03B5/1237—Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element comprising lumped inductance and capacitance active element in amplifier being semiconductor device comprising means for varying the frequency of the generator
- H03B5/124—Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element comprising lumped inductance and capacitance active element in amplifier being semiconductor device comprising means for varying the frequency of the generator the means comprising a voltage dependent capacitance
- H03B5/1243—Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element comprising lumped inductance and capacitance active element in amplifier being semiconductor device comprising means for varying the frequency of the generator the means comprising a voltage dependent capacitance the means comprising voltage variable capacitance diodes
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- Inductance-Capacitance Distribution Constants And Capacitance-Resistance Oscillators (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
゛産業上の利用分野
本発明はＶＨＦ及びＵＨＦさらにはＳＨＦ帯の送受無線
機器等に於いて、たとえばフェーズロック（位相同期）
方式で安定化を図る発振器に関するものである。
機器等に於いて、たとえばフェーズロック（位相同期）
方式で安定化を図る発振器に関するものである。
従来例の構成とその問題点
一般に発振器の長期及び短期安定度を向上するため、そ
の発振器単体では補償に限界があるので基準信号として
水晶発振器を用いたフェーズロッタ方式によって帰還回
路が構成される。
の発振器単体では補償に限界があるので基準信号として
水晶発振器を用いたフェーズロッタ方式によって帰還回
路が構成される。
第１図に従来の７工−ズロツク方式の代表的なブロック
構成を示す。
構成を示す。
第１図において、１は原発振器である電圧制御発振器（
以下、ｖＧＯと称す。）、２はその出力信号を局発源の
出力信号ムとフェーズロックル−プ晶分配する分配器、
３はそのループ系に分配された出力信号Ｂを基準信号で
ある水晶発振器４とで位相検波器５によって位相比較す
るため分周する分周器、６は位相検波器の位相差に応じ
たＤＣ電圧からｖＣＯｌに帰還を行うル−プフイルりで
ある。
以下、ｖＧＯと称す。）、２はその出力信号を局発源の
出力信号ムとフェーズロックル−プ晶分配する分配器、
３はそのループ系に分配された出力信号Ｂを基準信号で
ある水晶発振器４とで位相検波器５によって位相比較す
るため分周する分周器、６は位相検波器の位相差に応じ
たＤＣ電圧からｖＣＯｌに帰還を行うル−プフイルりで
ある。
上記フェーズロックループを用いた局発装置は、発振器
単体の直接発振と比較して、高安定が望める反面、部品
点数の多さが短所となっている。
単体の直接発振と比較して、高安定が望める反面、部品
点数の多さが短所となっている。
たとえば、上記構成で、分周器３、水晶発振器４、位相
検波器６はそれぞれディジタルＩＣによって構成が可能
であるがＶＣ７Ｏ１，１７分配器２は独立した構成を特
徴とする 特に１７分配器２はｖＣＯｌの出力を局発源の出力信号
ムと分周器３の入力となる出力信号Ｂとに分配するため
、そのｖｃｏｌの出力周波数に於いて伝送損失を小さく
・又互いの出力端子間のアイソレーションが大きく、さ
らには簡易的で小型であることが要求される。
検波器６はそれぞれディジタルＩＣによって構成が可能
であるがＶＣ７Ｏ１，１７分配器２は独立した構成を特
徴とする 特に１７分配器２はｖＣＯｌの出力を局発源の出力信号
ムと分周器３の入力となる出力信号Ｂとに分配するため
、そのｖｃｏｌの出力周波数に於いて伝送損失を小さく
・又互いの出力端子間のアイソレーションが大きく、さ
らには簡易的で小型であることが要求される。
とのＲ７分配器２は集中定数型及び分布定数型に分けら
れるが、周波数が高くなると集中定数では損失が増え構
成が困難となるため、通常ＵＨＦＨＦ上では分布定数型
が主流となっている。
れるが、周波数が高くなると集中定数では損失が増え構
成が困難となるため、通常ＵＨＦＨＦ上では分布定数型
が主流となっている。
しかしこの分布定数では高周波基板（誘電体基板）上に
エツチング、あるいは蒸着、印刷によってパターン化す
るため、その試作上あるいは加工精度上の問題、さらに
は設計値と実測値との違いを生じる等の支障があり、効
率の良い分配伝送が困難であるという欠点を有する。
エツチング、あるいは蒸着、印刷によってパターン化す
るため、その試作上あるいは加工精度上の問題、さらに
は設計値と実測値との違いを生じる等の支障があり、効
率の良い分配伝送が困難であるという欠点を有する。
発明の目的
本発明は上記欠点に鑑み、分配器を省略することのでき
る発振器を提供するものである。
る発振器を提供するものである。
いる三端子の能動デバイスを設け、前記高周波接地され
ている一端子を除く残りの二端子から局部発振手段への
出力信号を得るよう構成することによシ、上記目的を達
するものである。
ている一端子を除く残りの二端子から局部発振手段への
出力信号を得るよう構成することによシ、上記目的を達
するものである。
実施例の説明
以下、図面を参照しながら本発明の一実施例について説
明する。
明する。
第２図は本発明の一実施例における発振器の基本的回路
図でｂる。
図でｂる。
第２図において、１ｏは容量素子１１を介してベースが
接地されたトランジスタ、１２はエミッタ・コレクタ間
に並列接続された容量素子である。
接地されたトランジスタ、１２はエミッタ・コレクタ間
に並列接続された容量素子である。
１３は容量素子１４及び共振器１５を介してトランジス
タ１０のコレクタ側にそのカンードが接続されている可
変容量素子で、ア、ノード側は接地されている。１６は
可変容量素子１３の容量変化を生じさせるための電圧が
印加される端子、１７は一端がトランジスタ１０のエミ
ッタに接続され他端が接地されている容量素子、１８は
容量素子１９を介して出力を得る出力端子である。
タ１０のコレクタ側にそのカンードが接続されている可
変容量素子で、ア、ノード側は接地されている。１６は
可変容量素子１３の容量変化を生じさせるための電圧が
印加される端子、１７は一端がトランジスタ１０のエミ
ッタに接続され他端が接地されている容量素子、１８は
容量素子１９を介して出力を得る出力端子である。
上記構成は、通常の高周波発振器として用いられるベー
ス接地型コルピッツ型発振回路である。
ス接地型コルピッツ型発振回路である。
三端子（ベース端子１０ａ１コレクタ端子１０ｂ１エミ
ツタ端子１ｏＣ）を有するトランジスタ１０を駆動部と
し、その端子間には帰還容量として容量素子１２，１４
，１７．１９（あるいは浮遊容量として）が装架されて
おり、発振周波数はほぼ共振器１６によって決定される
。さらにｖＣＯであるため可変容量素子１３を用い電圧
で端子１６より、共振器１６、可変容量素子１３の共振
回路によってなるリアクタンスを変え発振周波数を可変
している。又容量素子１１はベース端子１０ａを発振周
波数の領域で高周波的に接地可能な容量値をもつもので
ある。上記、発振回路では出力端子としてエミッタ端子
１００で容量素子１９による容量結合にて出力端子１８
で出力の取り出しを行なっている。
ツタ端子１ｏＣ）を有するトランジスタ１０を駆動部と
し、その端子間には帰還容量として容量素子１２，１４
，１７．１９（あるいは浮遊容量として）が装架されて
おり、発振周波数はほぼ共振器１６によって決定される
。さらにｖＣＯであるため可変容量素子１３を用い電圧
で端子１６より、共振器１６、可変容量素子１３の共振
回路によってなるリアクタンスを変え発振周波数を可変
している。又容量素子１１はベース端子１０ａを発振周
波数の領域で高周波的に接地可能な容量値をもつもので
ある。上記、発振回路では出力端子としてエミッタ端子
１００で容量素子１９による容量結合にて出力端子１８
で出力の取り出しを行なっている。
さて、通常、第１図の様なシステムにおいては、この出
力端子１８からその出力が分配器２に入力され、それぞ
れフェーズロックルーズ系とシステムの局発源装置とし
ての出力端子７とに分配される。
力端子１８からその出力が分配器２に入力され、それぞ
れフェーズロックルーズ系とシステムの局発源装置とし
ての出力端子７とに分配される。
しかし上記第２図の構成ではこの様なシステムに於いて
分配器２を取除く簡易的で経済的なものとなっている。
分配器２を取除く簡易的で経済的なものとなっている。
すなわち第２図のｖＣＯでは、トランジスタ１゜の三端
子におけるベース１０ａは高周波領域では接地されてい
るが残りの二端子では出力端子として取り出し可能であ
る。
子におけるベース１０ａは高周波領域では接地されてい
るが残りの二端子では出力端子として取り出し可能であ
る。
以下、第３図を用いてその具体的実施例を説明する。
第３図において、第２図の構成と異なる点はｖＣＯｌの
出力端子として、共振器１５に分布している磁界とによ
って結合すべく結合線路２０を設けるとともに、出力端
子１８とは別に出力端子２１を設け、ｖｏｏｌの出力端
子を２ケ所設置した点である。
出力端子として、共振器１５に分布している磁界とによ
って結合すべく結合線路２０を設けるとともに、出力端
子１８とは別に出力端子２１を設け、ｖｏｏｌの出力端
子を２ケ所設置した点である。
第３図の構成によれば、第１図のシステム構成等に於い
ては分配器２を使用とせずＶＣＯｌより直接、ループ系
と局発源装置の出力端子系に出力を得ることができる。
ては分配器２を使用とせずＶＣＯｌより直接、ループ系
と局発源装置の出力端子系に出力を得ることができる。
発明の効果
以上の様に本発明は、従来必要とされていた分配器の機
能を発振器に直接、持たせることにより、前記分配器を
省略し部品点数の削減が計れ、そのためたとえばシステ
ムとして小型化を望むことができ、その効果は大きい。
能を発振器に直接、持たせることにより、前記分配器を
省略し部品点数の削減が計れ、そのためたとえばシステ
ムとして小型化を望むことができ、その効果は大きい。
第１図は従来の送受信機等の局部発振源として用いられ
るフェーズロックループシステムのブロック結線図、第
２図は本発明の一実施例における発振器の回路図、第３
図は同発振器のさらに具体的実施例を示す回路図である
。 １０・・・・・・トランジスタ、１１，１２，１４゜１
７．１９・・・・・容量素子、１３・・・・・・可変容
量素子、１６・・・・・・共振器、１６・°゛・・・端
子、１８．２１・・・・・・出力端子、２０・・・・・
結合線路。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名Ｉｌ
ｌ 図 イ ２図
るフェーズロックループシステムのブロック結線図、第
２図は本発明の一実施例における発振器の回路図、第３
図は同発振器のさらに具体的実施例を示す回路図である
。 １０・・・・・・トランジスタ、１１，１２，１４゜１
７．１９・・・・・容量素子、１３・・・・・・可変容
量素子、１６・・・・・・共振器、１６・°゛・・・端
子、１８．２１・・・・・・出力端子、２０・・・・・
結合線路。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名Ｉｌ
ｌ 図 イ ２図
Claims (2)
- （１）使用高周波数領域で一端子が接地されている三端
子の能動デバイスを設け、前記高周波接地されている一
端子を除く残りの二端子から局部発振手段への出力信号
を得る発振器。 - （２）能動デバイスはトランジスタであることを特徴と
する特許請求の範囲第１項記載の発振器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16182984A JPS6141206A (ja) | 1984-08-01 | 1984-08-01 | 位相同期型周波数シンセサイザ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16182984A JPS6141206A (ja) | 1984-08-01 | 1984-08-01 | 位相同期型周波数シンセサイザ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6141206A true JPS6141206A (ja) | 1986-02-27 |
Family
ID=15742704
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16182984A Pending JPS6141206A (ja) | 1984-08-01 | 1984-08-01 | 位相同期型周波数シンセサイザ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6141206A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5696504A (en) * | 1979-12-29 | 1981-08-04 | Mitsumi Electric Co Ltd | Local oscillation circuit in all channel tuner |
-
1984
- 1984-08-01 JP JP16182984A patent/JPS6141206A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5696504A (en) * | 1979-12-29 | 1981-08-04 | Mitsumi Electric Co Ltd | Local oscillation circuit in all channel tuner |
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