JPS6142079A - デ−タ収集装置 - Google Patents
デ−タ収集装置Info
- Publication number
- JPS6142079A JPS6142079A JP16322684A JP16322684A JPS6142079A JP S6142079 A JPS6142079 A JP S6142079A JP 16322684 A JP16322684 A JP 16322684A JP 16322684 A JP16322684 A JP 16322684A JP S6142079 A JPS6142079 A JP S6142079A
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- JP
- Japan
- Prior art keywords
- memory
- data
- computer
- fifo
- data collection
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02E—REDUCTION OF GREENHOUSE GAS [GHG] EMISSIONS, RELATED TO ENERGY GENERATION, TRANSMISSION OR DISTRIBUTION
- Y02E30/00—Energy generation of nuclear origin
- Y02E30/10—Nuclear fusion reactors
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［発明の技術分野］
本発明はデータ収集装置、特に間欠的に発生する大量の
データを計算機処理するデータ収１！装置に圓するもの
である。
データを計算機処理するデータ収１！装置に圓するもの
である。
［発明の技術的青ｅＩｌ
新しいエネルギー源としての核融合反応を利用した発電
を目）ｔｌ Ｌで建設、実験が進められている核融合実
ＷＡ装置においては、プラズマの種々のパラメータをは
じめ、プラズマへの入射ガス１及びプラズマ加熱ｖ装置
からの入射電力等を数百マイクロ秒〜数ミリ秒のサンプ
ル間隔で収集し、処理する必要がある。
を目）ｔｌ Ｌで建設、実験が進められている核融合実
ＷＡ装置においては、プラズマの種々のパラメータをは
じめ、プラズマへの入射ガス１及びプラズマ加熱ｖ装置
からの入射電力等を数百マイクロ秒〜数ミリ秒のサンプ
ル間隔で収集し、処理する必要がある。
この種の比較的高速のサンプルレイトを要求されるシス
テムでは、従来、入力したアナログ信号を＾／Ｄ変換器
を介してディジタル化し、これを順次メモリに記憶する
トランジェントレコーダの如きデータ収！！装置を使用
していた。
テムでは、従来、入力したアナログ信号を＾／Ｄ変換器
を介してディジタル化し、これを順次メモリに記憶する
トランジェントレコーダの如きデータ収！！装置を使用
していた。
第１図は従来方式のデータ収集装置のブロック構成図で
ある。第１図において１ａ、１ｂ・・・１ｎは＾／Ｄ変
換器、２ａ、 ２ｂ・・２ｎはメモリテ１１と２ｉ （
ｉ −ａ・・・ｎ）によって１チヤンネルのトランジェ
ントレコーダを構成する。そしてプラズマ放電実験期間
（第２図のｔ＜ ”−６２）は、＾／Ｄ変換器１ｉ （
ｉ＝ａ ・ｎ）は、クロック信号発生装置ｉ！３から送
られるクロック信号に同期して入力信号をディジタル化
し、順次メモリ２ｉ（ｉ−ａ・・・ｎ）に記憶する。メ
モリ２ｉ（ｉ−ａ・・・ｎ）に記憶された測定データは
、プラズマ放電休止期ｌ８１（第２図の６２〜６：ｌ）
にデータハイウェイ４を介して計算１１５に転送され、
処理される。
ある。第１図において１ａ、１ｂ・・・１ｎは＾／Ｄ変
換器、２ａ、 ２ｂ・・２ｎはメモリテ１１と２ｉ （
ｉ −ａ・・・ｎ）によって１チヤンネルのトランジェ
ントレコーダを構成する。そしてプラズマ放電実験期間
（第２図のｔ＜ ”−６２）は、＾／Ｄ変換器１ｉ （
ｉ＝ａ ・ｎ）は、クロック信号発生装置ｉ！３から送
られるクロック信号に同期して入力信号をディジタル化
し、順次メモリ２ｉ（ｉ−ａ・・・ｎ）に記憶する。メ
モリ２ｉ（ｉ−ａ・・・ｎ）に記憶された測定データは
、プラズマ放電休止期ｌ８１（第２図の６２〜６：ｌ）
にデータハイウェイ４を介して計算１１５に転送され、
処理される。
［背景技術の問題点］
上記した従来方式のデータ収集装置は、第２図に示すよ
うにプラズマ放電実験ＩＩ間（６，〜ｔｚ＞中はデータ
ハイウェイ４及び計９１５の負荷は極めて低いのに対し
て、プラズマ放電体止期間（ｔ、２〜乙、（）に負荷が
集中するため、１０のプラズマ放電実験で発生り′るデ
ータ量が極めて多い核融合実験装置では、Ｐ４速、高性
能のデータハイウェイ４及び計算１ｆｉ５が必要どされ
ていた。又、現在実験中及び製作中の核融合実験装置で
は、プラズマ放電時間が数百ミリ秒〜数秒であるため、
メモリ２ｉ（ｉ−〇・・・ｎ）の容ｒ：ｒｒ ′ｂ ａ
十キロワードで済むが、次期実験炉では１００秒！１度
のプラズマ放電時間が予定されており、従ってより大容
量のメモリが必要になるばかりか、プラズマ放電体止期
間におけるデータハイウェイ４を介したデータの転送時
間も更に大きくなる。加えて、このデータ収集装置は本
質的にはオフライン処理の構成であるため、入力信号の
異常値ヂエツク、盲報発生等を実時間で行なうこともで
きない。
うにプラズマ放電実験ＩＩ間（６，〜ｔｚ＞中はデータ
ハイウェイ４及び計９１５の負荷は極めて低いのに対し
て、プラズマ放電体止期間（ｔ、２〜乙、（）に負荷が
集中するため、１０のプラズマ放電実験で発生り′るデ
ータ量が極めて多い核融合実験装置では、Ｐ４速、高性
能のデータハイウェイ４及び計算１ｆｉ５が必要どされ
ていた。又、現在実験中及び製作中の核融合実験装置で
は、プラズマ放電時間が数百ミリ秒〜数秒であるため、
メモリ２ｉ（ｉ−〇・・・ｎ）の容ｒ：ｒｒ ′ｂ ａ
十キロワードで済むが、次期実験炉では１００秒！１度
のプラズマ放電時間が予定されており、従ってより大容
量のメモリが必要になるばかりか、プラズマ放電体止期
間におけるデータハイウェイ４を介したデータの転送時
間も更に大きくなる。加えて、このデータ収集装置は本
質的にはオフライン処理の構成であるため、入力信号の
異常値ヂエツク、盲報発生等を実時間で行なうこともで
きない。
更に、トランジェントレコーダの代りに高速のアナログ
装置を使用し、タイマーからの割込みにＪ、り計ｔ１ｎ
５のデータ収集プログラムを起動して、測定データを実
時間で収集する方式も考えられるが、数ミリ秒以下のサ
ンプル間隔でデータを収集しようとすると、計ＩＨ１３
１負荷は極めて高くなって不可能であり、しかも計算機
の処理時間の大部分はオペレーティングシステムのソフ
トウェアオーバーヘッド時間によって占められており、
効率の悪い不経済な使い方しかできなかった。
装置を使用し、タイマーからの割込みにＪ、り計ｔ１ｎ
５のデータ収集プログラムを起動して、測定データを実
時間で収集する方式も考えられるが、数ミリ秒以下のサ
ンプル間隔でデータを収集しようとすると、計ＩＨ１３
１負荷は極めて高くなって不可能であり、しかも計算機
の処理時間の大部分はオペレーティングシステムのソフ
トウェアオーバーヘッド時間によって占められており、
効率の悪い不経済な使い方しかできなかった。
［発明の目的］
本発明は上記問題点を解決することを目的としてなされ
たしのであり、計算機負荷を低くし、かつ効率的な動作
の可能なデータ収集ｉＷｌを提供することを目的として
いる。
たしのであり、計算機負荷を低くし、かつ効率的な動作
の可能なデータ収集ｉＷｌを提供することを目的として
いる。
［発明のＩＩ］
本発明ではトランジェントレコーダのメモリを割込信号
発生−能を有するＦＴＦＯメモリで置換え、プラズマ放
電中におけるデータ収集期間中にも、ＦＩＦＯメモリの
データを定周期で計＄ｉ機に読込み処理して、計算機負
荷をプラズマ放電１１聞及び休出期間にわたって平均化
し、長時間のデータ収集にてもＦＩＦＯメモリを小容量
とするものである。
発生−能を有するＦＴＦＯメモリで置換え、プラズマ放
電中におけるデータ収集期間中にも、ＦＩＦＯメモリの
データを定周期で計＄ｉ機に読込み処理して、計算機負
荷をプラズマ放電１１聞及び休出期間にわたって平均化
し、長時間のデータ収集にてもＦＩＦＯメモリを小容量
とするものである。
［発明の実施例］
以下図面を参照して実施例を説明彩る。第３図は本発明
にＪ、るデータ収集装置の一実施例構成図である。■中
の右号１ａへ−Ｉｎ、 ３．４．５は、第１図に対応し
ている。６ａ〜６ｎはＦＩＦＯメモリであり、＾／ＩＩ
Ｊ器１ｉ（ｉ・ａ・・・ｎ）からのライト動作とデータ
ハイウェイ４を介して計Ｒｍ５からのリード動作を行な
うことができ、かつメモリの内容を全て読出してメｔり
が空になると、データハイウェイ４ヲ介シテπ１ｔ）１
１５１．：ｌ了割込信号！１ｌＴＴＩＬＨｉ （ｉ−ａ
・・・ｎ）を発生する機能を有する。その他の構成は第
１国と同様Ｃある。
にＪ、るデータ収集装置の一実施例構成図である。■中
の右号１ａへ−Ｉｎ、 ３．４．５は、第１図に対応し
ている。６ａ〜６ｎはＦＩＦＯメモリであり、＾／ＩＩ
Ｊ器１ｉ（ｉ・ａ・・・ｎ）からのライト動作とデータ
ハイウェイ４を介して計Ｒｍ５からのリード動作を行な
うことができ、かつメモリの内容を全て読出してメｔり
が空になると、データハイウェイ４ヲ介シテπ１ｔ）１
１５１．：ｌ了割込信号！１ｌＴＴＩＬＨｉ （ｉ−ａ
・・・ｎ）を発生する機能を有する。その他の構成は第
１国と同様Ｃある。
次に動作について説明する。先ず、プラズマ放電開始に
より、アナログ入力信Ｊ３！（！−ａ・・・ｎ）はり１
１ツク信′；″Ｊ発生器３からのクロック信号に同期し
て＾１０変’ｌｋ ｉＥｖ ｌｉ （ｉ＝ａ・・・ｎ）
によってディジクル化８れ、目１ｕメーＬすＧｉ（ｉ−
ａ・・・ｎ）に記憶される。
より、アナログ入力信Ｊ３！（！−ａ・・・ｎ）はり１
１ツク信′；″Ｊ発生器３からのクロック信号に同期し
て＾１０変’ｌｋ ｉＥｖ ｌｉ （ｉ＝ａ・・・ｎ）
によってディジクル化８れ、目１ｕメーＬすＧｉ（ｉ−
ａ・・・ｎ）に記憶される。
一方、計ｎ礪５（５Ｌデータ収集開始後、一定周期で１
’ Ｉ Ｉ Ｏメモリ６ｉ（ｉ−ｉ・・・ｎ）のデータ
をデータハイウェイ４を介し゛Ｃブロック転送により読
込む。
’ Ｉ Ｉ Ｏメモリ６ｉ（ｉ−ｉ・・・ｎ）のデータ
をデータハイウェイ４を介し゛Ｃブロック転送により読
込む。
第４図はＨ１ｃ７ｔ！１が「ＩＦＯメモリ内容を読込む
動作タイミング図であり、計粋機５はＦＨＯメモリ６ｉ
（ｉ−ａ・・・ｎ）の内容を読込むためのマクロ命令Ｒ
ＨへＣＲＯｉ（ｉ−ａ・・・ｎ）を順次発行する。そし
て「１１０メモリ６ｉ、（ｉ−ａ・・・ｎ）の内容を全
で読込ｌυだことは、ブロック転送後の終了割込信号１
８１丁ＲＨｉ （ｉ＝ａ・・・ｎ）により検出１ｙる。
動作タイミング図であり、計粋機５はＦＨＯメモリ６ｉ
（ｉ−ａ・・・ｎ）の内容を読込むためのマクロ命令Ｒ
ＨへＣＲＯｉ（ｉ−ａ・・・ｎ）を順次発行する。そし
て「１１０メモリ６ｉ、（ｉ−ａ・・・ｎ）の内容を全
で読込ｌυだことは、ブロック転送後の終了割込信号１
８１丁ＲＨｉ （ｉ＝ａ・・・ｎ）により検出１ｙる。
この場合、サンプル周期１ミリ秒でデータを収集し、１
秒毎にデータを計Ｒ１ｊｌに転送するとずれば、ＦＩＦ
Ｏメモリの容量は１にワード程度で済み、一方、データ
ハイウェイ４は１メガワ一ド／秒程度の転送レイトは得
られるため、上記の１にワードのメモリ容量であれば、
ソフトウェアのオーバヘッドを青線しても数ミリ秒で１
チヤンネルのデータを収集できる。従って０＝１０の場
合であプても、全メモリの転送時囚は数十ミリ秒であり
、計Ｅ（１１５は残りの時間を使って収集したデータの
処理、異常値チェック及び補助記憶装置へのデータ転送
等の処理を行なうことができる。
秒毎にデータを計Ｒ１ｊｌに転送するとずれば、ＦＩＦ
Ｏメモリの容量は１にワード程度で済み、一方、データ
ハイウェイ４は１メガワ一ド／秒程度の転送レイトは得
られるため、上記の１にワードのメモリ容量であれば、
ソフトウェアのオーバヘッドを青線しても数ミリ秒で１
チヤンネルのデータを収集できる。従って０＝１０の場
合であプても、全メモリの転送時囚は数十ミリ秒であり
、計Ｅ（１１５は残りの時間を使って収集したデータの
処理、異常値チェック及び補助記憶装置へのデータ転送
等の処理を行なうことができる。
第５図はデータハイウェイ負荷と計算機負荷との関係図
であり、データハイウェイ４を介したＦＩＦＯメモリ６
ｉ（ｉ−ａ・・・ｎ）の内容のブロック転送にしたがい
、９尚の均簀化あるいはピーク４何の低減化がなされた
状態が示されている。
であり、データハイウェイ４を介したＦＩＦＯメモリ６
ｉ（ｉ−ａ・・・ｎ）の内容のブロック転送にしたがい
、９尚の均簀化あるいはピーク４何の低減化がなされた
状態が示されている。
第６図は本発明によるデータ収集装置の他の実施例図で
７３する。
７３する。
水実施例では全メモリ容量のうちのある２１合までデー
タが書込まれた時に、計算機に割込信号を発生さＵて、
より柔軟なデータ収集を行なわせようとづ°るらのであ
る。
タが書込まれた時に、計算機に割込信号を発生さＵて、
より柔軟なデータ収集を行なわせようとづ°るらのであ
る。
図中の符号１１〈１・ａ・・・ｎ）、４．５は第３図に
対応する。３ｉ （ｉ＝８・・・ｎ）はりＯツク信号発
生器であり、個ノＺの＾１０変操器１１（ｉ−ａ・・・
ｎ）に夫々対応してもうける。７ｉ（ｉ＝ａ・・・ｎ）
はＦＩＦＯメモリであり、全メモリ容量のある割合、例
えば８０％までデータが書込まれｌζ時に、計算機５に
割込信号ＩＮＴＦＵＬ １（ｉ＝ａ・・・ｎ）を発生す
る。
対応する。３ｉ （ｉ＝８・・・ｎ）はりＯツク信号発
生器であり、個ノＺの＾１０変操器１１（ｉ−ａ・・・
ｎ）に夫々対応してもうける。７ｉ（ｉ＝ａ・・・ｎ）
はＦＩＦＯメモリであり、全メモリ容量のある割合、例
えば８０％までデータが書込まれｌζ時に、計算機５に
割込信号ＩＮＴＦＵＬ １（ｉ＝ａ・・・ｎ）を発生す
る。
第７四はシ１（＞礪とデータハイウェイとの動作タイミ
ング図であり、ＦＩＦＯメモリから書込まれたデータが
メモリ′Ｂ吊の所定割合を越えたことを示す２．１１込
信号ＩＮＴｒｌｌＬｉ （１−ａ−ｎ）ニより、データ
転送プログラムを起動し、そのＦＩＦＯメモリ１１から
データをブロック転送によって読込む。／、【お、デー
タを全て読込んだことは前記した実施例の場合と同様に
、メモリ内容が空になったことによって発生する終了割
込信＠ ＩＮＴＴＲＨｉ （ｉ＝ａ・・・ｎ）によって
検出する。このため、クロック信号発生器３ｉ（ｉ−ａ
・・・ｎ）のクロック周期は夫々光なっていても良い。
ング図であり、ＦＩＦＯメモリから書込まれたデータが
メモリ′Ｂ吊の所定割合を越えたことを示す２．１１込
信号ＩＮＴｒｌｌＬｉ （１−ａ−ｎ）ニより、データ
転送プログラムを起動し、そのＦＩＦＯメモリ１１から
データをブロック転送によって読込む。／、【お、デー
タを全て読込んだことは前記した実施例の場合と同様に
、メモリ内容が空になったことによって発生する終了割
込信＠ ＩＮＴＴＲＨｉ （ｉ＝ａ・・・ｎ）によって
検出する。このため、クロック信号発生器３ｉ（ｉ−ａ
・・・ｎ）のクロック周期は夫々光なっていても良い。
［発明の効果］
以上説明した如く、本発明によれば間欠的に大暑に発生
するデータをＦＩＦＯメモリに記憶し、このデータ収集
期間中に「■［０メモリに記憶されたγ−タを順次読出
づように構成したので、データハイウェイの負荷を時間
的に平均化できるばかりか、計算機のピーク負荷を低減
でさ、たとえデータ収集時間が長時匍になってもトラン
ジエン１−メモリ容量を低く押えることが可能であり、
更にデータハイウェイ、計算機の性能が同じならば、よ
り短時間に測定データの処理を終了できるため、より効
率的なプラズマ実験を行なうことができる。
するデータをＦＩＦＯメモリに記憶し、このデータ収集
期間中に「■［０メモリに記憶されたγ−タを順次読出
づように構成したので、データハイウェイの負荷を時間
的に平均化できるばかりか、計算機のピーク負荷を低減
でさ、たとえデータ収集時間が長時匍になってもトラン
ジエン１−メモリ容量を低く押えることが可能であり、
更にデータハイウェイ、計算機の性能が同じならば、よ
り短時間に測定データの処理を終了できるため、より効
率的なプラズマ実験を行なうことができる。
第１図は従来のデータ収集装置のブロック構成図、′Ｉ
Ａ２図はデータハイウェイと計算様との負荷関係図、第
３図は本発明によるデータ収集装置の一実施例ブロック
図、第４図は計算−がメモリ内容を読込むタイミング図
、第５図１ｃＬデータハイウエイ負荷と計ＦＪ橢負荷と
の関係図、第６図は本発明によるデータ収集ｖＡ随の他
の実施例図、第７図は計算はとデータハイウェイとの動
作タイミング図である。 １ａ〜１０・・・＾／Ｄ変換器 ２ａ〜２ｎ・・・
メモリ３．３８〜３ｎ・・・クロック信号発生器４・・
・データハイウェイ ５・・・計算機Ｇｎ”□ （ｉ
ｎ・−・ｒ Ｉ 「ＯメＬす（ＩＮＴＴＲＨ信号発生礪
能付）７ａ 〜７ｎ−ｒｌｌＯメモリ（ＩＮＴＴＲＨ，
ＩＮＴＦＩＩＬ信＠発生闘能付）
Ａ２図はデータハイウェイと計算様との負荷関係図、第
３図は本発明によるデータ収集装置の一実施例ブロック
図、第４図は計算−がメモリ内容を読込むタイミング図
、第５図１ｃＬデータハイウエイ負荷と計ＦＪ橢負荷と
の関係図、第６図は本発明によるデータ収集ｖＡ随の他
の実施例図、第７図は計算はとデータハイウェイとの動
作タイミング図である。 １ａ〜１０・・・＾／Ｄ変換器 ２ａ〜２ｎ・・・
メモリ３．３８〜３ｎ・・・クロック信号発生器４・・
・データハイウェイ ５・・・計算機Ｇｎ”□ （ｉ
ｎ・−・ｒ Ｉ 「ＯメＬす（ＩＮＴＴＲＨ信号発生礪
能付）７ａ 〜７ｎ−ｒｌｌＯメモリ（ＩＮＴＴＲＨ，
ＩＮＴＦＩＩＬ信＠発生闘能付）
Claims (2)
- （１）複数のアナログ入力を対応するＡ／Ｄ変換器に入
力し、クロック信号に応じてディジタル信号に変換する
ことによりメモリに記憶し、前記メモリ内のデータをデ
ータハイウェイを介して計算機処理するデータ収集装置
において、上記メモリはそのメモリ内容が全て読出され
た際、計算機に対して割込信号を発生するＦＩＦＯメモ
リを用い、データ収集期間中に定周期で前記ＦＩＦＯメ
モリに記憶されたデータを順次転送して読出すことを特
徴とするデータ収集装置。 - （２）複数のアナログ入力を対応するＡ／Ｄ変換器に入
力し、クロック信号に応じてディジタル信号に変換する
ことによりメモリに記憶し、前記メモリ内のデータをデ
ータハイウェイを介して計算機処理するデータ収集装置
において、上記メモリはその記憶したメモリ量が全メモ
リ容量の所定割合に達した際、及びメモリ内容が全て読
出された際、計算機に対して割込信号を発生する機能を
有するＦＩＦＯメモリを用い、任意のＦＩＦＯメモリか
らの割込信号により、当該割込信号を発生したＦＩＦＯ
メモリに記憶されたデータを順次転送して読出すことを
特徴とするデータ収集装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16322684A JPS6142079A (ja) | 1984-08-02 | 1984-08-02 | デ−タ収集装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16322684A JPS6142079A (ja) | 1984-08-02 | 1984-08-02 | デ−タ収集装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6142079A true JPS6142079A (ja) | 1986-02-28 |
Family
ID=15769713
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16322684A Pending JPS6142079A (ja) | 1984-08-02 | 1984-08-02 | デ−タ収集装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6142079A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63100581A (ja) * | 1986-10-17 | 1988-05-02 | Fujitsu Ltd | データ集計方法 |
| US6839863B2 (en) | 2000-09-06 | 2005-01-04 | Nec Corporation | Input data processing circuit comprising of a readout circuit for selecting one of first and second FIFO buffers having a faster clock |
-
1984
- 1984-08-02 JP JP16322684A patent/JPS6142079A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63100581A (ja) * | 1986-10-17 | 1988-05-02 | Fujitsu Ltd | データ集計方法 |
| US6839863B2 (en) | 2000-09-06 | 2005-01-04 | Nec Corporation | Input data processing circuit comprising of a readout circuit for selecting one of first and second FIFO buffers having a faster clock |
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