JPS6147558U - 画信号処理回路 - Google Patents

画信号処理回路

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Publication number
JPS6147558U
JPS6147558U JP13154384U JP13154384U JPS6147558U JP S6147558 U JPS6147558 U JP S6147558U JP 13154384 U JP13154384 U JP 13154384U JP 13154384 U JP13154384 U JP 13154384U JP S6147558 U JPS6147558 U JP S6147558U
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JP
Japan
Prior art keywords
image signal
threshold level
signal
comparator
analog image
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Pending
Application number
JP13154384U
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Inventor
勝 山村
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Toshiba Corp
Original Assignee
Toshiba Corp
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Publication date
Application filed by Toshiba Corp filed Critical Toshiba Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来の画信号処理回路のブロック図、第２図ａ
” ｅおよび第３図ａ−ｅは第１図に示した回路の動
作を説明するためのタイミングチャート、第４図は本考
案の画信号処理回路のブロック図、第５図はその遅延回
路およびゲート回路の実例を示す回路図、第６図ａ ”
ｎは第５図に示した回路の動作を説明するためのタイ
ミングチャートである。 １１．１２，１３・・・比較器、１４．１５・・・１ビ
ット遅延回路、１６・・・ゲート回路、１７・・・クロ
ック端子、１８・・・入力樺子、１９・・・出力端子。

Claims (1)

  1. 【実用新案登録請求の範囲】 アナログ画信号を第１のしきい値レベルと比較して第１
    の２値化信号を発生する第１の比較器と、前記アナログ
    画信号を前記第１のしきい値レベルより高い第２のしき
    い値レベルと比較して第２の２値化信号を発生する第２
    の比較器と、前記アナログ画信号を前記第２のしきい値
    レベルより高い第３のしきい値レベルと比較して第３の
    ２値化信号を発生する第３の比較器と、 前記第２の２値化信号を前記アナログ画信号の最小画素
    分に対応した周期を有するクロツクパルスにしたがって
    それの前記周期に対応する時間だけ遅延させる第１の遅
    延回路と、前記第３の２値化信号を前記クロツクパルス
    にしたがって前記時間だけ遅延させる第２の遅延回路と
    、 前記第１の比較器の出力と、前記第１および第２の遅延
    回路の各出力とを演算して前記アナログ画信号に対応し
    たデジタル画信号を出力するゲート回路とよりなること
    を特徴とする画信号処理回路。
JP13154384U 1984-08-30 1984-08-30 画信号処理回路 Pending JPS6147558U (ja)

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JP13154384U JPS6147558U (ja) 1984-08-30 1984-08-30 画信号処理回路

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JP13154384U JPS6147558U (ja) 1984-08-30 1984-08-30 画信号処理回路

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JPS6147558U true JPS6147558U (ja) 1986-03-29

Family

ID=30690127

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