JPS6149611A - 負荷電力制御回路 - Google Patents
負荷電力制御回路Info
- Publication number
- JPS6149611A JPS6149611A JP59171042A JP17104284A JPS6149611A JP S6149611 A JPS6149611 A JP S6149611A JP 59171042 A JP59171042 A JP 59171042A JP 17104284 A JP17104284 A JP 17104284A JP S6149611 A JPS6149611 A JP S6149611A
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- Japan
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- load
- power control
- control circuit
- heater
- transistor
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
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Description
【発明の詳細な説明】
〔技術分野〕
本発明は負荷電力制御回路に関し、特に負荷への電力制
御を行う制御素子が破壊され、導通状態になった場合に
、負荷への電力供給を遮断する負荷電力制御回路に関す
る。
御を行う制御素子が破壊され、導通状態になった場合に
、負荷への電力供給を遮断する負荷電力制御回路に関す
る。
一般に定着ヒータを有する複写機においては、サーミス
タ断線、トライアック、５ＳＲ（ソリッドステートリレ
ー）等の制御素子の導通破浪及び制御系の不良等により
、定着ヒータ制御が不能になった場合、定着ヒータが過
熱し、周辺部材の溶解あるいは発煙、発火の恐れもちね
、大変危険である。このだめ通常、定着ヒータ過熱保護
のために、温度ヒユーズやサーマルプロテクタを定着ヒ
ータと直列に挿入し、定着ローラ近傍等に設けているが
、温度ヒユーズ等の故障率は高く、時として働かない場
合もあるばかりか、温度ヒユーズが設定温度に達して切
れたとしても、その時は定着ローラあるいは分離ソメが
溶ブう１し、定着器を交換しなければならなかった。ま
た祇が定着ローラに巻きついた状態で定着ヒータ制御不
能になった場合、温度ヒユーズ設定温度に達するまでに
紙が燃える場合もあり、もつと安全な保唐回路が要望さ
れていた。
タ断線、トライアック、５ＳＲ（ソリッドステートリレ
ー）等の制御素子の導通破浪及び制御系の不良等により
、定着ヒータ制御が不能になった場合、定着ヒータが過
熱し、周辺部材の溶解あるいは発煙、発火の恐れもちね
、大変危険である。このだめ通常、定着ヒータ過熱保護
のために、温度ヒユーズやサーマルプロテクタを定着ヒ
ータと直列に挿入し、定着ローラ近傍等に設けているが
、温度ヒユーズ等の故障率は高く、時として働かない場
合もあるばかりか、温度ヒユーズが設定温度に達して切
れたとしても、その時は定着ローラあるいは分離ソメが
溶ブう１し、定着器を交換しなければならなかった。ま
た祇が定着ローラに巻きついた状態で定着ヒータ制御不
能になった場合、温度ヒユーズ設定温度に達するまでに
紙が燃える場合もあり、もつと安全な保唐回路が要望さ
れていた。
その中で、サーミスタ断線に対してはサーミスタ断線検
知回路、ＣＰＨの暴走に対しては、暴走検知回路等を付
加することにより対策をたてているが、トライアック、
ＳＳＲ等の制御素子に対しては、瞬時電流の大きい負荷
を制御することもあって、故障率が高いにもかかわらず
、対策はたてられていなかった。
知回路、ＣＰＨの暴走に対しては、暴走検知回路等を付
加することにより対策をたてているが、トライアック、
ＳＳＲ等の制御素子に対しては、瞬時電流の大きい負荷
を制御することもあって、故障率が高いにもかかわらず
、対策はたてられていなかった。
本発明は、このような欠点を除去するもので、負荷への
電力供給を制御する制御素子の異常時の危険性を大幅に
削減し、極めて安全性の高い負荷への電力供給制御を行
うことが可能な負荷電力制御装置を提供することを目的
とする。
電力供給を制御する制御素子の異常時の危険性を大幅に
削減し、極めて安全性の高い負荷への電力供給制御を行
うことが可能な負荷電力制御装置を提供することを目的
とする。
〔実力ｍ例〕
以下図面を参照して本発明の詳細な説明する。
第１図は本発明の一実施例を示す回路図である。
第１図に示すようＫ、１００ｖの交流電源に接続される
端子札、Ａ２間には定着ヒータＨ１に直列に温度ヒユー
ズＦｕ１、トライアックＴＲ工及び遮断用リレー接点Ｒ
ｙ１− ａが接続されている。
端子札、Ａ２間には定着ヒータＨ１に直列に温度ヒユー
ズＦｕ１、トライアックＴＲ工及び遮断用リレー接点Ｒ
ｙ１− ａが接続されている。
また、リレー接点Ｒｙ １− ａ及びトライアックＴＲ
工の両端には異常電圧吸収用スパーククエンチＳＱ、１
及び８Ｑ２が接続され、また、交流電源のＡ。
工の両端には異常電圧吸収用スパーククエンチＳＱ、１
及び８Ｑ２が接続され、また、交流電源のＡ。
端子と、リレー接点Ｒア１−ａ、トライアックＴＲ工と
の接続点Ｂとの間に、並列に抵抗Ｒ１７とダイオードブ
リッジＤＢ１が直列接続され、前記ダイオードブリッジ
ＤＢｊの出力側にフォトカプラＰＣ１及び逆電圧防止用
ダイオードＤ１が接続される。
の接続点Ｂとの間に、並列に抵抗Ｒ１７とダイオードブ
リッジＤＢ１が直列接続され、前記ダイオードブリッジ
ＤＢｊの出力側にフォトカプラＰＣ１及び逆電圧防止用
ダイオードＤ１が接続される。
フォトカプラｐｃ１の出力側には、抵抗Ｒ１０、Ｒ１１
、コンデンサＣ２よりなる充放電回路及びツェナーダイ
オードＺＤ２ 、抵抗Ｒ１２，Ｒ１３）ランジスタＱ４
よシなるスイッチング回路が接続されている。
、コンデンサＣ２よりなる充放電回路及びツェナーダイ
オードＺＤ２ 、抵抗Ｒ１２，Ｒ１３）ランジスタＱ４
よシなるスイッチング回路が接続されている。
一方、ヒータ制御信号は抵抗Ｒ１，Ｒ２、トランジスタ
Ｑ１のスイッチング回路に接続され、さらに、トランジ
スタＱ１の出力側には抵抗Ｒ３゜Ｒ４、コンデンサＣ１
からなる充放電回路、及びツェナーダイオードｚＤ１、
抵抗Ｒ５、Ｒ６、Ｒ７、Ｒｅ、トランジスタＱ、２ 、
Ｑ、３よシなるコンデンサＣ３への電流供給回路が接続
されている。また、前記トランジスタＱ４の出力側には
、抵抗Ｒ９、Ｒ１４、コンデンサＣ６による充放電回路
及びツェナーダイオードＺＤ３、抵抗Ｒ１５，Ｒ１／ｉ
、トランジスタＱ、５よりなるスイッチング回路が接続
され、トランジスタＱ５の出力側にヒユーズ抵抗ＦＲ１
とリレーＲ７１及び逆電圧防止用ダイオードＤ２が接続
されている。
Ｑ１のスイッチング回路に接続され、さらに、トランジ
スタＱ１の出力側には抵抗Ｒ３゜Ｒ４、コンデンサＣ１
からなる充放電回路、及びツェナーダイオードｚＤ１、
抵抗Ｒ５、Ｒ６、Ｒ７、Ｒｅ、トランジスタＱ、２ 、
Ｑ、３よシなるコンデンサＣ３への電流供給回路が接続
されている。また、前記トランジスタＱ４の出力側には
、抵抗Ｒ９、Ｒ１４、コンデンサＣ６による充放電回路
及びツェナーダイオードＺＤ３、抵抗Ｒ１５，Ｒ１／ｉ
、トランジスタＱ、５よりなるスイッチング回路が接続
され、トランジスタＱ５の出力側にヒユーズ抵抗ＦＲ１
とリレーＲ７１及び逆電圧防止用ダイオードＤ２が接続
されている。
同、ツェナーダイオードＺＤ１〜ＺＤ５及びトランジス
タＱ、２．Ｑ４．Ｑ、５はそれぞれ同種のものを使用し
、以下ではツェナーダイオードｚＤ１〜ＺＤ５のツェナ
ー電位をＶｚ 、Ｑ、２ 、Ｑ、４ 、Ｑ５のペース、
エミッタ間電位をＶｎｘとする。
タＱ、２．Ｑ４．Ｑ、５はそれぞれ同種のものを使用し
、以下ではツェナーダイオードｚＤ１〜ＺＤ５のツェナ
ー電位をＶｚ 、Ｑ、２ 、Ｑ、４ 、Ｑ５のペース、
エミッタ間電位をＶｎｘとする。
定着ヒータの制御はトライアックＴＲ工を用いて、定着
ヒータ制御信号に基づき、全波及び半波通電の制御を行
なう様にしているつ全波通電制御時は第２図ａの様にゼ
ロクロスと同期した正パルス波形の制御信号を出力して
いる。また、半波通電制御時は、第２図ａのパルスを１
個おきに出力している。いま、第２図ａの様に定着ヒー
タ制御パルスを出力した場合、トライアックＴＲ工のゲ
ートにパルスが印加され、定着ヒータＨ１は通電される
。（通常リレー接点Ｒｙ１−ａは閉じている。） これによりＡ、、Ｂ間の電位ｄは第２図ｄの様な波形と
なり、ダイオードブリッジＤＢ１で全波整流され、フォ
トカプラｐｃ１を介して、抵抗Ｒ１０、Ｒ１１、コンデ
ンサＣ２の充放電回路にょυ平滑化される。また、この
ときツェナーダイオードＺＤ２のツェナー電位（Ｖ−）
とトランジスタＱ、４のペース、エミッタ間電位（ＶＢ
Ｅ）を加えた電位（ＶＰ ＋ Ｖｎｙ＋）にコンデンサ
Ｃ２の端子電圧θの電位が達するまで、トランジスタ９
．４のペースに電流が流れ込まないため、トランジスタ
Ｑ４はＯＮ ｌ、ないが、ｅの電位が（ｖ２＋ ＶＢｚ
）に達すると、トランジスタＱ４はＯＮする。また、ヒ
ータ制御信号ａは、トランジスタＱ、１を介して抵抗Ｒ
，、Ｒ４、コンデンサ０１よりなる充放電回路により、
第２図すの様に平滑化され、先に説明し／ζ如くコンデ
ンサＣ１端子電圧すの電位が（ｖ、 ＋ ＶＢＫ）に達
するとトランク、’！、りＱ、２はＯＮする。トランジ
スタＱ２がＯＮすると、トランジスタＱ５もＯＮする。
ヒータ制御信号に基づき、全波及び半波通電の制御を行
なう様にしているつ全波通電制御時は第２図ａの様にゼ
ロクロスと同期した正パルス波形の制御信号を出力して
いる。また、半波通電制御時は、第２図ａのパルスを１
個おきに出力している。いま、第２図ａの様に定着ヒー
タ制御パルスを出力した場合、トライアックＴＲ工のゲ
ートにパルスが印加され、定着ヒータＨ１は通電される
。（通常リレー接点Ｒｙ１−ａは閉じている。） これによりＡ、、Ｂ間の電位ｄは第２図ｄの様な波形と
なり、ダイオードブリッジＤＢ１で全波整流され、フォ
トカプラｐｃ１を介して、抵抗Ｒ１０、Ｒ１１、コンデ
ンサＣ２の充放電回路にょυ平滑化される。また、この
ときツェナーダイオードＺＤ２のツェナー電位（Ｖ−）
とトランジスタＱ、４のペース、エミッタ間電位（ＶＢ
Ｅ）を加えた電位（ＶＰ ＋ Ｖｎｙ＋）にコンデンサ
Ｃ２の端子電圧θの電位が達するまで、トランジスタ９
．４のペースに電流が流れ込まないため、トランジスタ
Ｑ４はＯＮ ｌ、ないが、ｅの電位が（ｖ２＋ ＶＢｚ
）に達すると、トランジスタＱ４はＯＮする。また、ヒ
ータ制御信号ａは、トランジスタＱ、１を介して抵抗Ｒ
，、Ｒ４、コンデンサ０１よりなる充放電回路により、
第２図すの様に平滑化され、先に説明し／ζ如くコンデ
ンサＣ１端子電圧すの電位が（ｖ、 ＋ ＶＢＫ）に達
するとトランク、’！、りＱ、２はＯＮする。トランジ
スタＱ２がＯＮすると、トランジスタＱ５もＯＮする。
すなわち、ヒータ制御パルスが出力されている間はトラ
ンジスタＱ３がＯＦＦ ｌ、ているため、トランジスタ
Ｑ４がＯＮ、ＯＦＦどちらでもコンデンサＣ５は充電さ
れることがないが、定着ヒータ制御パルスが出力されて
いない時には、トランジスタＱ４がＯＦＦ 、すなわち
定后ヒータが導通している時には、コンデンサＣ３の充
電が行なわれる。また、ヒータ制御パルスが出力されて
いない時に、トランジスタＱ３がＯＮした場合、すなわ
ち定着ヒータが非導通の時（正常状態）は、トランジス
タＱ４ ＯＮでコンデンサＣ！１は放電が行われる。
ンジスタＱ３がＯＦＦ ｌ、ているため、トランジスタ
Ｑ４がＯＮ、ＯＦＦどちらでもコンデンサＣ５は充電さ
れることがないが、定着ヒータ制御パルスが出力されて
いない時には、トランジスタＱ４がＯＦＦ 、すなわち
定后ヒータが導通している時には、コンデンサＣ３の充
電が行なわれる。また、ヒータ制御パルスが出力されて
いない時に、トランジスタＱ３がＯＮした場合、すなわ
ち定着ヒータが非導通の時（正常状態）は、トランジス
タＱ４ ＯＮでコンデンサＣ！１は放電が行われる。
コンデンサＣ５の端子電圧ｆの電位は正常時であっても
、信号の遅れ等の関係で、コンデンサＣ６の充電が行な
われ、第２図ｆに示す波形の如く、定着ヒータ制御パル
ス出力の前後で、コンデンサＣ３の電位が上井すること
があるが、ｆ電位が（■ｚ＋Ｖｎｚ）以上にならない限
り、トランジスタＱ５は０）Ｉｔ、ない。
、信号の遅れ等の関係で、コンデンサＣ６の充電が行な
われ、第２図ｆに示す波形の如く、定着ヒータ制御パル
ス出力の前後で、コンデンサＣ３の電位が上井すること
があるが、ｆ電位が（■ｚ＋Ｖｎｚ）以上にならない限
り、トランジスタＱ５は０）Ｉｔ、ない。
しかし、トライアックＴＲ工が導通破壊し、定着ヒータ
制御パルスを出力していないにもかかわらず、定着ヒー
タが導通状態になってしまった場合は、コンデンサＣ３
が徐々に充電され、−一定時間後に、（ｖ２１＋ ＶＢ
Ｒ）以上の電位になるため、トランジスタＱ５がＯＮ
Ｌ、リレーＲＹ１の入力端をほぼ同電位にすることによ
り、接点Ｐ、ｙ１−ａを開き、定着ヒータを遮断する。
制御パルスを出力していないにもかかわらず、定着ヒー
タが導通状態になってしまった場合は、コンデンサＣ３
が徐々に充電され、−一定時間後に、（ｖ２１＋ ＶＢ
Ｒ）以上の電位になるため、トランジスタＱ５がＯＮ
Ｌ、リレーＲＹ１の入力端をほぼ同電位にすることによ
り、接点Ｐ、ｙ１−ａを開き、定着ヒータを遮断する。
また、このときヒユーズ抵抗ＦＲｉに定格電力の数十倍
の電力がかかるため、ヒユーズ抵抗ＦＲ，ｉが溶断する
。
の電力がかかるため、ヒユーズ抵抗ＦＲ，ｉが溶断する
。
これＫより定着ヒータ遮断の状態を保持し、一旦電源ス
イッチＯＦＦ 桜に再度ＯＮ した場合でも定着ヒータ
は遮断したままとなるため安全である。
イッチＯＦＦ 桜に再度ＯＮ した場合でも定着ヒータ
は遮断したままとなるため安全である。
この様に、定着ヒータ制御信号と、実際定着ヒータに加
わっている電圧の整流信号とを比較することにより、少
なくともトライアック、ＳＳＲ等の制御素子の導通破壊
を検出し、定着ヒータを強制遮断するとともに、その状
態を保持することにより、定着ヒータの過熱による常置
及び危険性を大幅に削除することを可能（（シている。
わっている電圧の整流信号とを比較することにより、少
なくともトライアック、ＳＳＲ等の制御素子の導通破壊
を検出し、定着ヒータを強制遮断するとともに、その状
態を保持することにより、定着ヒータの過熱による常置
及び危険性を大幅に削除することを可能（（シている。
冑、前記実施例においては、全波半波通電による制御方
式をとったため、ヒータ制御波形をゼロクロスに同期し
たパルス波形にしているが、全波通電のみによる制御方
式ならば、例えばヒータＯＦＦのとき１″、ヒータＯＮ
で１″０”を出力するようなレベルによる制御波形でも
よく、この場合、トランジスタＱ２のペースに直接制御
信号を入力すればよい。
式をとったため、ヒータ制御波形をゼロクロスに同期し
たパルス波形にしているが、全波通電のみによる制御方
式ならば、例えばヒータＯＦＦのとき１″、ヒータＯＮ
で１″０”を出力するようなレベルによる制御波形でも
よく、この場合、トランジスタＱ２のペースに直接制御
信号を入力すればよい。
また、前記実施例ではヒユーズ抵抗を用いて異常時にヒ
ータの遮断を保持するようにしているが、リレーＲ７１
にラッチングリレー等を用いて、ヒータ遮断の保持を行
なう様にしてもよく、ヒユーズ抵抗の代わりにブレーカ
、ヒユーズ等の遮断保持手段を用いてもよい。
ータの遮断を保持するようにしているが、リレーＲ７１
にラッチングリレー等を用いて、ヒータ遮断の保持を行
なう様にしてもよく、ヒユーズ抵抗の代わりにブレーカ
、ヒユーズ等の遮断保持手段を用いてもよい。
さらに、前記実施例では異常時に定着ヒータを遮断する
構成であったが、定着ヒータ以外の例えば駆動モータや
照明ランプ等を同時に遮断することも容易に可能である
。
構成であったが、定着ヒータ以外の例えば駆動モータや
照明ランプ等を同時に遮断することも容易に可能である
。
又、前記実施例では定着ヒータへの電力制御の場合を例
にとり説明したが、本発明は定着ヒータに限るものでな
く、他のヒータ、ランプ等の負荷への電力制御を行うも
のについても応用可能なものである。
にとり説明したが、本発明は定着ヒータに限るものでな
く、他のヒータ、ランプ等の負荷への電力制御を行うも
のについても応用可能なものである。
以上の様に、本発明によれば負荷電力制御信号と、負荷
に加わる電圧とを比較することによυ、負荷への電力供
給を制御する制御素子の異常が検知でき、それによる危
険性を大幅に側波し、極めて安全性の高い負荷電力制御
を行うことができるつ
に加わる電圧とを比較することによυ、負荷への電力供
給を制御する制御素子の異常が検知でき、それによる危
険性を大幅に側波し、極めて安全性の高い負荷電力制御
を行うことができるつ
第１図は本発明の実施例における回路図、第２図は本発
明の説明を行なうだめのタイミング図である。 Ｒ１−Ｒ１７・・・抵抗 Ｃ１〜Ｃ６・・・コンデンサ ＺＤ１〜ｚＤ３・・ツェナーダイオードＤ１．Ｄ２・・
・ダイオード ＤＢｌ ・・・ダイオードブリッジ ＰＣ１・・・フォトカプラ Ｒ７１・・・リレー ＦＲｌ ・・・ヒユーズ抵抗 ａ〜９・・・各信号波形 、ｊｇ、ｊ二工Ｊ゛ 躬７反
明の説明を行なうだめのタイミング図である。 Ｒ１−Ｒ１７・・・抵抗 Ｃ１〜Ｃ６・・・コンデンサ ＺＤ１〜ｚＤ３・・ツェナーダイオードＤ１．Ｄ２・・
・ダイオード ＤＢｌ ・・・ダイオードブリッジ ＰＣ１・・・フォトカプラ Ｒ７１・・・リレー ＦＲｌ ・・・ヒユーズ抵抗 ａ〜９・・・各信号波形 、ｊｇ、ｊ二工Ｊ゛ 躬７反
Claims (3)
- （１）負荷電力制御信号に基づき負荷に供給される電力
を制御するための制御素子、前記負荷に加わる電圧を検
知する検知回路、前記負荷電力制御信号と前記検知回路
から得られた検知信号とを比較し各々の信号の関係が通
常生じない状態になつた場合に負荷電圧を遮断する制御
回路を有することを特徴とする負荷電力制御回路。 - （２）前記制御回路は遮断状態を保持するための素子を
備えたことを特徴とする特許請求の範囲第１項記載の負
荷電力制御回路。 - （３）前記制御回路は前記負荷電力制御信号がオフ信号
であるにもかかわらず、前記負荷が通電していた場合に
のみ負荷を遮断することを特徴とする特許請求の範囲第
１項記載の負荷電力制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59171042A JPS6149611A (ja) | 1984-08-17 | 1984-08-17 | 負荷電力制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59171042A JPS6149611A (ja) | 1984-08-17 | 1984-08-17 | 負荷電力制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6149611A true JPS6149611A (ja) | 1986-03-11 |
Family
ID=15916007
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59171042A Pending JPS6149611A (ja) | 1984-08-17 | 1984-08-17 | 負荷電力制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6149611A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US9505045B2 (en) | 2012-11-29 | 2016-11-29 | Jp Steel Plantech Co. | Leveler equipment and sheet material flattening method |
-
1984
- 1984-08-17 JP JP59171042A patent/JPS6149611A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US9505045B2 (en) | 2012-11-29 | 2016-11-29 | Jp Steel Plantech Co. | Leveler equipment and sheet material flattening method |
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