JPS6159489A - Ａｃ形プラズマ・デイスプレイ・パネルの駆動方式 - Google Patents
Ａｃ形プラズマ・デイスプレイ・パネルの駆動方式Info
- Publication number
- JPS6159489A JPS6159489A JP59182070A JP18207084A JPS6159489A JP S6159489 A JPS6159489 A JP S6159489A JP 59182070 A JP59182070 A JP 59182070A JP 18207084 A JP18207084 A JP 18207084A JP S6159489 A JPS6159489 A JP S6159489A
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Control Of Gas Discharge Display Tubes (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はプラズマ・ディスプレイ・パネル（Ｐｌａｓｍ
ａ Ｄｉｓｐｌａｙ Ｐａｎｅｌ、 ＰＤＰ ） （Ｄ
駆動回路ニ係り、特にＡＣ形ＰＤＰの動作に必要な理想
的な矩形波を供給するための駆動方式に関する。
ａ Ｄｉｓｐｌａｙ Ｐａｎｅｌ、 ＰＤＰ ） （Ｄ
駆動回路ニ係り、特にＡＣ形ＰＤＰの動作に必要な理想
的な矩形波を供給するための駆動方式に関する。
ＡＣ形ＰＤＰには、縦ｍ本、横ｎ本（縦の電極は、横方
向の座標を与えるので、以下Ｘ電極、またはＸと略して
呼び、横の電極はＹと呼ぶ。）の直交電極を持つものが
ある。このｍＸｎのセルには、すべてＸ、Ｘ電極を通し
て、並列に交互に変わる正負のパルス電圧Ｖｓ（維持電
圧）がかけである。
向の座標を与えるので、以下Ｘ電極、またはＸと略して
呼び、横の電極はＹと呼ぶ。）の直交電極を持つものが
ある。このｍＸｎのセルには、すべてＸ、Ｘ電極を通し
て、並列に交互に変わる正負のパルス電圧Ｖｓ（維持電
圧）がかけである。
このＶｓではどのセルも放電を開始することができない
が、−担何らかの手段によってひき起こされた放電につ
いては、セルはそれを持続できる特性を持っている。そ
して、１つのセルＣｔｊ（１＝１〜ｍｌ ｊ＝１〜ｎ
）に、それに属する電極Ｘｉ、Ｘｊを通じて放電のし
きい値を越え、放電成長に必要な時間幅を持った電圧（
書込電圧Ｖｗ ）を維持電圧に重畳、あるいはそのすき
まに加えると、そのセルは放電を開始する。−担放電を
開始したセルは、その後は維持電圧Ｖｓの振幅だけで放
電を繰返す。
が、−担何らかの手段によってひき起こされた放電につ
いては、セルはそれを持続できる特性を持っている。そ
して、１つのセルＣｔｊ（１＝１〜ｍｌ ｊ＝１〜ｎ
）に、それに属する電極Ｘｉ、Ｘｊを通じて放電のし
きい値を越え、放電成長に必要な時間幅を持った電圧（
書込電圧Ｖｗ ）を維持電圧に重畳、あるいはそのすき
まに加えると、そのセルは放電を開始する。−担放電を
開始したセルは、その後は維持電圧Ｖｓの振幅だけで放
電を繰返す。
これは放電により等測的な内部電圧（壁電圧）が生じ、
これが交互に反転する維持電圧に同極性として加わυ、
維持電圧の振幅でも実効的にしきい値を越えるからであ
る。放電点灯したもの一消去は、セルに放電をひき起こ
すが、むしろ壁電荷を消耗してしまうような、電圧と時
間幅をもった消去パルスを加える。本発明は、このよう
なＡＣ形ＦＤＰを対象にした駆動方式に関する。
これが交互に反転する維持電圧に同極性として加わυ、
維持電圧の振幅でも実効的にしきい値を越えるからであ
る。放電点灯したもの一消去は、セルに放電をひき起こ
すが、むしろ壁電荷を消耗してしまうような、電圧と時
間幅をもった消去パルスを加える。本発明は、このよう
なＡＣ形ＦＤＰを対象にした駆動方式に関する。
第４図（Ａ）に従来のＰＤＰの構成図を示し、 １が上
述のようなｍｘｎのセルを備えたパネルであ、６、ｘ、
ｙのアドレスドライバ群４．５を介してパネル１０ＸＹ
の交点のそれぞれのセルには交互に変わる正負のパルス
電圧Ｖｓ（維持電圧）が印加される。該維持電圧波形は
サスティンドライバ２゜３から供給される。さらに、書
込電圧Ｖｗ、消去パルスｖＥが例えばＹ軸側のサスティ
ンドライバ３からアドレスドライバ群５の選択されたド
ライバを介して選択されたＹ電極に印加される。
述のようなｍｘｎのセルを備えたパネルであ、６、ｘ、
ｙのアドレスドライバ群４．５を介してパネル１０ＸＹ
の交点のそれぞれのセルには交互に変わる正負のパルス
電圧Ｖｓ（維持電圧）が印加される。該維持電圧波形は
サスティンドライバ２゜３から供給される。さらに、書
込電圧Ｖｗ、消去パルスｖＥが例えばＹ軸側のサスティ
ンドライバ３からアドレスドライバ群５の選択されたド
ライバを介して選択されたＹ電極に印加される。
第４図（Ｂ）にサスティンドライバの例を示しておシ、
出力端子８を維持電圧Ｖｓにプルアップするトランジス
タＱ１と、接地電圧Ｏｖにプルダウンするトランジスタ
Ｑ２とが備えられ、入力端子６，７に供給する信号でト
ランジスタＱ＋ 、Ｑ２を交互にＯＮ。
出力端子８を維持電圧Ｖｓにプルアップするトランジス
タＱ１と、接地電圧Ｏｖにプルダウンするトランジスタ
Ｑ２とが備えられ、入力端子６，７に供給する信号でト
ランジスタＱ＋ 、Ｑ２を交互にＯＮ。
ＯＦＦさせ、出力端子８に維持電圧パルスを出力する。
第４図（Ｃ）は、Ｘアドレスドライバ群４の１つのドラ
イバの例を示し、端子９には図（Ｂ）のサスティンドラ
イバの端子８の出力が印加される。該ドライバが非選択
時にはアンドゲート１０（タイミング信号Ｔ２選択信号
Ａｉ）は閉じており、トランジスタＱＢ（ｎｐｎ形）の
ベースは低電位であり、ＱｇはＯＦＦとなり、トランジ
スタＱ４（ｎｐｎ形）のベースは高電位となるからＱ４
はＯＮになる。従って、端子９のサスティン（維持電圧
Ｖｓ波形） Ｖｓ波形はトランジスタＱ４を介して対応
するパネルのＸｉ電極に印加される。一方、該ドライバ
が選択された時には、選択信号Ａｉは′Ｈ”でアンドゲ
ート１０が開き、トランジスタＱ８のベースが高電位に
なシ、ＱｓがＯＮ、シたがってＱ４のベースが低電位に
なってＱ４がＯＦＦになる。従って、パネルのＸｉ電極
はトランジスタＱ８・ダイオードＤを介して接地され、
Ｘｔ電極の電位Ｖｘｌは−ＯＶになる。
イバの例を示し、端子９には図（Ｂ）のサスティンドラ
イバの端子８の出力が印加される。該ドライバが非選択
時にはアンドゲート１０（タイミング信号Ｔ２選択信号
Ａｉ）は閉じており、トランジスタＱＢ（ｎｐｎ形）の
ベースは低電位であり、ＱｇはＯＦＦとなり、トランジ
スタＱ４（ｎｐｎ形）のベースは高電位となるからＱ４
はＯＮになる。従って、端子９のサスティン（維持電圧
Ｖｓ波形） Ｖｓ波形はトランジスタＱ４を介して対応
するパネルのＸｉ電極に印加される。一方、該ドライバ
が選択された時には、選択信号Ａｉは′Ｈ”でアンドゲ
ート１０が開き、トランジスタＱ８のベースが高電位に
なシ、ＱｓがＯＮ、シたがってＱ４のベースが低電位に
なってＱ４がＯＦＦになる。従って、パネルのＸｉ電極
はトランジスタＱ８・ダイオードＤを介して接地され、
Ｘｔ電極の電位Ｖｘｌは−ＯＶになる。
第４ 図（Ｄ） Ｋ Ｙアドレスドライバ５の例を示し
、書込ドライバ（図示せず）の出力電圧Ｖｗが加わる・
他は（Ｃ）の回路と同等である〇 第５図にパネルのＸ、Ｙ電極に印加する波形Ｖｘ。
、書込ドライバ（図示せず）の出力電圧Ｖｗが加わる・
他は（Ｃ）の回路と同等である〇 第５図にパネルのＸ、Ｙ電極に印加する波形Ｖｘ。
Ｖｙを示し、維持電圧ｖｓ波形がＸ、Ｙで逆相に印加さ
れておシ、尚該Ｘ、Ｙが選択された書込時、Ｙには書込
電圧ＶＷが加わシ、ＸはＯＶに引かれる。
れておシ、尚該Ｘ、Ｙが選択された書込時、Ｙには書込
電圧ＶＷが加わシ、ＸはＯＶに引かれる。
また消去時には、消去に必要な短い幅だけＶｘがＯＶに
引かれ、ｖＹはｖｓが印加される。
引かれ、ｖＹはｖｓが印加される。
以上のようにＸ、Ｙに駆動波形が印加される時セルから
みると第５図のＶｙ −Ｖｘの正負の交番電圧が印加さ
れ念ようにみえ、該セルの放電点灯、放電維持、及び消
去が行なわれる。
みると第５図のＶｙ −Ｖｘの正負の交番電圧が印加さ
れ念ようにみえ、該セルの放電点灯、放電維持、及び消
去が行なわれる。
ところが、実際のサスティンドライバの出力はこのよう
な理想的な波形にならない。それはパネルのセルの放電
時に瞬時大電流が流れ、その結果、第４図（Ｂ）のサス
ティンドライバの内部抵抗（トランジスタＱｓ 、Ｑｚ
のインピーダンス等）により出力電圧が瞬間的に変動す
るためである。
な理想的な波形にならない。それはパネルのセルの放電
時に瞬時大電流が流れ、その結果、第４図（Ｂ）のサス
ティンドライバの内部抵抗（トランジスタＱｓ 、Ｑｚ
のインピーダンス等）により出力電圧が瞬間的に変動す
るためである。
第６図にこの様子を示し、放電の瞬時大電流によシ、Ｖ
ｘ 、Ｖｙはａ 、 ａ’及びす、ｂ′ノヨウニ変動ス
る。その結果、セルにか＼る電圧Ｖｙ −ＶＸは図のよ
うにＶＢから電圧低下をきたす。これは、ＰＤＰの上述
のメモリ表示機能を確保する、即ち、メモリ表示のため
に十分な動作電圧範囲（メモリマージン）を確保する上
で非常に不利である。
ｘ 、Ｖｙはａ 、 ａ’及びす、ｂ′ノヨウニ変動ス
る。その結果、セルにか＼る電圧Ｖｙ −ＶＸは図のよ
うにＶＢから電圧低下をきたす。これは、ＰＤＰの上述
のメモリ表示機能を確保する、即ち、メモリ表示のため
に十分な動作電圧範囲（メモリマージン）を確保する上
で非常に不利である。
本発明においては、Ｘサスティンドライバ２１１Ｙサス
テインドライバの少なくとも接地電位（Ｏｖ）出力時に
、サスティンドライバの接地側トランジスタのＯＮを補
助するように当該サスティンドライバに接続するＸまた
はＹアドレスドライバ群を一斉に動作せしめる。それに
よシ、サスティンドライバの導通接地と並列にアドレス
ドライバの各トランジスタが導通接地するので、内部抵
抗が低下し、放電時の瞬時大電流による電圧ドロップが
なくなる。また、サスティンドライバの維持電圧Ｖ、に
ついては、アドレスドライバ回路をプッシュプル構成に
して、サスティンドライバのＶＢレベル出力トランジス
タの動作を補助するように、アドレスドライバのトラン
ジスタ（Ｖｓ側）が−斉にＯＮするようにすればＶｓレ
ベルの放電時の電圧低下が防止される。
テインドライバの少なくとも接地電位（Ｏｖ）出力時に
、サスティンドライバの接地側トランジスタのＯＮを補
助するように当該サスティンドライバに接続するＸまた
はＹアドレスドライバ群を一斉に動作せしめる。それに
よシ、サスティンドライバの導通接地と並列にアドレス
ドライバの各トランジスタが導通接地するので、内部抵
抗が低下し、放電時の瞬時大電流による電圧ドロップが
なくなる。また、サスティンドライバの維持電圧Ｖ、に
ついては、アドレスドライバ回路をプッシュプル構成に
して、サスティンドライバのＶＢレベル出力トランジス
タの動作を補助するように、アドレスドライバのトラン
ジスタ（Ｖｓ側）が−斉にＯＮするようにすればＶｓレ
ベルの放電時の電圧低下が防止される。
第１図にＹ側についての本発明の実施例を示す。
図において、Ｘ側サスティンドライバ１１の出力端子８
は、Ｘアドレスドライバ（Ｘ１〜Ｘｍ） １２に供給さ
れ、Ｘアドレスドライバの各出力はパネル１の電極Ｘ１
〜Ｘｍにそれぞれ接続する。こ＼でサスティンドライバ
１１．アドレスドライバ（Ｘｌ−Ｘｍ） １２は先に示
した第４図（Ｂ） 、 （Ｃ）と同等である。本実施例
においては第２図のアドレスドライバ１２の選択信号Ａ
ｘｉに加えて補助パルスＶＣを印加し、該パルスＶｃの
印加時にアドレスドライバ１２の接地側トランジスタＱ
８をＯＮ して接地し、パネルＸｉ電極を接地電位に引
くようにする。そのため、本実施例ではアドレスドライ
バ１２の選択パルスＡｘｉ入力端子に第２図に示してい
るように補助パルスＶｃを重ねて入力する。第３図に補
助パルスＶＣのタイミングを示している。放電は実際の
電圧印加に遅れｔｄ（ｔｄ ＝ ２００ ｎｓ位、放電
時間０．５７７８位）でもって生ずるため、Ｖｘ 、Ｖ
ｙの放電の瞬時大電流によるドロップＳもｔｄの遅れを
もって同時間幅出力する。したがって、ドロップＳのタ
イミング時にアドレスドライバを動作させれば艮いわけ
であるが、実際上第３図に示すように、Ｖｘ、Ｖｙの接
地電位への引下タイミングで補助パルス■ｃ（ハルス幅
ｔｃ≧ｔｄ＋放電時間）を印加する。なお、以上でＹ側
のみ示したが、Ｙ側も同様に構成できるので（書込ドラ
イバを第４図（Ｄ）のように接続する他）、説明は略す
。
は、Ｘアドレスドライバ（Ｘ１〜Ｘｍ） １２に供給さ
れ、Ｘアドレスドライバの各出力はパネル１の電極Ｘ１
〜Ｘｍにそれぞれ接続する。こ＼でサスティンドライバ
１１．アドレスドライバ（Ｘｌ−Ｘｍ） １２は先に示
した第４図（Ｂ） 、 （Ｃ）と同等である。本実施例
においては第２図のアドレスドライバ１２の選択信号Ａ
ｘｉに加えて補助パルスＶＣを印加し、該パルスＶｃの
印加時にアドレスドライバ１２の接地側トランジスタＱ
８をＯＮ して接地し、パネルＸｉ電極を接地電位に引
くようにする。そのため、本実施例ではアドレスドライ
バ１２の選択パルスＡｘｉ入力端子に第２図に示してい
るように補助パルスＶｃを重ねて入力する。第３図に補
助パルスＶＣのタイミングを示している。放電は実際の
電圧印加に遅れｔｄ（ｔｄ ＝ ２００ ｎｓ位、放電
時間０．５７７８位）でもって生ずるため、Ｖｘ 、Ｖ
ｙの放電の瞬時大電流によるドロップＳもｔｄの遅れを
もって同時間幅出力する。したがって、ドロップＳのタ
イミング時にアドレスドライバを動作させれば艮いわけ
であるが、実際上第３図に示すように、Ｖｘ、Ｖｙの接
地電位への引下タイミングで補助パルス■ｃ（ハルス幅
ｔｃ≧ｔｄ＋放電時間）を印加する。なお、以上でＹ側
のみ示したが、Ｙ側も同様に構成できるので（書込ドラ
イバを第４図（Ｄ）のように接続する他）、説明は略す
。
以上は、サスティンドライバの低電位側のトランジスタ
の出力をアドレスドライバの動作で補助する実施例を示
したが、高電位Ｖｓ側のトランジスタ出力についても同
様に補助して放電による電圧ドロップを防止するように
もできることは明白である。ただし、この場合、アドレ
スドライバをプッシュプルに構成する必要がある。
の出力をアドレスドライバの動作で補助する実施例を示
したが、高電位Ｖｓ側のトランジスタ出力についても同
様に補助して放電による電圧ドロップを防止するように
もできることは明白である。ただし、この場合、アドレ
スドライバをプッシュプルに構成する必要がある。
本発明によれば、サスティンドライバの動作に合わせて
、本来アドレス時のみに動作するように構成されていた
アドレスドライバをアドレス時以外にも動作するよう構
成したので、パネルのセルの放電時にサスティンドライ
バの出力トランジスタの動作を、これに接続しているア
ドレスドライバ群のドライバトランジスタの動作で補助
強化することが可能になる。従って、パネルのセル放電
による瞬時大電流による維持電圧ドロップを有効に防止
でき、ＰＤＰのメモリ表示のために十分な動作電圧範囲
（メモリマージン）を確保することができる。
、本来アドレス時のみに動作するように構成されていた
アドレスドライバをアドレス時以外にも動作するよう構
成したので、パネルのセルの放電時にサスティンドライ
バの出力トランジスタの動作を、これに接続しているア
ドレスドライバ群のドライバトランジスタの動作で補助
強化することが可能になる。従って、パネルのセル放電
による瞬時大電流による維持電圧ドロップを有効に防止
でき、ＰＤＰのメモリ表示のために十分な動作電圧範囲
（メモリマージン）を確保することができる。
第１図は本発明の実施例の回路図、
第２図は第１図のＸアドレスドライバの回路図、第３図
は本発明の実施例のタイミング図、第４図（Ａ）はＰＤ
Ｐの構成図、（Ｂ）はサスティンドライバの回路図、（
Ｃ）はＸアドレスドライバの回路図、（Ｄ）はＸアドレ
スドライバの回路図、第５図はＰＤＰの駆動波形図、 第６図は従来のＰＤＰの駆動回路による波形図。 １・・・（ＦＤＰ）パネル、６・・・入力端子、７・・
・入力端子、８・・・出力端子、１１・・・サスティン
ドライバ（放電維持交番電圧発生回路）、１２・・・ア
ドレスドライバ、ｖｃ・・・補助パルス。
は本発明の実施例のタイミング図、第４図（Ａ）はＰＤ
Ｐの構成図、（Ｂ）はサスティンドライバの回路図、（
Ｃ）はＸアドレスドライバの回路図、（Ｄ）はＸアドレ
スドライバの回路図、第５図はＰＤＰの駆動波形図、 第６図は従来のＰＤＰの駆動回路による波形図。 １・・・（ＦＤＰ）パネル、６・・・入力端子、７・・
・入力端子、８・・・出力端子、１１・・・サスティン
ドライバ（放電維持交番電圧発生回路）、１２・・・ア
ドレスドライバ、ｖｃ・・・補助パルス。
Claims (1)
- パネルのＸ電極とＹ電極にそれぞれアドレスドライバ
を備え、該アドレスドライバに、セルの放電維持交番電
圧発生回路を接続するＡＣ形プラズマ・ディスプレイ・
パネルの駆動回路において、前記維持交番電圧発生回路
の動作を補助するように、セルの放電開始から終了の時
間をカバーできる時間幅で、該維持交番電圧発生回路に
接続するアドレスドライバを一斉に動作せしめることを
特徴とするＡＣ形プラズマ・ディスプレイ・パネルの駆
動方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59182070A JPS6159489A (ja) | 1984-08-31 | 1984-08-31 | Ａｃ形プラズマ・デイスプレイ・パネルの駆動方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59182070A JPS6159489A (ja) | 1984-08-31 | 1984-08-31 | Ａｃ形プラズマ・デイスプレイ・パネルの駆動方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6159489A true JPS6159489A (ja) | 1986-03-26 |
Family
ID=16111821
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59182070A Pending JPS6159489A (ja) | 1984-08-31 | 1984-08-31 | Ａｃ形プラズマ・デイスプレイ・パネルの駆動方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6159489A (ja) |
Citations (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5282024A (en) * | 1975-12-27 | 1977-07-08 | Fujitsu Ltd | Drive circuit of gas discharging panel |
| JPS5283135A (en) * | 1975-12-30 | 1977-07-11 | Fujitsu Ltd | Driving circuit of gaseous discharging panel |
| JPS5283136A (en) * | 1975-12-30 | 1977-07-11 | Fujitsu Ltd | Driving circuit of gaseous discharging panel |
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| JPS5548787A (en) * | 1978-09-29 | 1980-04-08 | Fujitsu Ltd | Gas discharge display unit |
| JPS56142593A (en) * | 1980-04-05 | 1981-11-06 | Fujitsu Ltd | Light emission maintaining system for discharge display panel |
| JPS5865484A (ja) * | 1981-10-07 | 1983-04-19 | 富士通株式会社 | 電極駆動回路 |
| JPS5912490A (ja) * | 1982-07-12 | 1984-01-23 | 富士通株式会社 | ガス放電パネルのサステイン電圧発生回路 |
-
1984
- 1984-08-31 JP JP59182070A patent/JPS6159489A/ja active Pending
Patent Citations (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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