JPS6162941A - 情報処理装置の検査方式 - Google Patents

情報処理装置の検査方式

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Publication number
JPS6162941A
JPS6162941A JP59184810A JP18481084A JPS6162941A JP S6162941 A JPS6162941 A JP S6162941A JP 59184810 A JP59184810 A JP 59184810A JP 18481084 A JP18481084 A JP 18481084A JP S6162941 A JPS6162941 A JP S6162941A
Authority
JP
Japan
Prior art keywords
operating system
tasks
patrol
execution
patrol execution
Prior art date
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Pending
Application number
JP59184810A
Other languages
English (en)
Inventor
Naoko Iino
飯野 直子
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP59184810A priority Critical patent/JPS6162941A/ja
Publication of JPS6162941A publication Critical patent/JPS6162941A/ja
Pending legal-status Critical Current

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    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00Error detection; Error correction; Monitoring
    • G06F11/07Responding to the occurrence of a fault, e.g. fault tolerance
    • G06F11/14Error detection or correction of the data by redundancy in operations
    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00Error detection; Error correction; Monitoring
    • G06F11/22Detection or location of defective computer hardware by testing during standby operation or during idle time, e.g. start-up testing

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  • Engineering & Computer Science (AREA)
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  • Quality & Reliability (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Test And Diagnosis Of Digital Computers (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は情報処理装置の検査方式に関し、特にオペレー
ティングシステム制御のもとで検査する〜ルスチェック
方式に関する。
〔従来技術〕
従来、この種の情報処理装置の故障は、該装置内のチェ
ック回路による検出と、チェック回路によってチェック
不可能な故障が発生するとオペレーティングシステムな
どのソフトウェアの論理矛盾という形での検出に委ねら
れていた。このため、後者のソフトウェアの論理矛盾と
いう形の検出に期待している故障は、ソフトウェアがハ
ードウェアの故障を検出する目的で作成されていないた
めに、ソフトウェアでも検出されない場合があった。
この場合はデータ化けとなり、故障の検出が故障発生後
長時間経過して行なわれていたので、データ復旧が困難
になるという致命的な問題があった。
〔発明の目的〕
本発明の目的は、ソフトウェアでも検出されないような
故障があった場合にデータ化けとなる境象な防止すると
同時に停止時の状態を引き継いでオペレーティングシス
テムを運転することを可能 ・とじた、情報処理装置の
検査方式を提供することζ二ある。
〔発明の構成〕
本発明の情報処理装置の検査方式は、主記憶装置に接続
された処理装置を試験するための処理装置毎のパトロー
ル実行タスクと、これらパトロール実行タスクを制御す
るオペレーティングシステムとを前記主記憶装置に格納
し、オペレーティングシステムは一定時間毎シーこれら
パトロール実行□タスクの全部を起動し、起動されたパ
トロール実行タスクは対応する処理装置の検査を実行し
、パトロール実行タスクがエラーを検出した時には、オ
ペレーティングシステムへ実行停止要求を行ない、これ
によりオペレーティングシステムは直ちに次の立上げに
必要とする情報を退避する緊急停止処理を実行した後、
オペレーティングシステム自身の実行を停止することを
特徴とする。
〔実施例〕
本発明の実施例を図面を参照しながら説明する。
第1図は本発明の情報処理装置の検査方式を適用した情
報処理装置のブロック図である。主記憶装置60上には
、オペレーティングシステム(以下、O8という)61
と、主記憶装置6oに接続された処理装置(以下、CP
Uという)41.42を試験するためのパトロール実行
タスク32.33が格納されている。
次に、本実施例の情報処理装置におけるパトロール実行
の動作を説明する。
パトロール実行タスク32.36の論理は同一であるの
で、以後パトロール実行タスク62について説明する。
第2図はCPU41用検査プログラムであるパトロール
実行タスク32の動作を示すフローチャートである。先
ず処理11(:よりパトロール実行タスク32を起動す
る。次の処理12に制御が移り、メツセージエリアに試
験対象のCPU番号、試験対象命令の情報を移送する。
処理16では試験対象である命令を実行する。処理14
では前記実行結果と期待値を比較する。判断15により
結果が一致していれば判断20へ移る。判= 3− 断20では最後の試験でなければ次の試験を処理12か
ら繰返し実行する。最後の試験であれば、判断20から
パトロール実行タスク62の制御は処理21に移り、1
時間のタイマをセットする。
1時間経過後、判断22から制御は処理11へ戻り、再
度検査が実行されることになる。
判断15において実行結果と期待値が一致しなかった場
合にはプログラムの制御は処理16へと移り、処理16
での実行結果と処理14で用いた期待値をメツセージ出
カニリアへ移送する。この後、処理17にてエラーメツ
セージを編集し、不図示のメツセージ出力装置へ出力す
る。処理18へプログラムの制御が移ると、0861へ
停止要求を出し、0831は緊急停止処理としてシステ
ムを再立上げするために必要な情報、例えばcpUが故
障したこと、故障したCPU番号を不図示のディスクに
書込む。その後、制御が処理19へ移り、os31は直
ちにシステム停止処理を行う。
これによって、0PU41.42の誤動作によるデータ
化けの発生が防止され、かつ障害発生時の情報を引き継
いで0831を運転することが可能:二なる。
以上の説明はCPU41用検査プログラムであるパトロ
ール実行タスク62についてであったが、CPU42用
検査プログラムであるパトロール実情報処理装置へも本
−発明は適用可能なことは容易に類推できる。
〔発明の効果〕
本発明は以上説明したように、処理装置の正常性を検査
するプログラムを処理装置の数だけ一定時間毎に実行し
、エラーを検出した時には、オペレーティングシステム
へ実行停止要求を行ない、これC−よりオペレーティン
グシステムは直ちに次の立上げに必要とする情報を退避
する緊急停止処理を実行した後、オペレーティングシス
テム自身の実行を停止するようにしたので、故障があっ
た場合(ニデータ化けの発生が防止されると同時に障害
発生時の情報を引き継いでオペレーテイングシステムを
運転することが可能になるという効果がある。
【図面の簡単な説明】
第1図は本発明の情報処理装置の検査方式を適用した情
報処理装置のブロック図、第2図は第1図の情報処理装
置における検査を実行するパトロール実行の概略を示す
フローチャートである。 30・・・主記憶装置、 31・・・オペレーティングシステム、62.66・・
・パトロール実行タスク、41.42・・・処理装置。 特許出願人  日本電気株式会社 代 理 人   弁理士 内 原  晋、/ 、 、、
’   :第1図

Claims (1)

    【特許請求の範囲】
  1. 主記憶装置に接続された処理装置を試験するための処理
    装置毎のパトロール実行タスクと、これらパトロール実
    行タスクを制御するオペレーティングシステムとを前記
    主記憶装置に格納し、オペレーティングシステムは一定
    時間毎にこれらパトロール実行タスクの全部を起動し、
    起動されたパトロール実行タスクは対応する処理装置の
    検査を実行し、パトロール実行タスクがエラーを検出し
    た時には、オペレーティングシステムへ実行停止要求を
    行ない、これによりオペレーティングシステムは直ちに
    次の立上げに必要とする情報を退避する緊急停止処理を
    実行した後、オペレーティングシステム自身の実行を停
    止することを特徴とする情報処理装置の検査方式。
JP59184810A 1984-09-04 1984-09-04 情報処理装置の検査方式 Pending JPS6162941A (ja)

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JP59184810A JPS6162941A (ja) 1984-09-04 1984-09-04 情報処理装置の検査方式

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JP59184810A JPS6162941A (ja) 1984-09-04 1984-09-04 情報処理装置の検査方式

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JP59184810A Pending JPS6162941A (ja) 1984-09-04 1984-09-04 情報処理装置の検査方式

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