JPS6170253U - - Google Patents
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- Publication number
- JPS6170253U JPS6170253U JP15192484U JP15192484U JPS6170253U JP S6170253 U JPS6170253 U JP S6170253U JP 15192484 U JP15192484 U JP 15192484U JP 15192484 U JP15192484 U JP 15192484U JP S6170253 U JPS6170253 U JP S6170253U
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- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Complex Calculations (AREA)
Description
第１図は本考案の実施例のブロツク図、第２図
ａ〜ｆは本実施例のタイミングチヤートである。 図において、１……デジタルデータの入力端子
、２……ストローブ信号の入力端子、３……累積
加算器、４……平均個数の入力端子、５……乗算
指令信号の入力端子、６……レジスタ、７……Ｒ
ＯＭ、８……乗算器、９……平均値出力端子であ
る。
ａ〜ｆは本実施例のタイミングチヤートである。 図において、１……デジタルデータの入力端子
、２……ストローブ信号の入力端子、３……累積
加算器、４……平均個数の入力端子、５……乗算
指令信号の入力端子、６……レジスタ、７……Ｒ
ＯＭ、８……乗算器、９……平均値出力端子であ
る。
Claims (1)
- 並列入力される複数のデジタルデータをストロ
ーブ入力に応じて累積加算する累積加算器と、前
記デジタルデータの平均個数を一時記憶するレジ
スタと、このレジスタの出力をアドレスとして前
記平均個数の逆数を出力するＲＯＭと、このＲＯ
Ｍの出力と前記累積加算器の出力との乗算を行う
乗算器とを含むデジタルデータ平均化回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15192484U JPS6170253U (ja) | 1984-10-08 | 1984-10-08 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15192484U JPS6170253U (ja) | 1984-10-08 | 1984-10-08 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6170253U true JPS6170253U (ja) | 1986-05-14 |
Family
ID=30710018
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15192484U Pending JPS6170253U (ja) | 1984-10-08 | 1984-10-08 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6170253U (ja) |
-
1984
- 1984-10-08 JP JP15192484U patent/JPS6170253U/ja active Pending
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