JPS6174877U - - Google Patents

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JPS6174877U
JPS6174877U JP15981884U JP15981884U JPS6174877U JP S6174877 U JPS6174877 U JP S6174877U JP 15981884 U JP15981884 U JP 15981884U JP 15981884 U JP15981884 U JP 15981884U JP S6174877 U JPS6174877 U JP S6174877U
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JP
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trigger
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input signal
circuit
storage
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JP15981884U
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Description

【図面の簡単な説明】
第１図は本考案の実施例のブロツク図、第２図
はアナログ入力信号における各部の波形説明図で
ある。 １：アナログ入力信号、２：入力段増幅回路、
３：ＡＤ変換器、４〜６：メモリ、７：メモリア
ドレス信号、８：メモリ書き込み信号、９〜１１
：メモリ制御回路、１２〜１４：プリトリガ設定
回路、１５：プリトリガ設定信号、１６：トリガ
信号、１７：トリガ回路、１８〜２０：書き込み
クロツク、２１：トリガレベル、２２：トリガポ
イント、２３〜２５：プリトリガ点、２７：第１
のメモリ期間、２８：第２のメモリ期間、２９：
第３のメモリ期間。

Claims (1)

    【実用新案登録請求の範囲】
  1. アナログ信号をＡＤ変換して、変換後のデイジ
    タル値を記憶する波形記憶装置において、前述の
    アナログ入力信号の持つ情報量別に行なう複数の
    記憶素子と、該アナログ入力信号に対応して、こ
    の記憶素子の書き込みを開始するトリガ点を制御
    するトリガ回路と、このトリガ点以前の波形をそ
    の情報量に比例して、記憶するための複数のプリ
    トリガ点を設定し、前述の記憶素子への書き込み
    を制御するためのプリトリガ設定回路と、これら
    のトリガ回路及びプリトリガ回路からの書き込み
    制御を受けて、記憶素子を制御するための手段を
    有することを特徴とする波形記憶装置。
JP15981884U 1984-10-24 1984-10-24 Pending JPS6174877U (ja)

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JP15981884U JPS6174877U (ja) 1984-10-24 1984-10-24

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JP15981884U JPS6174877U (ja) 1984-10-24 1984-10-24

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JPS6174877U true JPS6174877U (ja) 1986-05-20

Family

ID=30717764

Family Applications (1)

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JP15981884U Pending JPS6174877U (ja) 1984-10-24 1984-10-24

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JP (1) JPS6174877U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006349345A (ja) * 2005-06-13 2006-12-28 Yokogawa Electric Corp 波形測定装置

Cited By (1)

* Cited by examiner, † Cited by third party
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JP2006349345A (ja) * 2005-06-13 2006-12-28 Yokogawa Electric Corp 波形測定装置

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