JPS6181348U - - Google Patents
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- Publication number
- JPS6181348U JPS6181348U JP16670484U JP16670484U JPS6181348U JP S6181348 U JPS6181348 U JP S6181348U JP 16670484 U JP16670484 U JP 16670484U JP 16670484 U JP16670484 U JP 16670484U JP S6181348 U JPS6181348 U JP S6181348U
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- JP
- Japan
- Prior art keywords
- random number
- updating
- number data
- update
- stopping
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Calculators And Similar Devices (AREA)
Description
図面はこの考案の一実施例を示すもので、第１
図は回路構成を示すブロツク図、第２図は動作処
理の内容を示すフローチヤートである。 １１…キー入力部、１１１…テンキー、１１２
…四則演算キー、１１３…乱数キー、１２…アド
レスデコーダ、１３…ＲＯＭ、１４…アンド回路
、１５…制御部、１６…オア回路、１７…演算Ｒ
ＯＭ、１７１…乱数レジスタ、１８…マルチプレ
クサ、１９…演算部、２０…表示ＲＡＭ、２１…
バイナリカウンタ、２２…コモンカウンタ、２３
…キヤラクタジエネレータ（ＣＧ）ＲＡＭ、２４
，２５…表示ドライバ、２６…表示部。
図は回路構成を示すブロツク図、第２図は動作処
理の内容を示すフローチヤートである。 １１…キー入力部、１１１…テンキー、１１２
…四則演算キー、１１３…乱数キー、１２…アド
レスデコーダ、１３…ＲＯＭ、１４…アンド回路
、１５…制御部、１６…オア回路、１７…演算Ｒ
ＯＭ、１７１…乱数レジスタ、１８…マルチプレ
クサ、１９…演算部、２０…表示ＲＡＭ、２１…
バイナリカウンタ、２２…コモンカウンタ、２３
…キヤラクタジエネレータ（ＣＧ）ＲＡＭ、２４
，２５…表示ドライバ、２６…表示部。
Claims (1)
- 乱数データを記憶する乱数記憶手段と、乱数発
生命令により上記乱数記憶手段の乱数データを順
次更新設定し続ける乱数更新手段と、表示制御信
号を用いて上記乱数更新手段による乱数データの
更新動作を停止させる更新停止手段と、この更新
停止手段によつて更新動作が停止した時点での乱
数データを読出す読出制御手段とを具備したこと
を特徴とする乱数発生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16670484U JPS6181348U (ja) | 1984-11-02 | 1984-11-02 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16670484U JPS6181348U (ja) | 1984-11-02 | 1984-11-02 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6181348U true JPS6181348U (ja) | 1986-05-30 |
Family
ID=30724513
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16670484U Pending JPS6181348U (ja) | 1984-11-02 | 1984-11-02 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6181348U (ja) |
-
1984
- 1984-11-02 JP JP16670484U patent/JPS6181348U/ja active Pending