JPS6185948U - - Google Patents

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JPS6185948U
JPS6185948U JP17017684U JP17017684U JPS6185948U JP S6185948 U JPS6185948 U JP S6185948U JP 17017684 U JP17017684 U JP 17017684U JP 17017684 U JP17017684 U JP 17017684U JP S6185948 U JPS6185948 U JP S6185948U
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synchronization
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pcm
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  • Time-Division Multiplex Systems (AREA)
  • Transmission Systems Not Characterized By The Medium Used For Transmission (AREA)

Description

【図面の簡単な説明】
第１図は本考案の一実施例のブロツク図、第２
図は第１図を用いたデイジタル通信システムのブ
ロツク図、第３図は第２図の信号の波形図、第４
図は本実施例に用いるデータパネル列のフレーム
構成図である。図において、 １……デイジタル送受信装置、２……ＰＣＭ端
局装置、３……交換システム、４……単一チヤン
ネル簡易ＰＣＭ送受信装置、１１……ラインドラ
イバ・レシーバ回路、１２……フレーム同期回路
、１３……デマルチプレクサ、１４……音声デー
タ一時記憶部、１５……ＰＣＭＣＯＤＥＣにＰＣ
Ｍデータを取り込むためのタイミング発生回路、
１６……ＰＣＭＣＯＤＥＣ、１７……ＰＣＭフイ
ルタ、１８……音声入出力レベル調整回路、１９
……送信ＰＣＭデーター時記憶部、２０……ＰＣ
ＭＣＯＤＥＣからＰＣＭデータを受け取るための
タイミング発生回路、２１……マルチプレクサ、
２２……同期ビツトパターン作成回路、２３……
基本クロツク発生回路、２４……シグナリング入
出力回路である。

Claims (1)

    【実用新案登録請求の範囲】
  1. デイジタル無線送受信装置と接続するためのラ
    インドライバ・レシーバ回路と、データ列の位置
    を検出し同期保護の動作として非同期状態にある
    場合は正しい同期パターンを二回続けて検出され
    ない限り正規同期とせずまた同期状態から誤まつ
    た同期パターンが検出されてもハミング距離２以
    内で連続二回以上受信されない限り同期状態から
    外れないようにしたフレーム同期回路と、前記デ
    ータ列から音声データとシグナリングデータとを
    分離するデマルチプレクサと、前記音声データの
    一時記億する第１の記憶部と、音声信号の入力お
    よび出力レベルを調整するレベル調整回路と、こ
    のレベル調整回路の入出力信号の帯域制限を行う
    ＰＣＭフイルタと、このＰＣＭフイルタと接続さ
    れその入出力信号の変復調を行うＰＣＭコーデツ
    クと、このＰＣＭコーデツクからの送信ＰＣＭデ
    ータを一時記憶する第２の記憶部と、これら第１
    および第２の記憶部と前記ＰＣＭコーデツクとに
    データを入力しかつデータを送り出し所定クロツ
    クから各タイミングを作成するタイミング発生回
    路と、このタイミング発生回路の出力からフレー
    ム同期ビツト・シグナリングビツトを音声データ
    列に付加するマルチプレクサおよび同期ピツトパ
    ターン発生回路と、シグナリング入出力回路とを
    含む単一チヤンネルＰＣＭ送受信装置。
JP17017684U 1984-11-09 1984-11-09 Expired JPH0321096Y2 (ja)

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JP17017684U JPH0321096Y2 (ja) 1984-11-09 1984-11-09

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JPS6185948U true JPS6185948U (ja) 1986-06-05
JPH0321096Y2 JPH0321096Y2 (ja) 1991-05-08

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