JPS6188497U - - Google Patents

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JPS6188497U
JPS6188497U JP17333184U JP17333184U JPS6188497U JP S6188497 U JPS6188497 U JP S6188497U JP 17333184 U JP17333184 U JP 17333184U JP 17333184 U JP17333184 U JP 17333184U JP S6188497 U JPS6188497 U JP S6188497U
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inverter
bridge type
type transistor
transistor
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【図面の簡単な説明】
第1図は実施例の回路図、第2図はブリツジ形
トランジスタインバーター相分回路図、第3図は
従来のトランジスタベース入力波形、第4図はト
ランジスタQのONからOFFへ移行する際の
VCE,V電圧波形である。 Q,Q……同一リンク上下トランジスタ、
CP……比較器、F……フリツプフロツプ、
……アンドゲート、Dr……ベースドライ
ブ。
補正 昭60.10.22 考案の名称を次のように補正する。 考案の名称 ブリツジ形トランジスタインバ
ータの制御装置 実用新案登録請求の範囲、図面の簡単な説明を
次のように補正する。
【実用新案登録請求の範囲】 ブリツジ形トランジスタインバータにおいて、
インバータ出力電圧と零レベル電位とを比較しイ
ンバータ出力電圧が零レベル電位以下になつたと
きに出力信号を発し同一相上下トランジスタのう
ちの下トランジスタのベース入力信号を、またイ
ンバータ出力電圧と電源電圧とを比較しインバー
タ出力電圧が電源電圧以上となつたときに出力信
号を発し同一相上下トランジスタのうちの上トラ
ンジスタベース入力信号、を夫々供給するように
したことを特徴とするブリツジ形トランジスタイ
ンバータの制御装置。
【図面の簡単な説明】 第1図は実施例の回路図、第2図はブリツジ形
トランジスタインバータ一相分回路図、第3図は
従来のトランジスタベース入力波形、第4図はト
ランジスタQのONからOFFへ移行する際の
VCE,V電圧波形、第5図はトランジスタQ
の同じくONからOFFへ移行する際のV
圧波形である。 Q,Q……同一相上下トランジスタ、CP
,CP……比較器、F,F……フリツプ
フロツプ、A,A……アンドゲート、Dr
,Dr……ベースドライブ。

Claims (1)

    【実用新案登録請求の範囲】
  1. ブリツジ形トランジスタインバータにおいて、
    インバータ出力電圧と零レベル電位とを比較しイ
    ンバータ出力電圧が零レベル電位以下になつたと
    きに出力信号を発し同一相上下トランジスタのう
    ちの下トランジスタのベース入力信号及び他相上
    下トランジスタのうちの上トランジスタのベース
    入力信号、を供給し、同一リンク上下トランジス
    タの短絡を防ぐように構成したことを特徴とする
    ブリツジ形トランジスタインバータの制御装置。
JP17333184U 1984-11-14 1984-11-14 Expired JPH0431828Y2 (ja)

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JP17333184U JPH0431828Y2 (ja) 1984-11-14 1984-11-14

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Publication Number Publication Date
JPS6188497U true JPS6188497U (ja) 1986-06-09
JPH0431828Y2 JPH0431828Y2 (ja) 1992-07-30

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