JPS6188636A - 復調回路 - Google Patents
復調回路Info
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- JPS6188636A JPS6188636A JP59208188A JP20818884A JPS6188636A JP S6188636 A JPS6188636 A JP S6188636A JP 59208188 A JP59208188 A JP 59208188A JP 20818884 A JP20818884 A JP 20818884A JP S6188636 A JPS6188636 A JP S6188636A
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- H03D—DEMODULATION OR TRANSFERENCE OF MODULATION FROM ONE CARRIER TO ANOTHER
- H03D3/00—Demodulation of angle-, frequency- or phase- modulated oscillations
- H03D3/02—Demodulation of angle-, frequency- or phase- modulated oscillations by detecting phase difference between two signals obtained from input signal
- H03D3/24—Modifications of demodulators to reject or remove amplitude variations by means of locked-in oscillator circuits
- H03D3/241—Modifications of demodulators to reject or remove amplitude variations by means of locked-in oscillator circuits the oscillator being part of a phase locked loop
- H03D3/242—Modifications of demodulators to reject or remove amplitude variations by means of locked-in oscillator circuits the oscillator being part of a phase locked loop combined with means for controlling the frequency of a further oscillator, e.g. for negative frequency feedback or AFC
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03D—DEMODULATION OR TRANSFERENCE OF MODULATION FROM ONE CARRIER TO ANOTHER
- H03D3/00—Demodulation of angle-, frequency- or phase- modulated oscillations
- H03D3/02—Demodulation of angle-, frequency- or phase- modulated oscillations by detecting phase difference between two signals obtained from input signal
- H03D3/24—Modifications of demodulators to reject or remove amplitude variations by means of locked-in oscillator circuits
- H03D3/241—Modifications of demodulators to reject or remove amplitude variations by means of locked-in oscillator circuits the oscillator being part of a phase locked loop
- H03D3/245—Modifications of demodulators to reject or remove amplitude variations by means of locked-in oscillator circuits the oscillator being part of a phase locked loop using at least twophase detectors in the loop
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L7/00—Automatic control of frequency or phase; Synchronisation
- H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
- H03L7/08—Details of the phase-locked loop
- H03L7/085—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal
- H03L7/087—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal using at least two phase detectors or a frequency and phase detector in the loop
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L27/00—Modulated-carrier systems
- H04L27/18—Phase-modulated carrier systems, i.e. using phase-shift keying
- H04L27/22—Demodulator circuits; Receiver circuits
- H04L27/227—Demodulator circuits; Receiver circuits using coherent demodulation
- H04L27/2271—Demodulator circuits; Receiver circuits using coherent demodulation wherein the carrier recovery circuit uses only the demodulated signals
- H04L27/2272—Demodulator circuits; Receiver circuits using coherent demodulation wherein the carrier recovery circuit uses only the demodulated signals using phase locked loops
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03D—DEMODULATION OR TRANSFERENCE OF MODULATION FROM ONE CARRIER TO ANOTHER
- H03D2200/00—Indexing scheme relating to details of demodulation or transference of modulation from one carrier to another covered by H03D
- H03D2200/0001—Circuit elements of demodulators
- H03D2200/0031—PLL circuits with quadrature locking, e.g. a Costas loop
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- H03—ELECTRONIC CIRCUITRY
- H03D—DEMODULATION OR TRANSFERENCE OF MODULATION FROM ONE CARRIER TO ANOTHER
- H03D7/00—Transference of modulation from one carrier to another, e.g. frequency-changing
- H03D7/16—Multiple-frequency-changing
- H03D7/161—Multiple-frequency-changing all the frequency changers being connected in cascade
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔兄明のオリ用分野〕
本発明は復調回路に係り、特に搬送波抑圧内側帯波信号
の復調に際して安定に中間周波を釦生する回路に関する
。
の復調に際して安定に中間周波を釦生する回路に関する
。
従来の装置は、特開昭５８−１９７９４４号に記載のよ
うに、搬送波の周波数変動の大きい伝送システムにおい
又も同期検波用の搬送波を再生できる。さらに特開昭５
８−１５６１６０−５５においては同期検波周波数と位
相とを追従させて再生信号の誤り率の劣化を防いでいた
。しかし、ヘテロダイン受信機のように局Ｓ発掘器のド
リフトにともなう中間周波数のドリフトに対し℃固定の
中間周波数通過用バンドパスフィルタによる餓帯波の過
不足につい℃配慮され又いなかった。
うに、搬送波の周波数変動の大きい伝送システムにおい
又も同期検波用の搬送波を再生できる。さらに特開昭５
８−１５６１６０−５５においては同期検波周波数と位
相とを追従させて再生信号の誤り率の劣化を防いでいた
。しかし、ヘテロダイン受信機のように局Ｓ発掘器のド
リフトにともなう中間周波数のドリフトに対し℃固定の
中間周波数通過用バンドパスフィルタによる餓帯波の過
不足につい℃配慮され又いなかった。
本発明の目的は、２相あるいは４相の位相シフトキーイ
ングなどの搬送波抑圧両側帯波信号な安定に復調するヘ
テロダイン受信慎の復調回ｗ５を提供することにある。
ングなどの搬送波抑圧両側帯波信号な安定に復調するヘ
テロダイン受信慎の復調回ｗ５を提供することにある。
本発明は、中間Ｊｔａ波数に相当する基準発振器ヲ設ケ
、コスタスループ方式で入力周波数との位相差を検出し
、ループフィルタを何して局部兄振器に′Ｍ！遺するこ
とで中間周波数を安定させることによる。
、コスタスループ方式で入力周波数との位相差を検出し
、ループフィルタを何して局部兄振器に′Ｍ！遺するこ
とで中間周波数を安定させることによる。
以下、本発明の一実施例を第１図により説明する。本図
は中間周波数に２つの周波数をもつ二電ヘテロダイン方
式でキャリアｍｉ数を下げ。
は中間周波数に２つの周波数をもつ二電ヘテロダイン方
式でキャリアｍｉ数を下げ。
４相位相シフトキーインク信号を復調する実施例である
。１は入力端子、２は慕１の局部発振器、３は第１の混
合器、４は第２の局部発振器。
。１は入力端子、２は慕１の局部発振器、３は第１の混
合器、４は第２の局部発振器。
５はＮ２の混合器、６はバンドパスフィルタ。
７は第１の位相検波器、８は第２の位相検波器。
９は基準発振器、１０は９０°位相器、１１は帛１の！
ｆ４ＪＥ回Ｎ、 １２ ｔＸ第２ ノ’１４ｊ足回Ｍ
、１５ ｋ？第Ｉ Ｃ１）復調出力、１４は第２の傷調
出力、１５は第１の乗算器、１６はＮ２の乗算器、１７
は減算器、１８はループフィルタである。入力端子１に
与えられた信号と嵩１のｗＪ部発嶽器２とを第１の混合
器３を用いてビートダウンし第１の中間周波にする。そ
のホ１の中間局仮と第２の局ｓｇ振器４とを第２の混合
器５を用いてビートダウンし：第２の中間局仮にする。
ｆ４ＪＥ回Ｎ、 １２ ｔＸ第２ ノ’１４ｊ足回Ｍ
、１５ ｋ？第Ｉ Ｃ１）復調出力、１４は第２の傷調
出力、１５は第１の乗算器、１６はＮ２の乗算器、１７
は減算器、１８はループフィルタである。入力端子１に
与えられた信号と嵩１のｗＪ部発嶽器２とを第１の混合
器３を用いてビートダウンし第１の中間周波にする。そ
のホ１の中間局仮と第２の局ｓｇ振器４とを第２の混合
器５を用いてビートダウンし：第２の中間局仮にする。
バンドパスフィルタ６で不ｇな帯域外雑音、妨害などを
削除するとともに伝送路の特性を最通とするように波形
等化を行なう。その出力を嶌１の位相検波器７および薦
２の位相検波器８に加え、基準発振器９の位相と、その
出力を９０°移相発１０を通し、て９０’位相のずれた
信号で０同期検波してそれぞれ０°の位相と９０°の位
相でのベースバント化Ｊｊ４ｆｃされる。それらの信号
を纂１の判定回路１１および属２の判定回路１２で１ま
７°％：は−１に利足され、２１直のディジタル信号と
しておのおのＮ１の復調出力１３と第２の復―出力１４
に得る。。−万、謳１の位相＠１ｆＬ器７の出力と継２
′の＠足回路１２の出力とを第１の乗昇６１５に加え、
その出力を減算器１７の一方の入力とし１尾２の位′相
検＆器８の出力と第１の判定回路１１の出力どを第２の
乗算器１６に加え、その出力をｇ算器１７の他方の入力
とする。減算器１７の出力をループフィルタ１８をブト
して畠２の局部発振器４に帰還する。丁なわちｊＩ！１
の乗丼器１５．患２の乗算器１６、減算器１７およびル
ープフィルタ１８で第１の位相検波器７および縞２の位
相＠波番８０入力であるＮ２の中１に８ｍと基準発振器
９の出力の位相差を検出し、Ｎ２のＥ４部発振器４を制
卸し℃、第２の中ｒＩ４Ｊ周阪と基＄軸振器９の出力の
位相差をある一足値にする負帰還ルー１を構：戟するも
のである。位相差検出動作はｔｒｉ開咄５８−１９７９
４４号に運られているためここでは省略する。基準発振
器９を水晶軸振器など周波数安定度の良い発振器を用い
れば、上記負帰還ルーズのため薦２の中間周波の周波数
が安定した値となり、第１の局部発振器２の周波数か温
度変動などによりドリフトしたとしても、褐２の中間局
波の周波数カ一定であり、バンドパスフィルタ６の中心
周波数とのずれか生じなく、安定した特性を得ることが
できる。
削除するとともに伝送路の特性を最通とするように波形
等化を行なう。その出力を嶌１の位相検波器７および薦
２の位相検波器８に加え、基準発振器９の位相と、その
出力を９０°移相発１０を通し、て９０’位相のずれた
信号で０同期検波してそれぞれ０°の位相と９０°の位
相でのベースバント化Ｊｊ４ｆｃされる。それらの信号
を纂１の判定回路１１および属２の判定回路１２で１ま
７°％：は−１に利足され、２１直のディジタル信号と
しておのおのＮ１の復調出力１３と第２の復―出力１４
に得る。。−万、謳１の位相＠１ｆＬ器７の出力と継２
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その出力を減算器１７の一方の入力とし１尾２の位′相
検＆器８の出力と第１の判定回路１１の出力どを第２の
乗算器１６に加え、その出力をｇ算器１７の他方の入力
とする。減算器１７の出力をループフィルタ１８をブト
して畠２の局部発振器４に帰還する。丁なわちｊＩ！１
の乗丼器１５．患２の乗算器１６、減算器１７およびル
ープフィルタ１８で第１の位相検波器７および縞２の位
相＠波番８０入力であるＮ２の中１に８ｍと基準発振器
９の出力の位相差を検出し、Ｎ２のＥ４部発振器４を制
卸し℃、第２の中ｒＩ４Ｊ周阪と基＄軸振器９の出力の
位相差をある一足値にする負帰還ルー１を構：戟するも
のである。位相差検出動作はｔｒｉ開咄５８−１９７９
４４号に運られているためここでは省略する。基準発振
器９を水晶軸振器など周波数安定度の良い発振器を用い
れば、上記負帰還ルーズのため薦２の中間周波の周波数
が安定した値となり、第１の局部発振器２の周波数か温
度変動などによりドリフトしたとしても、褐２の中間局
波の周波数カ一定であり、バンドパスフィルタ６の中心
周波数とのずれか生じなく、安定した特性を得ることが
できる。
なお、ルーの乗算器１５および藁２め乗Ｘ器１６の一方
の入力に十分なｇミッタ効来かあれは萬１の判別回路１
１の出力および第２の判別回路１２の出゛力からの信号
は第１の位相検波回路および；第２の位相検波回路出力
でも同一の動作を行なう。
の入力に十分なｇミッタ効来かあれは萬１の判別回路１
１の出力および第２の判別回路１２の出゛力からの信号
は第１の位相検波回路および；第２の位相検波回路出力
でも同一の動作を行なう。
本発明の他の実施例とＬ℃、２相位相シフトキーインク
信号を復調する実施物を慕２図に示す。第１図と同一符
号のものは同−一舵を示す。
信号を復調する実施物を慕２図に示す。第１図と同一符
号のものは同−一舵を示す。
１９は乗算器である。入力端子１［与えられた信号は爲
２の中間周波に変換され、バッドパスフィルタ６を介し
て、諷１の位相検波器７および第２の位相検波＃８に加
え、基準発振器９の出力および９０°移相番１０で９０
°移相した信号と位相比較し、これら第１の位相検敦器
８および第２の位相＠成語９の出力を乗算器１９に加え
て栄算し、この出力をループフィルタ１８を介１、″′
Ｃ第２の局部軸振器４に帰還する。その精来第２の中間
周波の周波数は基準軸振器９０周波数になるため、安定
した特性が得られる。
２の中間周波に変換され、バッドパスフィルタ６を介し
て、諷１の位相検波器７および第２の位相検波＃８に加
え、基準発振器９の出力および９０°移相番１０で９０
°移相した信号と位相比較し、これら第１の位相検敦器
８および第２の位相＠成語９の出力を乗算器１９に加え
て栄算し、この出力をループフィルタ１８を介１、″′
Ｃ第２の局部軸振器４に帰還する。その精来第２の中間
周波の周波数は基準軸振器９０周波数になるため、安定
した特性が得られる。
なお乗算器１９の入力の一方はｍｌの位相慣波器７の出
力であるが、そのかわり［第１の判建＠略１１の出力で
も同僚な動作および効果を得る。
力であるが、そのかわり［第１の判建＠略１１の出力で
も同僚な動作および効果を得る。
本発明Ｋｊれは、ヘテロダイン受信俄の中間ｊｒｉＪ阪
の周波数を安定にできるので、バンドパスフィルタによ
る側帯波の過不足を生じなく安だＬベースバンド復調を
可能にする幼果がある。
の周波数を安定にできるので、バンドパスフィルタによ
る側帯波の過不足を生じなく安だＬベースバンド復調を
可能にする幼果がある。
さらに中間周波の周波数を安定にできるので。
喘；屍餡５８−１３６１６０号に記載されるようＩＬ９
０゜移相器の８波数変化に対する補償も不要になる効果
もある。
０゜移相器の８波数変化に対する補償も不要になる効果
もある。
４ 図面の？ＩＪｆ単な読切
ｈ−！、１図は本発明の一笑り例の１０ツク図、絹２図
を工水発明の他の実施例のブロック図である。
を工水発明の他の実施例のブロック図である。
４・・・第２の局部づム振器
７．８・・・位相検Ｖｔ器
１５ 、１６ 、１９・・・乗算器
手続補正書（自発）
事件の表示
昭和５９ 年特許願第 ２０８１８８号発明の名称 復
調回路 補正をする者 事件との関係 特許 出 願 人名 称 （５
１０１株式会社 日 立 製作所式 理 人 １、 明細書第３頁第１０行の「付して」を「介して」
に訂正する。
調回路 補正をする者 事件との関係 特許 出 願 人名 称 （５
１０１株式会社 日 立 製作所式 理 人 １、 明細書第３頁第１０行の「付して」を「介して」
に訂正する。
２・ 明細書第４頁第１６行の「移相器１０」を「移相
器１０」に訂正する。
器１０」に訂正する。
＆ 明細書第７頁第９行と第１０行の間に下記文章を加
入する。
入する。
［ここで、本発明を中間周波数が少なく、選局用の局部
発振器に帰還をする場合の詳細な説明を加える。第５図
はそのプルツク図である。
発振器に帰還をする場合の詳細な説明を加える。第５図
はそのプルツク図である。
１０１は加算器、１０２は選局用に局部発振器を制御す
る選局用電圧発生器、１０３はスイッチ。
る選局用電圧発生器、１０３はスイッチ。
１０４は制御回路、１０５は制御電圧入力端子、１０６
は制御電圧出力端子である。
は制御電圧出力端子である。
選局に際して制御回路１０４によりスイッチ１０３を開
き、′さらに選局用電圧発生器１０２の出力電圧を変化
させ、選局用電圧を加算器１０１を介してローカル発振
器２を制御して選局する。その後ループフィルタ１Ｂ出
力の位相誤差による制御電圧をスイッチ１０３を閉じて
加算器１０１を用いて選局用電圧に加えてローカル発振
器２を制御することで安定に選局および復調ができる。
き、′さらに選局用電圧発生器１０２の出力電圧を変化
させ、選局用電圧を加算器１０１を介してローカル発振
器２を制御して選局する。その後ループフィルタ１Ｂ出
力の位相誤差による制御電圧をスイッチ１０３を閉じて
加算器１０１を用いて選局用電圧に加えてローカル発振
器２を制御することで安定に選局および復調ができる。
」４． 明細書第８頁第１行の「ブロック図である。」
を、「ブロック図、第３図は本発明のさらに他の実施例
の一部のブロック図である。」に訂正する。
を、「ブロック図、第３図は本発明のさらに他の実施例
の一部のブロック図である。」に訂正する。
５、 図面第３図を別紙の通り加入する。
以上
第 ３ 図
Claims (1)
- 【特許請求の範囲】 １、混合器および局部発振器からなるヘテロダイン受信
機において、中間周波数に相当する基準発振器、９０°
位相器、第１および第２の位相検波器、およびループフ
ィルタを設け、該基準発振滲出力を該第１の位相検波器
に加えるとともに該９０°移相器を介して該第２の位相
検波器に加え、該第１および第２の位相検波器出力を該
乗算器に加え、該乗算器出力を該ループフィルタを介し
て該局部発振器に加えることを特徴とする復調回路。 ２、特許請求の範囲第１項において、第１および第２の
判定回路、第１および第２の乗算器、減算器を設け、該
第１および第２の位相検波器出力をおのおの該第１およ
び第２の判定回路に加えるとともに、該第１の位相検波
器出力と該第２の判定回路出力とを該第１の乗算器に加
えかつ該第２の位相検波器出力と該第１の判定回路出力
とを該第２の乗算器に加え該第１および第２の乗算器の
一方の乗算値から他方の乗算値を該減算器にて減算し、
該ループフィルタを介して該局部発振器に加えることを
特徴とする復調回路。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59208188A JPS6188636A (ja) | 1984-10-05 | 1984-10-05 | 復調回路 |
| KR1019850007082A KR900000464B1 (ko) | 1984-10-05 | 1985-09-26 | 복조 회로 |
| US06/783,521 US4642573A (en) | 1984-10-05 | 1985-10-03 | Phase locked loop circuit for demodulating suppressed carrier signals |
| CA000492125A CA1238952A (en) | 1984-10-05 | 1985-10-03 | Demodulation circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59208188A JPS6188636A (ja) | 1984-10-05 | 1984-10-05 | 復調回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6188636A true JPS6188636A (ja) | 1986-05-06 |
Family
ID=16552117
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59208188A Pending JPS6188636A (ja) | 1984-10-05 | 1984-10-05 | 復調回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6188636A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6330049A (ja) * | 1986-07-23 | 1988-02-08 | Hitachi Ltd | Ｍｓｋ復調回路 |
| JPH01208942A (ja) * | 1988-02-16 | 1989-08-22 | Matsushita Electric Ind Co Ltd | 受信装置 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4048566A (en) * | 1976-01-05 | 1977-09-13 | Motorola Inc. | Suppressed carrier automatic gain control circuitry |
-
1984
- 1984-10-05 JP JP59208188A patent/JPS6188636A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4048566A (en) * | 1976-01-05 | 1977-09-13 | Motorola Inc. | Suppressed carrier automatic gain control circuitry |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6330049A (ja) * | 1986-07-23 | 1988-02-08 | Hitachi Ltd | Ｍｓｋ復調回路 |
| JPH01208942A (ja) * | 1988-02-16 | 1989-08-22 | Matsushita Electric Ind Co Ltd | 受信装置 |
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