JPS6199970A - インデツクスパルス出力回路 - Google Patents
インデツクスパルス出力回路Info
- Publication number
- JPS6199970A JPS6199970A JP21852884A JP21852884A JPS6199970A JP S6199970 A JPS6199970 A JP S6199970A JP 21852884 A JP21852884 A JP 21852884A JP 21852884 A JP21852884 A JP 21852884A JP S6199970 A JPS6199970 A JP S6199970A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- circuit
- output
- pulse
- logic
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B19/00—Driving, starting, stopping record carriers not specifically of filamentary or web form, or of supports therefor; Control thereof; Control of operating function ; Driving both disc and head
- G11B19/02—Control of operating function, e.g. switching from recording to reproducing
Landscapes
- Indexing, Searching, Synchronizing, And The Amount Of Synchronization Travel Of Record Carriers (AREA)
- Rotational Drive Of Disk (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はフロッピーディスクドライブのインデックスパ
ルスを出力するインデックスパルス出力回路に関する。
ルスを出力するインデックスパルス出力回路に関する。
従来の８インチ、５，５インチサイズのフロッピーディ
スクドライブ装置（以下、ＦＤＤとする）では、そのメ
ディアケース１０に第３図に示すようなインデックスホ
ール１１が設げられている。
スクドライブ装置（以下、ＦＤＤとする）では、そのメ
ディアケース１０に第３図に示すようなインデックスホ
ール１１が設げられている。
また、第４図の側面断面図のようにメディア１２の磁気
記録部にもホール１３が設けられており、その垂直方向
にメディア１２をはさんでそれぞれ反対側に発光ダイオ
ード１４と受光トランジスタ１５が配置されている。メ
ディア１２の記録部が回転すると一回転に一度ホール１
３が発光ダイオード１４と受光トランジスタ１５の間を
通過し、通過する際に発光ダイオード１４から出た光が
受光トランジスタ１５に達して、この受光トランジスタ
１５を動作させることにより、インデックスパルスを得
ていた。
記録部にもホール１３が設けられており、その垂直方向
にメディア１２をはさんでそれぞれ反対側に発光ダイオ
ード１４と受光トランジスタ１５が配置されている。メ
ディア１２の記録部が回転すると一回転に一度ホール１
３が発光ダイオード１４と受光トランジスタ１５の間を
通過し、通過する際に発光ダイオード１４から出た光が
受光トランジスタ１５に達して、この受光トランジスタ
１５を動作させることにより、インデックスパルスを得
ていた。
しかしながら、３．５インチサイズのＦＤＤは、その用
途をＯＡ機器、ＨＡ （Ｈｏｍｅ Ａｕｔｏｍａｔｉ
ｏｎ）機器等としており、記録部保護のため、そのメデ
ィアケースにインデックスホール等を設けることができ
ない。従って、上記の従来の方法では３．５インチサイ
ズのＦＤＤにおいてデータを読み書きするとぎの原点と
なるインデックスパルスを検出することができなかった
。
途をＯＡ機器、ＨＡ （Ｈｏｍｅ Ａｕｔｏｍａｔｉ
ｏｎ）機器等としており、記録部保護のため、そのメデ
ィアケースにインデックスホール等を設けることができ
ない。従って、上記の従来の方法では３．５インチサイ
ズのＦＤＤにおいてデータを読み書きするとぎの原点と
なるインデックスパルスを検出することができなかった
。
本発明の目的は、インデックスホールを持たない３，５
インチサイズのＦＤＤのインデックスパルスを出力する
ことのできるインデックスパルス出力回路を提供するこ
とにある。
インチサイズのＦＤＤのインデックスパルスを出力する
ことのできるインデックスパルス出力回路を提供するこ
とにある。
まず、本発明の詳細な説明する。
３．５インチサイズのＦＤＤのメディアは動作状態では
モータのロータとノの相対位置から必ず同じになるよう
に設計されているため、ロータが一定の位置にきた時に
パルスを出力すれば、これをインデックスパルスとする
ことができる。また、一般にＦＤＤ用スビスピンドルモ
ータ位相検出用のホール素子と速度検出用の発電機が備
えられているので、特定の検出器を用いなくても、ホー
ル素子からの位相検出用信号および発電機からの速度検
出用信号を処理することにより、ロータの位置を検出し
てインデックスパルスを出力することができる。
モータのロータとノの相対位置から必ず同じになるよう
に設計されているため、ロータが一定の位置にきた時に
パルスを出力すれば、これをインデックスパルスとする
ことができる。また、一般にＦＤＤ用スビスピンドルモ
ータ位相検出用のホール素子と速度検出用の発電機が備
えられているので、特定の検出器を用いなくても、ホー
ル素子からの位相検出用信号および発電機からの速度検
出用信号を処理することにより、ロータの位置を検出し
てインデックスパルスを出力することができる。
本発明のインデックスパルス出力回路は、位相検出用の
ホール素子と速度検出用の発電機からの各出力信号をそ
れぞれ第１．第２の比較回路で波形整形し、微分回路が
第１の比較回路の出力信号を微分し、さらにスピンドル
モータのロータが１回転する間に一度だけ第２の比較回
路の出力信号とその論理が一致するあるいは一致しない
ようなパルス幅の信号を出力して、この信号と第２の比
較回路の出力信号との各論理にしだがって論理回路がロ
ータ１回転の間に一度だけ信号を出力することを特徴と
する。
ホール素子と速度検出用の発電機からの各出力信号をそ
れぞれ第１．第２の比較回路で波形整形し、微分回路が
第１の比較回路の出力信号を微分し、さらにスピンドル
モータのロータが１回転する間に一度だけ第２の比較回
路の出力信号とその論理が一致するあるいは一致しない
ようなパルス幅の信号を出力して、この信号と第２の比
較回路の出力信号との各論理にしだがって論理回路がロ
ータ１回転の間に一度だけ信号を出力することを特徴と
する。
本発明の実施例について図面を参照して説明する。
第１図は本発明の一実施例に係るインデックスパルス出
力回路のブロック図である。本実施例は位相検出用のホ
ール素子１および速度検出用の２６パルス／回転の発電
機６を備、えた２相６極スピンドルモータに適用された
ものである。コンパレータ４，７はそれぞれホール素子
１からの位相検出用信号２発電機６からの速度検出用信
号を矩形波整形して信号ａ ｒ Ｃを得る。微分回路５
はコンパレータ４で整形された信号ａの立上りのエツジ
を捕えて、これを微分しパルス幅Δ【の信号すを得る。
力回路のブロック図である。本実施例は位相検出用のホ
ール素子１および速度検出用の２６パルス／回転の発電
機６を備、えた２相６極スピンドルモータに適用された
ものである。コンパレータ４，７はそれぞれホール素子
１からの位相検出用信号２発電機６からの速度検出用信
号を矩形波整形して信号ａ ｒ Ｃを得る。微分回路５
はコンパレータ４で整形された信号ａの立上りのエツジ
を捕えて、これを微分しパルス幅Δ【の信号すを得る。
アンド回路８は微分回路５からの信号すとコンパレータ
７からの信号Ｃの論理積をとる。
７からの信号Ｃの論理積をとる。
モノステープルマルチパイプレータ９はアンド回路８の
出力信号ｄを入力して、外部回路に必要なパルス幅の信
号ｅに変換してとれをインデックスパルスとして出力す
る。
出力信号ｄを入力して、外部回路に必要なパルス幅の信
号ｅに変換してとれをインデックスパルスとして出力す
る。
ところで、ロータ１回転に対して１個のインデックスパ
ルスを得るために、微分回路５から出力される信号すの
パルス幅△ｔは次のように決定される。ロータが１回転
する間に、微分回路５からはモータの極数に対応するパ
ルス数の信号すが出力され、一方コンパレータ７からは
発電機６０回転数および極数に対応するパルス数の信号
Ｃが出力されるが、信号すのこれらパルスのうち１つの
パルスだけがその論理を信号Ｃの論理と同じくし、他の
パルスの論理を信号Ｃの論理とは異なるように信号すの
パルス幅Δ【が設定される。本実施例のモータは２相６
極であるから、第２図の信号波形図においてロータの周
期Ｔの間に３個のパルスを持つ信号すが微分回路５から
出力され、これらのパルスのうち時刻【１に出力された
パルスだけが信号Ｃとその論理を同じ（するように信号
すのパルス幅ΔＬが設定されている。たとえば、モータ
の極数２Ｐ＝１２ ＣＰ＝６）がきめられると、このＰ
と互いに素であるようなパルス数／回転二Ｍをもつ信号
Ｃが出力されるように発電機６が選定される。モータの
最大回転数をＮｍａｘとすれば、微分回路５の出力パル
ス幅△【は △【≦ｌ／Ｎｍａｘ０Ｍ−Ｐ となるように、さらに６
’ Ｇ６” ＊ △’ｔ≦、ＮｍａＸ、Ｐ を満足す
６１うにきめられる（Δ（′ｉは信号すの立上りから最
も近い信号Ｃの立上りまでの時間を示す）。信号ａと信
号Ｃの各１パルスの立上りのタイミングを公知の手段で
そろえておけば、信号すのうち１パルスが必ずモーター
回転の間に信号Ｃのハイレベルに対応するが信号すの他
のパルスの立上りが信号Ｃのローレベルであってもパル
ス幅△Ｌの大きさによっては、信号すの他のパルスの立
下りが信号Ｃのハイレベルにかかつてしまうことがある
。これを防ぐ一条件が△【≦△１／ｉである。
ルスを得るために、微分回路５から出力される信号すの
パルス幅△ｔは次のように決定される。ロータが１回転
する間に、微分回路５からはモータの極数に対応するパ
ルス数の信号すが出力され、一方コンパレータ７からは
発電機６０回転数および極数に対応するパルス数の信号
Ｃが出力されるが、信号すのこれらパルスのうち１つの
パルスだけがその論理を信号Ｃの論理と同じくし、他の
パルスの論理を信号Ｃの論理とは異なるように信号すの
パルス幅Δ【が設定される。本実施例のモータは２相６
極であるから、第２図の信号波形図においてロータの周
期Ｔの間に３個のパルスを持つ信号すが微分回路５から
出力され、これらのパルスのうち時刻【１に出力された
パルスだけが信号Ｃとその論理を同じ（するように信号
すのパルス幅ΔＬが設定されている。たとえば、モータ
の極数２Ｐ＝１２ ＣＰ＝６）がきめられると、このＰ
と互いに素であるようなパルス数／回転二Ｍをもつ信号
Ｃが出力されるように発電機６が選定される。モータの
最大回転数をＮｍａｘとすれば、微分回路５の出力パル
ス幅△【は △【≦ｌ／Ｎｍａｘ０Ｍ−Ｐ となるように、さらに６
’ Ｇ６” ＊ △’ｔ≦、ＮｍａＸ、Ｐ を満足す
６１うにきめられる（Δ（′ｉは信号すの立上りから最
も近い信号Ｃの立上りまでの時間を示す）。信号ａと信
号Ｃの各１パルスの立上りのタイミングを公知の手段で
そろえておけば、信号すのうち１パルスが必ずモーター
回転の間に信号Ｃのハイレベルに対応するが信号すの他
のパルスの立上りが信号Ｃのローレベルであってもパル
ス幅△Ｌの大きさによっては、信号すの他のパルスの立
下りが信号Ｃのハイレベルにかかつてしまうことがある
。これを防ぐ一条件が△【≦△１／ｉである。
次に、本実施例の動作を第２図の信号波形図を参照して
説明する。
説明する。
まず、時刻ｔ１にロータの回転により発生する磁界Ｂに
したがってホール素子１から信号が出力され、この信号
が抵抗２，３で決定されるヒステリシスを有するコンパ
レータ４に入力して、ここで矩形波に整形されて信号ａ
となる。信号ａは微分回路５で立上りのエツジが捕えら
れ微分されて、パルス幅へｔの信号すが出力される。一
方、発電機６からの出力信号がコンパレータ７で矩形波
に整形されて信号Ｃとなり、アンド回路８で信号すと信
号Ｃの論理積が演算されて信号ｄが出力される。さらに
、この信号ｄがモノステープルマルチバイブレータ９で
外部回路に必要なパルス幅の信号ｅに変換されて出力さ
れる。
したがってホール素子１から信号が出力され、この信号
が抵抗２，３で決定されるヒステリシスを有するコンパ
レータ４に入力して、ここで矩形波に整形されて信号ａ
となる。信号ａは微分回路５で立上りのエツジが捕えら
れ微分されて、パルス幅へｔの信号すが出力される。一
方、発電機６からの出力信号がコンパレータ７で矩形波
に整形されて信号Ｃとなり、アンド回路８で信号すと信
号Ｃの論理積が演算されて信号ｄが出力される。さらに
、この信号ｄがモノステープルマルチバイブレータ９で
外部回路に必要なパルス幅の信号ｅに変換されて出力さ
れる。
続いて、時刻ｔ２ ｇ ’３にも信号ａの矩形波がコン
パレータ４かも出力され、微分回路５からパルス幅△【
の信号すが出力されるが、この時刻【２゜ｔ３にはコン
パレータ７からの信号Ｃのパルスが存在しないので、ア
ンド回路８から信号ｄが出力さレス、モノステープルマ
ルチバイブレータ９からの信号ｅも出力されない。
パレータ４かも出力され、微分回路５からパルス幅△【
の信号すが出力されるが、この時刻【２゜ｔ３にはコン
パレータ７からの信号Ｃのパルスが存在しないので、ア
ンド回路８から信号ｄが出力さレス、モノステープルマ
ルチバイブレータ９からの信号ｅも出力されない。
次に、時刻【１からロニタの周期Ｔだけ経過した時刻ｔ
４には微分回路５からの信号すのパルスとコンパレータ
７からの信号Ｃのパルスがともに現われるので、アンド
回路８から再び信号ｄが、出力され、さらにモノステー
プルマルチバイブレータ９から信号ｅが出力される。
４には微分回路５からの信号すのパルスとコンパレータ
７からの信号Ｃのパルスがともに現われるので、アンド
回路８から再び信号ｄが、出力され、さらにモノステー
プルマルチバイブレータ９から信号ｅが出力される。
このようにして、信号ｅのパルスはロータの周期Ｔごと
に１個ずつ出力されるので、信号ｅをインデックスパル
スとして用いることができる。
に１個ずつ出力されるので、信号ｅをインデックスパル
スとして用いることができる。
なお、アンド回路８で信号すと信号Ｃの論理積をとらず
に、信号すと信号Ｃの排他的論理和をとる回路にしても
よ（、この場合にはロータ１回転における信号すのパル
スのうち１つのパルスだけが信号Ｃと論理を異とし、他
のパルスが信号Ｃと論理を等しくするように信号すのパ
ルス幅△ｔを設定すればよい。
に、信号すと信号Ｃの排他的論理和をとる回路にしても
よ（、この場合にはロータ１回転における信号すのパル
スのうち１つのパルスだけが信号Ｃと論理を異とし、他
のパルスが信号Ｃと論理を等しくするように信号すのパ
ルス幅△ｔを設定すればよい。
以上説明したように本発明によれば、インデックスホー
ルを持たない３．５インチサイズのＦＤＤあるいはその
他のサイズのＦＤＤにおいて、インデックスパルスを出
力することができる。しかも、特定の検出器を用いるこ
ともなく、一般にＦＤＤ用スビスピンドルモータえられ
ているホール素子と発電機の各出力信号を処理する簡単
な回路でインデックスパルスの出力を達成している。
ルを持たない３．５インチサイズのＦＤＤあるいはその
他のサイズのＦＤＤにおいて、インデックスパルスを出
力することができる。しかも、特定の検出器を用いるこ
ともなく、一般にＦＤＤ用スビスピンドルモータえられ
ているホール素子と発電機の各出力信号を処理する簡単
な回路でインデックスパルスの出力を達成している。
今後、ＦＤＤは８インチ、５．５インチサイズから３．
５インチサイズへと小型化する傾向にあるので、本発明
のインデックスパルス出力回路は非常に有用なものであ
る。
５インチサイズへと小型化する傾向にあるので、本発明
のインデックスパルス出力回路は非常に有用なものであ
る。
第１図は本発明の一実施例に係るインデックスパルス出
力回路のブロック図、第２図は第１図の実施例の動作を
示す信号波形図、第３図、第４図は従来のインデックス
パルス出力方法の説明図である。 １・・・ホール素子 ２，３・・・抵抗４．７・・
・コンパレータ ５・・・微分回路ｅ・・・インデ
ックスパルス。 第１図 第３図
力回路のブロック図、第２図は第１図の実施例の動作を
示す信号波形図、第３図、第４図は従来のインデックス
パルス出力方法の説明図である。 １・・・ホール素子 ２，３・・・抵抗４．７・・
・コンパレータ ５・・・微分回路ｅ・・・インデ
ックスパルス。 第１図 第３図
Claims (1)
- 【特許請求の範囲】 位相検出用のホール素子と速度検出用の発電機を備えた
フロッピーディスクドライブ用スピンドルモータを有す
るフロッピーディスクドライブ装置において、 それぞれ前記ホール素子および前記発電機からの出力信
号を波形整形する第１および第２の比較回路と、 前記第１の比較回路の出力信号を微分し、前記スピンド
ルモータのロータが１回転する間に一度だけ前記第２の
比較回路の出力信号とその論理が一致するあるいは一致
しないようなパルス幅の信号を出力する微分回路と、 該微分回路の出力信号と前記第２の比較回路の出力信号
との各論理にしたがつて前記スピンドルモータのロータ
が１回転する間に１度だけ信号を出力する論理回路とを
有することを特徴とするインデックスパルス出力回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21852884A JPS6199970A (ja) | 1984-10-19 | 1984-10-19 | インデツクスパルス出力回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21852884A JPS6199970A (ja) | 1984-10-19 | 1984-10-19 | インデツクスパルス出力回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6199970A true JPS6199970A (ja) | 1986-05-19 |
Family
ID=16721335
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP21852884A Pending JPS6199970A (ja) | 1984-10-19 | 1984-10-19 | インデツクスパルス出力回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6199970A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04362566A (ja) * | 1991-06-07 | 1992-12-15 | Teac Corp | ディスク装置 |
| US5995314A (en) * | 1996-06-04 | 1999-11-30 | Alps Electric Co. Ltd. | Index signal generating circuit |
-
1984
- 1984-10-19 JP JP21852884A patent/JPS6199970A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04362566A (ja) * | 1991-06-07 | 1992-12-15 | Teac Corp | ディスク装置 |
| US5995314A (en) * | 1996-06-04 | 1999-11-30 | Alps Electric Co. Ltd. | Index signal generating circuit |
| US6166501A (en) * | 1996-06-04 | 2000-12-26 | Alps Electric Co., Ltd. | Index signal generating circuit |
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