JPS62115518A - プログラマブル・コントロ−ラのａｄ変換ユニツト - Google Patents
プログラマブル・コントロ−ラのａｄ変換ユニツトInfo
- Publication number
- JPS62115518A JPS62115518A JP25618985A JP25618985A JPS62115518A JP S62115518 A JPS62115518 A JP S62115518A JP 25618985 A JP25618985 A JP 25618985A JP 25618985 A JP25618985 A JP 25618985A JP S62115518 A JPS62115518 A JP S62115518A
- Authority
- JP
- Japan
- Prior art keywords
- conversion unit
- input
- circuit
- gain
- programmable controller
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Programmable Controllers (AREA)
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（発明の分野）
この発明は、複数の入力電圧レンジを備え、かつこれを
ＣＰｔＪユニット側から任意に切替えることができるよ
うにしたプログラマブル・コントローラのＡＤ変換ユニ
ットに関する。
ＣＰｔＪユニット側から任意に切替えることができるよ
うにしたプログラマブル・コントローラのＡＤ変換ユニ
ットに関する。
（発明の概要）
この発明では、ＡＤ変換回路の入力側に可変利得増幅回
路を設けるとともに、その利得をＣＰＵユニット側で遠
隔制御することにより、ＡＤ変換ユニット側で電源を落
したり、あるいは手動の切替操作を伴うことなく、入力
電圧レンジの変更に即座に対応可能としたものである。
路を設けるとともに、その利得をＣＰＵユニット側で遠
隔制御することにより、ＡＤ変換ユニット側で電源を落
したり、あるいは手動の切替操作を伴うことなく、入力
電圧レンジの変更に即座に対応可能としたものである。
（従来技術とその問題点）
従来、この種のプログラマブル・コントローラのＡＤ変
換ユニットにおいては、入力電圧レンジの変更に際して
、その都度電源を落し、また短絡ピンの差替えなどのよ
うな手動切替操作を必要とし、このためニー１ｆ側にあ
ける電圧仕様の変更等に即座に対応できず、また短絡ピ
ンの差替えミスなどによって、入力電圧レンジを誤設定
するなどの問題があった。
換ユニットにおいては、入力電圧レンジの変更に際して
、その都度電源を落し、また短絡ピンの差替えなどのよ
うな手動切替操作を必要とし、このためニー１ｆ側にあ
ける電圧仕様の変更等に即座に対応できず、また短絡ピ
ンの差替えミスなどによって、入力電圧レンジを誤設定
するなどの問題があった。
（発明の目的）
この発明の目的は、この種のＡＤ変換ユニットにおいて
、同等ＡＤ変換ユニット側における手動切替操作を要す
ることなく、また電源を落す必要もなく、ただちに入力
電圧仕様の変更に対応できるようにしたＡＤ変換ユニッ
トを提供することにある。
、同等ＡＤ変換ユニット側における手動切替操作を要す
ることなく、また電源を落す必要もなく、ただちに入力
電圧仕様の変更に対応できるようにしたＡＤ変換ユニッ
トを提供することにある。
（発明の構成と効果）
この発明は上記の目的を達成するために、ＣＰＵユニッ
トからの制御で開き、システムバス上の利得情報を出力
する出力ポートと、 出力ポートから得られる利得情報を記憶する記憶回路と
、 外部入力端子から得られるアナログ入力電圧を、記憶さ
れた利得情報に応じて増幅する可変利（ｑ増幅回路と、 可変利得増幅回路から得られるアナログ電圧をデジタル
変換するＡ／Ｄ変換回路と、 ＣＰＵユニットからの制御で開き、変換後のデジタル情
報をシステムバス上に入力する入力ポートと、 からなることを特徴とするものである。
トからの制御で開き、システムバス上の利得情報を出力
する出力ポートと、 出力ポートから得られる利得情報を記憶する記憶回路と
、 外部入力端子から得られるアナログ入力電圧を、記憶さ
れた利得情報に応じて増幅する可変利（ｑ増幅回路と、 可変利得増幅回路から得られるアナログ電圧をデジタル
変換するＡ／Ｄ変換回路と、 ＣＰＵユニットからの制御で開き、変換後のデジタル情
報をシステムバス上に入力する入力ポートと、 からなることを特徴とするものである。
このような構成によれば、ＣＰＵユニット側から該当す
る入力ポートに対して利１ワ情報を送り出すだけで、た
だちに入力レンジの切替を行なうことができ、電源を落
す必要もないため、ユーザ側の電圧仕様の変更に対して
即座に対応が可能となる。
る入力ポートに対して利１ワ情報を送り出すだけで、た
だちに入力レンジの切替を行なうことができ、電源を落
す必要もないため、ユーザ側の電圧仕様の変更に対して
即座に対応が可能となる。
また、従来の短絡ピンの差替えを行なう装置のように、
何等手動切替操作を必要としないため、それに伴う電圧
レンジの誤ム２定も避けることができる。
何等手動切替操作を必要としないため、それに伴う電圧
レンジの誤ム２定も避けることができる。
（実施例の説明）
第１図は本発明に係るＡＤ変換ユニットの電気的な構成
を示すブロック図である。
を示すブロック図である。
このＡＤ変換ユニットは、コネクタ１を介してプログラ
マブル・コントローラ装置（ビルティング・ブロックタ
イプ）のシステムバス２に接続が可能となっている。
マブル・コントローラ装置（ビルティング・ブロックタ
イプ）のシステムバス２に接続が可能となっている。
また、端子台３に設けられた入力端子４からは、任意の
アナログ電圧を入力可能になっている。
アナログ電圧を入力可能になっている。
入力端子４から得られるアナログ入力電圧は、可変利得
増幅回路５で増幅される。
増幅回路５で増幅される。
この可変利得増幅回路５は、ボルテージフォロアとして
動作するＯＰアンプ５１と、可変利得増幅器として動作
するＯＰアンプ５２とから構成されている。
動作するＯＰアンプ５１と、可変利得増幅器として動作
するＯＰアンプ５２とから構成されている。
このＯＰアンプ５２には、３系統の帰還ループが設けら
れており、各帰還ループにはアナログスイッチ５３．５
４．５５が挿入されている。
れており、各帰還ループにはアナログスイッチ５３．５
４．５５が挿入されている。
アナログスイッチ５３がオンした状態では、第２図に示
されるように、ＯＰアンプ５２の利得は１倍に設定され
る。
されるように、ＯＰアンプ５２の利得は１倍に設定され
る。
また、アナログスイッチ５４がオンした状態では、第３
図に示す如く、ＯＰアンプ５２の利得は２倍に設定され
る。
図に示す如く、ＯＰアンプ５２の利得は２倍に設定され
る。
また、アナログスイッチ５５がオンした状態では、第４
図に示す如く、ＯＰアンプ５２の利得１，１５倍に設定
される。
図に示す如く、ＯＰアンプ５２の利得１，１５倍に設定
される。
可変利得増幅回路５から得られる増幅後のアナログ電圧
は、公知のＡ／Ｄ変換ＬＳＩ６でデジタル情報に変換さ
れた後、バッフ７７７、双方向バスドライバ（入出力兼
用ポートとして機能する）８を介して、ＣＰｔＪユニッ
トにつながるデータバス上に送り出される。
は、公知のＡ／Ｄ変換ＬＳＩ６でデジタル情報に変換さ
れた後、バッフ７７７、双方向バスドライバ（入出力兼
用ポートとして機能する）８を介して、ＣＰｔＪユニッ
トにつながるデータバス上に送り出される。
一方、可変利得回路５内の各アナログスイッチ５３〜５
５は、ラッチ回路９の出力Ｄｏ”Ｄ２によってオンオフ
制御され、またこのラッチ回路９には、双方向バスドラ
イバ８を介してＣＰＵユニット側から送られた利得情報
がラッチされる。
５は、ラッチ回路９の出力Ｄｏ”Ｄ２によってオンオフ
制御され、またこのラッチ回路９には、双方向バスドラ
イバ８を介してＣＰＵユニット側から送られた利得情報
がラッチされる。
次に、このＡＤ変換ユニットの利得を５倍に設定する場
合を例にとり、ユーザプログラムの構成を、第５図のラ
ダー図を参照しながら説明する。
合を例にとり、ユーザプログラムの構成を、第５図のラ
ダー図を参照しながら説明する。
第５図のラダー図に示されるプログラムは、第１図に示
されるＡＤ変換ユニットをチャンネル番号（ＣＨ３０）
に割当てるとともに、その利（ｑを５倍に設定し、さら
にアナログ入力の値に応じて、タイマ（６４−０）の設
定値を、大小変更するものである。
されるＡＤ変換ユニットをチャンネル番号（ＣＨ３０）
に割当てるとともに、その利（ｑを５倍に設定し、さら
にアナログ入力の値に応じて、タイマ（６４−０）の設
定値を、大小変更するものである。
すなわち、押ボタンスイッチ（ＰＢ−１）が操作される
と、そのときの入力アナログ電圧の大きざに応じて、タ
イマ（６４−０）の設定値が決定され、このタイマのタ
イムアツプとともに、リレー（１０−５＞が駆動される
ようにしたものである。
と、そのときの入力アナログ電圧の大きざに応じて、タ
イマ（６４−０）の設定値が決定され、このタイマのタ
イムアツプとともに、リレー（１０−５＞が駆動される
ようにしたものである。
゛この場合、第５図のラダー図に示す如く、通常のデー
タ転送命令ＬＤ、ＳＤのほかに、レンジ設定命令 Ｇ ５ を使用することによって、ＣＨ３０のＡＤ変換ユニット
のレンジを５倍とする。
タ転送命令ＬＤ、ＳＤのほかに、レンジ設定命令 Ｇ ５ を使用することによって、ＣＨ３０のＡＤ変換ユニット
のレンジを５倍とする。
なお、この際には第６図に示す如く、ＣＰＪＪユニット
内のＩ１０メモリにおいては、第６５チヤンネルにタイ
マ（６４−０）の設定値が記憶されているものとする。
内のＩ１０メモリにおいては、第６５チヤンネルにタイ
マ（６４−０）の設定値が記憶されているものとする。
次に、以上のユーザプログラムに対応した、ＣＰｔＪユ
ニット側にあける制御内容について説明する。
ニット側にあける制御内容について説明する。
第７図において、プログラムがスタートすると、まずイ
ニシャル処理において、各種フラグ、レジスタ類の初期
設定を行なった後（ステップ７０１）、システムサービ
ス処理（ステップ７０２＞、入力更新処理（ステップ７
０３）を順次行なう。
ニシャル処理において、各種フラグ、レジスタ類の初期
設定を行なった後（ステップ７０１）、システムサービ
ス処理（ステップ７０２＞、入力更新処理（ステップ７
０３）を順次行なう。
システムサービス処理では、モニタ、プログラミング等
の処理を行ない、また入力更新処理では、Ｉ１０メモリ
の入カニリアと、入カニニットとの間においてデータ更
新を行なう。
の処理を行ない、また入力更新処理では、Ｉ１０メモリ
の入カニリアと、入カニニットとの間においてデータ更
新を行なう。
以後、プログラムコンソールでＲＵＮモードに相当する
キー操作が行なわれない限り（ステップ７０４否定）、
出カニニットの状態は全てオフ状態に設定される。
キー操作が行なわれない限り（ステップ７０４否定）、
出カニニットの状態は全てオフ状態に設定される。
これに対して、プログラムコンソールでＲｔＪＮモード
に相当するキー操作が行なわれると（ステップ７０４肯
定）、ユーザプログラムの先頭から命令語を順次読出し
くステップ７０６） 、読み出された命令語がＥＮＤ命
令、ＲＧ語命令何れでもなければ（ステップ７０７否定
、７０８否定）、該当命令の実行を行なう（ステップ７
０９）。
に相当するキー操作が行なわれると（ステップ７０４肯
定）、ユーザプログラムの先頭から命令語を順次読出し
くステップ７０６） 、読み出された命令語がＥＮＤ命
令、ＲＧ語命令何れでもなければ（ステップ７０７否定
、７０８否定）、該当命令の実行を行なう（ステップ７
０９）。
これに対して、読み出された命令語がレンジ設定命令Ｒ
Ｇであると（ステップ７０８）、指定チャンネルのＡＤ
変換ユニットに対して、レンジ設定データの送出を行な
う（ステップ７１０）。
Ｇであると（ステップ７０８）、指定チャンネルのＡＤ
変換ユニットに対して、レンジ設定データの送出を行な
う（ステップ７１０）。
すると、第１図においては、出力ポートとして機能する
双方向バスドライバ８が開いてレンジ設定データはＡＤ
変換ユニットに取込まれ、ラッチ９に記憶される。
双方向バスドライバ８が開いてレンジ設定データはＡＤ
変換ユニットに取込まれ、ラッチ９に記憶される。
このとき、レンジ設定データを構成するＤｏ〜Ｄ７の中
で、Ｄ２だけを“１′′に設定しておくことによって、
アナログスイッチ５５のみをオンさせ、ＯＰアンプ５２
の利得を５倍に設定させることができる。
で、Ｄ２だけを“１′′に設定しておくことによって、
アナログスイッチ５５のみをオンさせ、ＯＰアンプ５２
の利得を５倍に設定させることができる。
同様に、ＤｏまたはＤｌだけを“１”に設定すれば、可
変利得増幅回路５の利得を、１倍、２倍にそれぞれ設定
することができる。
変利得増幅回路５の利得を、１倍、２倍にそれぞれ設定
することができる。
次に第７図に戻って、順次命令を読み出した結果、最終
的にＥＮＤ命令が読み出されれば（ステップ７０７肯定
）、出力更新処理を行なう（ステップ７１１〉。
的にＥＮＤ命令が読み出されれば（ステップ７０７肯定
）、出力更新処理を行なう（ステップ７１１〉。
この出力更新処理では、演算実行の結果占替が終了した
出力データを、出カニニットに送出し、外部への出力を
行なうものである。
出力データを、出カニニットに送出し、外部への出力を
行なうものである。
このように、この実施例では、ユーザプログラム中でレ
ンジ設定命令ＲＧを使用し、指定チャンネルの入力レン
ジを任意にユーザプログラム上で設定変更させることが
でき、従来装置のようにＡＤ変換ユニット側で電源を落
して手動切替操作を行なう等の必要は全くなく、このた
めユーザ側の電圧仕様の変更に対して即座に対応が可能
であり、またＪＪ定の虞れも少ない。
ンジ設定命令ＲＧを使用し、指定チャンネルの入力レン
ジを任意にユーザプログラム上で設定変更させることが
でき、従来装置のようにＡＤ変換ユニット側で電源を落
して手動切替操作を行なう等の必要は全くなく、このた
めユーザ側の電圧仕様の変更に対して即座に対応が可能
であり、またＪＪ定の虞れも少ない。
なお、この実施例ではユーザプログラム中で使用された
レンジ設定命令ＲＧをＣＰＵユニット側で解読させ、そ
の結果で入力レンジの切替を行なうようにしたが、別途
プログラムコンソールに専用のシフトキーをＦ、２Ｓブ
、これから入力されるレンジ７．２定データで直接にＡ
Ｄ変換ユニットの利得を変更してもよいことは勿論であ
る。
レンジ設定命令ＲＧをＣＰＵユニット側で解読させ、そ
の結果で入力レンジの切替を行なうようにしたが、別途
プログラムコンソールに専用のシフトキーをＦ、２Ｓブ
、これから入力されるレンジ７．２定データで直接にＡ
Ｄ変換ユニットの利得を変更してもよいことは勿論であ
る。
第１図は本発明に係るＡＤ変換ユニットの電気的な構成
を示すブロック図、第２図〜第４図は可変利得増幅回路
の各設定状態を示す説明図、第５図はレンジ変更のため
のユーザプログラムを示すラダー図、第６図はＩ１０メ
モリ内のタイマ設定値エリアの状態を示すメモリマツプ
、第７図はＣＰＵユニットの制御内容を示すフローチャ
ートである。 １・・・コネクタ ２・・・システムバス ３・・・端子台 ４・・・入力端子 ５・・・可変利得増幅回路 ６・・・ＡＤ変換ＬＳＩ ７・・・バッファ ８・・・双方向バスドライバ ９・・・ラッチ 特許出願人 立石電機株式会社 第５図 第６図
を示すブロック図、第２図〜第４図は可変利得増幅回路
の各設定状態を示す説明図、第５図はレンジ変更のため
のユーザプログラムを示すラダー図、第６図はＩ１０メ
モリ内のタイマ設定値エリアの状態を示すメモリマツプ
、第７図はＣＰＵユニットの制御内容を示すフローチャ
ートである。 １・・・コネクタ ２・・・システムバス ３・・・端子台 ４・・・入力端子 ５・・・可変利得増幅回路 ６・・・ＡＤ変換ＬＳＩ ７・・・バッファ ８・・・双方向バスドライバ ９・・・ラッチ 特許出願人 立石電機株式会社 第５図 第６図
Claims (1)
- （１）ＣＰＵユニットからの制御で開き、システムバス
上の利得情報を出力する出力ポートと、出力ポートから
得られる利得情報を記憶する記憶回路と、 外部入力端子から得られるアナログ入力電圧を、記憶さ
れた利得情報に応じて増幅する可変利得増幅回路と、 可変利得増幅回路から得られるアナログ電圧をデジタル
変換するＡ／Ｄ変換回路と、 ＣＰＵユニットからの制御で開き、変換後のデジタル情
報をシステムバス上に入力する入力ポートと、 からなることを特徴とするプログラマブル・コントロー
ラのＡＤ変換ユニット。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25618985A JPS62115518A (ja) | 1985-11-15 | 1985-11-15 | プログラマブル・コントロ−ラのａｄ変換ユニツト |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25618985A JPS62115518A (ja) | 1985-11-15 | 1985-11-15 | プログラマブル・コントロ−ラのａｄ変換ユニツト |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62115518A true JPS62115518A (ja) | 1987-05-27 |
Family
ID=17289142
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP25618985A Pending JPS62115518A (ja) | 1985-11-15 | 1985-11-15 | プログラマブル・コントロ−ラのａｄ変換ユニツト |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62115518A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2022025810A1 (en) * | 2020-07-29 | 2022-02-03 | Fingerprint Cards Anacatum Ip Ab | Adaptive readout from a global shutter optical biometric sensor |
| US11516413B2 (en) | 2020-07-29 | 2022-11-29 | Fingerprint Cards Anacatum Ip Ab | Adaptive readout from an optical biometric sensor to a host device |
-
1985
- 1985-11-15 JP JP25618985A patent/JPS62115518A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2022025810A1 (en) * | 2020-07-29 | 2022-02-03 | Fingerprint Cards Anacatum Ip Ab | Adaptive readout from a global shutter optical biometric sensor |
| CN114514739A (zh) * | 2020-07-29 | 2022-05-17 | 指纹卡安娜卡敦知识产权有限公司 | 全局快门光学生物特征传感器的适应性读出 |
| US11508180B2 (en) | 2020-07-29 | 2022-11-22 | Fingerprint Cards Anacatum Ip Ab | Adaptive readout from a global shutter optical biometric sensor |
| US11516413B2 (en) | 2020-07-29 | 2022-11-29 | Fingerprint Cards Anacatum Ip Ab | Adaptive readout from an optical biometric sensor to a host device |
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