JPS621340A - 通信制御装置 - Google Patents
通信制御装置Info
- Publication number
- JPS621340A JPS621340A JP60140956A JP14095685A JPS621340A JP S621340 A JPS621340 A JP S621340A JP 60140956 A JP60140956 A JP 60140956A JP 14095685 A JP14095685 A JP 14095685A JP S621340 A JPS621340 A JP S621340A
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- Japan
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- packet
- circuit
- host computer
- communication control
- decoder
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- Pending
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- 238000004891 communication Methods 0.000 title claims abstract description 21
- 238000000034 method Methods 0.000 claims abstract description 30
- 230000004044 response Effects 0.000 claims abstract description 7
- 230000005540 biological transmission Effects 0.000 description 6
- 238000011084 recovery Methods 0.000 description 3
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
Landscapes
- Data Exchanges In Wide-Area Networks (AREA)
- Communication Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は通信制御装置に関し、特にパケット交換網に収
容されるホストコンピュータとパケット交換網の間に介
在してパケット交換網とのインクフェースを行う通信制
御装置に関する。
容されるホストコンピュータとパケット交換網の間に介
在してパケット交換網とのインクフェースを行う通信制
御装置に関する。
識別情報を前もって通信制御装置には有さず、パケット
交換網からの呼設定要求パケット（以下着呼パケット）
がｙ／ｊＩ信する毎にホストコンピュータに割り込み、
ホストコンビ瓢−夕は呼設定に関するプロセス間の通信
に関与して通信処理のためにその処理時間を費やしてい
た。
交換網からの呼設定要求パケット（以下着呼パケット）
がｙ／ｊＩ信する毎にホストコンピュータに割り込み、
ホストコンビ瓢−夕は呼設定に関するプロセス間の通信
に関与して通信処理のためにその処理時間を費やしてい
た。
上述した従来のホストコンピュータと通信制御装置にお
いては、呼設定パケットが着信する毎に通信制御装置か
らホストコンピュータに割込み動作が発生し、ホストコ
ンピュータの処理時間上通信制御のための処理時間が費
やされ、ホストコンピュータの処理上常に相手端末又は
ホスト側からの割込み処理が必要とされるので、ホスト
コンビ、−夕の処理上大きな問題点となフている。
いては、呼設定パケットが着信する毎に通信制御装置か
らホストコンピュータに割込み動作が発生し、ホストコ
ンピュータの処理時間上通信制御のための処理時間が費
やされ、ホストコンピュータの処理上常に相手端末又は
ホスト側からの割込み処理が必要とされるので、ホスト
コンビ、−夕の処理上大きな問題点となフている。
本発明の通信制御装置は、ホストコンピュータとパケッ
ト交換網の間に接続され、前記ホストコンピュータ内に
存在するプロセスに対応する論理チャネル識別信号と前
記パケット交換網からの呼設定パケットの中に有する前
記ホストコンピュータの前記プロセスと通信することを
希望する プロセス識別信号とを照合する手段を備え、
着信側の通信制御装置で呼設定要求パケットに対する応
答パケットを返送している。
ト交換網の間に接続され、前記ホストコンピュータ内に
存在するプロセスに対応する論理チャネル識別信号と前
記パケット交換網からの呼設定パケットの中に有する前
記ホストコンピュータの前記プロセスと通信することを
希望する プロセス識別信号とを照合する手段を備え、
着信側の通信制御装置で呼設定要求パケットに対する応
答パケットを返送している。
次に、本発明について図面を参照して説明する。
第１図は本発明の通信制御装置の一実施例を示すブロッ
ク図である。
ク図である。
同図において、ホストコンピュータ４とパケット交換網
３の間に介在する通信制御装置１は、パケット交換網３
からの送受信中のモデム装ｆ２から受信信号を受ける受
信回路１０１と、この受信信号を一時蓄積する受信バッ
ファ回路１０２と、通信制御袋ＴＲ１がパケ
パット交換網３からみてパケット端末としてみえる
ときにはＣＣＩＴＴ勧告Ｘ、２５に従ったシーケンス制
御を行うシーケンス制御回路１０３と、受信バッファ回
路１０２で受信したパケットが着呼パケットであるとき
到着パケットのヘッダ部からその旨を解読する解読器１
０４と、受信バッファ回路１０２のユーザ部の一部から
発信端末がホストコンビ為−夕４のどのジｌブと通信し
たいかを解読する解読器１０５と、解読器１０４，１０
５の出力の論理積をとるアンド回路群１０６と、ホスト
コンピュータ４からのホストコンピュータ内のジ１ブ対
応のプロセスに対応する情報を受信する受信回路１０７
と、受信回路１０７からの情報を一時蓄積する受信バッ
ファ回路１０８と、受信バッファ回路１０８の出力の一
部からプロセス状態通知表示であることを解読する解読
器１０９と、受信バッファ回路１０８のジ冒ブ番号対応
のプロセス番号を表示する部分２よび該当するプロセス
番号の状態を表示する部分をそれぞれ解読する解読器１
１０および１１１と、解読器１０９からの指示により解
読器１１０，１１１のシーケンス制御を行うシーケンス
制御回路１１２と、シーケンス制御回路１１２の制御の
下に解読器１１０゜１１１の出力を記憶プロセス状態表
示メモリ群１１３と、アンド回路群１０６とプロセス状
態表示メモリ群１１３の出力をそれぞれ対応させて論理
積をとるアンド回路群１１４と１着呼受付パケット２よ
び復旧要求パケットを作成するパケット作成回路１１５
と、受信バッファ回路１０８からの送信データからシー
ケンス制御回路１０３の制御の下にデータパケットを作
成するパケット作成回路１１６と、パケット作成回路１
１５，１１６で作成したパケットをオア回路１１７を介
して受けてモデム装置２へ送信する送信回路１１８と、
アンド回路１１９を介して受信バッファ回路１０２から
受けたデータパケットを一時蓄積する送信バッファ回路
１２０と、送信バッファ回路１２０と接続されホストコ
ンピュータ４とインタフェースをとるインタフェース回
路１２１とを備えている。
３の間に介在する通信制御装置１は、パケット交換網３
からの送受信中のモデム装ｆ２から受信信号を受ける受
信回路１０１と、この受信信号を一時蓄積する受信バッ
ファ回路１０２と、通信制御袋ＴＲ１がパケ
パット交換網３からみてパケット端末としてみえる
ときにはＣＣＩＴＴ勧告Ｘ、２５に従ったシーケンス制
御を行うシーケンス制御回路１０３と、受信バッファ回
路１０２で受信したパケットが着呼パケットであるとき
到着パケットのヘッダ部からその旨を解読する解読器１
０４と、受信バッファ回路１０２のユーザ部の一部から
発信端末がホストコンビ為−夕４のどのジｌブと通信し
たいかを解読する解読器１０５と、解読器１０４，１０
５の出力の論理積をとるアンド回路群１０６と、ホスト
コンピュータ４からのホストコンピュータ内のジ１ブ対
応のプロセスに対応する情報を受信する受信回路１０７
と、受信回路１０７からの情報を一時蓄積する受信バッ
ファ回路１０８と、受信バッファ回路１０８の出力の一
部からプロセス状態通知表示であることを解読する解読
器１０９と、受信バッファ回路１０８のジ冒ブ番号対応
のプロセス番号を表示する部分２よび該当するプロセス
番号の状態を表示する部分をそれぞれ解読する解読器１
１０および１１１と、解読器１０９からの指示により解
読器１１０，１１１のシーケンス制御を行うシーケンス
制御回路１１２と、シーケンス制御回路１１２の制御の
下に解読器１１０゜１１１の出力を記憶プロセス状態表
示メモリ群１１３と、アンド回路群１０６とプロセス状
態表示メモリ群１１３の出力をそれぞれ対応させて論理
積をとるアンド回路群１１４と１着呼受付パケット２よ
び復旧要求パケットを作成するパケット作成回路１１５
と、受信バッファ回路１０８からの送信データからシー
ケンス制御回路１０３の制御の下にデータパケットを作
成するパケット作成回路１１６と、パケット作成回路１
１５，１１６で作成したパケットをオア回路１１７を介
して受けてモデム装置２へ送信する送信回路１１８と、
アンド回路１１９を介して受信バッファ回路１０２から
受けたデータパケットを一時蓄積する送信バッファ回路
１２０と、送信バッファ回路１２０と接続されホストコ
ンピュータ４とインタフェースをとるインタフェース回
路１２１とを備えている。
続いて本実施例の動作について説明する。
着呼パケットがパケット交換網３から転送されると受信
回路１０１を介して受信バッファ回路１０２に蓄積され
る。該到着パケットが着呼パケットであることはそのヘ
ッダ部を解読器１０４で解読することにより判明する。
回路１０１を介して受信バッファ回路１０２に蓄積され
る。該到着パケットが着呼パケットであることはそのヘ
ッダ部を解読器１０４で解読することにより判明する。
解読器１０４の出力はシーケンス制御回路１０３へも入
力され、パケットシーケンスの制御に役立てる。今、着
呼パケットが検出されるとアンド回路群１０６が付勢さ
れる。又、受信バッファ回路１０２のユーザ部の一部を
解読器１０５で解読することにより発信端末がホストコ
ンビ為−夕４のどのジ１ブと通信したいかが判明する。
力され、パケットシーケンスの制御に役立てる。今、着
呼パケットが検出されるとアンド回路群１０６が付勢さ
れる。又、受信バッファ回路１０２のユーザ部の一部を
解読器１０５で解読することにより発信端末がホストコ
ンビ為−夕４のどのジ１ブと通信したいかが判明する。
解読器１０５の出力はアンド回路群１０６へ導かれて解
読器１０４の出力と論理積がとられる。即ち着呼パケッ
トのときのみアンド回路群１０６が有効化され、解読器
１０５からの出力と一致したアンド回路１個が付勢され
る。
読器１０４の出力と論理積がとられる。即ち着呼パケッ
トのときのみアンド回路群１０６が有効化され、解読器
１０５からの出力と一致したアンド回路１個が付勢され
る。
一方、ホストコンピュータ４からのホストコンピュータ
内のジョブ対応のプロセスに対応する情報が転送される
と、受信回路１０７を経て、受信バッファ回路１０８に
蓄積される。受信パッファ回路１０Ｂの出力の一部が解
読器１０９で解読されてプロセス状態通知表示であるこ
とが判明すると、シーケンス制御回路１１２の制御の下
に解読器１１０．１１１の各出力に応じてプロセス状態
表示メモリ群１１３に記憶される。もしあるプロセス使
用中であれば、該メモリ群１１３には論理値１０”がセ
ットされ、又もし空いていれば論理値＠１″がセットさ
れる。従ってこのプロセス状態表示メモリ群１１３を見
れば、ホストコンビ為−夕４の各ジ冒ブに対応するプロ
セスの空塞状態が判明する。アンド回路群１０６の出力
とプロセス状態表示メモリ群１１３の出力をそれぞれ対
応させてアンド回路群１１４で論理積をとることにより
、発信毫末から着呼パケットで表示されたプロセスが空
が塞かが判る。もし該当するプロセスが空きであれば、
アンド回路群１１４の内の１つのアンド回路が付勢され
前記着呼パケットに応答して着呼受付パケットをパケッ
ト交換網３へ転送するべ（パケット作成回路１１５によ
って着呼受付〆パケットを作成し、オア回路１１７．送
信回路１１８、モデム装置２を介してパケット交換網３
へ該着呼受付パケットが転送される。これと同時に、シ
ーケンス制御回路１０３には該プロセス番号が登録され
る。
内のジョブ対応のプロセスに対応する情報が転送される
と、受信回路１０７を経て、受信バッファ回路１０８に
蓄積される。受信パッファ回路１０Ｂの出力の一部が解
読器１０９で解読されてプロセス状態通知表示であるこ
とが判明すると、シーケンス制御回路１１２の制御の下
に解読器１１０．１１１の各出力に応じてプロセス状態
表示メモリ群１１３に記憶される。もしあるプロセス使
用中であれば、該メモリ群１１３には論理値１０”がセ
ットされ、又もし空いていれば論理値＠１″がセットさ
れる。従ってこのプロセス状態表示メモリ群１１３を見
れば、ホストコンビ為−夕４の各ジ冒ブに対応するプロ
セスの空塞状態が判明する。アンド回路群１０６の出力
とプロセス状態表示メモリ群１１３の出力をそれぞれ対
応させてアンド回路群１１４で論理積をとることにより
、発信毫末から着呼パケットで表示されたプロセスが空
が塞かが判る。もし該当するプロセスが空きであれば、
アンド回路群１１４の内の１つのアンド回路が付勢され
前記着呼パケットに応答して着呼受付パケットをパケッ
ト交換網３へ転送するべ（パケット作成回路１１５によ
って着呼受付〆パケットを作成し、オア回路１１７．送
信回路１１８、モデム装置２を介してパケット交換網３
へ該着呼受付パケットが転送される。これと同時に、シ
ーケンス制御回路１０３には該プロセス番号が登録され
る。
ここで、もし該当するプロセスが塞の場合にはアンド回
路群１１４から出力されず、パケット作成回路１１５で
は復旧要求パケットを作成して前記着呼受付パケットと
同様のルートでパケット交換網３へ該復旧要求パケット
を転送する。
路群１１４から出力されず、パケット作成回路１１５で
は復旧要求パケットを作成して前記着呼受付パケットと
同様のルートでパケット交換網３へ該復旧要求パケット
を転送する。
アンド回路群１１４の１つアンド回路が付勢され出力さ
れると、その出力はパケット作成回路１１５に着呼受付
−パケットを作成させると共にプロセス状態表示メモリ
群１１３の該当ビットをリセットして＠０”状態にして
おく。
れると、その出力はパケット作成回路１１５に着呼受付
−パケットを作成させると共にプロセス状態表示メモリ
群１１３の該当ビットをリセットして＠０”状態にして
おく。
着呼受付パケット転送后にパケット交換網３から転送さ
れるデータパケットは解読器１０４の出力にデータパケ
ットが表示され、それに基づきシ ゛−ケンス制御
回路１０３の制御の下に該データパケットがアンド回路
１１９．送信バッファ回路１２０、インタフェース回路
１２１を経てホストコンビ為−夕４へ転送される。この
とき前記データパケットにおいて、パケット交換網３で
付与された論理チャネル番号はシーケンス制御回路１０
３の制御の下に先に選択されたプロセス番号が設定され
る。
れるデータパケットは解読器１０４の出力にデータパケ
ットが表示され、それに基づきシ ゛−ケンス制御
回路１０３の制御の下に該データパケットがアンド回路
１１９．送信バッファ回路１２０、インタフェース回路
１２１を経てホストコンビ為−夕４へ転送される。この
とき前記データパケットにおいて、パケット交換網３で
付与された論理チャネル番号はシーケンス制御回路１０
３の制御の下に先に選択されたプロセス番号が設定され
る。
次に、ホストコンビ為−夕４からの送信データは受信回
路１０７．受信バッファ回路１０８を経てパケット作成
回路１１６に入力され、パケット作成回路１１６はシー
ケンス制御回路１０３の制御の下にデータパケットを作
成してオア回路１１７゜送信バッファ回路１１８．、モ
デム装置２を介してパケット交換網３へ転送される。
路１０７．受信バッファ回路１０８を経てパケット作成
回路１１６に入力され、パケット作成回路１１６はシー
ケンス制御回路１０３の制御の下にデータパケットを作
成してオア回路１１７゜送信バッファ回路１１８．、モ
デム装置２を介してパケット交換網３へ転送される。
以上説明したように、本実施例では着呼パケットに対す
る応答はすべて通信制御装置１の中で実行されるので、
ホストコンビ為−夕４の負荷を減少させることができる
。
る応答はすべて通信制御装置１の中で実行されるので、
ホストコンビ為−夕４の負荷を減少させることができる
。
以上説明したように本発明は、パケット交換網からの呼
設定要求パケット（着呼パケット）に対する応答を通信
制御装置で実行することにより、ホストコンピュータへ
の割込み回数が減少し、かつホストコンピュータの着呼
パケットに対する応答処理が不要となるので、ホストコ
ンピュータの処理負荷軽減を図ることができる効果があ
る。
設定要求パケット（着呼パケット）に対する応答を通信
制御装置で実行することにより、ホストコンピュータへ
の割込み回数が減少し、かつホストコンピュータの着呼
パケットに対する応答処理が不要となるので、ホストコ
ンピュータの処理負荷軽減を図ることができる効果があ
る。
第１図は本発明の通信制御装置の一実施例を示すブロッ
ク図である。
ク図である。
Claims (1)
- ホストコンピュータとパケット交換網の間に介在する通
信制御装置において、前記ホストコンピュータ内に存在
するプロセスに対応する論理チャネル識別信号と前記パ
ケット交換網からの呼設定パケットの中に有する前記ホ
ストコンピュータの前記プロセスと通信することを希望
するプロセス識別信号とを照合する手段を備え、着信側
の通信制御装置では呼設定要求パケットに対する応答パ
ケットを返送することを特徴とする通信制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60140956A JPS621340A (ja) | 1985-06-27 | 1985-06-27 | 通信制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60140956A JPS621340A (ja) | 1985-06-27 | 1985-06-27 | 通信制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS621340A true JPS621340A (ja) | 1987-01-07 |
Family
ID=15280724
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60140956A Pending JPS621340A (ja) | 1985-06-27 | 1985-06-27 | 通信制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS621340A (ja) |
-
1985
- 1985-06-27 JP JP60140956A patent/JPS621340A/ja active Pending
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