JPS61120596A - 電子交換機における信号制御装置 - Google Patents
電子交換機における信号制御装置Info
- Publication number
- JPS61120596A JPS61120596A JP24067384A JP24067384A JPS61120596A JP S61120596 A JPS61120596 A JP S61120596A JP 24067384 A JP24067384 A JP 24067384A JP 24067384 A JP24067384 A JP 24067384A JP S61120596 A JPS61120596 A JP S61120596A
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- JP
- Japan
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- signal
- signal unit
- control device
- control
- line
- Prior art date
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- Pending
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04Q—SELECTING
- H04Q3/00—Selecting arrangements
- H04Q3/42—Circuit arrangements for indirect selecting controlled by common circuits, e.g. register controller, marker
- H04Q3/54—Circuit arrangements for indirect selecting controlled by common circuits, e.g. register controller, marker in which the logic circuitry controlling the exchange is centralised
- H04Q3/545—Circuit arrangements for indirect selecting controlled by common circuits, e.g. register controller, marker in which the logic circuitry controlling the exchange is centralised using a stored program
- H04Q3/54575—Software application
- H04Q3/54591—Supervision, e.g. fault localisation, traffic measurements, avoiding errors, failure recovery, monitoring, statistical analysis
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Exchange Systems With Centralized Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は、国際電信電話諮問委員会（ＣＣＩＴＴ ）勧
告、Ｎａ３信号方式を扱う電子交換機の共通線信号制御
装置に関する。
告、Ｎａ３信号方式を扱う電子交換機の共通線信号制御
装置に関する。
共通線信号制御方式は、交換機間の呼の制御信号をパケ
ット形の信号ユニットとして送受する方式である。従っ
て、信号の誤り制御、ルーチング。
ット形の信号ユニットとして送受する方式である。従っ
て、信号の誤り制御、ルーチング。
フロー制御等を行う必要がある。このため、プロセッサ
は信号ユニット処理に、多くの処理ステップを要するた
め、交換機はあらかじめこのための能力を見込んでおく
か、または別プロセッサを設ける等の処理が必要となる
。
は信号ユニット処理に、多くの処理ステップを要するた
め、交換機はあらかじめこのための能力を見込んでおく
か、または別プロセッサを設ける等の処理が必要となる
。
本発明の目的は、交換機における共通線信号制御装置を
、経済的に提供することにある。
、経済的に提供することにある。
このために本発明では複数の回線リンク対応のτコ
回線制御装置に対し網制御装置を設け、かつ信号トラヒ
ック量に対応して、該網制御装置を複数個設け、網制御
装置群の信号の中継用に共有メモリを設け、かつ交換処
理プロセッサ群と網制御装置群はバスで接続する。
ック量に対応して、該網制御装置を複数個設け、網制御
装置群の信号の中継用に共有メモリを設け、かつ交換処
理プロセッサ群と網制御装置群はバスで接続する。
以下、本発明の一実施例を第１図と第２図により説明す
る。第１図は１本発明における電子交換機における共通
線信号制御装置の全体構成を示したものである。ここで
、１０１は共通線信号用のリンク、１０２Ｃ５Ｅ１１〜
Ｃ３Ｅｎｊは、リンク対応に設けて、共通線信号ユニッ
トの識別、誤り検出、シーケンス番号制御による誤り訂
正、信号誤り率監視等を行うマイクロプロセッサ制御に
よる回線制御装置である。１０４Ｃ３Ｐ１〜Ｃ３Ｐｎは
、信号ユニットの交換処理プロセッサへの中継９回線間
の中継を行い、かつ流量制御、ルーチングチ御等を行う
、信号網制御装置である。
る。第１図は１本発明における電子交換機における共通
線信号制御装置の全体構成を示したものである。ここで
、１０１は共通線信号用のリンク、１０２Ｃ５Ｅ１１〜
Ｃ３Ｅｎｊは、リンク対応に設けて、共通線信号ユニッ
トの識別、誤り検出、シーケンス番号制御による誤り訂
正、信号誤り率監視等を行うマイクロプロセッサ制御に
よる回線制御装置である。１０４Ｃ３Ｐ１〜Ｃ３Ｐｎは
、信号ユニットの交換処理プロセッサへの中継９回線間
の中継を行い、かつ流量制御、ルーチングチ御等を行う
、信号網制御装置である。
１０３は、Ｃ８ＥとＣ８Ｐを接続するバスである。
１１０６Ｃは、ｃｓｐ間の信号ユニットの中継等の信号
ユニットのバッファ、及びルーチングチ−プル等を格納
する全Ｃ５Ｐに対しての共有メモリである。１０８ＣＰ
ｌ〜ＣＰｍは交換処理プロセッサである。１０７はｃｓ
ｐ、ｃｐ間を接続するバスである。１０１０９Ｏは、交
換機の保守、運用を行うプロセッサである。
ユニットのバッファ、及びルーチングチ−プル等を格納
する全Ｃ５Ｐに対しての共有メモリである。１０８ＣＰ
ｌ〜ＣＰｍは交換処理プロセッサである。１０７はｃｓ
ｐ、ｃｐ間を接続するバスである。１０１０９Ｏは、交
換機の保守、運用を行うプロセッサである。
次に、第１図において動作を説明する。信号ユニット受
信の場合リンク１０１よりの信号ユニットは、Ｃ：５Ｅ
１１に送られ、ここで、信号ユニット識別、誤り検出、
シーケンス番号検査による誤り訂正、再送要求処理等が
行われ、正常な信号ユニットはＣ５ＰＩ （１０４）に
送られる。Ｃ８Ｐでは信号ユニットに含まれている着信
局番号、及び通話回線番号により、ＣＭ （１０６）の
ルーチングチ−プルを参照し、該当する通話回線が収容
されているＣＰ （１０８）へバス１０６を経由し。
信の場合リンク１０１よりの信号ユニットは、Ｃ：５Ｅ
１１に送られ、ここで、信号ユニット識別、誤り検出、
シーケンス番号検査による誤り訂正、再送要求処理等が
行われ、正常な信号ユニットはＣ５ＰＩ （１０４）に
送られる。Ｃ８Ｐでは信号ユニットに含まれている着信
局番号、及び通話回線番号により、ＣＭ （１０６）の
ルーチングチ−プルを参照し、該当する通話回線が収容
されているＣＰ （１０８）へバス１０６を経由し。
信号ユニットを送る。また、上記処理において、信号ユ
ニットが、他局への中継をするものであれば、ＣＭ （
１０６）にある中継先の該当Ｃ５Ｅ（１０２）対応のバ
ッファに該信号ユニットを格納する。
ニットが、他局への中継をするものであれば、ＣＭ （
１０６）にある中継先の該当Ｃ５Ｅ（１０２）対応のバ
ッファに該信号ユニットを格納する。
次に、信号ユニットの送信処理の場合を述べる。
ＣＰＩ （１０８）よりの呼制御情報は、信号ユニット
として、相手局番号、対応通話回線番号が付与された形
で、Ｃ３ＰＩ （１０４）へ送られる。
として、相手局番号、対応通話回線番号が付与された形
で、Ｃ３ＰＩ （１０４）へ送られる。
この時、ＣＰ （１０８）とＣ３Ｐ （１０４）とは。
あらかじめ、信号トラヒック景に応じ反対応付けをして
おく、これは、必ずしも、該当ｃＳＰに接続されている
Ｃ５Ｅ （１０２）に対応しなくてもよい、、Ｃ３Ｐ１
で受けた信号ユニットは、ＣＭ（１０６）のルーチング
チ−プルに従って、宛先ｆ７）Ｃ５Ｅ （１０２）が決
定され、ＣＭ （１０６）内のＣ８Ｅ対応に設けられた
、送信バッファに格納される。この送信バッファには、
他Ｃ３Ｅよりの受信信号ユニットで、該ＣＳＥへ中継さ
れて出力される信号ユニットも収容される。
おく、これは、必ずしも、該当ｃＳＰに接続されている
Ｃ５Ｅ （１０２）に対応しなくてもよい、、Ｃ３Ｐ１
で受けた信号ユニットは、ＣＭ（１０６）のルーチング
チ−プルに従って、宛先ｆ７）Ｃ５Ｅ （１０２）が決
定され、ＣＭ （１０６）内のＣ８Ｅ対応に設けられた
、送信バッファに格納される。この送信バッファには、
他Ｃ３Ｅよりの受信信号ユニットで、該ＣＳＥへ中継さ
れて出力される信号ユニットも収容される。
第１図には示されていないが、交換局の信号ユニットの
トラヒックの少い局でＣ８Ｐが１台の場合の構成も可能
である。この場合、ＣＭ（１０６）を設置せず４こ、Ｃ
８Ｐ内のメモリで同等の機能をはたす。
トラヒックの少い局でＣ８Ｐが１台の場合の構成も可能
である。この場合、ＣＭ（１０６）を設置せず４こ、Ｃ
８Ｐ内のメモリで同等の機能をはたす。
さらに、交換局規模が小さく、ｃｐの処理能力に余裕の
ある場合、Ｃ８ＥをＣＰに接続し、ＣＰで、ｃｓｐで行
なった処理を行い、Ｃ５Ｐ、ＣＭを省く構成も可能であ
る。
ある場合、Ｃ８ＥをＣＰに接続し、ＣＰで、ｃｓｐで行
なった処理を行い、Ｃ５Ｐ、ＣＭを省く構成も可能であ
る。
第２図は、Ｃ８ＥとＣ８Ｐの構成を示した図である。２
０１は、第１図の１０１と同じ信号用リンクである。２
０２ （ＤＬＣ）は信号リンクを接続し、信号ユニット
の識別、誤り検査符号による誤り検出等の機能を有する
回線制御部、２０３、ＤＭＡＣは、ダイレクトメモリア
クセス制御回路であり、ＤＬＣ（２０２）とメモリＲＡ
Ｍ （２０６）との直接データ転送を行う、２０４ＭＣ
ＰＵは、回線制御装置を制御するマイクロプロセッサ。
０１は、第１図の１０１と同じ信号用リンクである。２
０２ （ＤＬＣ）は信号リンクを接続し、信号ユニット
の識別、誤り検査符号による誤り検出等の機能を有する
回線制御部、２０３、ＤＭＡＣは、ダイレクトメモリア
クセス制御回路であり、ＤＬＣ（２０２）とメモリＲＡ
Ｍ （２０６）との直接データ転送を行う、２０４ＭＣ
ＰＵは、回線制御装置を制御するマイクロプロセッサ。
２０６ ＲＯＭは、ＭＣ，ＰＵ （２０４）用のプログ
ラムを格納しているリードオンリーメモリ、 ２０６゜
ＲＡＭは、ランダムアクセスメモリ、２０７ＤＰ−ＲＡ
Ｍは１回線制御装置Ｃ５Ｅと、網制°御装置Ｃ８Ｐとの
データ転送を行うデュアルポートのランダムアクセスメ
モリであり、 Ｍ ＣＰ Ｕ （２０４）と、ＣＰＵ
（２１０）の共有メモリであるａ２０８はＭＣＰＵ （
２０４）のバスである。２０１〜２０８でＣ８Ｅを構成
する。２０９ＢＩは、 ｃｓｐのバスインタフェースで
あり、２１０ＣＰＵはＣ８Ｐのプロセッサ、２１２ＭＭ
はメモリ。
ラムを格納しているリードオンリーメモリ、 ２０６゜
ＲＡＭは、ランダムアクセスメモリ、２０７ＤＰ−ＲＡ
Ｍは１回線制御装置Ｃ５Ｅと、網制°御装置Ｃ８Ｐとの
データ転送を行うデュアルポートのランダムアクセスメ
モリであり、 Ｍ ＣＰ Ｕ （２０４）と、ＣＰＵ
（２１０）の共有メモリであるａ２０８はＭＣＰＵ （
２０４）のバスである。２０１〜２０８でＣ８Ｅを構成
する。２０９ＢＩは、 ｃｓｐのバスインタフェースで
あり、２１０ＣＰＵはＣ８Ｐのプロセッサ、２１２ＭＭ
はメモリ。
２１３ＳＣは、Ｃ５Ｐのシステム制御部であり、立上げ
の起動、プロセッサ監視等を行う２１４８Ｇは、２１７
システムバスとの接続回路、２１５ＣＭは、第１図で述
べた共有メモリである。２０９〜２１４でｃｓｐを構成
する。
の起動、プロセッサ監視等を行う２１４８Ｇは、２１７
システムバスとの接続回路、２１５ＣＭは、第１図で述
べた共有メモリである。２０９〜２１４でｃｓｐを構成
する。
次に第２図において、Ｃ８とＣ８Ｐの動作を述べる。Ｃ
５ＥはＲＯＭ （２０５）のマイクロプログラムによっ
て制御される。リンク（２０１）よりの受信信号ユニッ
トはＤＬＣ（２０２）により識別され、ＤＬＣ（２０２
）はＭＣＰＵ （２０４）に割込む。ＭＣＰＵ （２０
４）は、受信信号の格納エリアをＲＡＭ （２０６）に
確保し、ＤＭＡＣ（２０３）へ通知する。ＤＭＡＣ（２
０３）は、これに従って信号ユニットをＲＡＭ （２０
６）へ順次転送する６信号ユニット受信終了をＤＬＣ（
２０２）が識別すると、再びＤＬＣ： （２０２）より
ＭＣＰＵ （２０４）に割込を行う。これによりＭＣＰ
Ｕ （２０４）は、ＤＭＡＣ（２０３）を止め、次にＲ
ＡＭ （２０６）に格納された信号ユニットを読み出し
、信号ユニットの識別を行い。
５ＥはＲＯＭ （２０５）のマイクロプログラムによっ
て制御される。リンク（２０１）よりの受信信号ユニッ
トはＤＬＣ（２０２）により識別され、ＤＬＣ（２０２
）はＭＣＰＵ （２０４）に割込む。ＭＣＰＵ （２０
４）は、受信信号の格納エリアをＲＡＭ （２０６）に
確保し、ＤＭＡＣ（２０３）へ通知する。ＤＭＡＣ（２
０３）は、これに従って信号ユニットをＲＡＭ （２０
６）へ順次転送する６信号ユニット受信終了をＤＬＣ（
２０２）が識別すると、再びＤＬＣ： （２０２）より
ＭＣＰＵ （２０４）に割込を行う。これによりＭＣＰ
Ｕ （２０４）は、ＤＭＡＣ（２０３）を止め、次にＲ
ＡＭ （２０６）に格納された信号ユニットを読み出し
、信号ユニットの識別を行い。
Ｃ８Ｐへ送信する信号ユニットであれば、ＤＰ−ＲＡＭ
（２０７）へ格納する。
（２０７）へ格納する。
一方、ｃｓｐのＣＰＵ （２１０）は、傘下のＣ８Ｅの
ＤＰ−ＲＡＭ （２０７）を順次、走査し。
ＤＰ−ＲＡＭ （２０７）を順次、走査し。
信号ユニットがあれば取出す、ＣＰＵ （２１０）は、
該信号ユニットの属性を判断し、呼処理プロセッサ宛の
信号ユニットであれば、ＢＣ（２１４）経由送信用のバ
ッファエリアに格納し、送信を持つ。
該信号ユニットの属性を判断し、呼処理プロセッサ宛の
信号ユニットであれば、ＢＣ（２１４）経由送信用のバ
ッファエリアに格納し、送信を持つ。
送信動作についても同様であり、第１図により動作説明
に準じる。
に準じる。
本発明によれば、ＣＣＩＴＴ ｍ告、Ｎｉ２信号方式に
従った共通線信号制御装置を交換機の規模に応じ。
従った共通線信号制御装置を交換機の規模に応じ。
かつ、信号ユニットのトラヒックに応じた構成をとるこ
とができ、経済的に構成することが可能である。さらに
、信号ユニットの中継専用局（ＳＴＰ）を構成する場合
、交換処理プロセッサＣＰ及びその制御下の交換機部分
を除くことにより、構成する事が可能となる。
とができ、経済的に構成することが可能である。さらに
、信号ユニットの中継専用局（ＳＴＰ）を構成する場合
、交換処理プロセッサＣＰ及びその制御下の交換機部分
を除くことにより、構成する事が可能となる。
第１図は電子交換機における本発明による共通線信号制
御装置の接続を示す図、第２図は共通線信号制御装置の
構成を示す図である。 １０１・・・信号リンク、１０２・・・回線制御装置。 １０４・・・網制御装置、１０６・・・共通メモリ、１
０７・・・システムバス、１０８・・・交換処理プロセ
ッサ。 １０９・・・保守、運用プロセッサ、２０１・・・信号
リンク、２０２・・・信号リンク制御回路、２０４・・
・マイクロコンピュータ、２０７・・・デュアルポート
メモリ、２１０・・・プロセッサ、２１４・・・バス接
続口’ｆｒ ｒ ｒｉＵ ０ｑ
御装置の接続を示す図、第２図は共通線信号制御装置の
構成を示す図である。 １０１・・・信号リンク、１０２・・・回線制御装置。 １０４・・・網制御装置、１０６・・・共通メモリ、１
０７・・・システムバス、１０８・・・交換処理プロセ
ッサ。 １０９・・・保守、運用プロセッサ、２０１・・・信号
リンク、２０２・・・信号リンク制御回路、２０４・・
・マイクロコンピュータ、２０７・・・デュアルポート
メモリ、２１０・・・プロセッサ、２１４・・・バス接
続口’ｆｒ ｒ ｒｉＵ ０ｑ
Claims (1)
- 回線への信号ユニット送出及び受信を行い、フラグによ
る信号ユニットの識別、誤り検査符号による誤り検出、
シーケンス番号制御による誤り訂正及び誤り率監視を行
うマイクロプロセッサ制御による回線制御装置と、該制
御装置と共有メモリを介して接続され、かつ複数の該制
御装置と直接接続され、信号ユニットの交換処理プロセ
ッサへの中継制御、回線間の中継制御、流量制御、ルー
チング制御を行うプロセッサ制御による網制御装置と、
交換処理プロセッサ群を接続する通信バスと、複数の上
記網制御装置に対する共有メモリとを設けたことを特徴
とする電子交換機における信号制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24067384A JPS61120596A (ja) | 1984-11-16 | 1984-11-16 | 電子交換機における信号制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24067384A JPS61120596A (ja) | 1984-11-16 | 1984-11-16 | 電子交換機における信号制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61120596A true JPS61120596A (ja) | 1986-06-07 |
Family
ID=17062998
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP24067384A Pending JPS61120596A (ja) | 1984-11-16 | 1984-11-16 | 電子交換機における信号制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61120596A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03117953A (ja) * | 1989-09-23 | 1991-05-20 | Electron & Telecommun Res Inst | 信号中継器二重化構造システム |
-
1984
- 1984-11-16 JP JP24067384A patent/JPS61120596A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03117953A (ja) * | 1989-09-23 | 1991-05-20 | Electron & Telecommun Res Inst | 信号中継器二重化構造システム |
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