JPS6218733U - - Google Patents

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JPS6218733U
JPS6218733U JP11041585U JP11041585U JPS6218733U JP S6218733 U JPS6218733 U JP S6218733U JP 11041585 U JP11041585 U JP 11041585U JP 11041585 U JP11041585 U JP 11041585U JP S6218733 U JPS6218733 U JP S6218733U
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output terminals
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【図面の簡単な説明】
第１図は本考案の一実施例を示す回路構成図、
第２図はタイミングチヤート図、第３図は従来例
の回路構成図である。 Ｓ１…電源スイツチ、Ｔ１…トランス、Ｑ１〜
Ｑ３…トランジスタ、Ｄ１〜Ｄ６…ダイオード、
ＤＢ…ブリツジダイオード、Ｒ１〜Ｒ１０…抵抗
、Ｃ１〜Ｃ５…コンデンサ、Ｐ１〜Ｐ２…定電圧
電源、Ａ１〜Ａ３…負論理出力端、Ｂ１〜Ｂ３…
正論理出力端、Ｈ１〜Ｈ３…負論理出力端、＋Ｂ
１，＋Ｂ２…電源電圧。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数の制御系を持ち、一方が正論理出力端に、
    他方が負論理出力端に接続されてなり、電源がオ
    ンの時、両出力端が同時にリセツトされ、電源が
    オフの時、両出力端が各別のタイミングでリセツ
    トされるように構成したことを特徴とするリセツ
    ト回路。
JP11041585U 1985-07-18 1985-07-18 Pending JPS6218733U (ja)

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JP11041585U JPS6218733U (ja) 1985-07-18 1985-07-18

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JP11041585U JPS6218733U (ja) 1985-07-18 1985-07-18

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JPS6218733U true JPS6218733U (ja) 1987-02-04

Family

ID=30989394

Family Applications (1)

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JP11041585U Pending JPS6218733U (ja) 1985-07-18 1985-07-18

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