JPS62187882A - 漢字キヤラクタジエネレ−タ - Google Patents
漢字キヤラクタジエネレ−タInfo
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- JPS62187882A JPS62187882A JP61031174A JP3117486A JPS62187882A JP S62187882 A JPS62187882 A JP S62187882A JP 61031174 A JP61031174 A JP 61031174A JP 3117486 A JP3117486 A JP 3117486A JP S62187882 A JPS62187882 A JP S62187882A
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- Dot-Matrix Printers And Others (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発ｎＡＩｒｒ漢字キャラクタジェネレータ、特に複数
個のマスクルＯＭからなる漢字キャラクタジェネレータ
セットを少なくとも２Ｍ有する漢字キャラクタジェネレ
ータに関する。
個のマスクルＯＭからなる漢字キャラクタジェネレータ
セットを少なくとも２Ｍ有する漢字キャラクタジェネレ
ータに関する。
（従来の技術）
従来、パターンジェネレータの一種でるる汐字キャラク
タジェネレータでは、多数の漢字と多数の漢字以外の文
字等のパターン″に発生するものが商用に供されている
。このＬつな漢字キャラクタジェネレータでは、一つの
漢字で数百ビットの記憶素子ケ漢字等の数の分必要とす
るので、それぞれ汎用マスクＲ（Ｊ Ｍかも作られ、パ
ターン全分担しｔ複数のマスク九〇Ｍｉ使用して、洩字
キャラフタジェネレータセットとしたもの金、更に複数
セット用いて一式の漢字キャラクタジェネレータとした
ものが多用されている。
タジェネレータでは、多数の漢字と多数の漢字以外の文
字等のパターン″に発生するものが商用に供されている
。このＬつな漢字キャラクタジェネレータでは、一つの
漢字で数百ビットの記憶素子ケ漢字等の数の分必要とす
るので、それぞれ汎用マスクＲ（Ｊ Ｍかも作られ、パ
ターン全分担しｔ複数のマスク九〇Ｍｉ使用して、洩字
キャラフタジェネレータセットとしたもの金、更に複数
セット用いて一式の漢字キャラクタジェネレータとした
ものが多用されている。
例えば８ピツ）Ｘ１３１．０７２語の汎用マスクル０Ｍ
金用いてＪＩＳ漢字の第１水準、第２水準お工びこの漢
字以外の複数の文字等を２４ドツト×２４ドツトのマト
リックスパターンとして記憶させているものでは、第１
セットとして上記の＠１水準の漢字お工び漢字以外の一
部の文字等に３個の汎用マスクＲＯＭ’ｉ使用し、第２
セットとして上記の第２水準の漢字おＬびその他の漢字
以外の文字等に更に３個の汎用マスクＲＯＭｖｉ−便用
している。この場合の記憶形式は、横方向スキャン方式
の場合には１文字の縦方向２４ドツト′に３等分し九谷
８ドツトに、１セット３個の汎用マスクルＯＭのそれぞ
れの１語の８ビットｔ−割当て、各汎用Ｗ スフＲＱ
Ｍ Ｏ１３１、０７２語を３２語ごとに区切２７ｔそれ
ぞれの４．０９６区画を文字アドレスとし、上記の３２
＃！の各語はスキャンアドレスにエフ指定され、３２！
ｌＦｉ中の若番２４語ｔ−１文字の横方向の２４ビツト
列に対応させている。従って２つのセットには最大８．
１９２の漢字等のパターンが記憶でき、このうちから１
個の漢字等のパターンを発生するには、第１か第２かの
セット指定と、４．０９６区画？区別する１２ビットＱ
文字アドレスと、３２語全５ビツトのスキャンアドレス
を用いて順次ＯＳから２３番までスキャンすることに１
９、指定され７ｔ パターンの縦２４ドツトに対応する
２４ビツトの出力として、このパターンの右端列から右
端列までの２４列分得られる。
金用いてＪＩＳ漢字の第１水準、第２水準お工びこの漢
字以外の複数の文字等を２４ドツト×２４ドツトのマト
リックスパターンとして記憶させているものでは、第１
セットとして上記の＠１水準の漢字お工び漢字以外の一
部の文字等に３個の汎用マスクＲＯＭ’ｉ使用し、第２
セットとして上記の第２水準の漢字おＬびその他の漢字
以外の文字等に更に３個の汎用マスクＲＯＭｖｉ−便用
している。この場合の記憶形式は、横方向スキャン方式
の場合には１文字の縦方向２４ドツト′に３等分し九谷
８ドツトに、１セット３個の汎用マスクルＯＭのそれぞ
れの１語の８ビットｔ−割当て、各汎用Ｗ スフＲＱ
Ｍ Ｏ１３１、０７２語を３２語ごとに区切２７ｔそれ
ぞれの４．０９６区画を文字アドレスとし、上記の３２
＃！の各語はスキャンアドレスにエフ指定され、３２！
ｌＦｉ中の若番２４語ｔ−１文字の横方向の２４ビツト
列に対応させている。従って２つのセットには最大８．
１９２の漢字等のパターンが記憶でき、このうちから１
個の漢字等のパターンを発生するには、第１か第２かの
セット指定と、４．０９６区画？区別する１２ビットＱ
文字アドレスと、３２語全５ビツトのスキャンアドレス
を用いて順次ＯＳから２３番までスキャンすることに１
９、指定され７ｔ パターンの縦２４ドツトに対応する
２４ビツトの出力として、このパターンの右端列から右
端列までの２４列分得られる。
（発明が解決し１つとする問題点）
しかしながら、上述の漢字キャラクタジェネレータは、
文字アドレスに対応した１区画かスキャンアドレスのｎ
ビットに対応する２ｎ飴、％えは２５語の３２晧から構
成されていて、２４列しか使用しない場合には８語分が
使われないま＼となる久廓全有している。本発明の目的
は上記の欠保全除去し、第１セットの未使用部分に第２
セットの−ｓ金使用することにエフ第２セットの汎用マ
スクルＯＭの数を削減できるメ字キャラクタジェネレー
タ會提供することにめる。
文字アドレスに対応した１区画かスキャンアドレスのｎ
ビットに対応する２ｎ飴、％えは２５語の３２晧から構
成されていて、２４列しか使用しない場合には８語分が
使われないま＼となる久廓全有している。本発明の目的
は上記の欠保全除去し、第１セットの未使用部分に第２
セットの−ｓ金使用することにエフ第２セットの汎用マ
スクルＯＭの数を削減できるメ字キャラクタジェネレー
タ會提供することにめる。
（問題点を解決するｔめの手段）
本発明は、文字アドレス金指定し、最大数２のスキャン
アドレス全スキャンすることに１９、複数個のマスクル
ＯＭより並列に出力されるＸビットのｙ （ｙ＜２ ）
回の出力でｘＸｙドツトのマトリックスパターンを出力
する漢字キャラクタジェネレータにおいて、第２の漢字
キャラクタジェネレータセットのスキャンアドレス信号
ｔ’ｙ＋ｉから２までのアドレス信号のうちの複数のア
ドレス信号の繰返しに変換して第１の漢字キャラクタジ
ェネレータセットのスキャンアドレスに与える変換手段
と、このスキャンアドレスか与えられて第１の漢字キャ
ラクタジェネレータセットから得られるＸビットの並列
出力を前記複数のアドレス４１７号の繰返しごとにマス
クＲＯＭ単位に選択して第２の漢字キャラクタジェネレ
ータセットの並列出力と同時に出力する選択手段とｔ−
有して構成される。
アドレス全スキャンすることに１９、複数個のマスクル
ＯＭより並列に出力されるＸビットのｙ （ｙ＜２ ）
回の出力でｘＸｙドツトのマトリックスパターンを出力
する漢字キャラクタジェネレータにおいて、第２の漢字
キャラクタジェネレータセットのスキャンアドレス信号
ｔ’ｙ＋ｉから２までのアドレス信号のうちの複数のア
ドレス信号の繰返しに変換して第１の漢字キャラクタジ
ェネレータセットのスキャンアドレスに与える変換手段
と、このスキャンアドレスか与えられて第１の漢字キャ
ラクタジェネレータセットから得られるＸビットの並列
出力を前記複数のアドレス４１７号の繰返しごとにマス
クＲＯＭ単位に選択して第２の漢字キャラクタジェネレ
ータセットの並列出力と同時に出力する選択手段とｔ−
有して構成される。
この構成においてｘｘ（ｚ−ｙ）が、１つの漢字パター
ンについて１つのマスクＲＯＭ上に占るドツト数より大
きいか同じ場合には、従来第２の漢字キャラクタジェネ
レータセットの複数のマスクＲ（ＪＭのうちの一つに記
憶される各文字アドレスのパターンを、第１の漢字キャ
ラクタジェネレータの同じ文字アドレスの複数のマスク
ＲＯＭの未使用部分に分割して記憶しておくことにより
、第２の漢字キャラクタジェネレータセットの読出しに
は第１の漢字キャラクタジェネレータセットに分割記憶
し九部分も読出されて、１つの漢字パターンとすること
になり、従来の第２の漢字キャラクタ−ジェネレータセ
ットに用い九複数のマスクル（ＪＭのうちの１個金削減
できる。
ンについて１つのマスクＲＯＭ上に占るドツト数より大
きいか同じ場合には、従来第２の漢字キャラクタジェネ
レータセットの複数のマスクＲ（ＪＭのうちの一つに記
憶される各文字アドレスのパターンを、第１の漢字キャ
ラクタジェネレータの同じ文字アドレスの複数のマスク
ＲＯＭの未使用部分に分割して記憶しておくことにより
、第２の漢字キャラクタジェネレータセットの読出しに
は第１の漢字キャラクタジェネレータセットに分割記憶
し九部分も読出されて、１つの漢字パターンとすること
になり、従来の第２の漢字キャラクタ−ジェネレータセ
ットに用い九複数のマスクル（ＪＭのうちの１個金削減
できる。
（実７Ｍ例）
以下、不発明の実施例について図面全参照して詳細に説
明する。
明する。
第１因は本発明の一実施例のブロック図で、８ビツトＸ
１３１，０７２語のマスク１（１０Ｍ１５個使用して
、２４ドツト×２４ドツトで表現した最大８．１９２８
の漢字等のマトリックスパターン全山力する漢字キャラ
クタジェネレータの場合金示している。この漢字キャラ
クタジェネレータは第１の漢字キャラクタジェネレータ
セット（以下ＣＧ５１）１と、第２の漢字キャラクタジ
ェネレータセット（以下ＣＧ ８ｚ） ２と、スキャン
アドレス信号ＯＫ換回路（以下Ｃ０ＮＶ）３ と、ＣＧ
３１１ ＞ Ｌ ヒＣＧ５２２の出力の切替回路（以下
８Ｗ）５とから構成されている。さらにＣＧ３１１は３
個のマスクＲＯＭ（以下Ｒ＋０Ｍ１１ 、凡０Ｍ１２お
工ひ凡ＯＭｔｓ） １１ 。
１３１，０７２語のマスク１（１０Ｍ１５個使用して
、２４ドツト×２４ドツトで表現した最大８．１９２８
の漢字等のマトリックスパターン全山力する漢字キャラ
クタジェネレータの場合金示している。この漢字キャラ
クタジェネレータは第１の漢字キャラクタジェネレータ
セット（以下ＣＧ５１）１と、第２の漢字キャラクタジ
ェネレータセット（以下ＣＧ ８ｚ） ２と、スキャン
アドレス信号ＯＫ換回路（以下Ｃ０ＮＶ）３ と、ＣＧ
３１１ ＞ Ｌ ヒＣＧ５２２の出力の切替回路（以下
８Ｗ）５とから構成されている。さらにＣＧ３１１は３
個のマスクＲＯＭ（以下Ｒ＋０Ｍ１１ 、凡０Ｍ１２お
工ひ凡ＯＭｔｓ） １１ 。
１２お工び１３からなり、ＣＯ２，２は２個のマスクＲ
ＯＭ （以下ＲＯＭＨオＪ：ヒＲＯＭ２ｚ） ２１ ｋ
Ｌ Ｕ２２で構成されている。この構成において、５
個のマスクＲＯＭのそれぞれの１２個の文字アドレス端
子ＣＡ、 −ｙ ＣＡｌ１には、同一の文字アドレスが
与えられるよう接続されている。ま［ＣＯ２，１の３個
のマスク凡ＯＭのそれぞれの５個のスキャンアドレス１
子Ｓ、 ％８４には、５個のスキャンアト１／ス入力端
子Ｓ Ａ６−８ Ａ５からＣ０ＮＶ ３ ’（（介して
、スキャンアドレスが与えられていて、切替信号ＳＷＳ
が与えられていない（１０”）ときはＳＡｏ 〜ＳＡ、
の信号はそのま＼Ｓｏ％Ｓ４に与えられるが、切替
信号ＳＷ８が与えられ九（“ｌ”）ときは、ＳＡＧ〜Ｓ
Ａ２の信号はそのま＼８ｏ−ｓ−８２に与えられ、ＳＡ
３とＳＡ４は常に１１”信号が与えられる。なおＣＧ５
２２の２個のマスクＲ（ＪＭのそれぞれの５個のスキャ
ンアドレス潮干５ＯＳ−８４には、５個のスキャンアド
レス入力端子ＳＡ６ ％ ＳＡ４ の信号がそのま＼与
えられる接続となっている。また５ＥＬ４には切替信号
ＳＷ’ｄとスキャンアドレス端子ＳＡ３ 、！： ＳＡ
４のスキャンアドレスイキ号が与えられていて、ＳＥＩ
、４は切替信号が１１”のと８は ＳＡ３゜８Ａ４の信
号が−００９ならＲＯＭ１１１１ ｋｓ −１０”なら
凡ＯＭｘｚ １２會、１０１”なら凡０Ｍ１３１３のそ
れぞれ８ビツトの出力全選択して出力するが、切替信号
ＳＷ８か１０”のと＠はル０Ｍ１３１３の出力のみ音出
力する。さらにまたＳＷＳは、切替信号ＳＷ８が与えら
れていないと＠は凡（ＪＭｌｌｌｌ の８ビツトのそ
れぞれの出力を出力端子Ｏｏ 〜Ｏｒに、ＲＯＭｔｚ
１２の８ビツトのそれぞれの出力全出力端子０８〜Ｏ１
ｓに従続し、切替信号８Ｗ８が与えられるとル０Ｍ２１
２１の８ビツトのそれぞれの出力全出力端子Ｏｏ〜０７
に、ルＯＭ、□ｎの８ビツトのそれぞれの出力を出力端
子０８〜ＯｔＳに接続する。なおＳＥＬ、の８ビツトの
出力は常にそれぞれ出力端子０１６〜ＯＳＳに接続され
ている。
ＯＭ （以下ＲＯＭＨオＪ：ヒＲＯＭ２ｚ） ２１ ｋ
Ｌ Ｕ２２で構成されている。この構成において、５
個のマスクＲＯＭのそれぞれの１２個の文字アドレス端
子ＣＡ、 −ｙ ＣＡｌ１には、同一の文字アドレスが
与えられるよう接続されている。ま［ＣＯ２，１の３個
のマスク凡ＯＭのそれぞれの５個のスキャンアドレス１
子Ｓ、 ％８４には、５個のスキャンアト１／ス入力端
子Ｓ Ａ６−８ Ａ５からＣ０ＮＶ ３ ’（（介して
、スキャンアドレスが与えられていて、切替信号ＳＷＳ
が与えられていない（１０”）ときはＳＡｏ 〜ＳＡ、
の信号はそのま＼Ｓｏ％Ｓ４に与えられるが、切替
信号ＳＷ８が与えられ九（“ｌ”）ときは、ＳＡＧ〜Ｓ
Ａ２の信号はそのま＼８ｏ−ｓ−８２に与えられ、ＳＡ
３とＳＡ４は常に１１”信号が与えられる。なおＣＧ５
２２の２個のマスクＲ（ＪＭのそれぞれの５個のスキャ
ンアドレス潮干５ＯＳ−８４には、５個のスキャンアド
レス入力端子ＳＡ６ ％ ＳＡ４ の信号がそのま＼与
えられる接続となっている。また５ＥＬ４には切替信号
ＳＷ’ｄとスキャンアドレス端子ＳＡ３ 、！： ＳＡ
４のスキャンアドレスイキ号が与えられていて、ＳＥＩ
、４は切替信号が１１”のと８は ＳＡ３゜８Ａ４の信
号が−００９ならＲＯＭ１１１１ ｋｓ −１０”なら
凡ＯＭｘｚ １２會、１０１”なら凡０Ｍ１３１３のそ
れぞれ８ビツトの出力全選択して出力するが、切替信号
ＳＷ８か１０”のと＠はル０Ｍ１３１３の出力のみ音出
力する。さらにまたＳＷＳは、切替信号ＳＷ８が与えら
れていないと＠は凡（ＪＭｌｌｌｌ の８ビツトのそ
れぞれの出力を出力端子Ｏｏ 〜Ｏｒに、ＲＯＭｔｚ
１２の８ビツトのそれぞれの出力全出力端子０８〜Ｏ１
ｓに従続し、切替信号８Ｗ８が与えられるとル０Ｍ２１
２１の８ビツトのそれぞれの出力全出力端子Ｏｏ〜０７
に、ルＯＭ、□ｎの８ビツトのそれぞれの出力を出力端
子０８〜ＯｔＳに接続する。なおＳＥＬ、の８ビツトの
出力は常にそれぞれ出力端子０１６〜ＯＳＳに接続され
ている。
第２因は第１図のＣ０ＮＶ３の一実施例で、スキャンア
ドレス鴻子Ｓ３お工びＳ４には、切替信号ＳＷＳが与え
られて１１゛となっていると＠は論理積回路ＯＲ１お工
びＯａ２に介して、共に＠ｌ”が与えられ、ＳＷＳが１
０”であるときはそれぞれ８Ａ３お工びＳＡ４の信号が
そのま＼与えられる構成となっている。
ドレス鴻子Ｓ３お工びＳ４には、切替信号ＳＷＳが与え
られて１１゛となっていると＠は論理積回路ＯＲ１お工
びＯａ２に介して、共に＠ｌ”が与えられ、ＳＷＳが１
０”であるときはそれぞれ８Ａ３お工びＳＡ４の信号が
そのま＼与えられる構成となっている。
第３図は第１図のＳＥＩ、４の一実施例で、切替信号Ｆ
ＳＷ８とスキャンアドレス信号金入力とする制御回路（
以下ＣＵＮＴ ） ４１と％ＣＵＮＴ ４１の選択信号
にエフＲＯＭｔ１１１ 、 ＲＯＭ１□１２．凡（ＪＭ
１３１３のそれぞれの８ビツトの出力を切替えて送出す
るゲート回路（以下ＧＡ）４２とから構成されている。
ＳＷ８とスキャンアドレス信号金入力とする制御回路（
以下ＣＵＮＴ ） ４１と％ＣＵＮＴ ４１の選択信号
にエフＲＯＭｔ１１１ 、 ＲＯＭ１□１２．凡（ＪＭ
１３１３のそれぞれの８ビツトの出力を切替えて送出す
るゲート回路（以下ＧＡ）４２とから構成されている。
Ｃ（ＪＮＴ ４１は組合せ回路でＳＷＳ 、 ８Ａ３
、 ＳＡ４のそれぞれの信号が−１０００のと＠はＲＯ
Ｍｌｌ １１の、１１１０″のと＠は凡０Ｍ１２１２の
Ｍｌ０１”ま几は−０−一”のときはＩ（＋ ＯＭｌ。
、 ＳＡ４のそれぞれの信号が−１０００のと＠はＲＯ
Ｍｌｌ １１の、１１１０″のと＠は凡０Ｍ１２１２の
Ｍｌ０１”ま几は−０−一”のときはＩ（＋ ＯＭｌ。
１３の出力の選択信号全発生する。
第４図は第１図のＣＧＳＩＩの１つの文字アドレスに記
憶されているパターン表現図で、第５図は第１図のＣＯ
２，２の第４図の文字アドレスと同じ文字アドレスに記
憶されているパターン表現図でめる。第４因は、１つの
文字アドレスで必要とする２４ドツト×２４ドツトのパ
ターンを、パターンの上から１／３をＲＵＭ口１１に、
中間のし３＠：凡ＯＭｔｚ１２に、下のし３金Ｒ（Ｊ
Ｍｌ３１３に分担させ、それぞれ同じ文字アドレスの１
語８ビツトからなるスキャンアドレスのＯ査から２３査
に記憶されていて、さらにスキャンアドレスの２４番か
ら３１番までの８＠には、第５図で点線で示された従来
の方法では第３個目のマスク１（、ＯＭに記憶される部
分が、８語づつに分断されて順次凡ＯＭ１□１１．ＲＵ
Ｍ１□１２．几ＵＭｘ３１３に記憶されていることを示
している。また第５因は、１つの文字で必要とする２４
ドツト×２４ドツトのパターン金、上からし３全几（Ｊ
Ｍ２１２１に、中間１／３全凡０Ｍ２２２２に分和させ
て記憶し、上述のごとく下し３はＣＧ５２２には記憶し
てないこと金示している。なおこのパターンの記憶方法
はＣＧ５５１とｅＧｓ２２１Ｚ）同一の文字アドレスの
総てについて実施される。
憶されているパターン表現図で、第５図は第１図のＣＯ
２，２の第４図の文字アドレスと同じ文字アドレスに記
憶されているパターン表現図でめる。第４因は、１つの
文字アドレスで必要とする２４ドツト×２４ドツトのパ
ターンを、パターンの上から１／３をＲＵＭ口１１に、
中間のし３＠：凡ＯＭｔｚ１２に、下のし３金Ｒ（Ｊ
Ｍｌ３１３に分担させ、それぞれ同じ文字アドレスの１
語８ビツトからなるスキャンアドレスのＯ査から２３査
に記憶されていて、さらにスキャンアドレスの２４番か
ら３１番までの８＠には、第５図で点線で示された従来
の方法では第３個目のマスク１（、ＯＭに記憶される部
分が、８語づつに分断されて順次凡ＯＭ１□１１．ＲＵ
Ｍ１□１２．几ＵＭｘ３１３に記憶されていることを示
している。また第５因は、１つの文字で必要とする２４
ドツト×２４ドツトのパターン金、上からし３全几（Ｊ
Ｍ２１２１に、中間１／３全凡０Ｍ２２２２に分和させ
て記憶し、上述のごとく下し３はＣＧ５２２には記憶し
てないこと金示している。なおこのパターンの記憶方法
はＣＧ５５１とｅＧｓ２２１Ｚ）同一の文字アドレスの
総てについて実施される。
以下第１図の動作について説明？進めると、切替信号Ｓ
ＷＳが与えられていなく（′０”）、文字アドレス端子
ＣＡｏ〜ＣＡｌ、にアドレス信号金与えて、１つ文字ア
ドレス金指定し、スキャンアドレス端子５Ａｏ−ｓＡ４
に１１１１次スキャンアドレ全与えると、ＣＧ３１１の
１つの文字アドレスが指定され、 Ｃ（ＪＮＶ３は上述
のごと（ＳＡ、〜ＳＡ ４に与えられｔ信号音そのま＼
ＣＧ３１１のマスクＲＯＭのＳｏ”へ端子に与えるので
、ＣＧＳ、１のスキャンアドレスは０番から２３１１ま
でスキャンされて、ｅＧｓｌｌの几ＯＭＩＩ １１．凡
Ｕ Ｍｘｚ １２ ＊ ＲＯＭ１３１３の出力音そのま
＼出力し、まｙｔ Ｓ Ｗ ５は出力端子Ｏ０〜（ｈｓ
全ＣＧＳｘ １ ｌＩｔに切替えているので、上記の
ＣＧ５１１からの出力が出力端子Ｏｏ〜Ｏｎから得られ
る。次に切替信号ＳＷＳが与えられ（′１°）で。
ＷＳが与えられていなく（′０”）、文字アドレス端子
ＣＡｏ〜ＣＡｌ、にアドレス信号金与えて、１つ文字ア
ドレス金指定し、スキャンアドレス端子５Ａｏ−ｓＡ４
に１１１１次スキャンアドレ全与えると、ＣＧ３１１の
１つの文字アドレスが指定され、 Ｃ（ＪＮＶ３は上述
のごと（ＳＡ、〜ＳＡ ４に与えられｔ信号音そのま＼
ＣＧ３１１のマスクＲＯＭのＳｏ”へ端子に与えるので
、ＣＧＳ、１のスキャンアドレスは０番から２３１１ま
でスキャンされて、ｅＧｓｌｌの几ＯＭＩＩ １１．凡
Ｕ Ｍｘｚ １２ ＊ ＲＯＭ１３１３の出力音そのま
＼出力し、まｙｔ Ｓ Ｗ ５は出力端子Ｏ０〜（ｈｓ
全ＣＧＳｘ １ ｌＩｔに切替えているので、上記の
ＣＧ５１１からの出力が出力端子Ｏｏ〜Ｏｎから得られ
る。次に切替信号ＳＷＳが与えられ（′１°）で。
文字アドレス端子ＣＡＯ”％−ＣＡＩｍにアドレス信号
？与えて、スキャンアドレス端子Ｓ Ａ ６〜Ｓ Ａ
４に順次スキャンアドレス金与えると、ＣＧ５１１とＣ
Ｇ３２２ との両方に同じ文字アドレスが与えられて、
ＣＧ５２２にはＳＡｏ％ＳＡ４に与えられたスキャンア
ドレスがそのま＼与えられるが、Ｃ（１，２にはＣ０Ｎ
Ｖ３ ？介して上位２ビツトが帯にｌ”に変換された信
号が与えられるので、ＳＡＯ〜８Ａ４に１９スキヤンア
ドレスが０番から２３番に順次変えられると％Ｃ０ＮＶ
３からはスキャンアドレスム番から３１番の繰返し信号
が与えられることになる。ま几この繰返しに従つて、！
（Ｅｌ、４は九〇Ｍｌ。
？与えて、スキャンアドレス端子Ｓ Ａ ６〜Ｓ Ａ
４に順次スキャンアドレス金与えると、ＣＧ５１１とＣ
Ｇ３２２ との両方に同じ文字アドレスが与えられて、
ＣＧ５２２にはＳＡｏ％ＳＡ４に与えられたスキャンア
ドレスがそのま＼与えられるが、Ｃ（１，２にはＣ０Ｎ
Ｖ３ ？介して上位２ビツトが帯にｌ”に変換された信
号が与えられるので、ＳＡＯ〜８Ａ４に１９スキヤンア
ドレスが０番から２３番に順次変えられると％Ｃ０ＮＶ
３からはスキャンアドレスム番から３１番の繰返し信号
が与えられることになる。ま几この繰返しに従つて、！
（Ｅｌ、４は九〇Ｍｌ。
１１．１も０Ｍ１２１２．ル０Ｍ１ｓ １３と切替逆絖
會行なうので、ＣＧＳ、２からは第５図に示し九エウに
パターンの上２／３の出力ピッ）金、８Ｅｌｉ４からは
ＲＯＭ！１１１のスキャンアドレス２４番から３１番の
出力ビットに続いて、ル（７Ｍ１２１２ 、 Ｈ。
會行なうので、ＣＧＳ、２からは第５図に示し九エウに
パターンの上２／３の出力ピッ）金、８Ｅｌｉ４からは
ＲＯＭ！１１１のスキャンアドレス２４番から３１番の
出力ビットに続いて、ル（７Ｍ１２１２ 、 Ｈ。
０Ｍ１３１３からも逐次同様に出力ビット金出力する。
コのと＠８Ｗ５は出力端子Ｏｏ〜０ｘｓｔ” ＣＧＳｚ
２１１１１に切替えているので、出力端子ＯＧ〜０２３
から第５図に示す点線部分を含んだパターンの出力が得
られる。
２１１１１に切替えているので、出力端子ＯＧ〜０２３
から第５図に示す点線部分を含んだパターンの出力が得
られる。
なお以上の実施例では漢字キャラクタジェネレータセッ
トが２組の場合全示し友が、２組以上の偶数セットであ
ればそれぞれについて適用できることは明らかである。
トが２組の場合全示し友が、２組以上の偶数セットであ
ればそれぞれについて適用できることは明らかである。
まｔ以上の実施例では従来第２の漢字キャラクタジェネ
レータの第３香のマスクＲＯＭに記憶されていたパター
ンドツトと、第１の漢字キャラクタジェネレータの余剰
のドツトとが同じである場合を示したが、余剰のドツト
が多い場合には適用できることは明らかである。
レータの第３香のマスクＲＯＭに記憶されていたパター
ンドツトと、第１の漢字キャラクタジェネレータの余剰
のドツトとが同じである場合を示したが、余剰のドツト
が多い場合には適用できることは明らかである。
さらにま友、以上の実施例ではスキャンアドレスの変換
回路および出力ビットの選択回路？論理回路で構成し几
場合を示したが、作れもプログラム制御に工って行なっ
ても一同に拘はない。
回路および出力ビットの選択回路？論理回路で構成し几
場合を示したが、作れもプログラム制御に工って行なっ
ても一同に拘はない。
（発明の効果）
以上詳細に説明したとおり、本発明は催かな回路全付加
することにエリ、余剰の記憶素子ｔＶ効に利用できて、
マスクＲＯＭの数を削減できると云う効果かめる。
することにエリ、余剰の記憶素子ｔＶ効に利用できて、
マスクＲＯＭの数を削減できると云う効果かめる。
第１因は本発明の一実施例のブロック図、第２図のマス
クＲＯＭの１つの文字アドレスに記憶されているパター
ン表現図である。 １・・・第１の漢字キャラクタジェネレータセット（Ｃ
ＧＳ １ ）、２・・・第２の漢字キャラクタジェネレ
ータセット（■８２）、３・・・変換回路（ｅ（ＪＮＶ
）、４・・・選択回路（ＳＥＬ）、５・・・切替回路
（ＳＷ）、１１，１２．１３゜２１．２２・・・マスク
ル（ＪＭ（ルＯＭ１．．凡（７Ｍ１２゜ルＯＭ工３ 、
ＲＯＭ２１ 、 ＲＯＩ！ｖｈｚ）。 卒 ｌ 図 屏３ 図 第４ 面 第Ｓ 図
クＲＯＭの１つの文字アドレスに記憶されているパター
ン表現図である。 １・・・第１の漢字キャラクタジェネレータセット（Ｃ
ＧＳ １ ）、２・・・第２の漢字キャラクタジェネレ
ータセット（■８２）、３・・・変換回路（ｅ（ＪＮＶ
）、４・・・選択回路（ＳＥＬ）、５・・・切替回路
（ＳＷ）、１１，１２．１３゜２１．２２・・・マスク
ル（ＪＭ（ルＯＭ１．．凡（７Ｍ１２゜ルＯＭ工３ 、
ＲＯＭ２１ 、 ＲＯＩ！ｖｈｚ）。 卒 ｌ 図 屏３ 図 第４ 面 第Ｓ 図
Claims (1)
- 文字アドレスを指定し、最大数Ｚのスキャンアドレスを
スキャンすることにより、複数個のマスクＲＯＭより並
列に出力されるｘビットのｙ（ｙ＜ｚ）回の出力でｘ×
ｙドットのマトリックスパターンを出力する漢字キャラ
クタジェネレータセットを少なくとも２セット有する漢
字キャラクタジェネレータにおいて、第２の漢字キャラ
クタジェネレータセットのスキャンアドレス信号をｙ＋
１からｚまでのアドレス信号のうちの複数のアドレス信
号の繰返しに変換して第１の漢字キャラクタジェネレー
タセットのスキャンアドレスに与える変換手段と、この
スキャンアドレスが与えられて第１の漢字キャラクタジ
ェネレータセットから得られるｘビットの並列出力を前
記複数のアドレス信号の繰返しごとにマスクＲＯＭ単位
に選択して第２の漢字キャラクタジェネレータセットの
並列出力と同時に出力する選択手段とを有することを特
徴とする漢字キャラクタジェネレータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61031174A JPH0711748B2 (ja) | 1986-02-14 | 1986-02-14 | 漢字キヤラクタジエネレ−タ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61031174A JPH0711748B2 (ja) | 1986-02-14 | 1986-02-14 | 漢字キヤラクタジエネレ−タ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62187882A true JPS62187882A (ja) | 1987-08-17 |
| JPH0711748B2 JPH0711748B2 (ja) | 1995-02-08 |
Family
ID=12324076
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61031174A Expired - Fee Related JPH0711748B2 (ja) | 1986-02-14 | 1986-02-14 | 漢字キヤラクタジエネレ−タ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0711748B2 (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61272782A (ja) * | 1985-05-28 | 1986-12-03 | 沖電気工業株式会社 | キヤラクタジエネレ−タ |
-
1986
- 1986-02-14 JP JP61031174A patent/JPH0711748B2/ja not_active Expired - Fee Related
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61272782A (ja) * | 1985-05-28 | 1986-12-03 | 沖電気工業株式会社 | キヤラクタジエネレ−タ |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0711748B2 (ja) | 1995-02-08 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |