JPS62201087A - ブラシレスｄｃモ−タの速度制御装置 - Google Patents
ブラシレスｄｃモ−タの速度制御装置Info
- Publication number
- JPS62201087A JPS62201087A JP61041456A JP4145686A JPS62201087A JP S62201087 A JPS62201087 A JP S62201087A JP 61041456 A JP61041456 A JP 61041456A JP 4145686 A JP4145686 A JP 4145686A JP S62201087 A JPS62201087 A JP S62201087A
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- JP
- Japan
- Prior art keywords
- motor
- brushless
- pwm signal
- input
- circuit
- Prior art date
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- Pending
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- Control Of Motors That Do Not Use Commutators (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（技術分野）
本発明は目標値（速度）がステップ状の目標入力に追従
するブラシレスＤＣモータの速度制御装置に関する。こ
の種ブラシレスＤＣモータは例えば複写機の光学系駆動
装置に通用される。
するブラシレスＤＣモータの速度制御装置に関する。こ
の種ブラシレスＤＣモータは例えば複写機の光学系駆動
装置に通用される。
（従来技術）
第４図は一般的なブラシレスＤＣモータの速度制御装置
のブロック図である。
のブロック図である。
１はＰＷＭ （パルス幅変調）信号発生回路と信号処理
回路と増巾回路であり、この部分については後に説明す
る。
回路と増巾回路であり、この部分については後に説明す
る。
Ｕｒは目標入力でステップ状の電圧、ＳＷＩはスイッチ
、２はオペアンプで作った比較回路、３はオペアンプで
作った積分器、４．９．１０は最適レギュレータのフィ
ードバックゲインで本システムを安全に制御するもので
ある。５はオペアンプで作った比較回路、６のブロック
のＳはラプラス演算子、ＬはブラシレスＤＣモータのイ
ンダクタンス、ＲはブラシレスＤＣモータの抵抗である
。
、２はオペアンプで作った比較回路、３はオペアンプで
作った積分器、４．９．１０は最適レギュレータのフィ
ードバックゲインで本システムを安全に制御するもので
ある。５はオペアンプで作った比較回路、６のブロック
のＳはラプラス演算子、ＬはブラシレスＤＣモータのイ
ンダクタンス、ＲはブラシレスＤＣモータの抵抗である
。
７のブロックのにアはブラシレスＤＣモータのトルク定
数、ＪはブラシレスＤＣモータの回転子のイナーシャと
負荷のイナーシャの合成したものである。８のブロック
のに、はＦ／Ｖ変換器（ここでは特に述べていないが、
モータの回転速度を検出するエンコーダの信号を電圧に
変換する）、Ｔ、はローパスフィルターの時定数である
。ωはモータの速度、Ｖ、はＰＷＭ信号発生回路に入る
制御信号、■、はブラシレスＤＣモータの入力電圧、Ｖ
ｆはＦ／Ｖ変換器の出力電圧である。
数、ＪはブラシレスＤＣモータの回転子のイナーシャと
負荷のイナーシャの合成したものである。８のブロック
のに、はＦ／Ｖ変換器（ここでは特に述べていないが、
モータの回転速度を検出するエンコーダの信号を電圧に
変換する）、Ｔ、はローパスフィルターの時定数である
。ωはモータの速度、Ｖ、はＰＷＭ信号発生回路に入る
制御信号、■、はブラシレスＤＣモータの入力電圧、Ｖ
ｆはＦ／Ｖ変換器の出力電圧である。
ブロック１で示す部分の内、ＰＷＭ信号発生回路は制御
入力ＶＣを入力する部分と、この■、に基づいてＰＷＭ
信号を発生する部分からなる。また信号処理回路はブラ
シレスＤＣモータに取り付けられた位置検出器の出力に
よりブラシレスＤＣモータのコイルに流す電流を切り換
えるものである。
入力ＶＣを入力する部分と、この■、に基づいてＰＷＭ
信号を発生する部分からなる。また信号処理回路はブラ
シレスＤＣモータに取り付けられた位置検出器の出力に
よりブラシレスＤＣモータのコイルに流す電流を切り換
えるものである。
また増巾回路は信号処理回路の出力とＰＷＭ信号を増巾
するものである。そしてこの増巾された電圧はブラシレ
スＤＣモータの入力電圧ｖ１というごとになる。
するものである。そしてこの増巾された電圧はブラシレ
スＤＣモータの入力電圧ｖ１というごとになる。
第５図は上述したＳＷｌ、ＳＷ２．Ｖｃ （Ｖ、。
）、ωの関係を示すタイムチャートである。
ＳＷＩ、ＳＷ２をオンするとＶＣは増えるが、モータは
摩擦トルクやモータインダクタンスの影響で、モータが
起動するまでの時間であるも３時間立ってから起動する
。その時Ｖｅはフィードバック信号（第４図の９．１０
．８の出力）がないため急激に増え、モータに与えるの
でオーバーシュートが大きくなり、モータが目標値に落
ち着く時間であるｔ２の時間が非常に長くなる。
摩擦トルクやモータインダクタンスの影響で、モータが
起動するまでの時間であるも３時間立ってから起動する
。その時Ｖｅはフィードバック信号（第４図の９．１０
．８の出力）がないため急激に増え、モータに与えるの
でオーバーシュートが大きくなり、モータが目標値に落
ち着く時間であるｔ２の時間が非常に長くなる。
（目的）
本発明はこの様な背景に基づいてなされたものであり、
目標値（速度）がステップ状の目標入力に追従するブラ
シレスＤＣモータの速度制御装置において、オーバーシ
ュートを少なくし、整定時間を短くするごとの出来る速
度制御装置を提供することを目的とする。
目標値（速度）がステップ状の目標入力に追従するブラ
シレスＤＣモータの速度制御装置において、オーバーシ
ュートを少なくし、整定時間を短くするごとの出来る速
度制御装置を提供することを目的とする。
（構成）
この目的を達成するために本発明は、前述のＰＷＭ信号
発生回路は、前記制御人力の他に、バイアス電圧を入力
して前記制御入力と前記バイアス電圧を加算してＰ Ｗ
Ｍ信号を発生させることを特徴とするものである。
発生回路は、前記制御人力の他に、バイアス電圧を入力
して前記制御入力と前記バイアス電圧を加算してＰ Ｗ
Ｍ信号を発生させることを特徴とするものである。
以下、本発明の一実施例を図面に基づき説明する。
第１図は本発明の一実施例に係るＰＷＭ信号発生回路と
信号処理回路と増巾回路を示すものであり、第４図のブ
ロック１部分に相当する。
信号処理回路と増巾回路を示すものであり、第４図のブ
ロック１部分に相当する。
図において、１１はＰＷＭ信号発生回路で１１−２の制
御人力Ｖ、を入力する部分と、１１−３のバイアス電圧
■８を入力する部分と、１１−１のＶＣとＶ８を加算し
てＰＷＭ信号を発生する部分からなる。１２は信号処理
回路で、ブラシレスＤＣモータに取り付けられた位置検
出器の出力（Ｈ，、Ｈｂ、Ｈｃ）によりブラシレスＤＣ
モータのコイル（第２図のり、、Ｌｂ、Ｌｃ）に流す電
流を切り換えるものである。１３は増１１回路で１２の
信号処理回路の出力とＰＷＭ信号を増巾するものである
。
御人力Ｖ、を入力する部分と、１１−３のバイアス電圧
■８を入力する部分と、１１−１のＶＣとＶ８を加算し
てＰＷＭ信号を発生する部分からなる。１２は信号処理
回路で、ブラシレスＤＣモータに取り付けられた位置検
出器の出力（Ｈ，、Ｈｂ、Ｈｃ）によりブラシレスＤＣ
モータのコイル（第２図のり、、Ｌｂ、Ｌｃ）に流す電
流を切り換えるものである。１３は増１１回路で１２の
信号処理回路の出力とＰＷＭ信号を増巾するものである
。
第２図はブラシレスＤＣモータのコイルの配線を示した
ものである。
ものである。
第３図は本発明のタイムチャートを示す。
■１は実際にはＰＷＭ信号であるが、ここでは分かり易
いためにアナログ電圧に置き換えている。
いためにアナログ電圧に置き換えている。
Ｌｌはモータが起動するまでの時間、ｔ２はモータが目
標値に落ち着く時間（整定時間）である。
標値に落ち着く時間（整定時間）である。
ＳＷ２をオンすると、第１図の■８があるためモータに
はＶ、が与えられる。そしてＳＷＩをオンすると、■、
と■８を加算した電圧の■。がモータに与えられる。モ
ータの速度ωは図のような波形になる。
はＶ、が与えられる。そしてＳＷＩをオンすると、■、
と■８を加算した電圧の■。がモータに与えられる。モ
ータの速度ωは図のような波形になる。
この図から明らかなように、本発明では、制御人力Ｖ、
にバイアス電圧■イを加算した電圧Ｖ１がモータに与え
られるようにしたから、オーバシュートは少なくなり、
また整定時間も短くなる。
にバイアス電圧■イを加算した電圧Ｖ１がモータに与え
られるようにしたから、オーバシュートは少なくなり、
また整定時間も短くなる。
（効果）
本発明は以上述べた通りのものであり、本発明に係るブ
ラシレスＤＣモータの速度制御装置によれば （１１目標値に対して偏差が無い速度制御ができる。
ラシレスＤＣモータの速度制御装置によれば （１１目標値に対して偏差が無い速度制御ができる。
（２）オーバーシュートを減らして整定時間を短くする
。
。
等の効果を奏する。
第１図は本発明の速度制御装置の要部を示す回路図、第
２図はモータコイルを示す図、第３図は本発明に係る各
部のタイミングチャート、第４図は一般的な速度制御装
置全体のブロック図、第５図は従来例に係る各部のタイ
ミングチャートである。 １１・・・ＰＷＭ信号発生回路、１２・・・信号処理回
路、１３・・・増巾回路、■、・・・制御入力、■つ・
・・バイアス電圧。 第１図 第３図 第４図 第５Ｌち
２図はモータコイルを示す図、第３図は本発明に係る各
部のタイミングチャート、第４図は一般的な速度制御装
置全体のブロック図、第５図は従来例に係る各部のタイ
ミングチャートである。 １１・・・ＰＷＭ信号発生回路、１２・・・信号処理回
路、１３・・・増巾回路、■、・・・制御入力、■つ・
・・バイアス電圧。 第１図 第３図 第４図 第５Ｌち
Claims (2)
- （１）目標値がステップ状の目標入力に追従する最適レ
ギュレータで構成された制御回路と、前記制御回路の制
御入力を周波数変調するＰＷＭ信号発生回路と、ブラシ
レスＤＣモータの励磁を切り換える信号処理回路と、前
記信号処理回路の励磁切り換え出力と、前記ＰＷＭ信号
発生回路の出力を増巾し、ブラシレスＤＣモータのコイ
ルに供給する増巾回路からなる、ブラシレスＤＣモータ
の速度制御装置において、前記ＰＷＭ信号発生回路は、
前記制御入力の他に、バイアス電圧を入力して前記制御
入力と前記バイアス電圧を加算してＰＷＭ信号を発生さ
せることを特徴とするブラシレスＤＣモータの速度制御
装置。 - （２）前記信号処理回路の励磁切り換え出力と前記ブラ
シレスＤＣモータのコイルを導通し、同時または遅れて
から目標値を入力することを特徴とするブラシレスＤＣ
モータの速度制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61041456A JPS62201087A (ja) | 1986-02-28 | 1986-02-28 | ブラシレスｄｃモ−タの速度制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61041456A JPS62201087A (ja) | 1986-02-28 | 1986-02-28 | ブラシレスｄｃモ−タの速度制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62201087A true JPS62201087A (ja) | 1987-09-04 |
Family
ID=12608874
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61041456A Pending JPS62201087A (ja) | 1986-02-28 | 1986-02-28 | ブラシレスｄｃモ−タの速度制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62201087A (ja) |
-
1986
- 1986-02-28 JP JP61041456A patent/JPS62201087A/ja active Pending
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