JPS62202677A - イメ−ジ処理装置 - Google Patents
イメ−ジ処理装置Info
- Publication number
- JPS62202677A JPS62202677A JP4554786A JP4554786A JPS62202677A JP S62202677 A JPS62202677 A JP S62202677A JP 4554786 A JP4554786 A JP 4554786A JP 4554786 A JP4554786 A JP 4554786A JP S62202677 A JPS62202677 A JP S62202677A
- Authority
- JP
- Japan
- Prior art keywords
- memory
- run length
- image data
- code
- run
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000000034 method Methods 0.000 claims description 4
- 238000010586 diagram Methods 0.000 description 3
- 235000008375 Decussocarpus nagi Nutrition 0.000 description 1
- 244000309456 Decussocarpus nagi Species 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 230000006837 decompression Effects 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、イメージ処理装置ｉ２に関し、特に、伸長イ
メージの間引きに関する。
メージの間引きに関する。
従来のＬ支術
従来のイメージ処理装置での伸長イメージの間引きの例
を第２図、第３図に示す。
を第２図、第３図に示す。
第一図において、−−ｌのメモリに格納されたＭｔ（／
ＭＲコードデータを読出し、−一コのコードデコーダに
セットし、ランレングスを求めコー３のメモリに格納す
る。次にランレングスをランレングスデコーダーーダに
セットしてイメージデータをコー５のメモリに格納し、
−一６の間引き回路でイメージデータな間引き−一りの
メモリに間引きデータを格納してい念。
ＭＲコードデータを読出し、−一コのコードデコーダに
セットし、ランレングスを求めコー３のメモリに格納す
る。次にランレングスをランレングスデコーダーーダに
セットしてイメージデータをコー５のメモリに格納し、
−一６の間引き回路でイメージデータな間引き−一りの
メモリに間引きデータを格納してい念。
従って、第３図に示した様に、コー１０，１のランレン
グスから一一１０ＩＩのイメージデータな一度作成して
その後でイメージデータコ−ｔｏｓ （２−ｔｏｅ ）
をそれを読み出して各々のピットの白又は黒のチェック
を行い、そして間引きＩ／ｃ該当するピットを除いて、
２−１０４のイメージデータに変換する必要があった。
グスから一一１０ＩＩのイメージデータな一度作成して
その後でイメージデータコ−ｔｏｓ （２−ｔｏｅ ）
をそれを読み出して各々のピットの白又は黒のチェック
を行い、そして間引きＩ／ｃ該当するピットを除いて、
２−１０４のイメージデータに変換する必要があった。
発明が解決しようとする問題点
しかしながら、上述した従来のイメージ処理装置の伸長
イメージ間引きは、伸長された後のイメ−ジデータを扱
うために、間引き対象のイメージデータを全て一度読み
出してピットチェックする必要がある。
イメージ間引きは、伸長された後のイメ−ジデータを扱
うために、間引き対象のイメージデータを全て一度読み
出してピットチェックする必要がある。
又、伸長後のイメージデータはデータ量が増くなってい
て処理する量も多く、コードデコード及びランレングス
デコード以外に大くの時間が必要であるという欠点があ
った。
て処理する量も多く、コードデコード及びランレングス
デコード以外に大くの時間が必要であるという欠点があ
った。
本発明は従来の上記事情に鑑みてなされたものであり、
従って本発明の目的は、従来の技術に内在する上記諸欠
点を解消することな可能とした新規なイメージ処理装置
を提供することにある。
従って本発明の目的は、従来の技術に内在する上記諸欠
点を解消することな可能とした新規なイメージ処理装置
を提供することにある。
問題点を解決するための手段
上記目的を達成する為に１本発明に係るイメージ処理装
置は、イメージ処理装置においてＭＬ（（Ｍｏｄｉｆｉ
ｅｄ Ｈｕｆｆｍａｎ ）又はＭＲ（Ｍｏｄｉｆｉｅｄ
ＲｅｌａｔｉｖｅＥｌｅｍｅｎｔ Ａｄｄｒｅｓｓ
Ｄｅｓｉｇｎａｔｅ ）等の方式によって圧縮されたイ
メージのコードデータを格納しておくメモリと、コード
データをランレングスに変換するコードデコーダと、ラ
ンレングスを定められたある割合で間引く計算をする演
算回路と、ランレングスをイメージデータに変換するラ
ンレングスデコーダと、イメージデータを格納しておく
メモリ、および全体を制御する制御回路とを具備して構
成される。
置は、イメージ処理装置においてＭＬ（（Ｍｏｄｉｆｉ
ｅｄ Ｈｕｆｆｍａｎ ）又はＭＲ（Ｍｏｄｉｆｉｅｄ
ＲｅｌａｔｉｖｅＥｌｅｍｅｎｔ Ａｄｄｒｅｓｓ
Ｄｅｓｉｇｎａｔｅ ）等の方式によって圧縮されたイ
メージのコードデータを格納しておくメモリと、コード
データをランレングスに変換するコードデコーダと、ラ
ンレングスを定められたある割合で間引く計算をする演
算回路と、ランレングスをイメージデータに変換するラ
ンレングスデコーダと、イメージデータを格納しておく
メモリ、および全体を制御する制御回路とを具備して構
成される。
実施例
次に、本発明をその好ましい一実施例について図面を参
照して具体的に説明する。
照して具体的に説明する。
第１図は本発明の一実施例を示すブロック構成図である
。第７図を参照するに、参照番号／−／はＭＨ（Ｍｏｄ
ｉｆｉｅｄ Ｈｕｆｆｍａｎ又はＭＲ（Ｍｏｄｉｆｉｅ
ｄＲｅｌａｔｉｖｅ Ｅｌｅｍｅｎｔ Ａｄｄｒｅｓｓ
Ｄｅｓｉｇｎａｔｅ ） 等の方式によって圧縮さ
れたイメージのコードデータを格納して２くメモリを示
し、このメモリ／−／に格納されたＭｌ（／Ｍｉ（コー
ドデータを読み出し、コードデコーダ／−２にセットし
てランレングスを求め、メモリ／−ｊに格納する。次の
ランレングスを読み出してランレングス間引き演算回路
／−ダにより必要な間引率でランレングスを間引き、そ
の結果をランレングスデコーダｌ−３にセットする。ラ
ンレングスデコーダ／−５によってデコードされたイメ
ージデータはメモリ／−４に格納される。
。第７図を参照するに、参照番号／−／はＭＨ（Ｍｏｄ
ｉｆｉｅｄ Ｈｕｆｆｍａｎ又はＭＲ（Ｍｏｄｉｆｉｅ
ｄＲｅｌａｔｉｖｅ Ｅｌｅｍｅｎｔ Ａｄｄｒｅｓｓ
Ｄｅｓｉｇｎａｔｅ ） 等の方式によって圧縮さ
れたイメージのコードデータを格納して２くメモリを示
し、このメモリ／−／に格納されたＭｌ（／Ｍｉ（コー
ドデータを読み出し、コードデコーダ／−２にセットし
てランレングスを求め、メモリ／−ｊに格納する。次の
ランレングスを読み出してランレングス間引き演算回路
／−ダにより必要な間引率でランレングスを間引き、そ
の結果をランレングスデコーダｌ−３にセットする。ラ
ンレングスデコーダ／−５によってデコードされたイメ
ージデータはメモリ／−４に格納される。
次に第３図を参照してランレングスが求まった以後につ
いて説明する。ランレングス／ −１０Ｊは端からダビ
ット目ごとに／ビット引くことにより間引き後のランレ
ングス／ −１０１４となり、それをランレングスデコ
ーダ／−ｊにかけることにょ秒間引きイメージデータ／
−１０！が得られる。
いて説明する。ランレングス／ −１０Ｊは端からダビ
ット目ごとに／ビット引くことにより間引き後のランレ
ングス／ −１０１４となり、それをランレングスデコ
ーダ／−ｊにかけることにょ秒間引きイメージデータ／
−１０！が得られる。
この様にランレングスの間引き演算回路を設ケることに
より、必要なイメージデータを求めるの際の伸長された
イメージデータ縫が必要とする形で求まり、イメージデ
ータを間引き前と後という様に二重に持つ必要がなく、
省メモリとなる。
より、必要なイメージデータを求めるの際の伸長された
イメージデータ縫が必要とする形で求まり、イメージデ
ータを間引き前と後という様に二重に持つ必要がなく、
省メモリとなる。
発明の詳細
な説明したように、本発明によれば、間引きが必要なイ
メージ処理装置にランレングス間引き演算（ロ）路を設
けることにより、イメージデータを間引き前と後という
形に二重に持つ必要がなくなり、メモリが少なくて済み
、また伸長された大量のデータを読み出して各々ビット
をチェックする必要がなく、従って処理時間が短縮され
るという効果が得られる。
メージ処理装置にランレングス間引き演算（ロ）路を設
けることにより、イメージデータを間引き前と後という
形に二重に持つ必要がなくなり、メモリが少なくて済み
、また伸長された大量のデータを読み出して各々ビット
をチェックする必要がなく、従って処理時間が短縮され
るという効果が得られる。
第１図は本発明の一実施例を示す全体のブロック構成図
である（ ＭＨ／ＭＲでの例）。 ／−／・・・％’ＭＲコードが格納されているメモリ、
／−コ・・・ＭＨ７ＭＲコードをランレングスに変換ス
るコードデコーダ、ｌ−３・・・ランレングスを格納し
て２くメモリ、／−＆・・・ランレングスの間引キ計算
を行う演算回路、／−！・・・ランレングスをイメージ
に変換するランレングスデコーダ、ｌ−６・・・イメー
ジデータを格納しておくメモリ％ ／−７・・・メモリ
のアドレス制御他を行う制御回路、／−１０／・・・ｋ
凪４ｍｌコード、／ −１０コ５ ／ −１０３・・・
ランレングス、／−１０Ｑ・・・間引きされたランレン
グス、ｌ−１０！・・・イメージデータ 第２図は従来回路の構成を示すブロック図である（訃Ｖ
訊での例）。 一一／・・、Ｍ）ＩＲコードが格納されているメモＩハ
コーコ・・・Ｍ）（／ＭＲコードをランレングスに変換
するコードデコーダ、２−３・・・ランレングスを格納
しておくメモリ、−一７・・ランレングスをイメージに
変換するランレングスデコーダ、λ−３・・・イメージ
データを格納して２くメモリ、２−６・・・イメージデ
ータな間引く間引き回路、２−７・・・間引きイメージ
を格納しておくメモリ１，２−ｔ・・・アドレス制御他
を行う制御回路、λ−１０／・・・唐（／ＭＲコード、
コー１０コ、ｕ−１０３・・・ランレングス、−−ｉｏ
ダ。 コーｌＯ！・・・イメージデータ、−一１０ル・・・間
引きされたイメージデータ 第３図は本発明と従来技術を比較したパターンの間引き
手順例を示す図（間引率は／／４１である）であり、図
中のＷは白点を、Ｂは黒点をそれぞれ示し、０丁の数字
はう／レングス（各々のビット数）を示し、○は白点／
ピットを、・は黒点／ビットをそれぞれ示す。
である（ ＭＨ／ＭＲでの例）。 ／−／・・・％’ＭＲコードが格納されているメモリ、
／−コ・・・ＭＨ７ＭＲコードをランレングスに変換ス
るコードデコーダ、ｌ−３・・・ランレングスを格納し
て２くメモリ、／−＆・・・ランレングスの間引キ計算
を行う演算回路、／−！・・・ランレングスをイメージ
に変換するランレングスデコーダ、ｌ−６・・・イメー
ジデータを格納しておくメモリ％ ／−７・・・メモリ
のアドレス制御他を行う制御回路、／−１０／・・・ｋ
凪４ｍｌコード、／ −１０コ５ ／ −１０３・・・
ランレングス、／−１０Ｑ・・・間引きされたランレン
グス、ｌ−１０！・・・イメージデータ 第２図は従来回路の構成を示すブロック図である（訃Ｖ
訊での例）。 一一／・・、Ｍ）ＩＲコードが格納されているメモＩハ
コーコ・・・Ｍ）（／ＭＲコードをランレングスに変換
するコードデコーダ、２−３・・・ランレングスを格納
しておくメモリ、−一７・・ランレングスをイメージに
変換するランレングスデコーダ、λ−３・・・イメージ
データを格納して２くメモリ、２−６・・・イメージデ
ータな間引く間引き回路、２−７・・・間引きイメージ
を格納しておくメモリ１，２−ｔ・・・アドレス制御他
を行う制御回路、λ−１０／・・・唐（／ＭＲコード、
コー１０コ、ｕ−１０３・・・ランレングス、−−ｉｏ
ダ。 コーｌＯ！・・・イメージデータ、−一１０ル・・・間
引きされたイメージデータ 第３図は本発明と従来技術を比較したパターンの間引き
手順例を示す図（間引率は／／４１である）であり、図
中のＷは白点を、Ｂは黒点をそれぞれ示し、０丁の数字
はう／レングス（各々のビット数）を示し、○は白点／
ピットを、・は黒点／ビットをそれぞれ示す。
Claims (1)
- イメージ処理装置においてＭＨ（Ｍｏｄｉｆｉｅｄ Ｈ
ｕｆｆｍｅｎ）又はＭＲ（Ｍｏｄｉｆｉｅｄ Ｒｅｌａ
ｔｉｖｅ Ｅｌｅｍｅｎｔ Ａｄｄｒｅｓｓ Ｄｅｓｉ
ｇｎａｔｅ）等の方式によって圧縮されたイメージのコ
ードデータを格納しておくメモリと、コードデータをラ
ンレングスに変換するコードデコーダと、ランレングス
を定められたある割合で間引く計算をする演算回路と、
ランレングスをイメージデータに変換するランレングス
デコーダと、イメージデータを格納しておくメモリ、お
よび全体を制御する制御回路とを有することを特徴とし
たイメージ処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4554786A JPS62202677A (ja) | 1986-03-03 | 1986-03-03 | イメ−ジ処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4554786A JPS62202677A (ja) | 1986-03-03 | 1986-03-03 | イメ−ジ処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62202677A true JPS62202677A (ja) | 1987-09-07 |
Family
ID=12722388
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4554786A Pending JPS62202677A (ja) | 1986-03-03 | 1986-03-03 | イメ−ジ処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62202677A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56138356A (en) * | 1980-03-31 | 1981-10-28 | Fujitsu Ltd | Picture shrinking system |
-
1986
- 1986-03-03 JP JP4554786A patent/JPS62202677A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56138356A (en) * | 1980-03-31 | 1981-10-28 | Fujitsu Ltd | Picture shrinking system |
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