JPS6220585B2 - - Google Patents
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- Publication number
- JPS6220585B2 JPS6220585B2 JP57087620A JP8762082A JPS6220585B2 JP S6220585 B2 JPS6220585 B2 JP S6220585B2 JP 57087620 A JP57087620 A JP 57087620A JP 8762082 A JP8762082 A JP 8762082A JP S6220585 B2 JPS6220585 B2 JP S6220585B2
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- JP
- Japan
- Prior art keywords
- data
- bus
- bus line
- self
- receiver circuit
- Prior art date
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- Expired
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-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/0703—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation
- G06F11/0706—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation the processing taking place on a specific hardware platform or in a specific software environment
- G06F11/0745—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation the processing taking place on a specific hardware platform or in a specific software environment in an input/output transactions management context
-
- G—PHYSICS
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- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
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- G06F11/0706—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation the processing taking place on a specific hardware platform or in a specific software environment
- G06F11/0721—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation the processing taking place on a specific hardware platform or in a specific software environment within a central processing unit [CPU]
- G06F11/0724—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation the processing taking place on a specific hardware platform or in a specific software environment within a central processing unit [CPU] in a multiprocessor or a multi-core unit
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
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- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/22—Detection or location of defective computer hardware by testing during standby operation or during idle time, e.g. start-up testing
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- General Engineering & Computer Science (AREA)
- Quality & Reliability (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Debugging And Monitoring (AREA)
- Multi Processors (AREA)
- Test And Diagnosis Of Digital Computers (AREA)
Description
【発明の詳細な説明】
本発明は、マルチマイクロプロセサによる機能
分散構成のデータ処理装置に関し、特にマイクロ
プロセサ間のバス結合の正常異常を自己診断処理
する装置に関する。
分散構成のデータ処理装置に関し、特にマイクロ
プロセサ間のバス結合の正常異常を自己診断処理
する装置に関する。
機能分散型データ処理装置において、各マイク
ロプロセサはローカルメモリを備えて夫々が独立
に処理動作し、他のマイクロプロセサとのデータ
授受やメモリアクセスにはシリアルバスラインに
よる疎なる結合方式が採用されることが多い。こ
うした各マイクロプロセサの独立性確保は、他の
異常プロセサの影響を最小限にして正常プロセサ
がその機能動作を継続可能にする。しかし、シリ
アルバス方式にあつては、バスドライバ素子の短
絡モード故障でバスラインが短絡されて各マイク
ロプロセサ間の信号授受が全部不可能になる問題
があつた。
ロプロセサはローカルメモリを備えて夫々が独立
に処理動作し、他のマイクロプロセサとのデータ
授受やメモリアクセスにはシリアルバスラインに
よる疎なる結合方式が採用されることが多い。こ
うした各マイクロプロセサの独立性確保は、他の
異常プロセサの影響を最小限にして正常プロセサ
がその機能動作を継続可能にする。しかし、シリ
アルバス方式にあつては、バスドライバ素子の短
絡モード故障でバスラインが短絡されて各マイク
ロプロセサ間の信号授受が全部不可能になる問題
があつた。
本発明は、各マイクロプロセサに自己のバス結
合部の正常、異常の自己診断機能を持たせること
により、故障したバスドライバ素子をバスライン
から切離して他の健全なマイクロプロセサ間のバ
ス結合を確保できるようにした自己診断処理装置
を提供することを目的とする。
合部の正常、異常の自己診断機能を持たせること
により、故障したバスドライバ素子をバスライン
から切離して他の健全なマイクロプロセサ間のバ
ス結合を確保できるようにした自己診断処理装置
を提供することを目的とする。
第１図は本発明の一実施例を示す。マイクロプ
ロセサ１，２，３，…はバスライン１０によつて
疎なる結合が施される。バス結合部はマイクロプ
ロセサ１に代表して示すように、リレー１１の常
閉接点１１Ａをバス切離部としてバスライン１０
とバスドライバ／レシーバ回路１２との間に具備
する。
ロセサ１，２，３，…はバスライン１０によつて
疎なる結合が施される。バス結合部はマイクロプ
ロセサ１に代表して示すように、リレー１１の常
閉接点１１Ａをバス切離部としてバスライン１０
とバスドライバ／レシーバ回路１２との間に具備
する。
バスドライバ／レシーバ回路１２はシリアルポ
ート１３に結合され、マイクロプロセサ内部バス
１４の並列データとバスライン１０の直列データ
との直並列データ変換処理をする。
ート１３に結合され、マイクロプロセサ内部バス
１４の並列データとバスライン１０の直列データ
との直並列データ変換処理をする。
自己診断処理部１５は一定周期又は処理空き時
間を利用して自己のバス結合部の故障診断と処理
を施す。自己診断処理部１５はバス結合部の故障
と診断するときに、Ｉ／Ｏポート１６を通してリ
レー１１を動作させることによりバス結合部をバ
スライン１０から切離すと共に、故障表示器１７
による故障表示を行なう。
間を利用して自己のバス結合部の故障診断と処理
を施す。自己診断処理部１５はバス結合部の故障
と診断するときに、Ｉ／Ｏポート１６を通してリ
レー１１を動作させることによりバス結合部をバ
スライン１０から切離すと共に、故障表示器１７
による故障表示を行なう。
自己診断処理部１５による故障診断処理は第２
図に処理フローを示すようにエコーチエツクによ
る。第２図において、一定周期に自己診断を開始
し、まずシリアルポート１３から特定フオーマツ
トの点検データをバスライン１０側に送信する
（ステツプＳ１）。このとき、リレー１１は復帰状
態にあつてその接点を閉じ、シリアルポート１３
からの点検データがバスドライバ／レシーバ回路
１２のドライバを通してバスライン１０に送り出
される。この点検データに対しては他のマイクロ
プロセサ２，３は割込みとしては受付けない。そ
して、自己診断に入つたマイクロプロセサ１は自
己の点検データをバスドライバ／レシーバ回路１
２のレシーバで受信してシリアルポート１３を経
て自己診断処理部１５に取込む。この点検データ
の受信（ステツプＳ２）があるとき、送信データ
Txとそのエコーとしての受信データRxの一致を
判定し（ステツプＳ３）一致するときには他のマ
イクロプロセサのバス結合部、自己のバスライン
１０及びリレー接点１１Ａも含めてバス結合部が
正常であると判断し、自己診断を終了する。
図に処理フローを示すようにエコーチエツクによ
る。第２図において、一定周期に自己診断を開始
し、まずシリアルポート１３から特定フオーマツ
トの点検データをバスライン１０側に送信する
（ステツプＳ１）。このとき、リレー１１は復帰状
態にあつてその接点を閉じ、シリアルポート１３
からの点検データがバスドライバ／レシーバ回路
１２のドライバを通してバスライン１０に送り出
される。この点検データに対しては他のマイクロ
プロセサ２，３は割込みとしては受付けない。そ
して、自己診断に入つたマイクロプロセサ１は自
己の点検データをバスドライバ／レシーバ回路１
２のレシーバで受信してシリアルポート１３を経
て自己診断処理部１５に取込む。この点検データ
の受信（ステツプＳ２）があるとき、送信データ
Txとそのエコーとしての受信データRxの一致を
判定し（ステツプＳ３）一致するときには他のマ
イクロプロセサのバス結合部、自己のバスライン
１０及びリレー接点１１Ａも含めてバス結合部が
正常であると判断し、自己診断を終了する。
また、自己診断処理部１５は送信データTxの
送信から受信データRxの割込みが一定時間内に
発生しないとき、受信データRxのタイムアウト
として検出し（ステツプＳ４）、自己のバス結合
部又は他のマイクロプロセサバス結合部のバスラ
インのいずれが短絡モードの不良発生かを判断す
る処理に入る。これには、まずＩ／Ｏポート１６
からリレー１１の動作命令を発生（ステツプＳ
５）して接点１１Ａを切離しておき、再度点検デ
ータTx送信を施す（ステツプＳ６）。
送信から受信データRxの割込みが一定時間内に
発生しないとき、受信データRxのタイムアウト
として検出し（ステツプＳ４）、自己のバス結合
部又は他のマイクロプロセサバス結合部のバスラ
インのいずれが短絡モードの不良発生かを判断す
る処理に入る。これには、まずＩ／Ｏポート１６
からリレー１１の動作命令を発生（ステツプＳ
５）して接点１１Ａを切離しておき、再度点検デ
ータTx送信を施す（ステツプＳ６）。
この送信データTxに対してバスドライバ／レ
シーバ回路１２のレシーバから受信データRxの
割込みがあるとき（ステツプＳ７）、この両デー
タRxとTxの一致判定（ステツプＳ８）をし、一
致するときには他のマイクロプロセサ２，３又は
バスライン１０の異常と判定し（ステツプＳ
９）、他のマイクロプロセサ２，３が夫々持つ自
己診断処理による当該故障箇所の切離し処理を待
つて（ステツプＳ１０）、自己診断処理を終了す
る。
シーバ回路１２のレシーバから受信データRxの
割込みがあるとき（ステツプＳ７）、この両デー
タRxとTxの一致判定（ステツプＳ８）をし、一
致するときには他のマイクロプロセサ２，３又は
バスライン１０の異常と判定し（ステツプＳ
９）、他のマイクロプロセサ２，３が夫々持つ自
己診断処理による当該故障箇所の切離し処理を待
つて（ステツプＳ１０）、自己診断処理を終了す
る。
ステツプＳ６における点検データの送信に対し
て、エコーとしての受信データRxの割込みがな
いとき、自己のバス結合部異常と判定し（ステツ
プＳ１１）、リレー１１を動作状態にしたまま表
示器１７に異常表示させる（ステツプＳ１２）。
て、エコーとしての受信データRxの割込みがな
いとき、自己のバス結合部異常と判定し（ステツ
プＳ１１）、リレー１１を動作状態にしたまま表
示器１７に異常表示させる（ステツプＳ１２）。
また、ステツプＳ３又はＳ８において、送信デ
ータTxと受信データRxの一致判定に不一致が発
生するとき、点検データのＮ回の送り（ステツプ
Ｓ１３）と一致判定（ステツプＳ１４）を行な
い、Ｎ回のエコーチエツクのうちに一致が得られ
るときにはデータ送受信に雑音など他の原因によ
るデータ破壊があつたとして点検終了するし、Ｎ
回の判定に一致が得られないときにはバス結合部
も含めた自己内部異常として表示器１７による異
常表示を施す（ステツプＳ１５）。
ータTxと受信データRxの一致判定に不一致が発
生するとき、点検データのＮ回の送り（ステツプ
Ｓ１３）と一致判定（ステツプＳ１４）を行な
い、Ｎ回のエコーチエツクのうちに一致が得られ
るときにはデータ送受信に雑音など他の原因によ
るデータ破壊があつたとして点検終了するし、Ｎ
回の判定に一致が得られないときにはバス結合部
も含めた自己内部異常として表示器１７による異
常表示を施す（ステツプＳ１５）。
異常発生によるバスライン１０との切離しと表
示後にはオペレータ等の人員により異常箇所の解
消とマニアルスタートによりリレー１１の復帰等
を施して通常処理に戻る。
示後にはオペレータ等の人員により異常箇所の解
消とマニアルスタートによりリレー１１の復帰等
を施して通常処理に戻る。
なお、実施例において、バスドライバ／レシー
バ回路１２を二重化する場合には、リレー１１に
よつて故障回路をバスラインから切離すと共に残
りの健全な回路を接続してバスライン１０との結
合を確保することもできる。
バ回路１２を二重化する場合には、リレー１１に
よつて故障回路をバスラインから切離すと共に残
りの健全な回路を接続してバスライン１０との結
合を確保することもできる。
また、各種マイクロプロセサを含むデータ処理
装置間を結合する分散処理システムにおいて、デ
ータ処理装置間の結合に本発明を適用して同等の
作用効果を得ることができる。
装置間を結合する分散処理システムにおいて、デ
ータ処理装置間の結合に本発明を適用して同等の
作用効果を得ることができる。
以上のとおり、本発明によれば、シリアルバス
ラインとの結合不通状態を自己診断して故障部分
を切離しと表示するため、バスラインで結合する
健全なマイクロプロセサ又はデータ処理装置間の
結合を確保できるし、故障表示の装置の保守、点
検を容易にする。
ラインとの結合不通状態を自己診断して故障部分
を切離しと表示するため、バスラインで結合する
健全なマイクロプロセサ又はデータ処理装置間の
結合を確保できるし、故障表示の装置の保守、点
検を容易にする。
第１図は本発明の一実施例を示す回路図、第２
図は第１図における自己診断処理部のフローチヤ
ートである。 １，２，３…マイクロプロセサ、１０…バスラ
イン、１１…リレー、１２…バスドライバ／レシ
ーバ回路、１３…シリアルポート、１５…自己診
断処理部、１６…Ｉ／Ｏポート、１７…故障表示
器。
図は第１図における自己診断処理部のフローチヤ
ートである。 １，２，３…マイクロプロセサ、１０…バスラ
イン、１１…リレー、１２…バスドライバ／レシ
ーバ回路、１３…シリアルポート、１５…自己診
断処理部、１６…Ｉ／Ｏポート、１７…故障表示
器。
Claims (1)
- 【特許請求の範囲】 １ 送受信データを直並列変換するシリアルポー
トをドライブ出力信号を受信入力信号として取込
みできるバスドライバ／レシーバ回路を介してバ
スラインに結合するマイクロプロセツサを該バス
ラインに複数結合した機能分散構成のデータ処理
装置において、上記バスドライバ／レシーバ回路
とバスラインとの間の結合を切離しできる切離部
を設け、上記バスドライバ／レシーバ回路を通し
て点検データをバスライン側に送信しこの送信デ
ータに対して受信データがありかつ両データが一
致するときにバス結合の正常と診断し、受信デー
タが得られないとき上記切離部を動作させてバス
ラインとバスドライバ／レシーバ回路を切離し、
再度点検データを送信して該点検データに対する
受信データが得られないときに自己のバスライン
結合が異常と診断及び処理し、再度の点検データ
送信に対する受信データが一致するときに他のマ
イクロプロセツサ異常と診断し、再度の点検デー
タ送信に対する受信データが不一致のときに上記
切離部の動作処理で該バスラインから自己マイク
ロプロセツサを切離す自己診断処理を設けたこと
をを特徴とするデータ処理装置。 ２ 特許請求の範囲第１項において、自己診断処
理部は点検データの送信に対する受信データの不
一致が複数回発生したときにバスラインとの結合
が異常と診断及び処理することを特徴とするデー
タ処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57087620A JPS58203533A (ja) | 1982-05-24 | 1982-05-24 | デ−タ処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57087620A JPS58203533A (ja) | 1982-05-24 | 1982-05-24 | デ−タ処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58203533A JPS58203533A (ja) | 1983-11-28 |
| JPS6220585B2 true JPS6220585B2 (ja) | 1987-05-07 |
Family
ID=13920011
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57087620A Granted JPS58203533A (ja) | 1982-05-24 | 1982-05-24 | デ−タ処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58203533A (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61188602A (ja) * | 1985-02-16 | 1986-08-22 | Omron Tateisi Electronics Co | 入出力バスの監視回路 |
| JPH0690645B2 (ja) * | 1986-10-01 | 1994-11-14 | 三菱電機株式会社 | シ−ケンスコントロ−ラ用の出力ユニツト |
| US7069477B2 (en) | 2002-10-30 | 2006-06-27 | International Business Machines Corporation | Methods and arrangements to enhance a bus |
| JP5515896B2 (ja) | 2010-03-16 | 2014-06-11 | 富士通株式会社 | 入出力接続装置、情報処理装置及び入出力デバイス検査方法 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5729167A (en) * | 1980-07-30 | 1982-02-17 | Nissan Motor Co Ltd | Multicomputer system |
-
1982
- 1982-05-24 JP JP57087620A patent/JPS58203533A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS58203533A (ja) | 1983-11-28 |
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