JPS62206485A - デジタル時計表示装置 - Google Patents
デジタル時計表示装置Info
- Publication number
- JPS62206485A JPS62206485A JP61048942A JP4894286A JPS62206485A JP S62206485 A JPS62206485 A JP S62206485A JP 61048942 A JP61048942 A JP 61048942A JP 4894286 A JP4894286 A JP 4894286A JP S62206485 A JPS62206485 A JP S62206485A
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- Japan
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- segments
- signal
- tube
- segment
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は1表示管やLEDを用いたデジタル時計表示
装置に関し、詳しくは、少ない制御線でもって駆動しう
るようにしたデジタル時計表示装置に関する。
装置に関し、詳しくは、少ない制御線でもって駆動しう
るようにしたデジタル時計表示装置に関する。
第2図は表示管を用いた従来のデジタル時計表示装置の
駆動回路図で、4桁の数字による時計表示と、AM、P
Mなどの数字以外の4種類の所定の表示A、B、O,D
とを表示する構成としたも ・のである。図において、
(1)は時間表示器で1表示素子の一例である4個の数
字表示管(ロ)〜010と、同じく表示素子の一例であ
る数字以外の所定の表示を行う表示管αQとを有し1表
示管α刀〜α→はそれぞれθ〜9までを表示する7個の
セグメントa ” gとグリッドD1〜D4 とを有
し1表示管α0はA−Dの4種類の所定の表示を行う4
個のセグメントa〜dと、グリッドD5 とを有して
おり、各表示管α刀〜αQの各セグメント3−gはそれ
ぞれ同じ符号のものが1本のセグメント制御信号線(2
)に接続されており、合計7本のセグメント制御信号線
(2)でもって制御装置(3)に接続されており、さら
に、各表示管α刀〜α時のグリッドD1〜D5 は、
5本のグリッド制御信号線(4)でもって、それぞれ制
御装置(3)に接続されている。
駆動回路図で、4桁の数字による時計表示と、AM、P
Mなどの数字以外の4種類の所定の表示A、B、O,D
とを表示する構成としたも ・のである。図において、
(1)は時間表示器で1表示素子の一例である4個の数
字表示管(ロ)〜010と、同じく表示素子の一例であ
る数字以外の所定の表示を行う表示管αQとを有し1表
示管α刀〜α→はそれぞれθ〜9までを表示する7個の
セグメントa ” gとグリッドD1〜D4 とを有
し1表示管α0はA−Dの4種類の所定の表示を行う4
個のセグメントa〜dと、グリッドD5 とを有して
おり、各表示管α刀〜αQの各セグメント3−gはそれ
ぞれ同じ符号のものが1本のセグメント制御信号線(2
)に接続されており、合計7本のセグメント制御信号線
(2)でもって制御装置(3)に接続されており、さら
に、各表示管α刀〜α時のグリッドD1〜D5 は、
5本のグリッド制御信号線(4)でもって、それぞれ制
御装置(3)に接続されている。
つぎに、従来の表示装置の動作を、第2図を用いて説明
する。時刻表示器(1)は、制御装置(3)よシ。
する。時刻表示器(1)は、制御装置(3)よシ。
セグメント制御信号線(2)、およびグリッド制御信号
線(4)を通して、セグメントa ”’−g +および
グリッドD1〜D5 に信号を加えることにより、ダ
イナミックに点灯している。すなわち、まず、制御装置
(3)からグリッドD1 に信号が加えられ、同時に
。
線(4)を通して、セグメントa ”’−g +および
グリッドD1〜D5 に信号を加えることにより、ダ
イナミックに点灯している。すなわち、まず、制御装置
(3)からグリッドD1 に信号が加えられ、同時に
。
表示管(6)の1桁目の表示値に対応したセグメントの
みに制御装置(3)から信号が加えられ、これにより、
1桁目の数字が点灯表示される。つぎにグリッドD1
への信号を停止してグリッドD2 に信号を加え、、同
時に表示管@の2桁目の表示値に対応したセグメントの
みに信号が加えられ、これにょp2桁目の数字が点灯表
示される。以下同様の駆動動作が表示管(13、(14
)について行なわれ1表示管(ロ)〜α荀で時刻が点灯
表示される。つぎに、グリッドD4 への信号を停止し
てグリッドD5 に信号を加え、同時に1表示管αGの
表示に対応したセグメントのみに信号が加えられて、所
定の表示が点灯表示される。以上の制御動作によシ1時
刻および所定の表示が行なわれ、以下1時刻の経過にし
たがって、グリッドD1〜D5 およびセグメントa
〜gに順次信号を加えて1時計表示が行なわれる。
みに制御装置(3)から信号が加えられ、これにより、
1桁目の数字が点灯表示される。つぎにグリッドD1
への信号を停止してグリッドD2 に信号を加え、、同
時に表示管@の2桁目の表示値に対応したセグメントの
みに信号が加えられ、これにょp2桁目の数字が点灯表
示される。以下同様の駆動動作が表示管(13、(14
)について行なわれ1表示管(ロ)〜α荀で時刻が点灯
表示される。つぎに、グリッドD4 への信号を停止し
てグリッドD5 に信号を加え、同時に1表示管αGの
表示に対応したセグメントのみに信号が加えられて、所
定の表示が点灯表示される。以上の制御動作によシ1時
刻および所定の表示が行なわれ、以下1時刻の経過にし
たがって、グリッドD1〜D5 およびセグメントa
〜gに順次信号を加えて1時計表示が行なわれる。
従来のデジタル時計表示装置は以上のように構成されて
いるので1時刻表示のための4個の表示素子と1時刻以
外の表示を行うための1個の表示素子とを要し、制御装
置はこれら5個の表示素子を制御するための構成が必要
であり1表示素子と制御装置との配線も複雑となるなど
、装置の構成が複雑となシ、したがって、高価になると
いう問題点があった。
いるので1時刻表示のための4個の表示素子と1時刻以
外の表示を行うための1個の表示素子とを要し、制御装
置はこれら5個の表示素子を制御するための構成が必要
であり1表示素子と制御装置との配線も複雑となるなど
、装置の構成が複雑となシ、したがって、高価になると
いう問題点があった。
この発明は上記のような問題点を解消するためになされ
たもので、構成が簡単で、これにともなって価格の低減
が図れる時計表示装置を得ることを目的とする。
たもので、構成が簡単で、これにともなって価格の低減
が図れる時計表示装置を得ることを目的とする。
この発明に係る表示装置は、時刻の最上位の桁(4桁目
)の表示素子の複数個のセグメントのうち、3個のセグ
メントで時刻の最上位を表示し、残りのセグメントで複
数個の所定の表示を行うように構成したものである。
)の表示素子の複数個のセグメントのうち、3個のセグ
メントで時刻の最上位を表示し、残りのセグメントで複
数個の所定の表示を行うように構成したものである。
この発明における時計表示装置は、最上位の桁の表示素
子の3個のセグメントで時刻の最上位の桁の数字“1″
、“2”、“表示なし”の表示を行い、残りのセグメン
トで所定の表示を行う。
子の3個のセグメントで時刻の最上位の桁の数字“1″
、“2”、“表示なし”の表示を行い、残りのセグメン
トで所定の表示を行う。
以下、この発明の一実施例を、第1図を用いて説明する
。図において1表示管0刀〜03の各セグメント3 %
gと1表示管α→のセグメントa T Cと。
。図において1表示管0刀〜03の各セグメント3 %
gと1表示管α→のセグメントa T Cと。
表示管部のセグメン)d−gとは、それぞれ、同じ符号
のものが一本のセグメント制御信号線(2)に接続され
ておシ1合計7本のセグメント制御信号線(2)で制御
装置(3)に接続されている。なお、この表示管OQの
セグメントdんgに接続されているセグメント制御信号
線(2)は、第2図に示した従来装置の表示管α荀のセ
グメントd−gに接続されているものヲ転用したもので
ある。また表示管間〜aうのグリッドD1〜D5 の
うち、D4 とD5 は並列に接続されておジ、4本
のグリッド制御信号線(4)で。
のものが一本のセグメント制御信号線(2)に接続され
ておシ1合計7本のセグメント制御信号線(2)で制御
装置(3)に接続されている。なお、この表示管OQの
セグメントdんgに接続されているセグメント制御信号
線(2)は、第2図に示した従来装置の表示管α荀のセ
グメントd−gに接続されているものヲ転用したもので
ある。また表示管間〜aうのグリッドD1〜D5 の
うち、D4 とD5 は並列に接続されておジ、4本
のグリッド制御信号線(4)で。
制御装置(3)に接続されている。(5)は1表示管α
→のセグメントa + d + e t gを接続する
接続線で。
→のセグメントa + d + e t gを接続する
接続線で。
セグメントa + b r cがそれぞれ1本のセグメ
ント制御信号、1ilil(2)で制御装置(3)に接
続されている。
ント制御信号、1ilil(2)で制御装置(3)に接
続されている。
つぎに、この実施例の動作を説明する。
表示管α時〜α功の表示動作は従来装置と同じであるか
ら説明を省略し、表示管α→、α枠の動作を説明するO 表示管0→は、0時00分から9時59分までの間は、
グリッドD4.D5 に信号を加えたとき1表示管(
14のセグメントa −Cには信号を加えず。
ら説明を省略し、表示管α→、α枠の動作を説明するO 表示管0→は、0時00分から9時59分までの間は、
グリッドD4.D5 に信号を加えたとき1表示管(
14のセグメントa −Cには信号を加えず。
OFF状態にして何の表示も行なわない。つぎに。
10時OO分から19時59分までの間は、グリッドD
4.D5 に信号を加えたとき1表示管α→のセグメ
ントb、cに信号を加えて数字1を表示する。
4.D5 に信号を加えたとき1表示管α→のセグメ
ントb、cに信号を加えて数字1を表示する。
つぎに、20時00分から23時59分までの間は、グ
リッドD4.D5 に信号を加えたとき1表示管(ロ
)のセグメンl−a、bに信号を加えて数字2を表示す
る。
リッドD4.D5 に信号を加えたとき1表示管(ロ
)のセグメンl−a、bに信号を加えて数字2を表示す
る。
このように1表示管α荀は、3本のセグメント制御信号
線で最上位の桁の表示を全て表示することができる。
線で最上位の桁の表示を全て表示することができる。
表示管aυは、グリッドD4.D5 に信号を加えた
とき、4種類の表示A−Dのうち、所定の表示に対応す
るセグメントd−gに信号を加えて所定の表示を行う。
とき、4種類の表示A−Dのうち、所定の表示に対応す
るセグメントd−gに信号を加えて所定の表示を行う。
このように、この実施例は1表示管a< 、 aFJの
グリッドD4.D5 を共通にし、セグメントa =
Cで第4桁の数字を表示し、セグメン)d−gで4個
の所定の表示を行う構成としたので、従来、5個の表示
管とこれを制御する制御回路とが必要であったものが、
実質的に4個の表示管とこれを制御する制御回路とで同
じ時計表示を行うことができ、安価な時計表示装置召が
得られる。
グリッドD4.D5 を共通にし、セグメントa =
Cで第4桁の数字を表示し、セグメン)d−gで4個
の所定の表示を行う構成としたので、従来、5個の表示
管とこれを制御する制御回路とが必要であったものが、
実質的に4個の表示管とこれを制御する制御回路とで同
じ時計表示を行うことができ、安価な時計表示装置召が
得られる。
なお、上記実施例は1表示管α荀、0υを別の表示管で
構成した例を示したが、1個の表示管で構成し、同一の
グリッド内に数字1,2を表示するセグメントa −C
と、4種類の表示A−Dを表示するセグメントd−gを
配設した構成としてもよい。
構成した例を示したが、1個の表示管で構成し、同一の
グリッド内に数字1,2を表示するセグメントa −C
と、4種類の表示A−Dを表示するセグメントd−gを
配設した構成としてもよい。
また、上記実施例は1表示管を用いた例を示したが、複
数個のセグメントで数字や所定の表示を行うLED等の
表示素子を用いても、同様に構成でき、同様の効果が得
られる。
数個のセグメントで数字や所定の表示を行うLED等の
表示素子を用いても、同様に構成でき、同様の効果が得
られる。
以上のように、この発明によれば、第4桁の表示素子の
3個のセグメントでもって、数字“1″。
3個のセグメントでもって、数字“1″。
“2″、“表示なし”を表示し、4個のセグメントでも
って4種類の所定の表示を行うように構成したので、実
質的に4個の表示素子とそれを制御する制御回路とで時
計表示装置が構成できるという効果がある。
って4種類の所定の表示を行うように構成したので、実
質的に4個の表示素子とそれを制御する制御回路とで時
計表示装置が構成できるという効果がある。
第1図は、この考案の一実施例の回路図、第2図は、同
一の時計表示を行う従来の時計表示装置の回路図である
。 (2)・・・エレメント制御信号M、(3)・・・制御
装置、(4)・・・グリッド制御信号線、(5)・・・
接続線、A、B、C。 D・・・所定の表示、a””’g・・・セグメント、D
1〜D5・・・グリッド、回へαυ・・・表示管。 なお1図中、同一符号はそれぞれ同一、または相当部分
を示す。 手続補正書(自発) 昭和 年 月 日
一の時計表示を行う従来の時計表示装置の回路図である
。 (2)・・・エレメント制御信号M、(3)・・・制御
装置、(4)・・・グリッド制御信号線、(5)・・・
接続線、A、B、C。 D・・・所定の表示、a””’g・・・セグメント、D
1〜D5・・・グリッド、回へαυ・・・表示管。 なお1図中、同一符号はそれぞれ同一、または相当部分
を示す。 手続補正書(自発) 昭和 年 月 日
Claims (1)
- (1)第1桁から第3桁の“1”から“9”までの数字
を複数個のセグメントの組合せで表示する3組の表示素
子と、第4桁の“1”、“2”、“表示なし”の表示を
行う3個のセグメントおよび残りのセグメントで複数の
“所定の表示”を行う1組の表示素子と、上記4組の素
子を制御して時刻および上記複数の“所定の表示”の制
御を行う制御装置とを備えたデジタル時計表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61048942A JPS62206485A (ja) | 1986-03-06 | 1986-03-06 | デジタル時計表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61048942A JPS62206485A (ja) | 1986-03-06 | 1986-03-06 | デジタル時計表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62206485A true JPS62206485A (ja) | 1987-09-10 |
Family
ID=12817329
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61048942A Pending JPS62206485A (ja) | 1986-03-06 | 1986-03-06 | デジタル時計表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62206485A (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5155267A (ja) * | 1974-11-11 | 1976-05-14 | Casio Computer Co Ltd | Tokeisochi |
| JPS5558485A (en) * | 1978-10-25 | 1980-05-01 | Seiko Epson Corp | Full electronic watch |
-
1986
- 1986-03-06 JP JP61048942A patent/JPS62206485A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5155267A (ja) * | 1974-11-11 | 1976-05-14 | Casio Computer Co Ltd | Tokeisochi |
| JPS5558485A (en) * | 1978-10-25 | 1980-05-01 | Seiko Epson Corp | Full electronic watch |
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