JPS622560Y2 - - Google Patents
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- Publication number
- JPS622560Y2 JPS622560Y2 JP7134179U JP7134179U JPS622560Y2 JP S622560 Y2 JPS622560 Y2 JP S622560Y2 JP 7134179 U JP7134179 U JP 7134179U JP 7134179 U JP7134179 U JP 7134179U JP S622560 Y2 JPS622560 Y2 JP S622560Y2
- Authority
- JP
- Japan
- Prior art keywords
- controlled device
- signal
- reset
- time
- program timer
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 238000001514 detection method Methods 0.000 description 7
- 239000011888 foil Substances 0.000 description 5
- 238000010586 diagram Methods 0.000 description 4
- 238000007796 conventional method Methods 0.000 description 1
Landscapes
- Electric Clocks (AREA)
Description
【考案の詳細な説明】
本考案はプログラムタイマに係り、被制御機器
よりとり出される信号によつて該機器をオフせし
める機構を設け、リセツト時刻設定操作がいら
ず、プログラム設定を容易に行ない得るプログラ
ムタイマを提供することを目的とする。
よりとり出される信号によつて該機器をオフせし
める機構を設け、リセツト時刻設定操作がいら
ず、プログラム設定を容易に行ない得るプログラ
ムタイマを提供することを目的とする。
従来、プログラムタイマとテープレコーダとを
連動させ、プログラムタイマにて設定したセツト
時刻からリセツト時刻までテープレコーダをオン
状態にし、テープに記録されているメツセージを
自動的に再生するいわゆる自動放送がある。
連動させ、プログラムタイマにて設定したセツト
時刻からリセツト時刻までテープレコーダをオン
状態にし、テープに記録されているメツセージを
自動的に再生するいわゆる自動放送がある。
第１図はこのような自動放送に用いる従来のプ
ログラムタイマの一例のブロツク系統図を示す。
同図中、破線にて囲まれた部分がプログラムタイ
マで、中央処理装置のメモリ回路（以下、CPU
メモリという）１において、テープレコーダ等の
被制御機器２をオンせしめるためのセツト時刻及
び該機器２をオフせしめるためのリセツト時刻を
夫々設定する。CPUメモリ１よりセツト時刻に
とり出されたセツト信号はフリツプフロツプ３、
駆動回路４にて被制御機器駆動用信号とされ、被
制御機器２をオン状態としてテープ走行せしめ
る。一方、CPUメモリ１よりリセツト時刻にと
り出されるリセツト信号はフリツプフロツプ３、
駆動回路４にて被制御機器停止用信号とされ、被
制御機器２をオフ状態にしてテープ走行を停止せ
しめる。
ログラムタイマの一例のブロツク系統図を示す。
同図中、破線にて囲まれた部分がプログラムタイ
マで、中央処理装置のメモリ回路（以下、CPU
メモリという）１において、テープレコーダ等の
被制御機器２をオンせしめるためのセツト時刻及
び該機器２をオフせしめるためのリセツト時刻を
夫々設定する。CPUメモリ１よりセツト時刻に
とり出されたセツト信号はフリツプフロツプ３、
駆動回路４にて被制御機器駆動用信号とされ、被
制御機器２をオン状態としてテープ走行せしめ
る。一方、CPUメモリ１よりリセツト時刻にと
り出されるリセツト信号はフリツプフロツプ３、
駆動回路４にて被制御機器停止用信号とされ、被
制御機器２をオフ状態にしてテープ走行を停止せ
しめる。
然るに、この従来のプログラムタイマは、セツ
ト時刻及びリセツト時刻の２種類の時刻プログラ
ムを設定する必要があり、このため、プログラム
設定操作が煩わしく、又、プログラム数が多いた
めにCPUメモリ１を小形かつ安価に構成し得な
い等の欠点があつた。更に、必ずリセツト時刻を
設定しなければならないために、被制御機器２の
オフ時刻を計算して求める必要があり、しかも、
動作時間のバラツキを考慮に入れて多少余裕をも
たせてリセツト時刻を設定する必要があり、この
点からも操作が煩わしい欠点があつた。又更に、
上記の如く余裕をもたせてリセツト時刻を設定し
なければならないため、被制御機器２によるメツ
セージ再生が終了してもしばらくの間電源オンの
状態が続き、ノイズがとり出されて聴き苦しい等
の欠点があつた。
ト時刻及びリセツト時刻の２種類の時刻プログラ
ムを設定する必要があり、このため、プログラム
設定操作が煩わしく、又、プログラム数が多いた
めにCPUメモリ１を小形かつ安価に構成し得な
い等の欠点があつた。更に、必ずリセツト時刻を
設定しなければならないために、被制御機器２の
オフ時刻を計算して求める必要があり、しかも、
動作時間のバラツキを考慮に入れて多少余裕をも
たせてリセツト時刻を設定する必要があり、この
点からも操作が煩わしい欠点があつた。又更に、
上記の如く余裕をもたせてリセツト時刻を設定し
なければならないため、被制御機器２によるメツ
セージ再生が終了してもしばらくの間電源オンの
状態が続き、ノイズがとり出されて聴き苦しい等
の欠点があつた。
本考案は上記欠点を除去したものであり、以
下、第２図と共にその一実施例について説明す
る。
下、第２図と共にその一実施例について説明す
る。
第２図は本考案になるプログラムタイマの一実
施例のブロツク系統図を示し、同図中、第１図と
同一構成部分には同一番号を付し、その説明を省
略する。同図中、破線にて囲まれた部分がプログ
ラムタイマで、駆動回路４の出力信号（被制御機
器駆動用信号及び該機器停止用信号）をとり出す
ための出力端子５ａ及び被制御機器２の検出信号
（リセツト用信号）を入来されるリセツト端子５
ｂが設けられており、端子５ｂに入来した信号は
CPUメモリ６のリセツト出力信号と共にオア回
路７を介してフリツプフロツプ３に供給されるよ
う構成されている。なお、被制御機器２であるテ
ープレコーダのテープには、メツセージを記録さ
れている部分の後にセンシング箔が貼着されてお
り、テープレコーダはこのセンシング箔を検出し
て検出信号をとり出す構成とされている。
施例のブロツク系統図を示し、同図中、第１図と
同一構成部分には同一番号を付し、その説明を省
略する。同図中、破線にて囲まれた部分がプログ
ラムタイマで、駆動回路４の出力信号（被制御機
器駆動用信号及び該機器停止用信号）をとり出す
ための出力端子５ａ及び被制御機器２の検出信号
（リセツト用信号）を入来されるリセツト端子５
ｂが設けられており、端子５ｂに入来した信号は
CPUメモリ６のリセツト出力信号と共にオア回
路７を介してフリツプフロツプ３に供給されるよ
う構成されている。なお、被制御機器２であるテ
ープレコーダのテープには、メツセージを記録さ
れている部分の後にセンシング箔が貼着されてお
り、テープレコーダはこのセンシング箔を検出し
て検出信号をとり出す構成とされている。
ここで、被制御機器２をセツトするに際し、
CPUメモリ６にセツト時刻のみプログラムを設
定する。セツト時刻に至ると、CPUメモリ６よ
りのセツト信号はフリツプフロツプ３、駆動回路
４にて機器駆動用信号とされて被制御機器２に供
給され、被制御機器２をオン状態としてテープを
走行せしめる。被制御機器２のオンにより、テー
プに記録されているメツセージが再生される。
CPUメモリ６にセツト時刻のみプログラムを設
定する。セツト時刻に至ると、CPUメモリ６よ
りのセツト信号はフリツプフロツプ３、駆動回路
４にて機器駆動用信号とされて被制御機器２に供
給され、被制御機器２をオン状態としてテープを
走行せしめる。被制御機器２のオンにより、テー
プに記録されているメツセージが再生される。
メツセージの再生が終了し、センシング箔が検
出されると検出信号がとり出され、この検出信号
はプログラムタイマのリセツト端子５ｂを介して
オア回路７の一方の入力端子に供給される。これ
によりオア回路７より信号がとり出されてフリツ
プフロツプ３をリセツトし、フリツプフロツプ３
のリセツトにより駆動回路４より機器停止用信号
がとり出されて被制御機器２をオフ状態にしてテ
ープ走行を停止せしめる。
出されると検出信号がとり出され、この検出信号
はプログラムタイマのリセツト端子５ｂを介して
オア回路７の一方の入力端子に供給される。これ
によりオア回路７より信号がとり出されてフリツ
プフロツプ３をリセツトし、フリツプフロツプ３
のリセツトにより駆動回路４より機器停止用信号
がとり出されて被制御機器２をオフ状態にしてテ
ープ走行を停止せしめる。
このように被制御機器２よりのセンシング箔検
出信号にてフリツプフロツプ３をリセツトするよ
うにしているため、従来のようにCPUメモリ６
にてリセツト時刻を設定する必要がなく、操作が
容易である。
出信号にてフリツプフロツプ３をリセツトするよ
うにしているため、従来のようにCPUメモリ６
にてリセツト時刻を設定する必要がなく、操作が
容易である。
なお、リセツト端子５ｂと被制御機器２との間
にスイツチ（図示せず）を設け、上記の如きセン
シング箔による検出にて機器２をオフ状態にする
場合には該スイツチを閉成し、一方、第１図に示
す従来例のようにリセツト時刻設定によつて機器
２をオフ状態にする場合には該スイツチを開成し
ておけば、自動及び手動設定のいずれの場合にも
用い得る。
にスイツチ（図示せず）を設け、上記の如きセン
シング箔による検出にて機器２をオフ状態にする
場合には該スイツチを閉成し、一方、第１図に示
す従来例のようにリセツト時刻設定によつて機器
２をオフ状態にする場合には該スイツチを開成し
ておけば、自動及び手動設定のいずれの場合にも
用い得る。
又、CPUメモリ６のリセツト出力端子及びオ
ア回路７を設けることなく、被制御機器２よりの
検出信号を直接フリツプフロツプ３のリセツト入
力端子に供給せしめるように構成してもよい。こ
の場合、CPUメモリ６のプログラム数は従来の
CPUメモリのプログラム数に比して少なくて済
むため、CPUメモリ６を小形かつ安価に構成し
得る。
ア回路７を設けることなく、被制御機器２よりの
検出信号を直接フリツプフロツプ３のリセツト入
力端子に供給せしめるように構成してもよい。こ
の場合、CPUメモリ６のプログラム数は従来の
CPUメモリのプログラム数に比して少なくて済
むため、CPUメモリ６を小形かつ安価に構成し
得る。
上述の如く、本考案になるプログラムタイマ
は、被制御機器よりとり出される信号によつて該
機器をオフせしめる信号をとり出す機構を更に設
けたため、従来のように機器をオフせしめるため
のリセツト時刻をプログラム設定操作する必要が
なく、従来のものに比して設定操作が簡単であ
り、又、リセツト時刻を設定する必要がないため
に、従来のように、機器のオフ時刻を算出する煩
わしさがなく、更に、従来のように機器の動作時
間のバラツキを考慮に入れる必要がなく、又、機
器の所定の動作が終了した時点でとり出される信
号によつて機器をオフせしめ得るために、例え
ば、自動放送等のメツセージ再生に適用する場
合、メツセージ再生終了直後に電源をオフせしめ
得、従来のようにメツセージが終了してもしばら
くの間ノイズがとり出される等の不都合が生じる
ことはない等の特長を有する。
は、被制御機器よりとり出される信号によつて該
機器をオフせしめる信号をとり出す機構を更に設
けたため、従来のように機器をオフせしめるため
のリセツト時刻をプログラム設定操作する必要が
なく、従来のものに比して設定操作が簡単であ
り、又、リセツト時刻を設定する必要がないため
に、従来のように、機器のオフ時刻を算出する煩
わしさがなく、更に、従来のように機器の動作時
間のバラツキを考慮に入れる必要がなく、又、機
器の所定の動作が終了した時点でとり出される信
号によつて機器をオフせしめ得るために、例え
ば、自動放送等のメツセージ再生に適用する場
合、メツセージ再生終了直後に電源をオフせしめ
得、従来のようにメツセージが終了してもしばら
くの間ノイズがとり出される等の不都合が生じる
ことはない等の特長を有する。
第１図は従来のプログラムタイマの一例のブロ
ツク系統図、第２図は本考案になるプログラムタ
イマの一実施例のブロツク系統図である。 ２……被制御機器、３……フリツプフロツプ、
４……駆動回路、５ａ……出力端子、５ｂ……リ
セツト端子、６……CPUメモリ、７……オア回
路。
ツク系統図、第２図は本考案になるプログラムタ
イマの一実施例のブロツク系統図である。 ２……被制御機器、３……フリツプフロツプ、
４……駆動回路、５ａ……出力端子、５ｂ……リ
セツト端子、６……CPUメモリ、７……オア回
路。
Claims (1)
- セツト時刻及びリセツト時刻等のプログラムを
設定してこれらの時刻に被制御機器を夫々オン、
オフせしめる信号をとり出すプログラムタイマに
おいて、該被制御機器よりとり出される信号によ
つて該被制御機器をオフせしめる機構を更に設け
てなるプログラムタイマ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7134179U JPS622560Y2 (ja) | 1979-05-29 | 1979-05-29 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7134179U JPS622560Y2 (ja) | 1979-05-29 | 1979-05-29 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS55172898U JPS55172898U (ja) | 1980-12-11 |
| JPS622560Y2 true JPS622560Y2 (ja) | 1987-01-21 |
Family
ID=29305044
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7134179U Expired JPS622560Y2 (ja) | 1979-05-29 | 1979-05-29 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS622560Y2 (ja) |
-
1979
- 1979-05-29 JP JP7134179U patent/JPS622560Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS55172898U (ja) | 1980-12-11 |
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