JPS62287719A - 差分パルス符号変調符号化装置 - Google Patents
差分パルス符号変調符号化装置Info
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- JPS62287719A JPS62287719A JP62124130A JP12413087A JPS62287719A JP S62287719 A JPS62287719 A JP S62287719A JP 62124130 A JP62124130 A JP 62124130A JP 12413087 A JP12413087 A JP 12413087A JP S62287719 A JPS62287719 A JP S62287719A
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Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M7/00—Conversion of a code where information is represented by a given sequence or number of digits to a code where the same, similar or subset of information is represented by a different sequence or number of digits
- H03M7/30—Compression; Expansion; Suppression of unnecessary data, e.g. redundancy reduction
- H03M7/3002—Conversion to or from differential modulation
- H03M7/3044—Conversion to or from differential modulation with several bits only, i.e. the difference between successive samples being coded by more than one bit, e.g. differential pulse code modulation [DPCM]
- H03M7/3046—Conversion to or from differential modulation with several bits only, i.e. the difference between successive samples being coded by more than one bit, e.g. differential pulse code modulation [DPCM] adaptive, e.g. adaptive differential pulse code modulation [ADPCM]
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N19/00—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals
- H04N19/10—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals using adaptive coding
- H04N19/102—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals using adaptive coding characterised by the element, parameter or selection affected or controlled by the adaptive coding
- H04N19/124—Quantisation
-
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- Transmission Systems Not Characterized By The Medium Used For Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
３、発明の詳細な説明
本発明は、差分パルス符号変調符号化装置であフて、符
号化すべき信号を受信する入力端子と、符号化すべき信
号及び予測信号の間の差を示す所定数の２進エレメント
で形成した差分信号を供給する差回路と、予測信号を供
給する送信予測回路と、差分信号の２進エレメントの数
を制御情報の関数として低減する送信コード変換回路と
、アクティビティ情報を供給するアクティブティ測定回
路と、送信コード変換回路の出力信号につき可変語長符
号化を行う統計的符号化回路とを具え、更に、統計的符
号化回路の出力語を蓄積しかつ該出方路を差分パルス符
号変調符号化装置の出力端子に供給する緩衝記憶回路と
、緩衝記憶回路の占有情報を供給する占有測定回路とを
具える差分パルス符号化装置に関するものである。
号化すべき信号を受信する入力端子と、符号化すべき信
号及び予測信号の間の差を示す所定数の２進エレメント
で形成した差分信号を供給する差回路と、予測信号を供
給する送信予測回路と、差分信号の２進エレメントの数
を制御情報の関数として低減する送信コード変換回路と
、アクティビティ情報を供給するアクティブティ測定回
路と、送信コード変換回路の出力信号につき可変語長符
号化を行う統計的符号化回路とを具え、更に、統計的符
号化回路の出力語を蓄積しかつ該出方路を差分パルス符
号変調符号化装置の出力端子に供給する緩衝記憶回路と
、緩衝記憶回路の占有情報を供給する占有測定回路とを
具える差分パルス符号化装置に関するものである。
この種の符号化装置は特にディジタルテレビジョンの分
野において大規模に使用される。これについての参照文
献としてピータ−・パーシュ（Ｐｅｔｅｒ Ｐｉｒｓｃ
ｈ）著の論文“デザイン・オブ・ディ・ピー・シー・エ
ム・クオンタイザーズ・フォー・ビデオ・シグナルズ・
ユージング・サブジエクティブψテス７（Ｄｅｓｉｇｎ
ｏｆ ＤＰＣＭ Ｑｕａｎｔｉｚｅｒｓ ｆｏｒ Ｖ
ｉｃｌｅｏ Ｓｉｇｎａｌｓ ５ｕｂｊｅｃｔｉｖｅ
Ｔｅ５ｔｓ）”、 Ｊｕｌｙ １９３１゜アイ・イー・
イー・トランザクションズ・オン・コミュニケーション
ズ（ＩＥＥＥ Ｔｒａｎｓａｃｔｉｏｎｓ ｏｎＣｏｍ
ｍｕｎｉｃａｔｉｏｎｓ）”、 Ｖｏｌ、 Ｃａｍ、
２肌 Ｎｏ、 ７がある。
野において大規模に使用される。これについての参照文
献としてピータ−・パーシュ（Ｐｅｔｅｒ Ｐｉｒｓｃ
ｈ）著の論文“デザイン・オブ・ディ・ピー・シー・エ
ム・クオンタイザーズ・フォー・ビデオ・シグナルズ・
ユージング・サブジエクティブψテス７（Ｄｅｓｉｇｎ
ｏｆ ＤＰＣＭ Ｑｕａｎｔｉｚｅｒｓ ｆｏｒ Ｖ
ｉｃｌｅｏ Ｓｉｇｎａｌｓ ５ｕｂｊｅｃｔｉｖｅ
Ｔｅ５ｔｓ）”、 Ｊｕｌｙ １９３１゜アイ・イー・
イー・トランザクションズ・オン・コミュニケーション
ズ（ＩＥＥＥ Ｔｒａｎｓａｃｔｉｏｎｓ ｏｎＣｏｍ
ｍｕｎｉｃａｔｉｏｎｓ）”、 Ｖｏｌ、 Ｃａｍ、
２肌 Ｎｏ、 ７がある。
この種の符号化装置では、統計的符号化回路に起因して
緩衝記憶回路のオーバーフローの問題に当面することが
既知である。実際上、画像の符号化は語長の長い語の使
用を意味するので緩衝記憶回路に入るデータの数がこれ
を出て行くデータの数より大きくなることがある。
緩衝記憶回路のオーバーフローの問題に当面することが
既知である。実際上、画像の符号化は語長の長い語の使
用を意味するので緩衝記憶回路に入るデータの数がこれ
を出て行くデータの数より大きくなることがある。
この種の問題を解決するため統計的符号化回路が一層短
い長さの語を供給するようにコード変換回路を作動させ
ることは既知である（例えば、Ｔ。
い長さの語を供給するようにコード変換回路を作動させ
ることは既知である（例えば、Ｔ。
５ｈｉｏ他著の論文″スタティスティカル・パーフォー
マンス・アナリシス・オブ・アン・インターフレーム・
エンコーダ・フォー・ブロードキャスト・テレビジョン
・シグナルズ（Ｓｔａｔｉｓｔｉｃａｌ Ｐｅｒｆｏｒ
−ｍａｎｃｅ Ａｎａｌｙｓｉｓ ｏｆ ａｎ Ｉｎｔ
ｅｒｆｒａｍｅ Ｅｎｃｏｄｅｒ ｆｏｒＢｒｏａｄｃ
ａｓｔ Ｔｅ１ｅｖｉｓｉｏｎ Ｓｉｇｎａｌｓ）”Ｄ
ｅｃｅｍｂｅｒ １９８１゜ＩＥＥＥ Ｔｒａｎｓａｃ
ｔｉｏｎｓ ｏｎ Ｃｏｍｍｕｎｉｃａｔｉｏｎｓ、Ｖ
ｏｌ、 Ｃａｍ。
マンス・アナリシス・オブ・アン・インターフレーム・
エンコーダ・フォー・ブロードキャスト・テレビジョン
・シグナルズ（Ｓｔａｔｉｓｔｉｃａｌ Ｐｅｒｆｏｒ
−ｍａｎｃｅ Ａｎａｌｙｓｉｓ ｏｆ ａｎ Ｉｎｔ
ｅｒｆｒａｍｅ Ｅｎｃｏｄｅｒ ｆｏｒＢｒｏａｄｃ
ａｓｔ Ｔｅ１ｅｖｉｓｉｏｎ Ｓｉｇｎａｌｓ）”Ｄ
ｅｃｅｍｂｅｒ １９８１゜ＩＥＥＥ Ｔｒａｎｓａｃ
ｔｉｏｎｓ ｏｎ Ｃｏｍｍｕｎｉｃａｔｉｏｎｓ、Ｖ
ｏｌ、 Ｃａｍ。
２９、 Ｎｏ、１２参照）。
しかしこれらの方法では画像が過度に粗（符号化される
ので、画像の形態及び品位が貧弱になる。
ので、画像の形態及び品位が貧弱になる。
本発明の目的は、オーバーフローの危険性が検知される
極めて多数の場合において十分な品位の画像を保障でき
る差分パルス符号変調（ＤＰＣＭ）符号化装置を提供す
るにある。
極めて多数の場合において十分な品位の画像を保障でき
る差分パルス符号変調（ＤＰＣＭ）符号化装置を提供す
るにある。
かかる目的を達成するため本発明の差分パルス符号変調
符号化装置は、アクティブティ情報及び占有情報を供給
されるとこれに応動して制御情報を供給する合成装置を
具えたことを特徴とする。
符号化装置は、アクティブティ情報及び占有情報を供給
されるとこれに応動して制御情報を供給する合成装置を
具えたことを特徴とする。
また本発明は上記差分パルス符号変調符号化装置に関連
する復号装置に関し、かつ少なくとも１つのかかる符号
化装置又は復号装置を具える伝送装置に関する。
する復号装置に関し、かつ少なくとも１つのかかる符号
化装置又は復号装置を具える伝送装置に関する。
以下図面につき本発明の詳細な説明する。
第１図において数字１はテレビジョンカメラを示し、そ
の出力端子におけるアナログ信号はタイミング回路５に
よって規定される周波数においてサンプラ・エンコーダ
２によりディジタル形式に符号化される。
の出力端子におけるアナログ信号はタイミング回路５に
よって規定される周波数においてサンプラ・エンコーダ
２によりディジタル形式に符号化される。
このエンコーダの出力端子におけるサンプルを、予測回
路１０によって供給されるサンプルと比較する。この比
較のために差回路１２を使用し、この差回路によって得
た差信号をコード変換回路１５に供給し、このコード変
換回路は差信号の２進エレメントの数を低減するよう作
動する。この低減動作は、第２図に一部を示した形態の
特性Ｑ、、 Ｑ２及びＱ３に従って行われる。従って本
例では差信号を入力端子における５１１ （−２５５〜
＋２５５）のレベルにおけるＮＥに従って符号化する一
方、出力端子における信号を１５より多くないレベルＮ
Ｓに従って符号化し、これら異なる特性Ｑ、、 Ｑ２及
びＱ、の選択は入力端子２０に供給される制御信号によ
って決定される。コード変換回路１５の出力コードは、
予測回路１０の出力信号を一方の入力端子に供給される
加算器２１の他方の入力端子に供給し、かつ統計的符号
化回路２２の入力端子に供給し、語長の短いディジタル
語が最も頻繁に到来する入力語、即ち小さい値の差信号
を表わす語に対応するようにする。従って、ハフマンに
より提案された方法により、Ｎ５＝８に対しては１つの
２進エレメントから成る悟が得られ、ＮＳ＝ ９又は７
に対しては３つの２進エレメントから成る語が得られ、
Ｎ５＝１０又は６に対しては５つの２進エレメントから
成る語が得られ、以下同様の方法において譜が得られる
。この目的のためには、アール・シー・ゴンザレス（Ｒ
，Ｃ，Ｇｏｎｚａｌｅｚ）及ピー・ウインツ（Ｐ、Ｗｉ
ｎｔｚ）著の゛′ディジタル・イメージ・プロセッシン
グ（Ｄｉｇｉｔａｌ Ｉｍａｇｅ Ｐｒｏｃｅ−ｓｓｉ
ｎｇ）”、 １９７７年、アディソンーウエスレイ・
パブリッシング・カンパニー（Ａｄｄｉｓｏｎ−Ｗｅｓ
ｌｅｙ Ｐｕｂ−１ｉｓｈｉｎｇ Ｃｏｍｐａｎｙ）
福のセクション６、２．３．２を参照するとよい。
路１０によって供給されるサンプルと比較する。この比
較のために差回路１２を使用し、この差回路によって得
た差信号をコード変換回路１５に供給し、このコード変
換回路は差信号の２進エレメントの数を低減するよう作
動する。この低減動作は、第２図に一部を示した形態の
特性Ｑ、、 Ｑ２及びＱ３に従って行われる。従って本
例では差信号を入力端子における５１１ （−２５５〜
＋２５５）のレベルにおけるＮＥに従って符号化する一
方、出力端子における信号を１５より多くないレベルＮ
Ｓに従って符号化し、これら異なる特性Ｑ、、 Ｑ２及
びＱ、の選択は入力端子２０に供給される制御信号によ
って決定される。コード変換回路１５の出力コードは、
予測回路１０の出力信号を一方の入力端子に供給される
加算器２１の他方の入力端子に供給し、かつ統計的符号
化回路２２の入力端子に供給し、語長の短いディジタル
語が最も頻繁に到来する入力語、即ち小さい値の差信号
を表わす語に対応するようにする。従って、ハフマンに
より提案された方法により、Ｎ５＝８に対しては１つの
２進エレメントから成る悟が得られ、ＮＳ＝ ９又は７
に対しては３つの２進エレメントから成る語が得られ、
Ｎ５＝１０又は６に対しては５つの２進エレメントから
成る語が得られ、以下同様の方法において譜が得られる
。この目的のためには、アール・シー・ゴンザレス（Ｒ
，Ｃ，Ｇｏｎｚａｌｅｚ）及ピー・ウインツ（Ｐ、Ｗｉ
ｎｔｚ）著の゛′ディジタル・イメージ・プロセッシン
グ（Ｄｉｇｉｔａｌ Ｉｍａｇｅ Ｐｒｏｃｅ−ｓｓｉ
ｎｇ）”、 １９７７年、アディソンーウエスレイ・
パブリッシング・カンパニー（Ａｄｄｉｓｏｎ−Ｗｅｓ
ｌｅｙ Ｐｕｂ−１ｉｓｈｉｎｇ Ｃｏｍｐａｎｙ）
福のセクション６、２．３．２を参照するとよい。
この符号化回路２２の出力端子から直列形式で送出され
たコードは緩衝記憶回路２５に供給し、この記憶回路は
、一般に”ＦＩＦＯメモリ”の名称で知られる゛′先入
れ先出し″形式のメモリで構成する。
たコードは緩衝記憶回路２５に供給し、この記憶回路は
、一般に”ＦＩＦＯメモリ”の名称で知られる゛′先入
れ先出し″形式のメモリで構成する。
コード変換回路１５のコード変換特性Ｑ、、 Ｑ２及び
Ｑ３を決定するため、予測回路１０と共働するアクティ
ブティ（ａｃｔｉｖｉｔｙ）測定回路３０を使用する。
Ｑ３を決定するため、予測回路１０と共働するアクティ
ブティ（ａｃｔｉｖｉｔｙ）測定回路３０を使用する。
このアクティブティ測定回路によって発生したアクティ
ブティ値を、比較器３２及び３４の一方の入力端子に供
給することにより、その他方入力端子に供給した閾値Ｓ
Ｐ１ 及びＳＦ３ と比較する。
ブティ値を、比較器３２及び３４の一方の入力端子に供
給することにより、その他方入力端子に供給した閾値Ｓ
Ｐ１ 及びＳＦ３ と比較する。
かかるアクティブティ値により絵素間の遷移が規定され
ることは既知であり、かかる遷移が急激になるに従って
アクティブティは強くなる。きめの粗い特性、例えば、
Ｑ３は強いアクティブティと関連しており、その理由は
、遷移のいずれかの側に位置するレベル、を正確に符号
化する必要がないからである（前記ピータ−・パーシュ
の論文参照）。
ることは既知であり、かかる遷移が急激になるに従って
アクティブティは強くなる。きめの粗い特性、例えば、
Ｑ３は強いアクティブティと関連しており、その理由は
、遷移のいずれかの側に位置するレベル、を正確に符号
化する必要がないからである（前記ピータ−・パーシュ
の論文参照）。
その結果、きめの細い特性Ｑ２又は一層きめの細い特性
Ｑ１は弱いアクティブティと関連する。従ってこれらの
特性を選択することによっていわゆるノ＼フマン符号化
回路２２によって処理される語長の短い語に対応する８
に近いレベルＮＳに到達することが試みられる。しかし
語の長さが極めて長くなること、及び／又は伝送チャネ
ル（第１図において同軸ケーブル４０で示す）によって
決まる伝送速度が不十分であることから好ましくない場
合が起こることがある。その結果記憶回路２５がオーバ
ーフローする危険性が生じ、この危険性については緩衝
記憶回路２５に接続した占有測定回路４５によって発生
する占有情報を介して通報される。
Ｑ１は弱いアクティブティと関連する。従ってこれらの
特性を選択することによっていわゆるノ＼フマン符号化
回路２２によって処理される語長の短い語に対応する８
に近いレベルＮＳに到達することが試みられる。しかし
語の長さが極めて長くなること、及び／又は伝送チャネ
ル（第１図において同軸ケーブル４０で示す）によって
決まる伝送速度が不十分であることから好ましくない場
合が起こることがある。その結果記憶回路２５がオーバ
ーフローする危険性が生じ、この危険性については緩衝
記憶回路２５に接続した占有測定回路４５によって発生
する占有情報を介して通報される。
このオーバーフローを防止するため、本発明の符号化装
置は更に、アクティブティ情報及び占有情報を供給され
て制御情報を送出する合成装置５０を具える。
置は更に、アクティブティ情報及び占有情報を供給され
て制御情報を送出する合成装置５０を具える。
この合成装置５０は、比較器３２及び３４と、２つの乗
算器５２及び５４で構成し、これら乗算器は２つのあら
かじめ確立された閾値Ｓ１及びＳ２に係数αを乗算する
ことによって得られる閾値 Ｓｈ”α・５Ｉ ＳＰ２＝α・Ｓ２ を上記比較器の他方入力端子にそれぞれ供給する。
算器５２及び５４で構成し、これら乗算器は２つのあら
かじめ確立された閾値Ｓ１及びＳ２に係数αを乗算する
ことによって得られる閾値 Ｓｈ”α・５Ｉ ＳＰ２＝α・Ｓ２ を上記比較器の他方入力端子にそれぞれ供給する。
要素３２．３４．５２及び５４はこの符号化回路に関連
して復号回路にも存在する合成部５５の一部を構成する
。この係数αは次の演算 α（Ｔ＋１）＝α（Ｔ）−ｋ （ρａ（Ｔ）＋ 〔Ｂ（
Ｔ）−Ｂ（Ｔ−１）：ｌ ）但しに＝〔α（Ｔ）−α（
Ｔ−１） 〕／ （：Ｂ（Ｔ）−２Ｂ（Ｔ−１） ＋
Ｂ（Ｔ−２）及びρは減衰係数であり、０．５に等しく
することができる） を行う演算回路６０によって確立する。
して復号回路にも存在する合成部５５の一部を構成する
。この係数αは次の演算 α（Ｔ＋１）＝α（Ｔ）−ｋ （ρａ（Ｔ）＋ 〔Ｂ（
Ｔ）−Ｂ（Ｔ−１）：ｌ ）但しに＝〔α（Ｔ）−α（
Ｔ−１） 〕／ （：Ｂ（Ｔ）−２Ｂ（Ｔ−１） ＋
Ｂ（Ｔ−２）及びρは減衰係数であり、０．５に等しく
することができる） を行う演算回路６０によって確立する。
従って係数αは周期τ毎に瞬時１・τ（但しｉ＝−ω、
−−−、Ｔ−２，７−１，７） において計算され、
瞬時Ｔ・τは現在の瞬時に対応する。実際上、周期τの
持続時間は画像フレームの持続時間に対応する。Ｂ（Ｔ
）は多数の２進エレメントを格納する緩衝記憶回路の瞬
時Ｔにおける格納の度合い即ち格納度を示し、Ｂ（Ｔ−
１）は瞬時（Ｔ−１）における格納度を示し、Ｂ （Ｔ
−２）は瞬時（Ｔ−２） における格納度を示す。そこ
で、格納度Ｂ（Ｔ＋１）をゼロにするか、又はこの格納
度を減衰係数ρを介し低減せしめてこの格納度が先行す
る格納度の一部となる、即ちＢ（Ｔ＋１）＝（１−ρ）
Ｂ（Ｔ） となるようα（Ｔ＋１）を決定することを
提案する。
−−−、Ｔ−２，７−１，７） において計算され、
瞬時Ｔ・τは現在の瞬時に対応する。実際上、周期τの
持続時間は画像フレームの持続時間に対応する。Ｂ（Ｔ
）は多数の２進エレメントを格納する緩衝記憶回路の瞬
時Ｔにおける格納の度合い即ち格納度を示し、Ｂ（Ｔ−
１）は瞬時（Ｔ−１）における格納度を示し、Ｂ （Ｔ
−２）は瞬時（Ｔ−２） における格納度を示す。そこ
で、格納度Ｂ（Ｔ＋１）をゼロにするか、又はこの格納
度を減衰係数ρを介し低減せしめてこの格納度が先行す
る格納度の一部となる、即ちＢ（Ｔ＋１）＝（１−ρ）
Ｂ（Ｔ） となるようα（Ｔ＋１）を決定することを
提案する。
α（Ｔ＋１）を計算するため、格納度の変化はαの線形
関数であると考えられ、従ってこれは、消去すべき定数
α。と共に ） α（Ｔ）＝ｋ 〔Ｂ（Ｔ）−〇（Ｔ−１） 〕＋
ｃｘ。
関数であると考えられ、従ってこれは、消去すべき定数
α。と共に ） α（Ｔ）＝ｋ 〔Ｂ（Ｔ）−〇（Ｔ−１） 〕＋
ｃｘ。
と表わすことができる。
従ってα（Ｔ＋１）を推定するためにはＢ （Ｔ＋１）
−ｅ （Ｔ） ・ −ｐＢ（Ｔ）とすることが必要で
あり、従って次式 ％式％（）：］ 演算回路６０は緩衝記憶回路の格納度の読取時のみ格納
度の評価を行い、この格納度により、本例では、占有情
報が形成される。
−ｅ （Ｔ） ・ −ｐＢ（Ｔ）とすることが必要で
あり、従って次式 ％式％（）：］ 演算回路６０は緩衝記憶回路の格納度の読取時のみ格納
度の評価を行い、この格納度により、本例では、占有情
報が形成される。
第３図には占有測定回路４５と共働する符号化回路２２
の実施例を示すと共に、占有情報が処理される態様を示
しである。
の実施例を示すと共に、占有情報が処理される態様を示
しである。
本例の符号化回路は実際上、読出専用メモリ１００をも
って構成し、そのアドレス指定はコード変換回路１５の
出力コードによって行う。このメモリの出力端子におけ
るコードは２つの部分に分割し、一方の部分はレジスタ
１０２の並列接続入力端子に供給し、かつ他方の部分は
シフトレジスタ１０４の並列接続入力端子に供給し、レ
ジスタ１０２はシフトレジスタ１０４における語の幅を
示す値を含むようにする。これらレジスタ１０２及び１
０４へのローディングを制御する制御手段には、サンプ
ラ・エンコーダ２によって行われるサンプリングと同一
周波数において作用する信号ＨＣを供給する。シフトレ
ジスタ１０４の直列出力端子は記憶回路２５の入力端子
に接続する。この記憶回路への書込はシフトレジスタ１
０４のシフト周波数と同一周波数における信号ＷＦＯを
介して行われる。この信号ＷＦＯは２個の入力端子を有
するＡＮＤゲー） １０６の出力端子から供給され、こ
のＡＮＤゲートの一方の入力端子には周期信号Ｗを供給
し、この周期信号の周波数は信号ＨＣの周波数の増倍数
の周波数であってこの増倍数はシフトレジスタ１０４に
含まれるコードの最大長さに対応する。またＡＮＤゲー
ト１０６の他方入力端子はコード比較器１０８の出力端
子に接続し、このコード比較器は、レジスタ１０２に含
まれるコードと、信号ＷＦＯのパルスを計数するカウン
タ１１０ に含まれるコードとが等しいことが検出され
た場合、ＡＮＤゲート１０６にブロッキング信号を供給
する。信号ＨＣが作動レベルになると直ちにこのカウン
タはゼロにリセットされる。
って構成し、そのアドレス指定はコード変換回路１５の
出力コードによって行う。このメモリの出力端子におけ
るコードは２つの部分に分割し、一方の部分はレジスタ
１０２の並列接続入力端子に供給し、かつ他方の部分は
シフトレジスタ１０４の並列接続入力端子に供給し、レ
ジスタ１０２はシフトレジスタ１０４における語の幅を
示す値を含むようにする。これらレジスタ１０２及び１
０４へのローディングを制御する制御手段には、サンプ
ラ・エンコーダ２によって行われるサンプリングと同一
周波数において作用する信号ＨＣを供給する。シフトレ
ジスタ１０４の直列出力端子は記憶回路２５の入力端子
に接続する。この記憶回路への書込はシフトレジスタ１
０４のシフト周波数と同一周波数における信号ＷＦＯを
介して行われる。この信号ＷＦＯは２個の入力端子を有
するＡＮＤゲー） １０６の出力端子から供給され、こ
のＡＮＤゲートの一方の入力端子には周期信号Ｗを供給
し、この周期信号の周波数は信号ＨＣの周波数の増倍数
の周波数であってこの増倍数はシフトレジスタ１０４に
含まれるコードの最大長さに対応する。またＡＮＤゲー
ト１０６の他方入力端子はコード比較器１０８の出力端
子に接続し、このコード比較器は、レジスタ１０２に含
まれるコードと、信号ＷＦＯのパルスを計数するカウン
タ１１０ に含まれるコードとが等しいことが検出され
た場合、ＡＮＤゲート１０６にブロッキング信号を供給
する。信号ＨＣが作動レベルになると直ちにこのカウン
タはゼロにリセットされる。
従って記憶回路２５には可変長の各９吾を構成する２進
エレメントが順次格納される。記憶回路２５の格納度を
得るため加算器１１５及び累算レジスタ１１７をもって
構成したアキュムレータ回路を使用する。加算器１１５
はレジスタ１０２の内容と、レジスタ１１７の内容から
値１１ Ｂ Ｒ＃を減算した残りとの和を送出する。こ
の減算は減算回路１２０によって行う。
エレメントが順次格納される。記憶回路２５の格納度を
得るため加算器１１５及び累算レジスタ１１７をもって
構成したアキュムレータ回路を使用する。加算器１１５
はレジスタ１０２の内容と、レジスタ１１７の内容から
値１１ Ｂ Ｒ＃を減算した残りとの和を送出する。こ
の減算は減算回路１２０によって行う。
値” Ｂ Ｒ”によって記憶回路２５の最適格納度、例
えば、その容量の半分が規定される。周期τ後毎に作動
レベルになる信号Ｈτにより、レジスタ１２２に、演算
回路６０のための有効な格納度Ｂ（・・・）をロードす
ることができる。なお、記憶回路２５は読出信号ＲＦＯ
の周波数において読出される。かくして符号化された情
報を伝送できるようにするためマルチプレクサ１５０（
第１図参照）を使用し、このマルチプレクサはタイミン
グ回路５によって供給される同期コードＳＹＴ”を第１
周期中に送信回路１５１を介して伝送チャンネル２０へ
送信し、次いで演算回路６０の出力端子に接続した並列
接続入力端子を有するシフトレジスタ１５２から生ずる
値αを第２周期中に送信し、最後に、記憶回路２５から
生ずる画像情報を第３周期中に送信し、これが各画像フ
レームを介して再生される。上述した各信号ＷＳＨτ、
ＨＣ及びＲＦＯはタイミング回路５から供給する。
えば、その容量の半分が規定される。周期τ後毎に作動
レベルになる信号Ｈτにより、レジスタ１２２に、演算
回路６０のための有効な格納度Ｂ（・・・）をロードす
ることができる。なお、記憶回路２５は読出信号ＲＦＯ
の周波数において読出される。かくして符号化された情
報を伝送できるようにするためマルチプレクサ１５０（
第１図参照）を使用し、このマルチプレクサはタイミン
グ回路５によって供給される同期コードＳＹＴ”を第１
周期中に送信回路１５１を介して伝送チャンネル２０へ
送信し、次いで演算回路６０の出力端子に接続した並列
接続入力端子を有するシフトレジスタ１５２から生ずる
値αを第２周期中に送信し、最後に、記憶回路２５から
生ずる画像情報を第３周期中に送信し、これが各画像フ
レームを介して再生される。上述した各信号ＷＳＨτ、
ＨＣ及びＲＦＯはタイミング回路５から供給する。
本発明の復号装置は受信回路１６１を具え、その入力端
子を伝送チャンネル４０に接続し、かつその出力端子を
タイミング回路１６５０入力端子及びデマルチプレクサ
１７０の入力端子に接続し、このデマルチプレクサを受
信側のタイミング回路１６５ により制御して、値αを
レジスタ１７５に供給し、かつ可変長の語を、符号化回
路２２と逆の動作を行う復号回路１７２に供給するよう
にする。コード逆変換回路１８０はコード変換回路１５
によって行われるのと逆の動作を行い、即ち逆の特性Ｑ
ｌ ’＋ ０２”−’＋Ｑ、−１の一つに対応する動作
を行う。選択すべき値が各ステップの中央に来るように
する。従ってコードＮ Ｓ ＝１０は特性Ｑ、−″１に
対してはＮＥ−９に対応し、これら特性の選択はその入
力端子１８１に供給されるコード情報に依有する。加算
器１８５により、コード逆変換回路１８０の出力コード
及び予測回路１０と同一構造を有する予測回路１９０の
出力端子における出力コードの和を発生させ、またアク
ティブティ測定回路３０と同一構造を有するアクティブ
ティ測定回路１９２を設け、その測定結果と情報αとを
合成部１９５により、合成部５５におけると同−態様で
処理して制御情報を供給するようにする。従ってディジ
タル・アナログ・コンバータ２００ａにより、表示装置
２１０ａを作動させるに好適な情報が供給される。
子を伝送チャンネル４０に接続し、かつその出力端子を
タイミング回路１６５０入力端子及びデマルチプレクサ
１７０の入力端子に接続し、このデマルチプレクサを受
信側のタイミング回路１６５ により制御して、値αを
レジスタ１７５に供給し、かつ可変長の語を、符号化回
路２２と逆の動作を行う復号回路１７２に供給するよう
にする。コード逆変換回路１８０はコード変換回路１５
によって行われるのと逆の動作を行い、即ち逆の特性Ｑ
ｌ ’＋ ０２”−’＋Ｑ、−１の一つに対応する動作
を行う。選択すべき値が各ステップの中央に来るように
する。従ってコードＮ Ｓ ＝１０は特性Ｑ、−″１に
対してはＮＥ−９に対応し、これら特性の選択はその入
力端子１８１に供給されるコード情報に依有する。加算
器１８５により、コード逆変換回路１８０の出力コード
及び予測回路１０と同一構造を有する予測回路１９０の
出力端子における出力コードの和を発生させ、またアク
ティブティ測定回路３０と同一構造を有するアクティブ
ティ測定回路１９２を設け、その測定結果と情報αとを
合成部１９５により、合成部５５におけると同−態様で
処理して制御情報を供給するようにする。従ってディジ
タル・アナログ・コンバータ２００ａにより、表示装置
２１０ａを作動させるに好適な情報が供給される。
第５図は予測回路１０．１９０ 、アクティブティ測定
回路３０．１９２及び合成回路５５．１９５並びに制御
情報を発生する態様の好適例を示す。これらの回路では
先行ライン上の点及び同一ライン上の先行点の輝度を用
いる。
回路３０．１９２及び合成回路５５．１９５並びに制御
情報を発生する態様の好適例を示す。これらの回路では
先行ライン上の点及び同一ライン上の先行点の輝度を用
いる。
第５図の例は縦続接続した遅延素子２００．２０１゜２
０２及び２０３を具え、遅延素子２００．２０２及び２
０３により１絵素の遅延を発生し、遅延素子２０１によ
り１画像ラインから２絵素を差引いた時間に等価な遅延
を発生するようにする。これら遅延素子の出力端子にお
ける種々の信号から予測を行うことができる一方、アク
ティビティをも測定できる。
０２及び２０３を具え、遅延素子２００．２０２及び２
０３により１絵素の遅延を発生し、遅延素子２０１によ
り１画像ラインから２絵素を差引いた時間に等価な遅延
を発生するようにする。これら遅延素子の出力端子にお
ける種々の信号から予測を行うことができる一方、アク
ティビティをも測定できる。
予測については各マルチプレクサ２１０．２１１，２１
２及び２１３により遅延素子２００．２０１．２０２及
び２０３の出力端子に右ける信号と、予測係数ＫＭ、’
ＫＯ，ＫＣ及びＫＢとの積をそれぞれ形成し、加算器
２１５によりこれらの積の和を形成することによって予
測値を発生させるようにする。
２及び２１３により遅延素子２００．２０１．２０２及
び２０３の出力端子に右ける信号と、予測係数ＫＭ、’
ＫＯ，ＫＣ及びＫＢとの積をそれぞれ形成し、加算器
２１５によりこれらの積の和を形成することによって予
測値を発生させるようにする。
アクティブティについては、その入力端子に供給された
信号の差の絶対値を発生する演算器２２０゜２２１、２
２２．２２３．２２４及び２２５を使用する。これらの
入力端子は遅延素子２００〜２０３の各出力端子に接続
する。第１群の比較器２５０〜２５５は、演算器２２０
〜２２５の一つによって発生した絶対値の一つが閾値Ｓ
ＰＩを超えたか否かを検出し、ＯＲゲート２５８はこれ
ら比較器２２０〜２２５のすべての出力を供給されて制
御情報の第１の２進エレメントを回復する。第２群の比
較器２６０〜２６５は、演算器２２０〜２２５の一つに
よって発生した絶対値の一つが閾値ＳＰ２を超えたか否
かを検出し、ＯＲゲート２６８はこれら比較器２６０〜
２６５のすべての出力を供給されて制御情報の第２の２
進エレメントを形成する。
信号の差の絶対値を発生する演算器２２０゜２２１、２
２２．２２３．２２４及び２２５を使用する。これらの
入力端子は遅延素子２００〜２０３の各出力端子に接続
する。第１群の比較器２５０〜２５５は、演算器２２０
〜２２５の一つによって発生した絶対値の一つが閾値Ｓ
ＰＩを超えたか否かを検出し、ＯＲゲート２５８はこれ
ら比較器２２０〜２２５のすべての出力を供給されて制
御情報の第１の２進エレメントを回復する。第２群の比
較器２６０〜２６５は、演算器２２０〜２２５の一つに
よって発生した絶対値の一つが閾値ＳＰ２を超えたか否
かを検出し、ＯＲゲート２６８はこれら比較器２６０〜
２６５のすべての出力を供給されて制御情報の第２の２
進エレメントを形成する。
コード逆変換回路１８０及びコード変換回路１５は読出
専用メモリで構成し、そのアドレスは小さい重みに対し
て差回路１２又は復号回路１７２の出力信号で構成し、
かつ大きい重みに対しては制御情報で構成すると有利で
ある。
専用メモリで構成し、そのアドレスは小さい重みに対し
て差回路１２又は復号回路１７２の出力信号で構成し、
かつ大きい重みに対しては制御情報で構成すると有利で
ある。
第６図は、係数αが絵素当りのビット符号化の下限を示
すエントロピーＳにつき影響を及ぼす態様の一例を示す
。従ってこれは可能な調整速度を示す。
すエントロピーＳにつき影響を及ぼす態様の一例を示す
。従ってこれは可能な調整速度を示す。
第１図は本発明の符号化装置の実施例を示すブロック図
、 第２図は第１図のコード変換回路の作動説明図、第３図
は第１図の統計的符号化回路及び占有測定回路の実施例
を示す線図、 第４図は本発明の復号装置の実施例を示すブロック図、 第５図は予測回路、アクティブティ測定回路及び合成部
の実施例を示す線図、 第６図は、係数αが絵素当りのビット符号化の下限を示
すエントロピーＳにつき影響を及ぼす態様の一例を示す
図である。 ■・・・テレビジョンカメラ ２・・・サンプラ・エンコーダ ５・・・タイミング回路 １０・・・送信予測回路１
２・・・差回路 １５・・・コード変換回路
２０・・・伝送チャネル ２１・・・加算器２２・
・・統計的符号化回路 ２５・・・緩衝記憶回路３０・
・・アクティブティ測定回路 ３２、３４・・・比較器 ４０・・・同軸ケーブ
ル４５・・・占有測定回路 ５０・・・合成装置５
２、５４・・・乗算器 ５５・・・合成部６０・
・・演算回路 １００・・・読出専用メモリ １０２・・・レジスタ１
０４・・・シフトレジスタ １０８・・・コード比較器
１１０・・・カウンタ １１５・・・加算器１１
７・・・累算レジスタ １２０・・・減算回路１２２
・・・レジスタ １５０・・・マルチプレクサ １５１・・・送信回路１
６１・・・受信回路 １７０・・・デマチプレクサ １７２・・・復号回路１
７５・・・レジスタ １８０・・・コード逆変換
回路１８５・・・加算器 １９０・・・予測回
路１９２・・・アクティブティ測定回路 １９５・・・合成部 ２００ａ・・・ディジタル・アナログ・コンバータ２０
０〜２０３・・・遅延素子 ２１０ａ・・・表示装置２
１０〜２１３・・・マルチプレクサ ２１５・・・加算器 ２２０〜２２５・・・演
算器２５０〜２５５・・・比較器 ２６０〜２６５・
・・比較器特許出願人 エヌ・ベー・フィリップス
・フルーイランペンファブリケン
、 第２図は第１図のコード変換回路の作動説明図、第３図
は第１図の統計的符号化回路及び占有測定回路の実施例
を示す線図、 第４図は本発明の復号装置の実施例を示すブロック図、 第５図は予測回路、アクティブティ測定回路及び合成部
の実施例を示す線図、 第６図は、係数αが絵素当りのビット符号化の下限を示
すエントロピーＳにつき影響を及ぼす態様の一例を示す
図である。 ■・・・テレビジョンカメラ ２・・・サンプラ・エンコーダ ５・・・タイミング回路 １０・・・送信予測回路１
２・・・差回路 １５・・・コード変換回路
２０・・・伝送チャネル ２１・・・加算器２２・
・・統計的符号化回路 ２５・・・緩衝記憶回路３０・
・・アクティブティ測定回路 ３２、３４・・・比較器 ４０・・・同軸ケーブ
ル４５・・・占有測定回路 ５０・・・合成装置５
２、５４・・・乗算器 ５５・・・合成部６０・
・・演算回路 １００・・・読出専用メモリ １０２・・・レジスタ１
０４・・・シフトレジスタ １０８・・・コード比較器
１１０・・・カウンタ １１５・・・加算器１１
７・・・累算レジスタ １２０・・・減算回路１２２
・・・レジスタ １５０・・・マルチプレクサ １５１・・・送信回路１
６１・・・受信回路 １７０・・・デマチプレクサ １７２・・・復号回路１
７５・・・レジスタ １８０・・・コード逆変換
回路１８５・・・加算器 １９０・・・予測回
路１９２・・・アクティブティ測定回路 １９５・・・合成部 ２００ａ・・・ディジタル・アナログ・コンバータ２０
０〜２０３・・・遅延素子 ２１０ａ・・・表示装置２
１０〜２１３・・・マルチプレクサ ２１５・・・加算器 ２２０〜２２５・・・演
算器２５０〜２５５・・・比較器 ２６０〜２６５・
・・比較器特許出願人 エヌ・ベー・フィリップス
・フルーイランペンファブリケン
Claims (1)
- 【特許請求の範囲】 １、差分パルス符号変調符号化装置であって、符号化す
べき信号を受信する入力端子と、符号化すべき信号及び
予測信号の間の差を示す所定数の２進エレメントで形成
した差分信号を供給する差回路と、予測信号を供給する
送信予測回路と、差分信号の２進エレメントの数を制御
情報の関数として低減する送信コード変換回路と、アク
ティビティ情報を供給するアクティブティ測定回路と、
送信コード変換回路の出力信号につき可変語長符号化を
行う統計的符号化回路とを具え、更に、統計的符号化回
路の出力語を蓄積しかつ該出力語を差分パルス符号変調
符号化装置の出力端子に供給する緩衝記憶回路と、緩衝
記憶回路の占有情報を供給する占有測定回路とを具える
差分パルス符号化装置において、アクティブティ情報及
び占有情報を供給されるとこれに応動して制御情報を供
給する合成装置を具えたことを特徴とする差分パルス符
号変調符号化装置。 ２、前記コード変換回路が、あらかじめ確立されており
、かつ制御情報によってあらかじめ決定できる数個の特
性を有する特許請求の範囲第１項記載の差分パルス符号
変調符号化装置において、前記合成装置に、アクティブ
ティ情報を閾情報と比較して制御情報を送出させる比較
手段と、占有情報と、あらかじめ確立された閾情報を供
給されて閾情報を供給する合成回路とを設けた特許請求
の範囲第１項記載の差分パルス符号変調符号化装置。 ３、占有情報が緩衝記憶回路の格納度に対応する形態Ｂ
（Ｔ）において得られる特許請求の範囲第２項記載の差
分パルス符号変調符号化装置において、合成装置に瞬時
ｉτ（但しｉ＝−∞、−−−、Ｔ−２、Ｔ−１、Ｔ）に
おいてα（Ｔ＋１）＝α（Ｔ）−ｋ｛ρ８（Ｔ）＋〔Ｂ
（Ｔ）−Ｂ（Ｔ−１）〕｝但しｋ＝〔α（Ｔ）−α（Ｔ
−１）〕／〔Ｂ（Ｔ）−２Ｂ（Ｔ−１）＋Ｂ（Ｔ−２）
〕なる演算を行う演算回路を設け、かつ前記合成回路を
、前記あらかじめ確立された閾情報とこの値αとの乗算
を行う乗算器とすることを特徴とする差分パルス符号変
調符号化装置。 ４、差分パルス符号変調符号化装置であって、符号化す
べき信号を受信する入力端子と、符号化すべき信号及び
予測信号の間の差を示す所定数の２進エレメントで形成
した差分信号を供給する差回路と、予測信号を供給する
送信予測回路と、差分信号の２進エレメントの数を制御
情報の関数として低減する送信コード変換回路と、アク
ティビティ情報を供給するアクティブティ測定回路と、
送信コード変換回路の出力信号につき可変語長符号化を
行う統計的符号化回路とを具え、更に、統計的符号化回
路の出力語を蓄積しかつ該出力語を差分パルス符号変調
符号化装置の出力端子に供給する緩衝記憶回路と、緩衝
記憶回路の占有情報を供給する占有測定回路とを具える
差分パルス符号化装置において、アクティブティ情報及
び占有情報を供給されるとこれに応動して制御情報を供
給する合成装置を具えた差分パルス符号変調符号化装置
に関連して使用され、占有情報から導出した復号情報を
伝送する手段を具える変調復号装置において、復号情報
の抽出回路と、可変長のディジタル語を復号する復号回
路と、送信符号変換回路の符号変換を受信制御情報の関
数としてあらかじめ確立する受信コード変換回路と、受
信コード変換回路の出力信号に、受信予測回路によって
供給された信号を加算して、復号された信号をユーザ及
び受信予測回路の２進エレメントに供給する加算回路と
、受信アクティブティ測定回路と、アクティブティ情報
及び占有情報を供給されて受信制御情報を送出する合成
装置とを具えたことを特徴とする変調復号装置。 ５、差分パルス符号変調符号化装置であって、符号化す
べき信号を受信する入力端子と、符号化すべき信号及び
予測信号の間の差を示す所定数の２進エレメントで形成
した差分信号を供給する差回路と、予測信号を供給する
送信予測回路と、差分信号の２進エレメントの数を制御
情報の関数として低減する送信コード変換回路と、アク
ティビティ情報を供給するアクティブティ測定回路と、
送信コード変換回路の出力信号につき可変語長符号化を
行う統計的符号化回路とを具え、更に、統計的符号化回
路の出力語を蓄積しかつ該出力語を差分パルス符号変調
符号化装置の出力端子に供給する緩衝記憶回路と、緩衝
記憶回路の占有情報を供給する占有測定回路とを具える
差分パルス符号化装置において、アクティブティ情報及
び占有情報を供給されるとこれに応動して制御情報を供
給する合成装置を具えた差分パルス符号変調符号化装置
と、 占有情報から導出した復号情報を伝送する 手段を具える変調復号装置において、復号情報の抽出回
路と、可変長のディジタル語を復号する復号回路と、送
信符号変換回路の符号変換を受信制御情報の関数として
あらかじめ確立する受信コード変換回路と、受信コード
変換回路の出力信号に、受信予測回路によって供給され
た信号を加算して、復号された信号をユーザ及び受信予
測回路の２進エレメントに供給する加算回路と、受信ア
クティブティ測定回路と、アクティブティ情報及び占有
情報を供給されて受信制御情報を送出する合成装置とを
具えた復号装置とを含むことを特徴とする伝送装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| FR8607392A FR2599201A1 (fr) | 1986-05-23 | 1986-05-23 | Dispositif de codage a modulation differentielle par impulsions codees, dispositif de decodage associe et systeme de transmission comportant au moins un tel dispositif de codage ou de decodage |
| FR8607392 | 1986-05-23 |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8233184A Division JPH09121162A (ja) | 1986-05-23 | 1996-09-03 | 差分パルス符号変調符号化装置を具えた伝送システム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62287719A true JPS62287719A (ja) | 1987-12-14 |
Family
ID=9335556
Family Applications (2)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62124130A Pending JPS62287719A (ja) | 1986-05-23 | 1987-05-22 | 差分パルス符号変調符号化装置 |
| JP8233184A Pending JPH09121162A (ja) | 1986-05-23 | 1996-09-03 | 差分パルス符号変調符号化装置を具えた伝送システム |
Family Applications After (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8233184A Pending JPH09121162A (ja) | 1986-05-23 | 1996-09-03 | 差分パルス符号変調符号化装置を具えた伝送システム |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US4893123A (ja) |
| EP (1) | EP0246701B1 (ja) |
| JP (2) | JPS62287719A (ja) |
| DE (1) | DE3774761D1 (ja) |
| FR (1) | FR2599201A1 (ja) |
Families Citing this family (25)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| FR2633133B1 (fr) * | 1988-06-17 | 1990-10-05 | Thomson Csf | Procede de regulation du remplissage de la memoire tampon d'un codeur d'images, et dispositif de regulation pour la mise en oeuvre de ce procede |
| FR2640841A1 (fr) * | 1988-12-20 | 1990-06-22 | Trt Telecom Radio Electr | Dispositif de transmission de mots d'un code statistique |
| JPH0314383A (ja) * | 1989-06-13 | 1991-01-23 | Canon Inc | 符号化装置 |
| DE3926154A1 (de) * | 1989-06-30 | 1991-01-10 | Thomson Brandt Gmbh | Signalverarbeitungssystem |
| GB9012326D0 (en) * | 1990-06-01 | 1990-07-18 | Thomson Consumer Electronics | Wide screen television |
| US5311309A (en) * | 1990-06-01 | 1994-05-10 | Thomson Consumer Electronics, Inc. | Luminance processing system for compressing and expanding video data |
| WO1992009173A1 (de) * | 1990-11-16 | 1992-05-29 | Siemens Aktiengesellschaft | Verfahren zur adaptiven quantisierung zwecks datenreduktion bei der übertragung von digitalen bildern |
| US5287188A (en) * | 1992-01-07 | 1994-02-15 | Thomson Consumer Electronics, Inc. | Horizontal panning for wide screen television |
| EP0616466B1 (en) * | 1992-01-07 | 2000-06-07 | Thomson Consumer Electronics, Inc. | Horizontal panning for wide screen television |
| GB9200281D0 (en) * | 1992-01-08 | 1992-02-26 | Thomson Consumer Electronics | A pip horizontal panning circuit for wide screen television |
| JP2871316B2 (ja) * | 1992-07-10 | 1999-03-17 | 日本ビクター株式会社 | 動画像符号化装置 |
| JP3165296B2 (ja) * | 1992-12-25 | 2001-05-14 | 三菱電機株式会社 | フレーム間符号化処理方式及びフレーム間符号化処理方法及び符号化制御方式 |
| FR2702857B1 (fr) * | 1993-03-18 | 1995-06-02 | Pierre Antonini | Procédé et dispositif d'autorisation d'accès à un appareil comportant un système informatique d'exploitation. |
| US6870886B2 (en) * | 1993-12-15 | 2005-03-22 | Koninklijke Philips Electronics N.V. | Method and apparatus for transcoding a digitally compressed high definition television bitstream to a standard definition television bitstream |
| JPH0865665A (ja) * | 1994-08-25 | 1996-03-08 | Hitachi Denshi Ltd | 画像圧縮伝送方法および画像圧縮伝送システム |
| US6222881B1 (en) | 1994-10-18 | 2001-04-24 | Intel Corporation | Using numbers of non-zero quantized transform signals and signal differences to determine when to encode video signals using inter-frame or intra-frame encoding |
| US5802213A (en) * | 1994-10-18 | 1998-09-01 | Intel Corporation | Encoding video signals using local quantization levels |
| US5621901A (en) * | 1994-10-31 | 1997-04-15 | Intel Corporation | Method and apparatus for serial bus elements of an hierarchical serial bus assembly to electrically represent data and control states to each other |
| US5926222A (en) * | 1995-09-28 | 1999-07-20 | Intel Corporation | Bitrate estimator for selecting quantization levels for image encoding |
| US5926569A (en) * | 1995-09-28 | 1999-07-20 | Intel Corporation | Bitrate damper for selecting quantization levels for image encoding |
| US5758092A (en) * | 1995-11-14 | 1998-05-26 | Intel Corporation | Interleaved bitrate control for heterogeneous data streams |
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