JPS6230295U - - Google Patents
Info
- Publication number
- JPS6230295U JPS6230295U JP12137885U JP12137885U JPS6230295U JP S6230295 U JPS6230295 U JP S6230295U JP 12137885 U JP12137885 U JP 12137885U JP 12137885 U JP12137885 U JP 12137885U JP S6230295 U JPS6230295 U JP S6230295U
- Authority
- JP
- Japan
- Prior art keywords
- signal
- flushing
- information
- color
- representing
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000011010 flushing procedure Methods 0.000 claims description 14
- 230000008094 contradictory effect Effects 0.000 claims 4
- 238000000034 method Methods 0.000 claims 4
- 238000010586 diagram Methods 0.000 description 4
- 230000000737 periodic effect Effects 0.000 description 1
- 230000001360 synchronised effect Effects 0.000 description 1
Landscapes
- Processing Of Color Television Signals (AREA)
Description
第1図は本考案の一実施例に係るフラツシング
回路の構成を示すブロツク図、第2図はブロツク
着色フレーム構成に対応するメモリ構成を示す概
念図、第3図a及びbは第1図における信号のタ
イミング図、第4図は2相フラツシングを説明す
るための画面上の状態図である。 11……ラツチ、13……タイマ、17,19
,23……アンドゲート、25……マルチプレク
サ、31……パターン面メモリ、S1……正相フ
ラツシング情報信号、S2……逆相フラツシング
情報信号、S3……ラツチコントロール信号、S
4……正相周期信号、S5……逆相同期信号、S
6……パターン情報信号、S7……背景色情報信
号、S8……前景色情報信号、S9……色情報信
号、S10……フラツシング処理信号。
回路の構成を示すブロツク図、第2図はブロツク
着色フレーム構成に対応するメモリ構成を示す概
念図、第3図a及びbは第1図における信号のタ
イミング図、第4図は2相フラツシングを説明す
るための画面上の状態図である。 11……ラツチ、13……タイマ、17,19
,23……アンドゲート、25……マルチプレク
サ、31……パターン面メモリ、S1……正相フ
ラツシング情報信号、S2……逆相フラツシング
情報信号、S3……ラツチコントロール信号、S
4……正相周期信号、S5……逆相同期信号、S
6……パターン情報信号、S7……背景色情報信
号、S8……前景色情報信号、S9……色情報信
号、S10……フラツシング処理信号。
Claims (1)
- 【実用新案登録請求の範囲】 1 互いに相反する色情報の第1及び第2のフラ
ツシング情報信号を、フラツシングの対象指令情
報を表わす第3信号に基づいてラツチするラツチ
手段と、互いに相反する選択制御情報を表わす第
4及び第5の制御信号を発生する手段と、前記ラ
ツチ手段の出力信号と前記第4及び第5制御信号
とに基づいて第1フラツシシング処理の有無を表
わす第6信号を発生する手段と、前記第6信号と
第2フラツシング処理の有無を表わす第7信号と
に基づいて多重化選択信号を発生する手段と、前
記多重化選択信号に応じて互いに相反する色情報
を表わす2つの色情報信号を選択し、多重化され
た色信号を出力する手段とを有することを特徴と
するフラツシング回路。 2 前記互いに相反する色情報は、前景色及び背
景色を表わす情報であることを特徴とする実用新
案登録請求の範囲第1項に記載のフラツシング回
路。 3 前記フラツシング処理は、2相フラツシング
処理であることを特徴とする実用新案登録請求の
範囲第1項記載のフラツシング回路。 4 前記第4及び第5の制御信号は、互いに相反
する論理レベルを有する論理信号であることを特
徴とする実用新案登録請求の範囲第1項に記載の
フラツシング回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12137885U JPS6230295U (ja) | 1985-08-07 | 1985-08-07 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12137885U JPS6230295U (ja) | 1985-08-07 | 1985-08-07 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6230295U true JPS6230295U (ja) | 1987-02-23 |
Family
ID=31010594
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12137885U Pending JPS6230295U (ja) | 1985-08-07 | 1985-08-07 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6230295U (ja) |
-
1985
- 1985-08-07 JP JP12137885U patent/JPS6230295U/ja active Pending
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JPS6230295U (ja) | ||
| JPS5611528A (en) | Switching control circuit of different period clock | |
| JPH02150879U (ja) | ||
| JPS641824Y2 (ja) | ||
| JPS62183445U (ja) | ||
| JPH036325U (ja) | ||
| JPH0469938U (ja) | ||
| JPS6223349U (ja) | ||
| JPS62164422U (ja) | ||
| JPH0399368U (ja) | ||
| JPS6189945U (ja) | ||
| JPH01146640U (ja) | ||
| JPH01164547U (ja) | ||
| JPS6356828U (ja) | ||
| JPH0361759U (ja) | ||
| JPS6338470U (ja) | ||
| JPS62161399U (ja) | ||
| JPH028248U (ja) | ||
| JPS6263792U (ja) | ||
| JPS6399931U (ja) | ||
| JPS6310676U (ja) | ||
| JPS6246931U (ja) | ||
| JPS6281232U (ja) | ||
| JPH0330149U (ja) | ||
| JPS6355628U (ja) |